• 제목/요약/키워드: 주파수 범위

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새로운 구조의 프로그램어블 주파수 분주기를 사용한 주파수 합성기 설계 (Design of Frequency Synthesizer using Novel Architecture Programmable Frequency Divider)

  • 김태엽;박수양;손상희
    • 한국통신학회논문지
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    • 제27권5C호
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    • pp.500-505
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    • 2002
  • 본 논문에서는 50%의 duty cycle 출력을 가지며, 디지털 방식으로 분주수를 제어할 수 있는 새로운 분주기 구조를 제안하였다. 그리고 0.25$\mu\textrm{m}$ 2-poly, 5-metal CMOS 공정 파라미터를 이용한 HSPICE 모의실험을 통해서 제안한 주파수 분주기를 이용한 900MHz 주파수 합성기를 설계하였다. 제안한 주파수 분주기의 동작은 0.65$\mu\textrm{m}$ 2-poly, 2-metal CMOS 공정을 사용하여 제작한 칩을 측정하여 확인하였다. 설계한 전압제어발진기(VCO)는 2.5V 전원전압 하에서 900MHz의 중간주파수, $\pm$10%의 동작 범위, 154MHz/V의 이득을 가진다. 또한 모의실험 결과 주파수 합성기의 settling time은 약 $1.5\mu\textrm{s}$이고, 짝수와 홀수 분주시 50%의 duty cycle과 820MHz~1GHz의 동작 주파수 범위를 갖으며, 전력소모는 대략 70mW임을 확인하였다.

새로운 구조의 프로그램어블 주파수 분주기를 사용한 주파수 합성기 설계 (Design of Frequency Synthesizer using Novel Architecture Programmable frequency Divider)

  • 김태엽;박수양;손상희
    • 한국통신학회논문지
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    • 제27권6C호
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    • pp.619-624
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    • 2002
  • 본 논문에서는 50%의 duty cycle 출력을 가지며, 디지털 방식으로 분주수를 제어할 수 있는 새로운 분주기 구조를 제안하였다. 그리고 0.25$\mu\textrm{m}$ 2-poly, 5-metal CMOS 공정 파라미터를 이용한 HSPICE 모의실험을 통해서 제안한 주파수 분주기를 이용한 900MHz 주파수 합성기를 설계하였다. 제안한 주파수 분주기의 동작은 0.657m 2-poly, 2-metal CMOS 공정을 사용하여 제작한 칩을 측정하여 확인하였다. 설계한 전압제어발진기(VCO)는 2.5V 전원전압 하에서 900Mh의 충간주파수, $\pm$10%의 동작 범위, 154MHz/V의 이득을 가진다. 또한 모의실험 결과 주파수 합성기의 settling time은 약 $1.5\mu\textrm{m}$이고 짝수와 홀수 분주시 50%의 duty cycle과 820MHz~1GHz의 동작 주파수 범위를 갖으며, 전력소모는 대략 70mW 임을 확인하였다.

넓은 입력 범위를 가지는 LLC 공진형 컨버터의 공진 주파수 변경을 통한 효율 개선 (Wide Input Range LLC Resonant Converter with Resonant Frequency Change for High Conversion Efficiency)

  • 연철오;박무현;박진식;문건우
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2016년도 전력전자학술대회 논문집
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    • pp.155-156
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    • 2016
  • 수명이 짧은 전해 캐패시터 대신 필름 캐패시터를 링크 캐패시터로 가지는 컨버터의 경우, 매우 넓은 입력 전압 범위를 가질 수 밖에 없다. 일반적인 넓은 입력 범위를 가지는 LLC 공진형 컨버터의 경우, 변압기 인덕터($L_M$) 값을 작게 하여 순환 전류가 커지도록 설계될 수 밖에 없고, 이는 LLC 공진형 컨버터의 더 큰 도통 손실 및 더 큰 turn-off 손실을 야기하여 LLC 공진형 컨버터의 변환 효율을 감소시키게 된다. 이를 개선하기 위하여 공진 인덕터에 보조 권선을 감소, 추가 스위치를 이용하여 입력 범위에 따라 공진 주파수($f_O$)를 변경할 수 있는 컨버터를 제안한다. 제안하는 컨버터는 $L_M$ 값을 키워 정상 상태 시 도통 손실 및 turn-off 손실을 줄여 효율을 개선할 수 있으며, 낮은 입력 시 보조 스위치를 이용, $f_O$ 변경을 통하여 추가적인 Gain을 얻으면서 공진 인덕터의 철손을 줄여 넓은 입력 범위를 커버하면서 높은 변환 효율을 얻을 수 있다. 또한 제안하는 컨버터는 간단한 제어 방법과 낮은 전류 스펙을 가지는 작은 스위치를 사용할 수 있어 전력 밀도 증가를 최소화하면서 높은 효율을 가져갈 수 있다는 장점을 가진다.

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광 지연선 기반의 넓은 고도 범위를 갖는 고정밀 FMCW 전파고도계 송수신기 설계 (Design of the Transceiver for a Wide-Range FMCW Radar Altimeter Based on an Optical Delay Line)

  • 최재현;장종훈;노진입
    • 한국전자파학회논문지
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    • 제25권11호
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    • pp.1190-1196
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    • 2014
  • 본 논문은 넓은 고도 범위와 낮은 측정 오차를 갖는 주파수 변조 연속파(FMCW) 레이더 고도계의 설계 방안을 제안한다. 측정 고도의 동적 범위를 줄이기 위해 전파 고도계의 송신 경로에 광 지연선을 적용하여 넓은 고도 범위를 얻을 수 있다. 송신 전력과 수신단 이득을 제어하여 또한 수신 전력의 동적 범위를 줄일 수 있다. 더불어, 직접 디지털 합성기를 사용하여 변조 선형성을 향상시키고, 기준 클럭 신호를 위상 고정 루프의 옵셋(offset) 주파수로 사용하여 위상잡음을 최소화함으로써 낮은 고도 측정오차를 갖는다.

고효율 하프-브리지 LLC 컨버터를 위한 Hold-Up Time 보상 기법 (Hold-Up Time Compensation Method for High Efficiency Half-Bridge LLC Converter)

  • 백재일;김재국;이재범;윤한신;문건우
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2016년도 전력전자학술대회 논문집
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    • pp.301-302
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    • 2016
  • Hold-up time 조건에 의해 넓은 입력전압 범위에서 설계되는 하프-브리지 LLC 컨버터는 높은 전압 이득을 얻기 위해 작은 자화 인덕턴스와 넓은 스위칭 주파수 범위가 요구된다. 하지만 이는 큰 1차측 도통손실 및 코어 손실을 초래한다. 본 논문에서는 하프-브리지 LLC 컨버터가 좁은 입력전압에서 설계되기 위한 새로운 hold-up time 보상 기법을 제안한다. 따라서 제안된 기법에서의 하프-브리지 LLC 컨버터는 큰 자화 인덕턴스 및 좁은 스위칭 주파수 범위로 설계 될 수 있다. 제안된 회로의 효과는 90-264Vrms 입력, 250-400V 링크 전압, 48V/480W 출력을 갖는 prototype의 실험을 통해 검증된다.

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메이서와 레이서 I

  • 조철
    • 전기의세계
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    • 제18권6호
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    • pp.58-63
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    • 1969
  • 필자는 메이서와 레이서에 대하여 되돌고이면 평이하게 정성적으로 기술하려고 한다. "Maser"란 말은 Microwave Amplification by Stimulated Emission of Radiation. 또 "Laser"란 Light Amplification by Stimulated Emission of Radiation의 약자이다. 이 메이서나 레이서는 진공관 원리에서 사용되는 자유전자대신 원자의 구속전자를 사용하여 에너지를 발생하든가 증폭작용을 하고 있다. 자극방사 (Stimulated emission)란 말은 원자에서 에너지 방사가 있기 위해서는 구속전자에 자극을 줘야하기 때문에 생긴 것이다. microwave란 말을 붙인 것은 전자에너지중 이 주파수범위내에 해당되는것에만 이용된다는 것이고 이와 마찬가지로 광(light)은 전자복사중 이 빛의 파장범위에서 작용된다는 것을 말한다. 따라서 이 메이서나 레이서는 매우 높은 주파수 범위에서 사용되는 에너지 발생장치 또는 증폭기라고 생각할 수 있다. 이 메이서나 레이서의 동작원리는 진공관증폭기의 동작원리와 다르므로 따라서 그 동작원리를 이해하려면 새로운 개념이 필요하게된다. 과학기술의 발달과 함께 과거의 전자기긱의 성능은 그 한계에 도달하게 되었고 통신, 천문학, 의학, 산업, 과학연구분야등에서 이 메이서와 레이서는 새로운 기회와 가능성을 제시해주고 있다.운 기회와 가능성을 제시해주고 있다.

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이산시간 LQ 조절기의 안정도 강인성 향상에 관한 연구 (On the improvement of the stability robustness in the discrete-time LQ regulator)

  • 김상우;권욱현
    • 제어로봇시스템학회논문지
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    • 제1권2호
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    • pp.83-87
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    • 1995
  • 본 논문에서는 이산시간 LQ 조절기의 안정도 강인성을 주파수 영역및 시간영역에서 고찰하고 그 향상책을 제시하낟. 주파수영역에서 강인성 척도인 궤환차행렬(return difference matrix) 의 최소특이치가 상태가중치 행렬과 제어가중치 행렬의 비와 반비례함을 보이고, 시간영역에서 매개변수의 변화에 대한 안정도 강인성 범위들을 얻는다. 이 범위들의 점근적 성질을 밝히기 위하여 LQ 궤환이득의 특이치들이 상태가중치 행렬과 제어기중치 행렬의 비의 증가함수 임을 보인다. 몇가지 조건하에서 시스템 행렬(입력행렬)에 대한 안정도 강인성 범위가 상태 가중치 행렬과 제어가중치 행렬의 비가 증가(감소)함에 따라서 증가함을 보이고, 이러한 사실들을 예제를 통하여 검증한다.

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무정전전원장치에 적합한 주파수 제한기와 안티 와인드업을 가지는 PLL 방식 (PLL Strategy Hating Frequency Limiter and Anti-windup Suitable to UPS)

  • 지준근;김효성;설승기;김경환
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2004년도 전력전자학술대회 논문집(2)
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    • pp.778-782
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    • 2004
  • 본 논문에서는 전력 품질 기기의 제어에 있어서 필수적 요소라고 할 수 있는 전원각을 찾는 방법중에서 PLL(Phase Locked Loop)에 관하여 기존의 방식들을 먼저 알아보고, 정상분을 추출하여 이용하는 기존의 PLL 방식을 무정전전원장치에 적합한 형태로 개선한 주파수를 제한한 PLL 방식을 제안하였다. 제안된 PLL 방식은 기존의 PI 제어기에 주파수 제한기(limiter)와 안티 와인드업(anti-windup)을 추가하였다. 이것의 기본적인 동작 원리는 기존의 방법들과 같지만, 차이점은 주파수 제한기의 삽입으로 인하여 주파수 변동률을 일정한 범위 내에서 제한할 수 있다는 것이다. 기존의 PLL 방법과 본 논문에서 제안된 주파수를 제한한 PLL 방법의 차이를 알아보기 위하여 동적 전압 보상기로 전압을 보상하는 시뮬레이션을 하였고, 결과적으로 제안된 주파수를 제한한 PLL 방법이 기존의 PLL 방법보다 UPS에 적합함을 입증하였다.

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THz 대역의 무선통신시스템 기술

  • 정태진
    • 정보와 통신
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    • 제27권2호
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    • pp.20-26
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    • 2010
  • THz 대역의 주파수 범위는 일반적으로 100GHz ~ 10THz 사이로서, 전자파의 투과성과 광파의 직진성을 동시에 가지고 있다. THz 캐리어 주파수는 대기의 수분에 강하게 흡수되어 1THz 이상에서 1 [dB/m] 정도의 대기 전파감쇠가 발생하나 0.1 [dB/m] 정도의 비교적 낮은 주파수 윈도우가 존재하여 이 영역의 주파수 스펙트럼을 이용한 무선통신시스템의 개발이 활발히 진행되고 있다. 최근 RF MMIC의 기술개발 동향을 고려해 볼 때 무선통신시스템 응용을 위한 가장 유력한 THz 주파수 대역은 H-밴드(220 ~ 325GHz)이다. H-밴드에서 가용한 주파수 대역폭은 약 45GHz 이상이며, 이러한 초광대역폭을 이용하여 10Gbps급 이상의 데이터 전송속도를 ASK 또는 BPSK와 같은 간단한 변조방식으로 용이하게 실현할 수 있다. 본고에서는 THz 대역에서 무선통신 응용을 위한 전파특성 및 주파수 대역, 무선링크 특성과 THz 송수신기 기술에 대하여 알아본다.

가변 클록 발생을 위한 DLL 주파수 합성기 (A DLL-Based Frequency Synthesizer for Generation of Various Clocks)

  • 이지현;송윤귀;최영식;최혁환;류지구
    • 한국정보통신학회논문지
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    • 제8권6호
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    • pp.1153-1157
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    • 2004
  • 본 논문에서는 DLL(delay locked loop)에서의 프로그램 가능한 새로운 주파수 합성기를 제안하고자 한다. 일반적으로 주파수를 합성하기 위해서 PLL(phase locked loop)이 많이 이용되어 왔으며, locking 시간이 빠른 DLL 역시 주파수 합성에 이용되고 있다. 하지만 DLL의 경우 주파수를 합성하기 위해서는 따로 주파수를 체배하는 블록이 필요하다. 기존의 DLL에서 사용된 주파수 체배기는 주파수를 체배하는 배수가 한번 정해지면 바꿀 수 없다는 단점이 있다. 그러나 본 논문에서 제안하는 체배기는 입력주파수에 대해서 6배에서 10배까지 선형적으로 주파수를 체배할 수 있다. 제안된 DLL의 동작 주파수 범위는 600MHz에서 1GHz까지 이다. $0.35-\mu\textrm{m}$ CMOS 공정을 이용해 HSPICE simulation 하여 동작을 검증하였다.