• 전기의세계
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• 제28권11호
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• pp.26-30
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• 1979

현재 산업용으로 많이 쓰이고 있는 연축전지나 Alkali 전지의 충전용 충전기가 반도체화 이후 Thyristor식 자동충전기로 전환되고 있는데 발맞추어 본 연구에서는 현재의 충전기로서의 장점을 충분히 가지고 있으면서 부하단자가 단락되거나 개방되거나 또는 전원이 잘못 접속될 경우에도 충전기 부하나 회로를 충분히 보호할 수 있는 충전기를 설계하고져 했다. 본 연구의 연구대상은 Battery의 잔류전압을 이용한 UJT 이장발진기로 구동되는 SCR식 충전기 회로이다. 아울러 Soft start 회로와 동기회로 그리고 Pulse 증폭회로를 첨가시켜 보다 충전특성을 향상시켰으며 엄밀한 특성시험, 즉 지연회로 시험, 출력단자 개방시험, 단락시험, 출력단자 오결선시험등을 통해 여러가지 장해가 없음을 확인했다. 그리고 가급적 휴대가 가능하도록 소형화 시키면서 누구나 손쉽게 조작할 수 있는 간편하고 실용적인 충전기를 설계하는데 힘썼다. 그래서 다음과 같은 장점을 본래의 장점에다 부가시킬 수 있었다. (가) Soft start 회로를 첨가시켜 평균 30-50sec의 지연시간을 얻을 수 있었다. (나) 동기회로를 별도로 첨가시켜 Pulse 신호의 동기를 확실하게 할 수 있었다. (다) Pulse 증폭회로를 사용하여 SCR의 제어능력을 확실하게 할 수 있었다. 결론적으로 본 충전기는 Trickle 충전을 제외한 초충전 균등충전 부동충전 보정충전 급속충전등을 자유로이 할 수 있었고 소형 경량이고 취급이 간편하여 실용적이라고 본다. 그러나 여러가지 조건하에서의 현장실험을 다해보지 못한 것이 약간 아쉽다.

• 한국정보통신학회:학술대회논문집
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• 한국정보통신학회 2019년도 춘계학술대회
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• pp.467-468
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• 2019

본 논문은 차량용 장거리 레이더를 위한 저 위상잡음 77GHz CMOS 전압제어발진기를 제안한다. 이러한 회로는 낮은 위상잡음을 가지도록 설계되어 있고, 1.5볼트 전원에서 동작한다. 제안한 회로는 TSMC $0.13{\mu}m$ 고주파 CMOS 공정으로 설계하였다. 제안한 회로는 최근 발표된 연구결과에 비해 저 위상잡음, 저 전력 및 적은 면적 특성을 보였다.

• 한국정보통신학회논문지
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• 제20권1호
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• pp.117-122
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• 2016

본 논문에서는 차량 추돌 방지 단거리 레이더용 24-GHz CMOS 고주파 전력 증폭기 (RF power amplifier)를 제안한다. 이러한 회로는 클래스-A 모드 증폭기로서 단간 (inter-stages) 공액 정합 (conjugate matching) 회로를 가진 공통-소스 단으로 구성되어 있다. 제안한 회로는 TSMC $0.13-{\mu}m$ 혼성신호/고주파 CMOS 공정 ($f_T/f_{MAX}=120/140GHz$)으로 설계하였다. 2볼트 전원전압에서 동작하며, 저전압 전원에서도 높은 전력 이득, 낮은 삽입 손실 및 낮은 음지수를 가지도록 설계되어 있다. 전체 칩 면적을 줄이기 위해 넓은 면적을 차지하는 실제 인덕터 대신 전송선(transmission line)을 이용하였다. 설계한 CMOS 고주파 전력 증폭기는 최근 발표된 연구결과에 비해 $0.1mm^2$의 가장 작은 칩 크기, 40mW의 가장 적은 소비전력, 26.5dB의 가장 높은 전력이득, 19.2dBm의 가장 높은 포화 출력 전력 및 17.2%의 가장 높은 최대 전력부가 효율 특성을 보였다.

• 한국전자통신학회논문지
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• 제11권9호
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• pp.869-876
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• 2016

위상변조 풀브리지 컨버터를 설계, 개발하는데 있어, 전력반도체와 그 전력반도체 구동회로, 변압기 및 인덕터, 정류기 등을 포함한 많은 설계 요인들이 존재한다. 그 중에서 위상변조 풀브리지 컨버터의 최적 성능에 매우 큰 영향을 끼치는 것은 변압기 설계이다. 특히 변압기 설계는 대형 컴퓨터 데이터센터에 사용되는 전원장치에서처럼 저전압, 고전류 응용에서 매우 중요하다. 이 논문에서는 위상변조 풀브리지 컨버터의 최적 성능을위한 변압기 설계에 관한 연구 결과를 발표한다. 변압기 설계에 관련된 설계 수식들을 유도하고 세밀한 분석을 한다. 이를 토대로, 12V, 1200W 서버전원장치 응용을 위한 위상변조 풀브리지 컨버터 최적 성능을 위한 변압기 설계를 결과물로 제시한다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2007년도 하계학술대회 논문집
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• pp.280-282
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• 2007

기존 PDP 전원 시스템은 일반적으로 두 개의 절연형 Transformer 를 사용하여 유지전원($V_S$)과 어드레스 전원($V_A$), Multi단 전원($V_M$) 으로 구성된다. 이들 각 전력 변환 회로에 Transformer 및 제어 IC 가 사용되므로, 효율 저감 및 원가 상승, 소자 스트레스 등의 단점을 가지고 있다. 본 논문에서는 절연형 Transformer 한 개로 PDP 전원시스템을 구동하는 방식에 대해 제안한다. 제안된 방식은 DC/DC 전력단의 고효율 동작 및 신뢰성 개선은 물론 부피, 크기를 줄여 원가 저감에 기여한다. 또한, 제안된 방식은 PDP 구동 방식의 하나인 Address Display Separation Method (ADSM) 에 적합하다. 기존 방식과 제안된 방식을 비교하고 이론적 분석과 실험을 통해 제안된 방식의 우수성을 확인 하였다.

• 조명전기설비학회논문지
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• 제18권6호
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• pp.183-190
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• 2004

본 논문은 냉난방 인버터 에어컨용 전원시스템에 역률개선 회로인 부분 스위칭 PFC 모듈을 적용하여 입력의 역률 개선 및 전류의 고조파 성분을 최소화하여 IEC555-2규정을 만족하는 입력 전원부를 설계하여 인덕터부하에 적용되는 회로 설계시의 문제점들을 해결 할 수 있는 방안들을 제시하였다. 그리고 출력전압의 상승을 억제하면서 전류파형을 개선하는 방법 및 부분 스위칭 PFC회로를 제안하여 스위칭 횟수를 적게 함으로써 압축기의 모터에 인가 할 수 있는 전압을 상승시켜 모터 적정 운전 전압을 확립하였으며, 효율이나 경제성 및 전자 노이즈 등의 문제점들을 해결하였다. 그리고 에어컨의 소비 전력을 줄일 수 있다. 이상의 결과에서 시스템 총합 운전에너지 효율이 상승되는 것을 확인하는 모든 사항은 시뮬레이션과 실험을 통하여 그 타당성을 입증했다.

• 조명전기설비학회논문지
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• 제15권5호
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• pp.61-67
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• 2001

여자자속의 포화는 전자레인지에 사용되는 고압 변압기의 초기 입력 전원의 위상에 의존한다. 고압트랜스의 돌입전류를 제한하기 위해서는 릴레이의 접점을 입력전원위상의 최저점일 때 ˝ON˝하여야 한다. 개선된 회로는 보정된 인터럽터 신호를 마이컴의 입력으로서 릴레이의 접점이 돌입전류가 최소 일 때 ˝ON˝한다. 실험결과는 입력전압변동모드에 대해서 개선된 회로가 설계목표치 50[A]를 만족함을 나타내었다. 그리고 통계적 기법으로서 이를 검증한다.

• 한국전자파학회논문지
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• 제18권2호
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• pp.199-205
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• 2007

본 논문에서는 초고속 디지털 PCB 회로에서 발생하는 GBN(Ground Bounce Noise)을 억제하기 위한 새로운 EBG(Electromagnetic Bandgap) 구조의 전원면을 제안하였다. 제안된 구조는 육각형 모양의 단위 셀과 각 셀을 연결하는 선로로 구성되어 있다. 육각형 모양의 단위 셀은 등방성을 띄어 인접 셀의 각 포트 사이의 전달 특성을 동일하게 한다. 제안된 구조는 실제 제작, 측정되었고 330 MHz부터 5.6 GHz까지 넓은 주파수 대역에서 -30 dB 이하로 GBN을 억제하는 특성을 나타낸다. Electromagnetic Interference(EMI) 방사 측정 시에도 일반 전원면/접지면에 비해 낮은 EMI 특성을 나타낸다. 본 논문에서 제안한 육각형 EBG 구조의 전원면은 실제 EBG 전원면의 적용에 효율적으로 작용하여 초고속 디지털 회로의 EMI 문제를 해결하는 데 기여할 것으로 기대된다.

• 대한전자공학회논문지
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• 제15권3호
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• pp.11-17
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• 1978

Medium scale 집적회로인 BCD to seven segment decoder/driver를 P-channel Metal-Oxide-Semiconductor집적회로 제작 기법으로 설계, 제작하였다. 본 소자는 특별히 common cathode seven segment light emitting diode에 적합하도록 설계되었다. decoder logic은 직렬로 연결된 두 개의 Read-Only-Memory로 구성되어 있으며 driver로는 channel이 넓은 FET를 사용하였다. 제작된 집적회로는 전원 전압이 -7 volt에서 -26 volt까지 변화할 때 정상적으로 동작하였으며 LED각 segment 전류의 non-uniformity는 약 ±10%이었다.

• 한국통신학회논문지
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• 제24권6B호
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• pp.1074-1079
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• 1999

155.52 Mbps STM-1급 디지털 통신용 고성능 CMOS 리시버 칩을 설계 제작하였다. 제작된 리시버는 전송선로의 단락 또는 송신 중단 등으로 인해 데이터신호가 입력되지 않거나, 정전 발생 또는 시스템의 유지보수 등으로 인해 전원이 차단되었다가 복구될 때에도 155.52 MHz의 클락 주파수를 유지하여 항상 안정된 동작을 할 수 있는 구조로 이루어진다. 이를 위해 설계된 회로는 PLL을 기본으로 한 데이터 및 클락 복원회로 외에 데이터 감시회로와 전원 감시회로도 내장한다. 측정 결과 제작된 IC는 데이터신호가 입력되는 정상적인 상황에서뿐만 아니라, 데이터신호가 입력되지 않는 비정상적인 상황하에서도 항상 155.52 MHz의 안정된 클락을 발생시키고 있음을 알 수 있었음, PLL 루프의 실효 지터도 23 ps로 우수한 특성을 나타내었다.