• 제목/요약/키워드: 저전력 모드

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공급 전압 변화에 둔감한 Gbps급 저전력 LVDS I/O회로 (Power Supply-Insensitive Gbps Low Power LVDS I/O Circuits)

  • 김재곤;김삼동;황인석
    • 대한전자공학회논문지SD
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    • 제44권6호
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    • pp.19-27
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    • 2007
  • 본 논문에서는 공급전압 변화에 둔감한 Gbps급 저전력 LVDS I/O회로를 설계하였다. 제안된 LVDS I/O는 1.8 V, $0.18\;{\mu}m$ TSMC 공정을 이용하여 설계, 시뮬레이션 및 검증하였다. 설계된 LVDS I/O회로는 송신단과 수신단을 포함한다. 제안하는 송신단은 phase splitter와 SC-CMFB를 이용한 출력버퍼로 구성된다. phase splitter의 출력은 공급 전압이 변화하여도 $50{\pm}2%$의 duty cycle을 가지며 $180{\pm}0.2^{\circ}$의 위상차를 가진다. 출력 버퍼는 SC-CMFB를 이용하여 허용 가능한 $V_{CM}$ 전압 값인 $1.2{\pm}0.1V$을 유지하도록 설계하였다. $V_{OD}$전압 또한 허용범위에서 최소값인 250 mV를 갖도록 설계하여 저전력 동작이 가능하도록 구성하였다 수신단은 38 mV의 히스테리시스 전압값을 가지면서 DC옵셋 전압값이 $0.2{\pm}2.6 V$로 넓은 공통 모드전압 범위가 가능하도록 설계하였고 공급전압 변화에도 rail-to-rail로 복원할 수 있는 기능을 가지고 있다. 또한, 수신단은 1 GHz에서 38.9 dB의 높은 전압 이득을 갖도록 설계하였다.

디지털 미디어 환경에서 사용자 환경 모드에 따른 색채 인지 특성 연구 (A Study on the Characteristics of Colour Perception According to Light and Dark Mode in the Digital Media Environment)

  • 홍지영
    • 한국인터넷방송통신학회논문지
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    • 제23권3호
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    • pp.65-70
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    • 2023
  • 디지털 미디어 환경은 디지털 매체를 다각화시키면서 사용자 중심의 다양한 형태로 접근하고 있다. 디지털 기술의 발전에 의해 디지털 미디어 환경은 광대한 네트워크 정보망을 형성하고 보다 인터렉티브한 커뮤니케이션을 지원함으로써 이와 관련 사용자 중심의 기초 연구가 필요하다. 디지털 미디어 환경을 대표할 수 있는 모바일 디스플레이는 휴대성이 높은 장점을 갖고 있지만 소형화와 전력절감을 위해 얇은 디스플레이 패널과 저성능 이미지 센서를 채택하는 등 대형 디스플레이에 비해 색상 표현력이 떨어질 수밖에 없다. 본 연구에서는 대표적 디지털 융합 매체인 모바일 디스플레이를 구체적 연구대상으로 사용자 중심의 다크 모드와 라이트 모드에서 시감적 색채 인지특성에 대해 알아보고자 한다. 시감적 색채 인지 특성을 알아보고자 KS 12가지 색채를 기반으로 색채 속성을 각각 제어하여 정신물리학 실험을 진행하고 이를 분석하였다. 본 연구에서는 진행된 실험 결과를 분석하여 다크 모드와 라이트 모드에서 색채 인지에 차이가 있는지 알아보고 색채 인지 특성에 대한 기초 연구 자료로써 유의미 여부를 정의한 후 향후 연구방향을 제시한다.

0.18 um CMOS 공정을 이용한 UWB 단일 입력-차동 출력 이득 제어 저잡음 증폭기 설계 (A Design of Ultra Wide Band Single-to-Differential Gain Controlled Low Noise Amplifier Using 0.18 um CMOS)

  • 정무일;최용열;이창석
    • 한국전자파학회논문지
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    • 제19권3호
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    • pp.358-365
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    • 2008
  • 본 논문에서는 CMOS 0.18 um 공정을 이용하여 UWB(Ultra Wide Band) 시스템의 낮은 대역 $3.1{\sim}4.8GHz$에서 사용할 수 있는 단일 입력-차동 출력 이득 제어 저잡음 증폭기를 설계하였다. 측정 결과는 높은 이득 모드에서 차동 출력 전력 이득은 각각 $14.1{\sim}15.8dB,\;13.3{\sim}15dB$로, 입력 반사 계수는 -10dB 이하로, lIIP3는 -19.3dBm, 잡음 지수는 $4.85{\sim}5.09dB$로 측정되었으며, 이때 전원 전압 1.8V에서 사용 전력은 19.8 mW를 사용하였다. 낮은 이득 모드에서 차동 출력 전력 이득은 각각 $-6.1{\sim}-4.2dB,\;-7.6{\sim}-5.6dB$로, 입력 반사 계수는 -10dB 이하로, IIP3는 -1.45 dBm, 잡음 지수는 $8.8{\sim}10.3dB$로 측정되었으며, 이때 전원 전압 1.8V에서 사용 전력은 5.4mW를 사용하였다.

위상급변 기능을 갖는 3상 전력품질 외란발생기 (3-Phase Power Quality Disturbance Generator with Phase Jump Function)

  • 이병철;최성훈;팽성훈;박성대;최남섭;김인동;전태원;김흥근;노의철
    • 전력전자학회논문지
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    • 제11권5호
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    • pp.463-470
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    • 2006
  • 본 논문에서는 새로운 방식의 3상 전력품질 외란발생기를 제안하였다. 제안한 방식은 전압새그(sag), 스웰(swell), 순간정전, 전압불평형, 과전압, 저전압 뿐 아니라 위상급변 발생도 가능하다. 전압변동의 각 모드별 동작해석을 하였으며, 특히 위상급변 모드에서의 위상변위량을 정량적으로 제시하였다. 위상변위량은 외란발생기를 구성하는 변압기들의 변압비에 의해 결정되므로 변위량의 설정이 용이하다. 기존방식에 비하여 구조가 간단하고 주요 구성품이 SCR 사이리스터와 변압기류이므로 시스템의 신뢰도가 높고 저렴한 비용으로 구현이 가능하다는 특징이 있다. 또한 PWM 스위칭 없이 동작이 이루어지므로 효율을 극대화할 수 있으며 제어도 용이하다. 각 모드별 동작을 시뮬레이션을 통하여 확인하였으며 5kVA 용량의 부하조건에서 실험을 수행하여 제안한 방식의 타당성을 입증하였다. 제안한 방식의 외란발생기는 UPS, DVR, DSTATCOM, SSTS 등의 전력품질 개선장치들의 성능시험을 하는데 있어서 효과적이고 경제적인 시스템을 구현하고자 하는 경우에 크게 기여할 것으로 기대한다.

전류 적분기를 이용한 2V CMOS 연속시간 필터 설계 (Design of 2V CMOS Continuous-Time Filter Using Current Integrator)

  • 안정철;유영규;최석우;윤창헌;김동용
    • 전자공학회논문지C
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    • 제35C권9호
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    • pp.64-72
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    • 1998
  • 본 논문에서는 상보형 high swing cascode 전류미러를 이용하여 저전압, 저전력 구동이 가능하고 고주파수 응용이 가능한 전류 적분기를 설계하였다. 간단한 전류미러로 구성된 적분기는 적분기의 비 이상적인 입력, 출력 저항 때문에 출력 전류 오차가 발생하는데 제안된 전류 적분기는 출력 저항이 증가하여 출력 전류의 오차가 감소하였다. 설계된 무손실, 유손실 전류 적분기를 이용한 설계 예로 3차 버터워스 저역통과 필터를 개구리도약형으로 구현하였다. 필터 구현시 무손실 전류 적분기의 위상 추이 때문에 발생하는 차단주파수 부근에서의 크기 특성 왜곡을 predistortion 설계법을 이용하여 감소시켰다. 설계된 전류모드 필터를 0.8㎛ CMOS n-well 공정 파라미터를 이용하여 SPICE 시뮬레이션한 결과 단일 2V 공급 전압에서 차단주파수는 20MHz, 전력소모는 615㎼를 갖는다. 또한 필터의 차단주파수는 DC 바이어스 전류에 의해 동조 할 수 있다.

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저 에너지의 취침 기상 사이클로 작동하는 무선센서 네크워크 노드들을 위한 시간 동기화 (Time Synchronization for WSN Nodes Operating on Low-Energy Sleep-Wake Cycles)

  • 윤호중;윤주성;이승구
    • 한국정보과학회논문지:컴퓨팅의 실제 및 레터
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    • 제16권3호
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    • pp.331-335
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    • 2010
  • 무선 센서 네트워크에서 중요한 이슈 중 하나는 배치되는 센서 노드들이 최대한 요래 지속되도록 전력 소비를 줄이는 것과, 네트워크를 시간 동기화 하는 것이다. 기존의 저 전력 시간 동기화 알고리즘은 취침모드에 대한 고려 없이 교환되는 패킷의 수를 줄이거나, 네트워크 토폴로지에 따라 다른 시간 동기화 방법을 사용하는 하이브라드 방법이 전부였다. 무선 센서 네트워크에서 효율적인 에너지 절약 방법은 노드의 취침을 통한 duty cycle의 감소이기 때문에, 본 논문에서는 노드의 취침을 통해 duty cycle을 줄일 수 있는 시간 동기화 알고리즘을 제안하였다. 알고리즘 제안 시, 실험을 통해 노드 구성요소의 특성을 파악하여 모델을 세운 후 접근하였다. 제안한 알고리즘의 성능 파악을 위해 네트워크에 요구되는 시간 동기화 정확도가 있을 때, 이를 만족시키기 위한 시간 동기화 주기 값을 구해보았으며, 노드 사이의 편차율을 구할 때 걸리는 시간을 확률적인 개념을 사용해 분석하여 보았다. 제안된 알고리즘을 $3{\times}3$ 격자(grid) 구조에서 구현해본 결과, duty cycle 5%, 시간동기 주기 10초일 때, 107.57 $\mu{s}$의 평균 시간동기 오차를, duty cycle 2.5%, 시간동기 주기 20초일때, 130 $\mu{s}$의 평균 시간동기 오차를 보여주었다.

차량 추돌 방지 레이더용 24-GHz 전력 증폭기 설계 (Design of 24-GHz Power Amplifier for Automotive Collision Avoidance Radars)

  • 노석호;류지열
    • 한국정보통신학회논문지
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    • 제20권1호
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    • pp.117-122
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    • 2016
  • 본 논문에서는 차량 추돌 방지 단거리 레이더용 24-GHz CMOS 고주파 전력 증폭기 (RF power amplifier)를 제안한다. 이러한 회로는 클래스-A 모드 증폭기로서 단간 (inter-stages) 공액 정합 (conjugate matching) 회로를 가진 공통-소스 단으로 구성되어 있다. 제안한 회로는 TSMC $0.13-{\mu}m$ 혼성신호/고주파 CMOS 공정 ($f_T/f_{MAX}=120/140GHz$)으로 설계하였다. 2볼트 전원전압에서 동작하며, 저전압 전원에서도 높은 전력 이득, 낮은 삽입 손실 및 낮은 음지수를 가지도록 설계되어 있다. 전체 칩 면적을 줄이기 위해 넓은 면적을 차지하는 실제 인덕터 대신 전송선(transmission line)을 이용하였다. 설계한 CMOS 고주파 전력 증폭기는 최근 발표된 연구결과에 비해 $0.1mm^2$의 가장 작은 칩 크기, 40mW의 가장 적은 소비전력, 26.5dB의 가장 높은 전력이득, 19.2dBm의 가장 높은 포화 출력 전력 및 17.2%의 가장 높은 최대 전력부가 효율 특성을 보였다.

단일전력단 Two-Switch Forward 컨버터에 관한 연구 (A Study on the Single-Stage Two-Switch Forward Converter)

  • 배진용;김용
    • 조명전기설비학회논문지
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    • 제19권7호
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    • pp.60-66
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    • 2005
  • 본 연구에서는 단일전력단 Two-Switch Forward 컨버터에 관하여 논하였다. 최근 국제적으로 제정된 ICE 61000-3-2와 IEEE 519같은 규정에서 입력 전류에 대한 고조파 규제가 강화되면서 전원 공급 장치의 역률개선 회로가 필수적으로 되었다. 따라서 본 연구에서는 저전압 대전류 출력에 적합한 방안으로 단일전력단 Two-Switch Forward 컨버터 회로를 제안하고, 모드별 동작, 특성 및 설계에 관하여 논하였으며, MOSFET를 사용하여 200[W](5[V], 40[A])급 시작품을 제작, 100[kHz]에서 실험하였다.

밀리미터파대역(Ka-대역)소형 레이더용 고 전력 저 손실 2축 도파관 로터리 조인트 연구 (A Study on the High-power Low-loss Dual Axes Waveguide Rotary Joint for Ka-Band Millimeter-Wave Small Radar)

  • 정채현;성종현;백종균;이국주;박창현;권준범
    • 한국인터넷방송통신학회논문지
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    • 제18권1호
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    • pp.91-96
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    • 2018
  • 본 논문에서는 고 전력 저 손실 특성을 가지는 소형 레이더용 Ka-대역 밀리미터파 2축 도파관 로터리 조인트 설계 및 제작하였다. 전기적 성능은 상온 S-parameter 시험, 고 전력 시험, 운용 온도 시험을 통해 검증하였다. 로터리 조인트는 기능적으로 구형 도파관에서 원형 도파관으로 변환하는 모드 변환기 구조 및 회전 부분의 초크 구조로 구성된다. 본 구조는 고정된 송신기와 2축으로 회전하는 안테나를 최소 손실을 가지도록 전기적 연결 및 경량화를 고려하여 설계하였다. 설계된 로터리 조인트는 중심 주파수 Fc 기준 ${\pm}500MHz$의 대역에서 VSWR 1.5:1 이하 반사 손실, -2.0 dB 이상 삽입 손실 특성을 가지며, 측정 결과는 설계 결과와 유사함을 확인하였다.

능·수동 듀얼(Dual) 모드 GPS 안테나를 위한 0.13㎛ CMOS 고주파 프론트-엔드(RF Front-end) (A 0.13 ㎛ CMOS Dual Mode RF Front-end for Active and Passive Antenna)

  • 정춘식;이승민;김영진
    • 한국항행학회논문지
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    • 제13권1호
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    • pp.48-53
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    • 2009
  • 본 논문은 1P8M CMOS $0.13{\mu}m$ 공정을 이용하여 GPS응용에 적합한 프론트-엔드(front-end)를 구현하였다. 저잡음 증폭기(LNA)는 능동 안테나와 수동 안테나를 지원하기 위해 높은 전압이득과 낮은 잡음지수(Noise Figure)의 LNA1모드와 낮은 이득과 높은 입력 3차 교차점(IIP3: 3rd Input Intercept Point)의 LNA2모드로 동작한다. 두 LNA의 측정된 성능은 1.2 V의 공급전압에서 각각 3.2/2 mA의 전류를 이용하여 16.4/13.8 dB 이득과, 1.4/1.68 dB NF, 그리고 -8/-4.4 dBm의 IIP3값을 갖는다. 쿼드 하향주파수 혼합기(quadrature downconversion 혼합기)는 트랜스임피던스 증폭기(transimpedance amplifier)와 가변저항을 이용하여 27.5 dB에서 41 dB의 변환이득을 갖는다. 프론트-엔드는 LNA1모드 동작 시 6.6 mW의 전력을 소모하여 39.8 dB의 변환이득, 2.2 dB의 잡음지수와 -33.4 dBm의 IIP3의 성능을 갖는다.

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