• Journal of KIISE:Computing Practices and Letters
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• v.13 no.7
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• pp.454-461
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• 2007

Portable embedded systems have recently become smaller in size and offer a variety of junctions for users. These systems require high performance processors to handle the many functions and also a small battery to fit inside the system. However, due to its size, the battery life has become a major issue. It is important to have both efficient power design and management for each function, while optimizing processor voltage and clock frequency in order to extend the battery life of the system. In this paper, we calculated the efficiency of power in optimizing power rail. This system has two microprocessors. One is used to play music and movie files while the other is for DMB. In order to reduce power consumption, the DMB microprocessor is turned of while music or videos are played. Lastly, DVFS is applied to the processor in the system to reduce power consumption. Experimental results of the implemented system have resulted in reduced power consumption.

• Proceedings of the Korean Society of Computer Information Conference
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• 2013.01a
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• pp.13-16
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• 2013

최근 Web 서비스, MP3, 동영상 재생, 무선통신 등 다양한 기능을 제공하는 스마트폰, 테블릿 PC와 같이 베터리로 동작하는 디지털 컨버젼스 기기들의 사용량이 증가되었고, 이러한 이동형 임베디드 기기들은 베터리 용량에 따라 사용시간이 제한된다. 그렇기 때문에 기기들의 평가항목 중 전력소모라는 성능지표가 대두되고 있으며, 소비전력을 낮추기 위한 저전력 기법이 전 세계적으로 연구되고 있다. 본 논문에서는 이동형 임베디드 기기에 사용 가능한 cnu_RTOS에 DPM(Dynamic Power Management)과 S3C2450에서 제공하는 DPM(Device Power Management)을 이용한 저전력 기능을 구현하여, 소비전력 감소율을 측정하였다.

• Journal of the Korean Institute of Intelligent Systems
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• v.10 no.5
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• pp.478-486
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• 2000

This paper proposes a design method that can minimize the power dissipation of CMOS digital circuits without affecting their optimal operation speeds. The proposed method is based on genetic algorithms(GAs) combined to the retiming technique, a circuit transformation technique of repositioning flip-flops. The proposed design method consists of two phases: the phase of retiming for optimizing clock periods and the phase of GA retiming for minimizing power dissipation. Experimental results using Synopsys Design Analyzer show that the proposed design method can reduce the critical path delay of example circuits by about 30-50% and improve the dynamic power performance of the circuits by about 1.4~18.4%.

• Journal of Digital Contents Society
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• v.14 no.1
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• pp.59-64
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• 2013

In this paper, we proposed low power algorithm for a task. The task means the inside of a necessary processor and external resources to work accomplishment of a system. Each task analyzes a life time and a number of called for implement a low power circuit. First of all, reduce power consumption of a task have maximum power consumption for low power circuit implementation. Therefore, first selecting a task had maximum power consumption. The task had a maximum power consumption ranking consider a life time and a number of called for each task. While a life time of task is long, top priority ranking to decrease power consumption to the task that the number of call generates the power consumption how a disguise is large in case of a lot of task becomes. Frequency decision to have minimum power consumption, and decrease power consumption all the circuit by a change of frequency of the task which the minimum task that a wasting past record is the maximum becomes. Also, keep continuously minimum power consumption, with every effort task until last life time in opening life time, and decrease gets total power consumption. Experiments results show reduction in the power consumption by 5.43% comparing with that [7] algorithm.

• Proceedings of the Korea Information Processing Society Conference
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• 2009.11a
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• pp.3-4
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• 2009

내장형 시스템 시장의 확대는 시스템의 전체 성능 향상뿐만 아니라 전력 소모량을 줄이는 것도 고려하게 만들었다. 특히 시스템 내부적으로 많은 비중을 차지하는 캐시 시스템의 전력 소모량을 줄이는 것은 내장형 시스템 설계의 중요한 주제 가운데 하나로 부각 되었다. 본 논문에서는 태그 압축을 통한 저전력 캐시의 구현을 제안한다. 제안된 기법은 지역성이 높은 내장형 응용 프로그램의 특징을 활용한 것으로, 지역 버퍼와 태그 압축 비트를 활용하는 새로운 형태의 저전력 캐시용 태그 압축 기법이다. 모의실험 결과, 본 논문에서 제안된 기법은 시스템의 전체적인 성능 감소 없이, 기존 모델 대비 최대 27%, 평균 18%의 캐시 에너지 감소를 보였다.

• Proceedings of the Korean Information Science Society Conference
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• 2003.10c
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• pp.121-123
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• 2003

현재 사용되는 PDA, 핸드폰 등의 이동기기는 보다 좋은 성능과 향상된 기능에 대한 시장의 지속적인 요구로 고성능을 요구하는 응용 프로그램이 점차 추가되고 있다. 이에 고성능 프로세서의 탑재가 일반화 되고 있으며, 그에 따른 전력 소비 또한 증가하고 있다. 시스템 전력 사용량의 증가 문제를 해결하고자 DVS기법, DPM기법 둥이 제시되었으나 모바일 기기에 저전력 프로세서의 탑재가 일반화 되면서 전체 에너지 소비측면에서 디바이스의 비중이 상대적으로 증대되어 기존 스케줄링 기법은 하나의 시스템 요소만을 위한 최적화 방법을 제시할 뿐 전체 시스템의 에너지 소비를 최적화시키지는 못하게 되었다. 이에 본 논문에서는 이동기기에서 프로세서의 속도를 결정하는 과정과 스케줄러가 태스크의 우선순위를 결정하는 과정에 있어 단위 시간당 디바이스의 에너지 소비가 프로세서의 단위 시간당 에너지 소비보다 큰 현실을 반영하여, 태스크의 실행 중 필요한 디바이스의 전력 소모량을 기준으로 스케줄러가 프로세서 최적화 정책과 디바이스 최적화 정책 중 올바른 스케줄링 정책을 선택하여 프로세서의 속도를 결정하고 실행순서를 조절함으로써 시스템의 가용시간을 향상시키는 기법을 제안한다.

• Proceedings of the KIPE Conference
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• 2019.07a
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• pp.4-5
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• 2019

본 논문은 DC마이크로그리드에서 저전압 배터리 에너지 저장 시스템과 DC 버스 연결을 위한 Dual Active Bridge(DAB) 컨버터의 제어 방법에 대한 연구이다. DC 마이크로그리드에서 전력을 효율적으로 사용하기 위해 양방향 전력전달이 쉬운 DAB 컨버터는 많이 사용되고 있다. 다만, 낮은 배터리 저장 시스템을 사용하는 경우 과도상태에서 DC 버스 측 커패시터를 충전하기 위해 높은 돌입전류가 발생하게 된다. 이러한, 높은 돌입전류는 시스템의 전력반도체 소자를 파손시키는 문제를 가져온다. 따라서, 초기 돌입전류를 저감시킬 수 있는 소프트 스타트 알고리즘이 필요하다. 본 논문에서는 돌입전류 저감을 위한 소프트 스타트 알고리즘을 제안하고, 3kW급 DAB 컨버터의 실험 결과를 바탕으로 제안 된 알고리즘을 검증하였다.

• Journal of the Korea Institute of Information and Communication Engineering
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• v.24 no.2
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• pp.285-289
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• 2020

The configuration of hierarchical wireless networks is provided to support diverse network environments. In the base station, two system state can be basically considered for the operation management so that the state transition may be occurred between active and sleep modes. Hence, to reduce energy consumption the system operation management of the low power should be considered to the base station system. In this paper we consider the analytical model of Discontinuous Reception (DRX) to investigate the system management. We provide the analysis scheme of base station system by the DRX model, and the low power factor would be investigated for the energy consumption. We also use the finite-state Markov system model that in a system state period the wireless resource request and the operation of service call arrival interval is considered to numerically analyze the performance of energy saving operations of base station.

• Proceedings of the KIPE Conference
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• 2013.07a
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• pp.149-150
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• 2013

본 논문에서는 계통 이상 시 요구되는 대용량 분산발전용 계통연계형 PCS의 LVRT(Low Voltage Ride Through) 알고리즘을 시험하기 위한 저전압발생장치를 제안한다. 제안한 저전압 발생장치는 변압기 tap 변경 방식을 적용하여 원하는 시점과 전압레벨에 저전압 조건을 만들 수 있는 시스템을 구성하고 대용량 확장성을 고려하여 모든 나라의 LVRT 계통 코드를 만족 할 수 있다. 제안한 저전압 발생 시스템의 나라별 LVRT 코드 발생 특성을 살펴보고 10kVA급 저전압발생 시스템을 통해 유용성을 확인한다.

• Journal of KIISE:Computing Practices and Letters
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• v.15 no.4
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• pp.304-308
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• 2009

This paper presents the deadline driven CPU-Power management scheme for the Real-Time Embedded OS: named TMO-eCos. It used the scheduling scenarios generated by a task serialization technique for hard real- time TMO system. The serializer does a off-line analysis at design time with period, deadline and WCET of periodic tasks. Finally, TMO-eCos kernel controls the CPU speed to save the power consumption under the condition that periodic tasks do not violate deadlines. As a result, the system shows a reasonable amount of power saving. This paper presents all of these processes and test results.