• Title/Summary/Keyword: 잡음 여유

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Performance Evalvation of Adaptive Equalizer in 3-Way Fading Channel considered Impulsive Noise and AWGN (임펄스성 잡음 및 가우시안 잡음이 고려된 3-Way Fading Channel considered Impulsive Noise and AWGN)

  • 금홍식;김용로
    • The Journal of the Acoustical Society of Korea
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    • v.12 no.1E
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    • pp.5-11
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    • 1993
  • 본 논문에서는 페이딩 채널에서 백색 가우시안 잡음과 임펄스성 잡음이 부가된 디지털 신호를 복원하기 위하여 적응 LMS알고리즘과 RLS 알고리즘을 사용하여 TDL 등화기, 결정 궤환 등화기, 그리고 격자 등화기의 성능을 평가하고 비교하였다. 오차 성능 분석 결과, 페이딩이 존재하고 임펄스성과 가우스성 잡음이 존재하는 채널에서 10-3BER을 얻기 위해서, 격자 등화기는 LMS이 등화기보다 3.0dB, RLS TDL 등화기보다 3.9dB의 신호대 잡음비(SNR)여유를, 그리고 LMS DFE 등화기보다 0.5dB, RLS DFE등화기보다 -0.5dB의 SNR 여유를 갖음을 확인하였다.

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다목적실용위성 2호의 각 유닛과 Harness 간의 EMC 해석

  • 이나영;이진호
    • Bulletin of the Korean Space Science Society
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    • 2003.10a
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    • pp.106-106
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    • 2003
  • 인공위성의 전기적 호환성 해석은 인공위성의 각 유닛들에서 발생할 수 있는 잡음이 인공위성의 정상 동작에 미치는 영향을 분석하고 그 영향을 최소로 만들 수 있는 방안을 연구하기 위해 필요하다. 본 논문에서는 인공위성의 탑제컴퓨터와 탑제체 간의 인터페이스에서 전기 신호의 호환성 해석, Harness의 호환성 해석 그리고 radiation 해석이 이루어졌다. 인공위성의 탑제컴퓨터와 탑제체 간의 인터페이스에서 전기 신호의 호환성 해석은 전기 신호의 전압 레벨이 전압 히스테리시스의 경계 영역에서 충분한 여유를 가지고 있는지 판단하기 위해 필요하다. 전기 신호에 충분한 여유분이 없는 경우 여유분을 증가시키기 위한 방법이 제안되었으며 제안된 방법에 의해 인터페이스의 올바른 동작에 충분한 여유분이 생겼음이 시뮬레이션 결과에 나타났다. Harness의 호환성 해석은 다목적실용위성 2호에 사용된 Harness에 대한 conductive epoxy potting의 전도도를 검증하기 위해 이루어졌다. 본 논문에서는 전송 임피던스 측정 방법을 이용하여 epoxy potting의 전도성이 모든 주파수 영역에서 인공위성의 요구사항에 만족함을 보여준다. Radiation 해석은 인공위성 시스템의 radiated emission(RE)을 추정하고 S-band 수신기와 GPS 안테나와 같은 수신단에 대한 상호간섭에 의한 위험도를 분석하기 위해 필요하다. RF 수신기의 수신 대역에서 발생한 잡음의 영향으로 신호대잡음비가 허용수치이하로 감소하여 위성 명령을 수신하는 동작에 지장을 초래할 수 있다. 본 논문에서는 RF 수신단에 가장 큰 영향을 미칠 것으로 예상되는 star tracker의 RE test 결과를 분석하여 test 결과가 GPS 수신기와 S-band 수신기의 각각의 성능에 적합한지 해석하였다. 또한 solar array regulator의 스윗칭에 의해 발생되는 radiation이 위성 구조체에 미치는 영향을 해석하고 시뮬레이션 하였다.

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Design of the Voltage Controlled Oscillator for Low Voltage (저전압용 전압제어발진기의 설계)

  • Lee, Jong-In;Jeong, Dong-Soo;Jung, Hak-Kee;Lee, Sang-Young;Yoon, Young-Nam
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • 2012.05a
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    • pp.699-702
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    • 2012
  • 본 논문에서는 WCDMA(Wide Code Division Multiple Access) 시스템 사양을 만족시키는 주파수 합성기 블록 중 위상잡음 및 전력소모의 최적 설계가 필요한 LC-VCO(voltage controlled oscillator)의 설계를 제안 하였다. 최적 설계를 위한 핵심내용은 LC-tank의 손실성분을 보상하는 MOS트랜지스터의 전달컨덕턴스와 인덕턴스 평면에 여유이득라인과 튜닝 범위 라인을 그어 설계 가능한 영역 내에서 위상잡음이 최소가 되는 인덕턴스 값을 구하고 선택하는 것이다. 제안한 최적 설계방법에 의해 진행된 LC-VCO의 시뮬레이션 결과 위상잡음 특성은 1MHz옵셋에서 -113dBc/Hz였다.

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Design of the Voltage Controlled Oscillator for Low Voltage (저전압용 전압제어발진기의 설계)

  • Lee, Jong-In;Jung, Dong-Soo;Jung, Hak-Kee;Yoon, Young-Nam;Lee, Sang-Young
    • Journal of the Korea Institute of Information and Communication Engineering
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    • v.16 no.11
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    • pp.2480-2486
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    • 2012
  • The design of low voltage LC-VCO(LC Voltage Controlled Oscillator) has been presented to optimize the phase noise and power consumption for the block of frequency synthesis to satisfy WCDMA system specification in this paper. The parameters for minimum phase noise has been obtained in the region of design, using the lines of the tuning range and the excess gain in the plane of the inductance and the transconductance of MOS transistor to compensate the loss of LC-tank. As a result of simulation, the phase noise characteristics is -113dBc/Hz for offset of 1MHz. The optimum designed LC-VCO has been fabricated using the process of 0.25um CMOS. As a result of measurement for fabricated chip, the phase noise characteristics is -116dBc/Hz for offset of 1MHz. The power consumption is 15mW, and Kvco is 370MHz/V.

Characterization and design guideline for neuron-MOSFET inverters (Neuron-MOSFET 인버터의 특성 분석 및 설계 가이드라인)

  • Kim, Sea-W.;Lee, Jae-K.;Park, Jong-T.;Jeong, Woon-D.
    • Journal of IKEEE
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    • v.3 no.2 s.5
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    • pp.161-167
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    • 1999
  • 3-input neuron-MOSFET inverters and 3-bit D/A converters using enhancement type device have been designed and fabricated by using standard 2-poly CMOS process. The voltage transfer curve and the noise margin of neuron-MOSFET inverters have been measured and characterized as the same method in normal CMOS inverters. From the theoretical calculation of the effects of coupling ratio on the voltage transfer curve and noise margin, we set up the design guideline for the gate oxide thickness and input gate layout in neuron-MOSFET inverters. BT using one of input gates as a control gate, we can design and fabricate the neuron-MOSFET D/A converter without offset voltage.

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Performance Evaluation of IMT-2000 Receiving System (IMT-2000 수신시스템의 성능평가)

  • Ju, Jae-Han
    • Proceedings of the Korea Contents Association Conference
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    • 2004.11a
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    • pp.461-465
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    • 2004
  • In this paper, we examined receiving parameters of IMT-2000 receiving system and also analyzed them through simulation based on the minimum specification of DCS and PCS mobile station. As a result of simulation, noise figure which is the parameter of specification of the receiving sensitivity is 7.21dB, 6.03dB, and 7.89dB in case of DCS, PCS and IMT-2000 respectively. Therefore we found the receiving sensitivity of IMT-2000 mobile station lower than that of DCS and PCS.

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Design of Dual loop PLL with low noise characteristic (낮은 잡음 특성을 가지기 위해 이중 루프의 구조를 가지는 위상고정루프 구현)

  • Choi, Young-Shig;Ahn, Sung-Jin
    • Journal of the Korea Institute of Information and Communication Engineering
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    • v.20 no.4
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    • pp.819-825
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    • 2016
  • In this paper, a phase locked loop structure with parallel dual loop which have a different bandwidth has been proposed. The bandwidths depending on transfer functions are obtained through dual loops. Two different bandwidths of each loop are used to suppress noise on the operating frequency range. The proposed phase locked loop has two different voltage controlled oscillator gains to control two different wide and narrow loop filters. Furthermore, it has the locking status indicator to achieve an accurate locking condition. The phase margin of $58.2^{\circ}$ for wide loop and $49.4^{\circ}$ for narrow loop is designed for stable operation and the phase margin of $45^{\circ}$ is maintained during both loops work together. It has been designed with a 1.8V 0.18um complementary metal oxide semiconductor (CMOS) process. The simulation results show that the proposed phase locked loop works stably and generates a target frequency.

Design of PLL Frequency Synthesizer with High Spectral Purity and Ultra-Fast Switching Speed (고순도 스펙트럼과 초고속 스위칭 속도의 PLL 주파수 합성기 설계)

  • 이현석;손종원;안병록;유흥균
    • The Journal of Korean Institute of Communications and Information Sciences
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    • v.26 no.10B
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    • pp.1464-1469
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    • 2001
  • 본 논문에서는 디지털 하이브리드 위상고정루프(Digital Hybrid Phase-Locked Loop, DHPLL) 주파수 합성기 구조에서 고 순도 스펙트럼과 초고속 스위칭 속도를 위한 설계기술을 제안한다. D/A 변환기 출력으로 전압제어발진기(Voltage Controlled Oscillator, VCO)를 구동하는 개 루프(open-loop) 구성 방식과 기존 위상고정루프(Phase Locked Loop, PLL)의 폐 루프(closed-loop) 구성 방식을 혼합한 하이브리드 구조의 주파수 합성기를 고려하여, 시스템 변수(개 루프 대역과 위상 여유)와 성능 파라미터(정착시간, 위상 잡음, 그리고 최대 오버슈트(Max. overshoot)의 관계를 연구하였다. 그리고 이 관계를 통해 스펙트럼 순도와 스위칭 속도를 향상시키기 위한 최적의 3가지 설계방안을 제시한다. 컴퓨터 시뮬레이션 결과, 주파수 스위칭 과정에서 발생하는 최대 오버슈트가 0.0991%이고 완전 정상상태 도달시간은 0.288msec이다. offset 주파수 10KHz에서 위상 잡음은 -128.15dBc이다.

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Analysis of Parameters for a RF Receiver System in the CMS (CMS에서 RF수신기 시스템의 파라메타 분석)

  • Chun, Jong-Hun;Park, Jong-An
    • The Journal of the Acoustical Society of Korea
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    • v.16 no.1
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    • pp.67-75
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    • 1997
  • In this paper, A method is proposed to analyze the noise figure for some parameters based on IS-98 recommendation when a RF receiver for the CDMA mobile station is designed. Simulation results show that the maximum noise figure of the receiver, which fits in the receiving sensitivity of the mobile station, is about 11dB, and this value is smaller about 3dB than the existing specification. In addition, we have tested the relationship between frame error rate and Eb/Nt of traffic channel for each coding rate. according to the speed changes of the traffic channel. In order to prove IMD to be most important variable in LNA we have tested IMD spurious in case that LNA always turns on and in case that LNA turns ON/OFF.

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투명산화물반도체 a-IGZO TFT를 이용한 인버터 소자의 제작과 그 특성분석

  • Lee, Gwang-Jun;Kim, Jun-U;Jeong, Jae-Uk;Choe, Byeong-Dae
    • Proceedings of the Korean Vacuum Society Conference
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    • 2012.02a
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    • pp.369-369
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    • 2012
  • 본 연구에서는 투명한 산화물반도체 a-IGZO 박막을 채널층로 사용하여 박막형트랜지스터를 제작하였고, 이를 이용하여 증가 및 공핍모드를 가지는 인버터소자를 제작하였다. 제작된 인버터는 4인치 유리기판위에 게이트, 채널 그리고 소스/드레인 영역을 스퍼터링방식으로 증착하였고, PECVD를 사용하여 SiNx 절연막을 증착하였다. 또한 투명소자에 응용하기위해 게이트, 소스, 드레인 영역을 투명한 a-IZO 박막으로 증착하였다. 제작된 인버터의 특성은 높은 전압이득과, 잡음여유를 가짐으로써 투명소자회로에서 다양한 응용 가능성을 보였다.

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