Journal of the Institute of Electronics Engineers of Korea SD
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v.46
no.8
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pp.125-136
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2009
This paper presents a high-speed low-complexity two-bit level pipelined Viterbi decoder architecture for MB-OFDM UWB systems. As the add-compare-select unit (ACSU) is the main bottleneck of the Viterbi decoder, this paper proposes a novel two-bit level pipelined MSB-first ACSU, which is based on 2-step look-ahead techniques to reduce the critical path. The proposed ACSU architecture requires approximately 12% fewer gate counts and 9% faster speed than the conventional MSB-first ACSU. The proposed Viterbi decoder was implemented with $0.18-{\mu}m$ CMOS standard cell technology and a supply voltage of 1.8V. It operates at a clock frequency of 870 MHZ and has a throughput of 1.74 Gb/s.
In this paper, we propose a mobile robot navigation algorithm using data fusion of a monocular camera and ultrasonic sensors. Threshold values for binary image processing are generated by a fuzzy inference method using image data and data of ultrasonic sensors. Threshold value variations improve obstacle detection for mobile robot to move to the goal under poor illumination environments. Obstacles detected by data fusion of camera and ultrasonic sensors are expressed on the grid map and avoided using the circular planning algorithm. The performance of the proposed method is evaluated by experiments on the Pioneer 2-DX mobile robot in the indoor room with poor lights and a narrow corridor.
In this paper, we propose a suitable multiplication architecture for cellular automata in a finite field $GF(2^m)$. Proposed least significant bit first multiplier is based on irreducible all one Polynomial, and has a latency of (m+1) and a critical path of $ 1-D_{AND}+1-D{XOR}$.Specially it is efficient for implementing VLSI architecture and has potential for use as a basic architecture for division, exponentiation and inverses since it is a parallel structure with regularity and modularity. Moreover our architecture can be used as a basic architecture for well-known public-key information service in $GF(2^m)$ such as Diffie-Hellman key exchange protocol, Digital Signature Algorithm and ElGamal cryptosystem.
Journal of the Institute of Electronics Engineers of Korea SD
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v.41
no.11
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pp.97-104
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2004
This paper proposes an efficient VLSI architecture of 9-7/5-3 Lifting DWT filters that is used by lossy or lossless compression of JPEG2000. The proposed architecture uses only internal line memories to compute Lifting-DWT operations and its PE(Processing Element) has critical path with 1 multiplier and 1 adder. To reduce the number of PE, we make the vertical filter that is responsible for the column operations of the first level perform both the row and column operations of the second and following levels. As a result, the architecture has smaller hardware cost compared to that of other architectures. It was modeled in RTL level using VHDL and implemented on Altera APEX 20K FPGA.
Journal of the Institute of Electronics and Information Engineers
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v.51
no.10
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pp.72-79
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2014
This paper presents a method for constructing a pipeline-aware quasi-cyclic irregular repeat accumulate low-density parity-check (PA-QC-IRA-LDPC) codes and efficient rate-1/2 (2016, 1008) PA-QC-IRA-LDPC decoder architecture. A novel pipeline scheduling method is proposed. The proposed methods efficiently reduce the critical path using pipeline without any bit error rate (BER) degradation. The proposed pipeline-aware LDPC decoder provides a significant improvement in terms of throughput, hardware efficiency, and energy efficiency. Synthesis and layout of the proposed architecture is performed using 90-nm CMOS standard cell technology. The proposed architecture shows more than 53% improvement of area efficiency and much better energy efficiency compared to the previously reported architectures.
Journal of the Korean Institute of Telematics and Electronics C
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v.35C
no.6
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pp.1-8
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1998
In this paper, we designed a low power 8bit ELM adder with static CMOS and hybrid logic styles on a chip. The designed 8bit ELM adder with both logic styles was fabricated in a 0.8$\mu\textrm{m}$ single-poly double-metal, LG CMOS process and tested. Hybrid logic style consists of CCPL(Combinative Complementary Pass-transistor Logic), Wang's XOR gate and static CMOS for critical path which determines the speed of ELM adder. As a result of chip test, the ELM adder with hybrid logic style is superior to the one with static CMOS by 9.29% in power consumption, 14.9% in delay time and 22.8% in PDP(Power Delay Product) at 5.0V supply voltage, respectively.
Fluidized bed reactors operated in subatmospheric pressure has been focused because several industrial applications such as vacuum drying and plasma cvd requires reduced pressure fludization. However, the hydrodynamics of fluidized beds in subatmospheric pressure has not been extensively investigated. The pressure drop in the fluidized bed has been measured with variation of downstream pressures from 1.33 to 101.3 kPa in the shallow and deep fluidized beds under the sub-atmospheric pressures. The obtained minimum fluidization velocity of powders is a function of pressure due to the changes of gas density and mean free path. We can experimentally determine the critical Knudsen number and the critical pressure to define the slip regime significantly to influence the hydrodynamics of fluidized beds.
The Journal of the Institute of Internet, Broadcasting and Communication
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v.15
no.6
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pp.155-161
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2015
As the popularity of the smartphone becomes increase, indoor smartphone positioning technology has been actively studied. The acoustic signal generated from the smartphone is received from the several microphones at the relative positioning system, and the trigger signal is proposed to mitigate the multipath effect and the effect is verified. But for the simple trigger method, there would be error occurred according to the variation of the distance or surrounding noise. In this paper, in order to resolve the problems, the dynamic trigger threshold technology is proposed and its effect is verified by the experiment.
비 신뢰적이고 비 대칭적인 무선 링크를 갖는 무선센서네트워크에서 데이터전송이 성공했음에도 ACK 메시지 전송 실패로 발생하는 불필요한 데이터 재전송을 피해 에너지 효율을 높이는 전송기법들이 제안되었다. 이러한 전송기법의 하나인 Probability-based Data Forwarding(PDF)기법에서 기대 전송 횟수 임계치를 설정해 임계값만큼 데이터를 재전송 하였다면 더 이상 재전송하지 않음으로 불필요한 에너지 낭비를 줄인다. 하지만 PDF 는 데이터 전송 횟수만을 고려함으로, 여전히 ACK 메시지의 신뢰성 있는 전송을 보장하지 못한다. 따라서 본 논문은 에너지 효율적인 PDF 기법에 비 대칭적 무선 노드의 특성을 고려하여 ACK 메시지 전송 시 사용되는 역방향 링크의 신뢰성이 낮다면 높은 신뢰성의 역방향 링크를 갖는 노드들을 선택하여 멀티 홉으로 송신 노드에게 ACK 메시지를 전송하는 기법을 적용한다. 이를 통해 불필요한 데이터 전송을 줄여 에너지의 낭비를 줄이고 무선센서네트워크의 수명을 연장한다.
This study investigated the characteristics of bifurcation and the instability due to the initial imperfection of the space truss, which is sensitive to the initial conditions, and the calculated buckling load by the analysis of Eigen-values and the determinant of tangential stiffness. A two-free nodes model, a star dome, and a three-ring dome model were selected as case studies in order to examine the unstable phenomenon due to the sensitivity to Eigen mode, and the influence of the rise-span ratio and the load parameter on the buckling load were analyzed. The sensitivity to the imperfection of the two-free nodes model changed the critical path after reaching the limit point through the bifurcation mode, and the buckling load level was reduced by the increase in the amount of imperfection. The two sensitive buckling patterns for the model can be explained by investigating the displaced position of the free node, and the asymmetric Eigen mode was a major influence on the unstable behavior due to the initial imperfection. The sensitive mode was similar to the in-extensional mechanism basis of the simplified model. Since the rise-span ratio was higher, the effect of local buckling is more prominent than the global buckling in the star dome, and bifurcation on the equilibrium path occurring as the value of the load parameter was higher. Additionally, the buckling load levels of the star dome and the three-ring model were about 50-70% and 80-90% of the limit point, respectively.
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[게시일 2004년 10월 1일]
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