• 한국공간정보시스템학회 논문지
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• 제7권3호
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• pp.55-65
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• 2005

본 논문은 이동체의 잦은 갱신에 의해 발생하는 색인 재구성에 대한 비용을 줄이기 위해 이동체의 지연 다량 삽입 기법을 제안한다. 기존 이동체 색인에 대한 연구는 주로 색인 구성 후에 발생하는 질의 처리 효율성에 초점을 두었다. 이들은 이동체 데이터의 갱신 연산에 의한 색인 재구성에 대한 디스크 접근 오버헤드를 거의 고려하지 않았다. 이러한 이동체 데이터의 갱신 연산에 대한 비용을 줄이기 위해 다량 삽입 기법과 여러 색인이 제안되었다. 하지만 제안된 기법들은 매우 가변적이고 대량인 데이터를 효율적으로 처리하는데 많은 디스크 I/O 비용을 필요로 한다. 본 논문에서는 빠른 데이터 생성 속도에 적합하도록 디스크 접근 오버헤드를 고려해서 R-트리를 관리할 수 있는 현재색인에 대한 다량 삽입 기법을 제안한다. 이 기법에서는 다차원 색인 구조에서의 다량 삽입 기법을 위한 버퍼링 기법을 사용한다. R-트리의 단말 노드 정보를 관리하는 보조 색인을 추가하여 노드의 분할과 합병을 예상한다. 또한 연산을 종류에 따라 분류하여 불필요한 삽입과 삭제 연산을 줄인다. 노드의 변환를 최소화하는 방향으로 이동 객체의 처리 순서를 정하여 데이터 갱신에 따른 노드의 분할과 합병을 최소화한다. 실험을 통해 제안한 기법을 이용한 다량 삽입 기법이 기존의 삽입 기법들보다 색인의 갱신 비용을 감소시키는 것을 알 수 있다.

• 한국콘텐츠학회논문지
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• 제10권1호
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• pp.68-77
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• 2010

본 논문에서는 데이터의 접근성에 따른 병합 가치를 고려한 새로운 로그 버퍼 관리 기법을 제안한다. 제안하는 기법은 로그 블록의 병합 가치를 평가하여 빈번하게 갱신이 발생하지 않는 데이터에 대해서 데이터 블록과의 병합연산을 수행한다. 또한 빈번하게 갱신되는 데이터에 대해 데이터 블록과의 병합을 최대한 지연한다. 이를 통해 불필요한 데이터 블록의 병합 연산을 방지하여 플래시 메모리의 소거 연산 횟수를 크게 감소시켰고, 공간 활용을 극대화 하였다. 마지막으로, 로그 버퍼 관리 기법의 대표적인 기법인 BAST와 FAST와의 성능 비교를 통해 본 논문에서 제안하는 기법의 우수성을 증명하였다. 성능평가 결과 제안하는 기법이 BAST와 FAST에 비해 소거연산 측면에서 평균 25%와 65%의 성능 향상이 있었다.

• 한국정보통신학회논문지
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• 제19권2호
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• pp.407-413
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• 2015

본 논문에서 제안된 십진 부동소수점 가산기(decimal floating-point adder, DFPA)는 선행 제로 예측기(leading zero anticipator, LZA)를 이용해 임계 경로 단축을 통해 지연시간을 줄임으로서 연산 처리 속도를 향상시키는 파이프라인 구조로 설계하였다. 제안된 십진 부동소수점 가산기의 성능 평가 및 검증 환경은 시뮬레이션에 Flowrian 툴을 사용하였으며, 합성에는 QuartusII 툴 상에서 Cyclone III FPGA를 대상으로 지정하였다. 제안된 방식은 동일한 입력 데이터를 이용하여 기존에 제안된 설계 방식들과 시뮬레이션을 통해 비교 검증한 결과, L.K.Wang이 제안한 방식 및 기존 제안된 방식들보다 각각 11.2%, 5.9%의 성능이 향상되었다. 또한 연산 처리 속도 향상 및 임계 경로 상의 지연 소자의 수가 감소됨을 확인하였다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2008년도 한국컴퓨터종합학술대회논문집 Vol.35 No.1 (B)
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• pp.366-370
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• 2008

NAND 플래시 메모리는 특성상 쓰기 횟수가 제한적이라는 단점을 가지고 있어 쓰기 연산이 빈번히 발생하게 되면 NAND 플래시 메모리의 수명이 줄어든다. 이러한 문제점을 해결하기 위해 NAND 플래시 메모리의 특성을 고려한 지연 쓰기 기법이 연구되고 있다. 하지만 지연 쓰기를 하기 때문에 쓰기 횟수는 줄어들지만 캐시 적중률이 낮아진다. 이러한 문제해결을 위해 본 논문에서는 NAND 플래시 메모리 기반 파일 시스템을 위한 더블 캐시 정책을 제안한다. 더블 캐시는 실질적인 캐시인 Real Cache와 요구 페이지의 패턴을 관찰하기 위한 Ghost Cache로 구성된다. 이 정책은 Real Cache에서의 지연 쓰기를 하지 않고, Ghost Cache 공간에서 dirty페이지와 clean페이지를 활용하여 효율적인 지연 쓰기가 가능하도록 설계함으로써 쓰기 횟수를 줄이고, 적중률을 높인다.

• 소음진동
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• 제5권4호
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• pp.453-460
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• 1995

본 논문에서는 정현파 소음을 제어하기 위한 filtered-x LMS에 바탕을 둔 새로운 적응 알고리듬을 제안하였다. 이러한 알고리듬은 두개의 연속적인 계수조정 식으로, 제어기의 계수를 조정한다. 서로 독립인 각 주파수별로 처리하기 때문에 빠른 수렴을 얻을 수 있다. 두번째식은 이차경로로 인한 위상지연을 추정한다. 정현 파 신호 주파수보다 4배 이상 빠른 표본화 주파수를 선택하여 추정된 위상지연 추정 값은 $2{\pi}f_0$만큼 오차를 나타내며, 이 값은 $\pi$2보다 작다. 정현파 신호의 주파수를 알면 이러한 오차는 $2{\pi}f_0$를 더함으로써 제거할 수 있다. 이러한 방법은 위상지연이 $\pi$2보다 큰 경우 수렴속도를 증가시킨다는 사실을 실험을 통하 여 알 수 있다. 추정된 위상지연은 제어기 계수값을 조정하는데 필요한 필터링된 참조신호를 발생시키믄데 사용된다. 참조신호의 위상지연이 각 주파수 성분별로 수행 되기 때문에, 콘볼루션 연산이 생략되어 계산량을 줄일 수 있다. 또한 연속적으로 위상지연을 추정하기 때문에 시변 상황에 적용이 가능하다. 조정식의 수렴조건을 유도하였다. 제안된 알고리듬은 제어기 계수를 추정하는데 바이어스가 없으며, 위상 지연추정을 위한 수렴상수의 최대허용치는 제어기계수에 대한 수렴상수에 반비례함을 이론적으로 분석을 통해 알 수 있다. 모의실험을 통하여 제안된 알고리듬이 filtered-x LMS 알고리듬에 바탕을 둔 다른 알고리듬보다 환경변화에 우수한 성능을 보임을 알 수 있다.

• 한국정보통신학회논문지
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• 제10권7호
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• pp.1188-1195
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• 2006

본 논문은 개량된 분기한정법(branch-and bound method)을 이용하여 고속연산이 가능한 2차원 상태공간 디지털 필터의 설계방법을 제안하였다. 설계된 디지털 필터가 갖는 계수행렬의 모든 요소 값들은 오직 2개의 2의 멱수 (powers-of-two) 의 합으로만 표현되어진다. 따라서 제안된 방법으로 설계한 2 차원 상태공간 디지털필터는 간단한 가산연산만으로 수행이 이루어지므로 고속연산이 가능하고, 또한 구조가 간단하며 저가격으로 실현이 가능하다는 장점을 가진다 . 본 논문에서 제안된 방법의 타당성을 설계예시를 통해 고찰한 결과, 설계된 디지털 필터의 근사오차와 군지연특성이 동일한 설계사양으로 연속계수공간에서 설계되어진 디지털필터와 비교하여 유사한 결과를 얻을 수 있었다.

• 한국통신학회논문지
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• 제30권3A호
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• pp.217-225
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• 2005

본 논문은 다양한 무선 통신 표준에서 사용되는 비터비 알고리즘을 위한 전용의 DSP 명령어 및 하드웨어 구조를 제안한다. 제안한 구조는 비터비 알고리즘의 Trace Back(TB) 연산 사이클을 효과적으로 줄일 수 있다. 제안된 비터비 전용 명령어와 하드웨어 구조는 비터비 연산의 Add Compare Select(ACS) 연산 과정과 TB 연산 과정의 병렬 처리가 가능하며, 병렬 연산을 지원하기 위해 트랠리스 버터플라이 연산 과정에서 필요한 데이터를 자동으로 생성하는 Offset Calculation Unit(OCU)을 제안한다. 제안된 OCU는 삼성 SEC 0.18μm라이브러리로 로직 합성하여 1,460 게이트 개수를 가지며, 최대 지연 시간은 5.75ns를 나타내었다. 사용된 ACS-TB 병렬 처리 방식은 Eb/No 값이 6dB인 경우 MLSE 등화기 사용 사용되는 일반적인 TB 연산 방식과 비교하여 거의 동일한 BER 성능을 보여 주었으며, 제안한 DSP는 구속장 K=5 일 때 Carmel DSP와 비교하여 11%, TI TMS320c55x와 비교하여 45%의 연산 사이클이 줄일 수 있다.

• 한국컴퓨터정보학회논문지
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• 제11권3호
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• pp.141-149
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• 2006

본 논문에서는 회로 설계 소프트웨어에서 사용되는 primal-dual 최적화 문제의 해를 구하기 위해 필요한 삼중 행렬 곱셈 연산 ($P=AHA^{t}$)의 성능 개선에 관하여 연구하였다. 이를 위하여 삼중 행렬 곱셈 연산의 속도를 개선하기 위하여 기존의 2단계 연산 방법을 대신하여 1단계 연산 방법을 제안하고 성능을 분석하였다. 제안된 방법은 희소 행렬 H의 블록 대각 구조의 특성을 이용하여 부동 소숫점 연산량을 감소시킴으로써 성능 개선을 이루었으며 더불어 메모리 사용량도 기존 방법에 비하여 50% 이하로 감소하였다. 그 결과 Intel Itanium II 플랫폼에서 기존 2단계 연산 방법과 비교하여 속도 면에서 주어진 실험 데이터 집합에 대하여 평균 2.04 의 speedup을 얻었다. 또한 본 논문에서는 플랫폼의 메모리 지연량과 예측된 캐쉬 미스율을 이용한 성능 모델링을 통하여 이와 같은 성능 개선 수치의 가능 범위를 보이고 실측된 성능개선을 평가하였다. 이와 같은 연구는 희소 행렬의 성능 개선 연구를 기본 연산이 아닌 복합 연산에 적용하는 연구로써 큰 의미가 있다.

• 한국산학기술학회논문지
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• 제19권2호
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• pp.185-191
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• 2018

본 연구는 유발된 정서가 뒤따르는 수 연산과제에 미치는 간섭현상의 종류와 크기를 확인해 보기 위해 수행되었다. 유발된 정서상태의 유지가 작업기억 요소 간 원활한 수행을 간섭할 수 있는 단계별 인지과제 처리 과정을 통해 자극유형 및 정서의 종류가 기초 연산(fundamental arithmetic operation)과제 수행에 미치는 영향을 알아 보았다. 피험자는 인구학적 변인에서 거의 차이가 없는 균질적인 대학생 집단으로 구성되었으며, 사전 연습시행에서 표정모방을 통해 유발된 정서를 유지하면서 후속되는 연산과제 수행 및 제시되는 답의 정오를 판단하도록 지침을 받았다. 분석결과, 자극유형 간에 간섭의 크기에서는 차이가 없었으나 유발된 정서의 종류 간에는 차이가 발견되었다. 유발된 정서의 시간지연 주효과가 계산과정의 어느 단계에 영향을 주었는지를 알아보기 위해, 자극 유형별로 정서 간 오류율과 지연 정반응률을 구하여 함께 분석하였는데, 긍정정서(기쁨조건)의 시간지연이 문장자극일 때에는 오류율 간 차이로, 그림자극일 때에는 지연 정반응률 간 차이로 나타남을 확인하였다. 이와 같은 결과는 유발된 긍정 정서의 영향이 부정정서(분노 및 슬픔 조건)에 비해 계산지연을 확대시키는 방향으로 나타났다는 점 외에 문장자극의 정서유발이 계산실패로 이어지기 쉬운 반면, 그림자극의 정서유발은 계산요동으로 이어지기 쉬운 특성이 있는 것으로 그 주효과의 영향이 분리될 수 있음을 시사한다고 하겠다.

• 정보처리학회논문지C
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• 제10C권1호
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• pp.87-94
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• 2003

인터넷 사용자의 폭발적인 증가로 인해 캐시 서버의 사용이 대두되고 있다. 이에 따라 캐시 서버의 성능을 향상시키기 위한 많은 연구들이 진행되었다. 본 논문에서는 캐시 서버의 병목 현상을 유발하는 원인을 분석하고 그에 대한 해결책으로 중재 쓰레드와 지연 캐싱을 제안한다. 중재 쓰레드를 사용함으로써 캐시 서버가 디스크 쓰기 연산 시에 준비된 다중 쓰레드를 탐색해야 하는 문제점을 없애고 즉시 사용자의 서비스 요청에 응답함으로써 보다 빠른 서비스를 제공할 수 있도록 한다. 또한 준비된 다중 쓰레드가 없는 경우에는 지연 캐싱을 이용해 과부하 상태의 디스크 연산을 피하고 큐가 안정화될 때 캐싱을 하도록 하여 시스템이 안정성 있게 동작하도록 하였다. 제안된 캐시 서버는 스퀴드(SQUID) 캐시 서버를 변형하여 구현되었고 실험을 통해 기존 스퀴드 캐시 서버의 성능과 비교한 결과, 응답 시간의 향상을 관찰할 수 있었다.