Atomic layer deposition (ALD)에 의한 알루미늄 산화 막(Al2O3)은 고효율 결정질 실리콘 태양전지를 위한 우수한 표면 패시베이션 특성을 제공한다. 알루미늄 산화막는 고정적인 음전하를 가지고 있기 때문에 p-형 실리콘 태양 전지 후면은 전계에 의한 우수한 패시베이션 효과를 형성한다. 그러나, ALD 방식으로 증착된 알루미늄 산화막은 매우 긴 공정 시간을 필요로 하기 때문에 기존의 실리콘 태양 전지 공정에 적용하기가 어렵다. 본 논문에서는 알루미늄 산화막 형성에서 공정 시간을 줄이기 위해 Plasma assisted atomic layer deposition (PA-ALD) 방식을 적용했다. PA-ALD 기술은 trimethylaluminum (TMA)과 O2를 사용하여 기판 표면에 알루미늄 산화막을 증착하는 것으로 ALD 방식과 유사하지만, O2 플라즈마를 사용함으로써 증착 속도를 향상시킬 수 있다. 이는 좋은 패시베이션 특성을 가지는 알루미늄 산화막을 실리콘 태양전지양산 공정에 적용할 수 있는 가능성을 제시한다. PA-ALD 방식에 의한 알루미늄 산화막의 패시베이션 특성을 최적화하기 위해서 증착 후 열처리 조건에 대한 연구도 수행하였다. 막증착률이 1.1${\AA}$/cycle인 Al2O3층의 두께 변화에 따른 특성을 최적화하기 위해 공정 온도를 $250^{\circ}C$ 고정하고, 열처리 온도와 시간을 가변하였으며 유효 반송자수명을 측정하여 알루미늄 산화막의 패시베이션 특성을 확인했다.
핵연료 피복관용 신합금을 개발하기 위한 기초연구로서 Zr-xNb계 합금과, Zr-0.8Sn-xNb계 합금을 각각 4종씩 선정하였다. 이들 합금을 판재시편으로 가공한 뒤 Autoclave를 이용하여 36$0^{\circ}C$에서 부식 시험을 실시하였다. 부식과정에서 생성되는 산화막의 미세구조를 관찰하기 위해 천이 전 영역에서 동일두께를 갖도록 부식시편을 준비하여 산화막/금속계면에 대해 SEM관찰을 실시하였다. 또한 석출물의 크기와 부식과의 관계를 조사하기 위하여 부식전의 시편에 대해 TEM관찰을 실시하였다. Zr-xNb 2원계 합금에서는 Nb함량이 적을수록 부식저항성이 증가하는 경향을 보이는데, 0.2Nb가 첨가된 합금이 가장 우수한 부식저항성을 보였다. Zr-0.8Sn-xNb 3원계에서도 천이 전 영역에서는 2원계 합금과 마찬가지로 Nb함량이 적을수록 부식저항성이 증가하나, 천이 후 영역에서는 이런 경향이 바뀌는 것이 관찰되었다. 이는 Sn이 첨가됨으로서 Nb가 부식에 미치는 영향이 달라지기 때문이라 생각된다. 산화막 관찰결과, 순수 Zr은 결정립계를 따라서 산화막이 급격히 성장하는 반면에, Zircaloy-4합금은 매우 균일한 산화막 계면을 유지한다. Zr-xNb계 합금과 Zr-0.8Sn-xNb계 합금에서도 내식성이 우수한 합금은 균일한 산화막/금속 계면을 유지하는 것이 관찰되었다.
본 연구에서는 금속-절연막-반도체 (MIS) 형태를 이용한 비휘발성 메모리 (NVM) 소자의 메모리 특성 향상을 위해 수소화 (Hydrogenation) 처리된 게이트산화막을 블로킹 산화막으로 응용하였다. 기존 연구의 경우 저온 공정시 게이트산화막의 고품위 전기적 특성 확보에 어려움이 있었다. 하지만 이번 연구에서는 게이트산화막 형성 시 H2 또는 NH3가스를 함께 주입시켜 Si-H 결합의 증대를 통한 passivation 효과를 얻을 수 있었다. 형성된 게이트산화막의 전기적 특성을 확인하기 위해 우선적으로 박막트랜지스터 (TFT)를 제작하여 전기적 특성을 확인하였다. 수소화 처리된 게이트산화막을 이용한 TFT 경우 그렇지 않은 게이트산화막을 이용한 TFT 보다 약 5V의 threshold voltage (Vth) 이득이 있으며 Vth의 hysteresis 특성 역시 거의 0V로 매우 안정적이었다. MIS 형태의 NVM 소자의 경우 -20V에서 +15V, +15V에서 -20V로 sweep하여 측정한 flatband voltage (Vfb)의 변화량 역시 약 88%의 메모리 특성 이득이 있음을 확인하였다.
질산 용액을 이용한 처리를 통해서 실리콘 웨이퍼 위에 누설 전류가 thermal oxidation 방법과 비슷한 수준의 얇은 실리콘 산화막을 형성할 수 있다. 이러한 처리 방법은 thermal oxidation에 비해서 낮은 온도에서 공정이 가능하다는 장점을 가진다. 이 때 질산 용액으로 68 wt% $HNO_3$을 쓰는데, 이 용액에만 넣었을 때에는 실리콘 산화막이 어느 정도 두께 이상은 성장하지 않는 단점이 있다. 그렇기 때문에 실리콘 웨이퍼를 68 wt% $HNO_3$에 넣기 전에 seed layer 산화막을 형성 시킨다. 본 연구에서는 p-type 웨이퍼를 phosphorus로 도핑해서 에미터를 형성 시킨 후에 seed layer를 형성 시키고 68 wt% $HNO_3$를 이용해서 에미터 위의 실리콘 산화막을 성장 시켰다. 이 때 보다 더 효과적인 seed layer를 형성 시키는 용액을 찾아서 실험하였다. 40 wt% $HNO_3$, $H_2SO_4-H_2O_2$, HCl-$H_2O_2$ 용액에 웨이퍼를 10분 동안 담그는 것을 통해서 seed layer를 형성하고, 이를 $121^{\circ}C$인 68 wt% $HNO_3$에 넣어서 실리콘 산화막을 성장시켰다. 이렇게 형성된 실리콘 산화막의 특성은 엘립소미터, I-V 측정 장치, QSSPC를 통해서 알아보았다.
LPCVD 방법으로 실리콘 산화막 두께 10nm에서 80nm인 MOS를 제작하였다. 그리고 스트레스 전계 산화막 전류의 두께 의존성을 조사하였다. 산화막 전류는 스트레스 전류와 전이전류로 구성되어 있음을 보여 주었다. 스트레스 전류는 스트레스 유기 누설전류와 직류전류로 이루어졌으며 산화막을 통하는 트립 어시스트 터널링으로 행해진다. 전이전류는 계면에서 트랩의 터널링 충전과 방전에 의해 이루어진다. 스트레스 전류는 산화막 전류의 두계 한계를 평가하는데 이용되고 전이전류는 기억소자에서 데이터 유지에 사용된다.
실리콘 산화막 위에 구리 확산 방지막으로서 W-N 박막을 $NH_3$ 펄스 플라즈마를 이용한 원자층 증착방법으로 형성하였다. 플라즈마 원자층 증착방법 (PPALD)은 일반적인 원자층 증착방법(ALD)의 성장 기구를 그대로 따라 간다. 그러나 일반적인 ALD 방법에 의해 증착한 W-N 박막에 비해 PPALD 방법으로 증착한 W-N 박막은 F 함유량과 비저항이 감소하였고 열적 안정성에 대한 특성도 향상되었다. 또한 $WF_6$ 가스는 실리콘 산화막과 반응을 하지 않기 때문에 $WF_6$ 가스와 $NH_3$ 가스를 사용해서 ALD 증착방법으로 실리콘 산화막 위에 W-N 박막을 증착하기 어려운 문제점(8,9)을 $NH_3$ 반응종으로 실리콘 산화막 표면을 먼저 변형시켜 $WF_6$ 가스가 산화막과 반응을 할 수 있게 함으로써 ALD 방법으로 W-N 박막을 실리콘 산화막 위에 증착 할 수 있었다.
박막 태양전지의 단락전류를 증가시키기 위해서는 투명전도 산화막의 표면 식각을 통한 광포획 특성 극대화가 중요하며, 일반적으로 스퍼터링법으로 제작된 투명전도 산화막의 표면 식각은 HCl solution을 이용한다. 본 연구는 투면전도 산화막 증착시 seed로 작용할 수 있는 colloidal 형태의 nanoparticle을 유리기판에 형성한 뒤 rf-magnetron sputtering 법을 이용하여 ZnO:Al(AZO) 투명전도 산화막을 증착하여 광학 전기적 특성 변화를 분석하였다. Nanoparticle을 사용하여 제조된 AZO 박막은 nanoparticle의 확산에 의한 전자농도의 향상이 보였으나, 이동도의 감소로 인해 전기적 특성에 큰 변화는 없었다. 반면 AZO 박막의 표면형상이 nanoparticle로 인해 변하여 박막의 광 포획을 위한 안개도가 향상됨을 확인 할 수 있었으며, 이로 인해 표면 형상 제어를 통한 박막 태양전지 적용을 위한 투명전도 산화막을 제작할 수 있었다.
본 연구에서는 비대칭 이중게이트 MOSFET의 상하단 게이트 산화막 두께 비에 대한 문턱전압이하 스윙 및 전도중심의 변화에 대하여 분석하고자한다. 문턱전압이하 스윙은 전도중심에 따라 변화하며 전도중심은 상하단의 산화막 두께에 따라 변화한다. 비대칭 이중게이트 MOSFET는 상단과 하단의 게이트 산화막 두께를 다르게 제작할 수 있어 문턱전압이하 스윙의 저하 등 단채널효과를 감소시키기에 유용한 소자로 알려져 있다. 본 연구에서는 포아송방정식의 해석학적 해를 이용하여 문턱전압이하 스윙을 유도하였으며 상하단의 산화막두께 비가 전도중심 및 문턱전압이하 스윙에 미치는 영향을 분석하였다. 결과적으로 문턱전압이하 스윙 및 전도중심은 상하단 게이트 산화막 두께 비에 따라 큰 변화를 나타냈다. 또한 채널길이 및 채널두께, 상하단게이트 전압 그리고 도핑분포함수의 변화에 따라 문턱전압이하 스윙 및 전도중심은 상호 유기적으로 변화하고 있다는 것을 알 수 있었다.
$N{_2}O$ 게이트 산화막을 사용한 nMOSFET가 금속 플라즈마 식각 피해에 대한 면역도가 동일한 두께의 순수한 산화막을 갖는 nMOSFET보다 향상됨을 보여준다. Area Antenna Ratio(AAR)를 증가시킴에 따라 $N{_2}O$ 산화막을 갖는 nMOSFET는 좁은 초기 분포 특성과 정전계 스트레스하에서 더 작은 열화특성을 보이는 데 이는 Si기판과 산화막 계면에서의 질소기의 영향으로 설명되어진다. 또한 $N{_2}O$ 게이트 산화막을 사용하면 순수한 게이트 산화막을 사용할 때 보다 금속 Area Antenna Ratio(AAR)과 Perimeter Area ratio(PAR) 의 최대 허용 크기를 더 증가할 수 있다. 이러한 $N{_2}O$ 게이트 산화막을 갖는 NMOSFET의 개선은 Si기판과 $N{_2}O$ 산화막 계면에 있는 질소기에 의한 계면 강도의 영향 때문으로 판단된다.
본 논문에서는 비대칭 이중게이트 MOSFET의 상하단 게이트 산화막 두께에 대한 드레인 유도 장벽 감소 현상을 분석하기 위하여 전위장벽에 영향을 미치는 드레인전압에 따른 문턱전압의 변화를 관찰할 것이다. 비대칭 이중게이트 MOSFET는 상단과 하단의 게이트 산화막 두께를 다르게 제작할 수 있는 특징이 있다. 상단과 하단의 게이트 산화막 두께 변화에 따른 드레인 유도 장벽 감소 현상에 대하여 포아송방정식을 이용하여 분석하였다. 결과적으로 드레인 유도 장벽 감소 현상은 상하단 게이트 산화막 두께에 따라 큰 변화를 나타냈다. 상단과 하단 게이트 산화막 두께가 작을수록 드레인 유도 장벽은 선형적으로 감소하였다. 채널길이에 대한 드레인 유도 장벽 감소 값은 비선형적인 관계가 있었다. 고농도 채널도핑의 경우 상단 산화막 두께가 하단 산화막 두께보다 드레인 유도 장벽 감소에 더 큰 영향을 미치고 있었다.
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[게시일 2004년 10월 1일]
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