무선인지 기반의 시스템에서, 주 사용자를 위한 주파수 할당을 보장하면서도 부가 사용자에게도 끊김없는 서비스를 제공해야 한다. 부가 사용자의 멀티미디어 데이터의 전송 시 무선 링크의 빈번한 변경 때문으로 인한 데이터 전송 지연과 손실이 발생할 경우 QoS 저하를 피할 수 없게 된다. 부가 사용자에게도 끊김없는 서비스를 유지하기 위해서는 효율적인 주파수 자원 관리가 필요하다. 본 논문에서는 퍼지 다기준 의사 결정 방법에 근거한 주파수 선정 방법을 제안한다. 제안되는 주파수선정 방법은 퍼지 집합 이론을 활용하며 주파수 선택을 위한 결정 프로세스에 기존의 전파 수신 감도 이외에 셀 부하, 데이터 전송률, 가용 대역 등을 고려한다. 시뮬레이션을 통하여, 제안된 방법이 수신 신호 세기만을 사용하는 기존의 방법보다 우수함을 보인다.
본 논문에서는 다운 디지털 회로(DLC)를 이용하여 4치 논리 게이트를 설계하였고, 이들 게이트를 이용하여 동기식 4치 up/down 카운터를 제안하였다. 제안된 카운터는 T-type 4치 플립플롭과 $2\times1$ 임계-t 멀티플렉서로 이루어져 있고, T-type 4치 플립플롭은 D-type 4치 플립플롭과 4치 논리 게이트들(모듈러-4 가산 게이트, 4치 인버터, 항등 셀, $4\times1$ 멀티플렉서)로 구성되어 있다. 이 카운터의 모의실험 결과는 10[ns]의 지연시간과 8.48[mW]의 전력소모를 보여준다. 또한 다치논리 회로로 설계된 카운터는 상호결선과 칩 면적의 감소뿐만 아니라 디지트 확장의 용이함의 이점을 가진다.
최근 인터넷 상의 멀티미디어 트래픽의 급격한 증가가 IP 트래픽에 대해 고속 전송,다양한 QoS를 만족하며 넓은 대역폭을 지원하는 IP 네트워크를 요구하게 되었다. 본 논문에서는 ATM 기반의 토폴로지 구동형 IP 스위치 네트워크에서 트래픽을 실시간 트래픽과 비실시간 트래픽의 두 가지 형태로 분류하고, 분류된 트래픽 유형에 따른 VC-Merging 기능을 갖는 출력 버퍼형ATM 스위치 기반 IP 교환 방식을 제안한다. 제안된 방식은 트래픽 유형에 따른 QoS를 제공하기 위해 실시간 트래픽에 대해 지연 특성, 비실시간 트래픽에 대해서 손실 특성을 보장한다. 그리고, 본 방식을 실시간 트래픽과 비실시간 트래픽이 존재한 경우에 대해 셀 손실,지연 특성 관점에서 성능 분석을 행하고, 기존 방식과 비교 분석하여 본 방식의 우수함을 분명히 한다.
본 논문에서는 이종 접속망에서 이동 단말기 및 접속망 상태 등에 따라 가변적으로 변하는 자원관리 기능을 이동 단말기의 핸드오버 처리에 적용함으로써 최적의 QoS를 보장할 수 있는 정책기반 자원관리 프레임워크를 제안하였다. 본 논문에서 제안한 정책기반 자원관리 프레임워크의 성능을 평가하기 위하여 중첩된 이종 접속망간에서 발생하는 핸드오버시 최적의 셀을 선정하기 위한 가중치 정책을 적용했을 경우, 멀티미디어 서비스 세션의 수가 증가할수록 전송 지연이 현저히 향상된 것으로 분석되었다. 이는 서비스 중인 접속망에서 QoS 저하가 발생할 경우에 최적의 접속망으로 핸드오버가 수행되어 현재 서비스에 가장 적합한 이종 시스템으로의 서비스 절체가 이루어지므로 서비스의 연속성을 최대한 보장할 수 있다.
구조전지에서 멀티스케일로 일어나는 다중물리현상은 기계적 물성을 테스트하는 것을 어렵게 한다. 본 연구에서는 구조전지 셀에 적합한 기계적 물성 테스트 방법을 이용하여 탄소섬유직물의 전해질 코팅이 기계적 성능에 미치는 효과를 알아보았다. 이를 위해 ASTM의 표준 시편 규격을 참고하여 2가지 종류의 시편을 제작하였다. 기계적 물성 실험은 탄소섬유직물에 전해질을 도포하여 전해질 코팅을 수행하고 이를 다시 에폭시에 경화를 시켜 시편을 만들고 만능 인장시험기를 이용하여 인장실험을 진행하였다. 실험결과, 탄소섬유직물에 전해질의 코팅이 기계적물성에는 큰 영향을 주지 않음을 확인할 수 있었다. 또한 실험에 이용한 축소된 규격의 시편이 타당함을 확인할 수 있었다.
WCDMA 방식 이동 멀티미디어 시스댐어써 고속 데이터 λ냉자에 의한 간섭은 시스템의 용량과 성능을 저하 시키는 주요 요인이 되며, 적응형 안테나 시스템을 도입하여 고속 데이터 사용자의 간성을 크게 줄여줌으로써 시스템의 성능을 향상시킬 수 있다 이 경우, 적용형 안테나의 효과를 극대화하기 위한 방법으로서, 호 수락제어 기법의 최적화가 중요하고 생간 핸드요프 과정에 있어서의 효율적인 제어 방식이 중요한 논제가 된다. 본 논문에서 는 핸드요프 되는 고속의 데이터들을 효과적으로 처리하기 위하여 Soft QoS 를 적용한 호 수락 제어 알고리즘을 제안하고, 전송 속도에 따른 적응형 핸드요프 제어 방식을 제안하였다 제안된 알고리듬을 적용함으로써, 적응형 안테나 시스템의 고속 데이터 전송을 효과적으로 수행하연서도 셀 내 저속 가업자의 호 블록킹 확률을 크게 줄일 수 있음을 컴퓨터 시뮬레이션을 통한 비교분석으로 입증하였다.
본 논문은 멀티패스 페이딩이 존재하는 CDMA 채널에서 새로운 빔형성 알고리즘을 통해 적응 배열 안테나의 성능을 향상시키기 위한 최적의 웨이트 벡터를 구하는 방법을 제시하였다. 제안한 빔형성 알고리즘은 멱승법을 근간으로 하며, 전체 계산량이 O(4N)밖에 되지 않는 선형화 된 멱승법(power method) 알고리즘이다. 여기서 N은 안테나 수를 의미한다. 제안된 알고리즘의 성능은 IS-2000 1X CDMA 환경에서 심볼 에러율(symbol error rate), 사용 가능자수(allowable capacity), 수렴도(convergence) 등에 대한 분석을 통해 확인하였다. 성능분석 결과 적응 배열 안테나 시스템은 기지국 셀 내에서 기존 안테나 시스템에 비해 6-10배정도 사용 가능자수가 증가하였다. 또한, 제안 알고리즘은 심볼 에러율, 수렴도, 계산량의 모든 경우에서 기존 알고리즘에 비해 우수한 성능을 보임을 확인하였다.
차세대 멀티 레벨 셀 플래시 메모리들을 위해 복잡도가 낮은 에러 정정 코드 구현에 대한 요구가 커지고 있다. 일반적으로 부 표현 (sub-expression) 들을 공유하는 것은 복잡도와 칩 면적을 줄이기 위한 효과적인 방법이다. 본 논문에서는 직렬 선형 귀환 쉬프트 레지스터 구조를 기반으로 부 표현들을 이용한 저 복잡도 m-비트 병렬 BCH 인코더 구현 방법을 제안한다. 또한, 부 표현들을 탐색하기 위한 일반화된 방법을 제시한다. 부 표현들은 패리티 생성을 위해 사용하는 행렬(생성 행렬, generator matrix)의 부 행렬 (sub-matrix)과 다른 변수들의 합과의 행렬 연산에 의해 표현된다. 부 표현들의 수는 개로 한정되며, 탐색된 부 표현들은 다른 병렬 BCH 인코더 구현을 위해 공유되어질 수 있다. 본 논문은 구현 과정에서 다수의 팬 아웃에 의해 발생하는 문제점(지연)의 해결이 아닌 복잡도(로직 사이즈) 감소에 그 목적이 있다.
고속통신망에서 데이터 전송률의 결정은 폭주제어 기법을 갖는 되먹임 구조 통신망시스템의 안정성에 매우 중요한 요소이다. 비동기전송망에서, ABR 서비스는 하위 노드의 트래픽 정보를 전달할 수 있는 RM(resource management) 셀 기반의 되먹임 구조를 갖는다. 그러나 일반적인 IP 기반 통신망에서는 하위 노드 트래픽의 현재상태가 각 전송원으로 바로 전달되어 질 수 없다. 본 논문에서는 고속통신망에서의 폭주 제어를 위해 지수이동가중 평균(exponential weighted moving average: EWMA)을 이용한 전송률 기반의 효과적인 되먹임 통신망 제어 기법을 제안한다. 제안된 통신망 폭주 제어기법은 스위치 대기열의 안정성을 보장하고 보다 높은 통신망 활용 효율을 보인다. 또한, 제안된 폭주제어 기법은 통신망에서의 전송원의 수의 증가에 대하여 보다 유연성을 갖으며, 이를 통하여 망 확장성을 증가시킬 수 있다.
본 논문에서는 RISC 마이크로프로세서에 DSP프로세서를 추가하여 멀티미디어 기능이 강화된 응용에 알맞은 마이크로프로세서(YS-RDSP)를 제안한다. YS-RDSP는 최대 4개의 명령어를 동시에 병렬로 처리할 수 있다. 프로그램의 크기를 줄이기 위해 YS-RDSP는 16비트와 32비트의 두 가지 명령어 길이를 지원한다. YS-RDSP는 칩 하나로 RISC마이크로프로세서의 programmability 및 제어능력에 DSP의 처리능력을 제공하기 위하여 8-KByte ROM과 8-KByte RAM을 내장하고 있다. 칩 내에 있는 주변장치중 하나인 시스템 컨트롤러는 저전압 동작을 위한 3가지의 전압강하모드를 지원하며 SLEEP명령어는 CPU코어와 주변장치의 동작상태를 변환시킨다. YS-RDSP프로세서는 Verilog-HDL를 이용하여 하향식설계방식으로 구현되었고 C-언어로 작성된 사이클 단위 시뮬레이터를 이용하여 개선되고 검증되었다. 검증된 모델은 0.6um, 3.3V CMOS 표준 셀 라이브러리로 합성되었으며 자동화 P&R에 의해 10.7mm8.4mm코어 면적을 갖도록 레이아웃 되었다.
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[게시일 2004년 10월 1일]
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