This paper describes an efficient harmonic-CELP speech coder by taking advantages of harmonic and CELP coders into account. According to frame voicing decision, the proposed harmonic-CELP coder adopts the RP-VSELP coder as a fast CELP in case of an unvoiced frame, or an improved harmonic coder in case of a voiced frame. The proposed coder has main features as follows: simple pitch detection, fast harmonic estimation, variable dimension harmonic vector quantization, perceptual weighting reflecting frequency resolution, fast harmonic synthesis, naturalness control using band voicing, and multi-mode. These features make the proposed coder require very low complexity, compared with HVXC coder To demonstrate the performance of the proposed coder, a 2.4 kbps coder has been implemented and compared with reference coders. From results of informal listening tests, the proposed coder showed good quality while requiring low delay and complexity.
Park, Tae-Jin;Lee, Un-Seon;Lee, Sang-Hee;Park, Man-Gon
Journal of Korea Multimedia Society
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v.14
no.7
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pp.895-904
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2011
In welding machine that executes existing spot welding, wrong operation of system has often occurs because of their mechanical motion that can be caused by a number of supply like the welding object. In exposed working environment for various situations such as worker or related equipment moving into any place that we are unable to exactly distinguish between good and not condition of nut. Also, in case of defective welding of nut, it needs various evaluation and analysis through image processing because the problem that worker should be inspected every single manually. Therefore in this paper, if the object was not stabilization state correctly, we have purpose to algorithm implementation that it is to reduce the analysis time and exact recognition as to improve system of image processing. As this like, as image analysis for assessment whether it is good or not condition of nut, in his paper, implemented algorithms were suggested and list by group and that it showed the effectiveness through more than one experiment. As the result, recognition rate of normality and error according to the estimation time have been shown as 40%~94.6% and 60%~5.4% from classification 1 of group 1 to classification 11 of group 5, and that estimation time of minimum, maximum, and average have been shown as 1.7sec.~0.08sec., 3.6sec.~1.2sec., and 2.5sec.~0.1sec.
The Journal of Korean Institute of Communications and Information Sciences
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v.28
no.3C
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pp.239-247
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2003
This paper presents a dual-rate (2.4/4.0 kbps) Improved Harmonic-CELP(IHC) speech coder based on the EHC(Efficient Harmonic-CELP) which was presented by the authors. The proposed IHC employs the harmonic coding for voiced and the CELP for unvoiced segments. In the IHC, an initial voiced/unvoiced estimate is obtained by the pitch gain and energy. Then, the final V/UV mode is decided by using the frame energy contour. A new harmonic estimation combining peak picking and delta adjustment provides a more reliable harmonic estimation than that in the EHC. In addition, a noise mixing scheme in conjunction with an improved band voicing measurement provides the naturalness of the synthesized speech. To demonstrate the performance of the proposed IHC coder, the coder has been implemented and compared with the 2.0/4.0 kbps HVXC(Harmonic excitation Vector Coding) standardized by MPEG-4. Results of subjective evaluation showed that the proposed IHC coder and produce better speech quality than the HVXC, with only 40% complexity of the HVXC.
In this paper, we propose a fast variable-size block matching algorithm for motion estimation based on bit-pattern. Motion estimation in the proposed algorithm is performed after the representation of image sequence is transformed 8bit pixel values into 1bit ones depending on the mean value of search block, which brings a short searching time by reducing the computational complexity. Moreover, adaptive searching methods according to the motion information of the block make the procedure of motion estimation efficient by eliminating an unnecessary searching of low motion block and deepening a searching procedure in high motion block. Experimental results show that the proposed algorithm provides better performance-0.5dB PSNR improvement-than full search block matching algorithm with a fixed block size.
Proceedings of the Korean Society of Computer Information Conference
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2014.01a
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pp.373-376
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2014
최근 모바일 기기 및 무선기기의 발달로 인하여 센서 네트워크가 다양한 분야에서 응용되고 있다. 따라서 센서에서 실시간으로 발생하는 스트리밍 데이터에서 이벤트를 감지하고 분석하는 것은 중요한 연구 분야로 부각되고 있다. 단순 이벤트의 발생 조건을 빠르게 판별하기 위해 비트맵 인덱스 기반 복합 이벤트 검출 기법 등 여러 가지 방법들이 사용되고 있지만, 아직까지 이기종 센서에서 발생하는 각기 다른 형태의 데이터를 융합하여 이벤트를 검출하는 복합 이벤트 처리에 대한 연구는 미비한 실정이다. 본 논문에서는 각기 다른 형태를 가지는 스트리밍 데이터에 멤버쉽 함수를 적용하여 퍼지화 함으로서 이기종 센서에서 발생하는 데이터를 융합 처리가능하며, Quine-Mccluskey 감축기법을 통하여 규칙의 신뢰도 및 속도가 향상된 의사결정을 하는 고속 이벤트 탐지기법을 제안한다.
Proceedings of the Korea Information Processing Society Conference
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2000.04a
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pp.1112-1115
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2000
본 논문에서는 One-bit 변환을 기반으로 한 고속의 가변 블록 크기 움직임 예측 알고리즘을 제안한다. 제안된 방법은 블록 내의 평균값을 이용하여 8bit 화소값을 1bit로 변환한 후 움직임 예측을 수행한다. One-bit 변환을 통한 영상의 단순화는 움직임 추정의 계산적 부담을 감소시켜 빠른 탐색을 가능하게 한다. 그리고 블록 내의 움직임 정도를 미리 판별하여 이를 기반으로 한 적응적 탐색이 불필요한 탐색을 제거하고 움직임이 큰 블록에서는 정합과정을 심화시켜 보다 정확한 움직임 예측을 수행한다. 본 제안된 방식을 가지고 실험한 결과 한 프레임당 적은 수의 블록으로 고정된 크기의 블록을 가진 전역 탐색 블록 정합 알고리즘(full search block matching algorithm; FSBMA)보다 예측 에러를 적게 발생시켜 평균적으로 0.5dB 정도의 PSNR 개선을 가져왔다. 특히, 움직임이 많은 영상에서 뛰어난 효과를 나타냈다.
Kim Shinhoo;Kim Yunjeong;Youn Jaeyoun;Lim Shin-ll;Kang Sung-Mo;Kim Suki
The Journal of Korean Institute of Communications and Information Sciences
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v.30
no.1A
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pp.104-112
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2005
Some design techniques for high speed and low power pipelined 8-bit ADC are described. To perform high-speed operation with relatively low power consumption, open loop architecture is adopted, while closed loop architecture (with MDAC) is used in conventional pipeline ADC. A distributed track and hold amplifier and a cascading structure are also adopted to increase the sampling rate. To reduce the power consumption and the die area, the number of amplifiers in each stage are optimized and reduced with proposed zero-crossing point generation method. At 500-MHz sampling rate, simulation results show that the power consumption is 210mW including digital logic with 1.8V power supply. And the targeted ADC achieves ENOB of about 8-bit with input frequency up to 200-MHz and input range of 1.2Vpp (Differential). The ADC is designed using a $0.18{\mu}m$ 6-Metal 1-Poly CMOS process and occupies an area of $900{\mu}m{\times}500{\mu}m$
케이블의 원가절감을 위해 절연체의 절연두께를 줄이거나 초초고압화가 되어 갈수록 절연성능의 신뢰성 향상이 한층 요구되고 있다. 이를 위해 케이블 및 접속함의 절연체 내에 각종의 결함이 어느 정도 절연성능을 떨어뜨리는지 정량적으로 파악하여 개선할 필요가 있다. 또한 완제품 내 잔족하고 있는 이물의 종류 및 위치를 알 수 있으면 생산공정 내에서 이물 유입 경로를 파악하여 이물이 유입되는 것을 차단할 수 있다. AC내전압 파괴시험을 수행할 때 설계치 보다 저전계에서 파괴될 경우 파괴공을 조사하여 원인을 규명하고자 하지만 국부적인 결함으로 인한 파괴는 결함부를 소실시키기 때문에 파괴공 및 주위의 절연체를 현미경으로 관찰하여도 찾기가 어렵다. 따라서, 전원을 고속으로 차단하여 결함부가 완전히 소손되는 것을 막고 PD발생 위치를 추정하여 결함을 확인하는 방법이 요구 되어진다. 이러한 시험 방법을 전구차단법 이라고 하며, 고도의 PD측정기술과 판정기술이 필요한 종합적인 기술이다. 본 논문에서는 PPD 기술의 핵심인 노이즈 제거 기술과 판별기술을 서술하고 실제 접속함(PMJ)에 적용하여 PPD 기술의 유효함을 증명하였다.
Proceedings of the Korea Multimedia Society Conference
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2012.05a
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pp.201-204
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2012
최근 우리나라 사회가 고령화로 진행함에 따라 노인성 질환인 치매 환자가 증가하고 있는 추세이다. 치매를 진단하기 위한 방법으로는 뇌 MR 영상을 사용하여 치매에 의해 영향을 받는 특정 뇌 영역인 해마의 위축률을 기반으로 진단 할 수 있다는 보고가 있다. 본 연구에서는 치매 환자 위한 보조적 판별 시스템 개발의 예비 연구로써 뇌 MR 영상 데이터를 3차원으로 가시화하는 것이 목적이며, 최근 대용량으로 획득되는 MR 영상을 고속으로 처리하기 위하여 CUDA를 사용한 병렬 컴퓨팅 구축을 하고 FPS(Frame Per Second)를 측정하여 유용성을 평가하고자 한다.
전력계통의 안정도 향상 방안으로 적용되는 재폐로계전기에서 재폐로의 성공뿐만 아니라 투입시점에 따른 최적재폐로의 적용으로 계통의 동요를 최소화 하게된다. 본 논문에서는 순간고장 제거 후 계통 안정화되는 계통의 최적재폐로 적용과, 불안정하게 되는 계통에서의 직렬 커패시턴스 투입 재폐로 제어로 안정화 가능성을 높였고, 영구고장으로 재폐로 실패되어 계통이 불안정해지는 경우에 계통 최소충격을 위한 최적재폐로가 적용되도록 하였다. 이를 위해 순간고장과 영구고장의 식별 기법과 광역 측정장치(WAM), 고속전송 적용 등으로 계통 안정의 정도를 판별, 예측하여 실시간 과도안정도가 고려된 최적제어가 되도록 하였다.
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[게시일 2004년 10월 1일]
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