스마트폰의 내장형 3축 가속도 센서를 이용한 사용자 행위 인식은 사용자 개개인의 행위 패턴이 모두 달라 사용자에 따른 의존성이 크고, 스마트폰의 위치나 방향이 일정하게 고정되어 있지 않기 때문에 센서 데이터를 토대로 서로 다른 행위들을 정확히 분류하는데 어려움이 있다. 본 논문에서는 특정 사용자나 스마트폰의 특정 위치에 대한 의존성이 적은 효과적인 행위 인식 방식을 제안하고, 이를 기초로 안드로이드 스마트폰 기반의 실시간 행위 인식 시스템을 구현하였다. 총 6642개의 데이터 집합을 이용하여 본 논문에서 제안한 행위 인식 시스템의 사용자 의존성 및 폰 위치 의존성 분석 실험을 수행하고, 그 결과를 소개한다.
The Pohang Light Source (PLS) - II is a 3 GeV third-generation synchrotron radiation facility. To inject electron beam from LINAC, a kicker modulator system and kicker magnets are installed in the PLS-II storage ring tunnel. The injected beam then falls into the storage ring beam dynamic aperture. This paper describes the design and implementation of the solid-state kicker modulator for PLS-II. The solid-state kicker modulator is consisted of high voltage solid state switch stacks. the technical considerations of the solid-state switch stacking for kicker modulator is discussed. The achieved capability of the solid-state kicker modulator demonstrates that is fulfills the design requirement of providing half-sine pulsed current of 10kA (peak), 6us (Base-width), with jitter < 2ns (Standard deviation). simulation and experimental results are presented to demonstrate the performance of the solid-state kicker modulator.
본 논문에서는 IPSec 가속기의 성능분석 모델을 제안한다. 제안된 성능분석은 큐잉 모델링을 기반으로 하고 트래픽로드는 포아송 분포를 채택하였다. 성능분석 시 새로운 파라미터로 디코딩지연을 정의하여 시뮬레이션에 이용하였다. 제안된 모델을 이용하여 IPSec 가속장치인 BCM5820의 성능을 분석한 결과, 장비를 통해 실측된 결과와 15% 정도의 차이만을 나타내었다. 제안된 모델을 이용한 성능분석 결과는 IPSec 가속기의 최대성능을 유지하기 위한 서버내의 하드웨어들의 적합한 구조를 제시하고 나아가 고속 네트워크 컴퓨터의 통계적 설계공간탐색에 이용될 수 있다.
본 논문에서는 안드로이드 플랫폼 기반의 스마트폰에 내장된 다양한 센서를 이용하여 운동량을 측정하고 확인할 수 있는 애플리케이션을 설계하고 구현한다. 이 애플리케이션에서는 가속도 센서, 근접 센서, 기압 센서를 사용하여 줄넘기, 팔굽혀펴기, 계단 오르기 등의 운동량을 측정하고 확인할 수 있도록 구현한다. 그리고 NFC 태그를 이용하여 매일 운동을 꾸준히 할 수 있도록 도와주는 모니터링 기능을 구현한다.
본 논문에서는 구조물의 전역적인 손상도 평가와 국부 구조 연결부의 손상 검색을 동시에 수행할 수 있는 하이브리드 구조 손상 모니터링 체계가 제시되었다. 하이브리드 손상 모니터링 체계는 진동기반 기법과 전기/역학적 임피던스 기법으로 구성되었다. 진동기반 기법은 구조물의 모드특징의 변화를 사용하여 구조물의 전역적 특성의 변화를 감지하고, 전기/역학적 임피던스 기법은 PZT 센서의 저항 변화를 사용하여 국부 구조 연결부의 손상 여부를 검출한다. 제안된 하이브리드 모니터링 체계를 검증하기 위해 구조 연결부의 볼트 풀림 상황을 손상 시나리오로 선택하였으며, 가속도 응답과 임피던스 응답 신호가 계측되었다. 실험 결과, 제안된 하이브리드 모니터링 체계를 통해 구조물의 전역적 손상 상태와 국부 구조 연결부의 손상을 정확하게 모니터링 할 수 있었다.
최근 유비쿼터스 컴퓨팅에 대한 관심이 높아지면서 유비쿼터스 환경에서의 서비스를 위한 인간과 컴퓨터의 상호 작용, 특히 인간의 행동을 인식하는 연구가 활발히 진행되고 있다. 기존의 영상기반 연구와는 달리 모바일 환경에 적합하도록 가속도 센서, 생리신호 센서 등 다양한 센서들을 활용하여 사용자의 행동을 인식하는 기법이 연구되고 있다. 본 논문에서는 멀티모달 센서들을 통합하고 동적 베이지안 네트워크를 계층적으로 구성하여 사용자의 행동을 인식하는 방법을 제안한다. 연산량이 비교적 적은 베이지안 네트워크로 전반적인 사용자 행동을 추론하고 획득된 각 행동의 확률순으로 동적 베이지안 네트워크를 구성한다. 동적 베이지안 네트워크는 OVR(One-Versus-Rest) 전략으로 학습되며, 확률순으로 행동이 검증되어 임계치를 넘는 경우 선택된 행동보다 낮은 확률의 행동에 대한 동적 베이지안 네트워크를 검증하지 않아 추론 연산량을 줄인다. 본 논문에서는 가속도 센서와 생리적 신호 센서를 기반으로 총 8가지의 행동을 인식하는 문제에 제안하는 방법을 적용하여 평균적으로 97.4%의 분류 정확률을 얻었다.
도로의 결빙과 해빙으로 도로면의 수축과 팽창이 반복되어 도로면에서 침투한 수분이 포장면의 결합력을 약화시켜 노면홈(포트홀)을 발생시킨다. 현재의 포트홀 조사는 현장에서 육안 조사하고 기록하는 수동적인 방식으로 매년 수 만개소의 포트홀이 발생하는 것에 어려움이 발생하고 있다. 포트홀 정보를 자동으로 수집하기 위해 최근까지 가속도 센서를 이용한 기술과 레이저 스캐닝을 이용한 기술이 많이 연구되었다. 하지만, 가속도 센서 기반 기술은 낮은 인식률과 제한된 센싱 영역의 문제가 있고, 레이저 스캐닝 기반 기술은 비용이 너무 큰 문제가 있다. 따라서, 본 논문에서는 대중적으로 사용하는 차량용 블랙박스 카메라를 이용한 자동 포트홀 탐지 기술을 제안한다. 일반적으로 차량용 블랙박스 카메라에 탑재한 연산프로세서는 낮은 컴퓨팅 능력을 가지므로 포트홀 탐지 알고리즘을 그게 맞게 설계할 필요가 있다. 설계된 알고리즘을 블랙박스에 내장하여 도로 주행실험을 실시하며, 포트홀 탐지 성능을 중심으로 한 실험결과는 포트홀 탐지 정밀도, 민감도 등의 지표를 토대로 분석하고, 실시간 포토홀 탐지 기술의 현장 적용성을 확인한다.
정부 R&D성과의 질적 수준을 제고하고 중장기 국가 재정사업의 효율성을 높이기 위한 각 연구 기관의 시도들이 있어 왔다. 연구사업의 발굴, 기획 및 수행에 있어 효과적인 정부 R&D 예산의 배분, 우선순위를 도출, 기술개발 전략 수립을 하는 것이 매우 중요해지고 있다. 정부 재정사업인 국가 R&D사업은 국가 기간산업을 활성화하고 경제발전을 수반할 수 있는 중요한 모멘텀으로서의 역할을 하고 있다. 또한, 국가 R&D사업의 한 축인 거대과학은 최첨단 기술의 개발과 미래성장동력의 발굴이라는 대명제로 그 중요성이 강조되고 있다. 거대과학 연구는 그 분야의 특수성으로 인해 대학의 과학자, 공공 연구기관의 연구원, 기업의 엔지니어가 함께 참여하여야 하고 대규모 국가 예산을 동원하는 과학 연구 사업이다. 이는 대규모 예산을 기반으로 하고 있기에 집중적 투자가 수반된다면 단기적으로 기초과학의 발전을 이뤄낼 수 있다. 이것은 산업발전에 밑거름이 되어 그 분야 자체로 하나의 산업생태계를 구성하고 요소 기술들의 응용으로 파생기술이 전파된다면 새로운 신산업 창출 등 국가산업에 많은 혜택을 줄 수 있다. 하지만 많은 인력과 대규모 투자 그리고 중장기 프로젝트라는 특성으로 인해 실패 가능성도 높아 전략적 선택 및 추진이 필요하다. 따라서 본 논문에서는 거대과학의 기술개발전략의 수립을 위하여 중이온 입자가속기 핵심부품 국산화 전략수립 사례를 중심으로 효율적인 R&D추진 방안을 도출해보고자 한다. 또한, 논문, 특허를 기반으로 한 3P분석을 통하여 중이온 가속기 핵심부품의 국산화 전략을 제안하고, 추진 우선순위 및 전략을 제시하고자 한다.
ECC (Elliptic Curve Cryptography)와 RSA를 기반으로 하는 다양한 공개키 암호 프로토콜 구현을 지원하는 하드웨어 가속기 설계에 관해 기술한다. NIST 표준으로 정의된 소수체 상의 5가지 타원곡선과 3가지 키길이의 RSA를 지원하며 또한, 4가지 타원곡선 점 연산과 6가지 모듈러 연산을 지원하도록 설계되어 ECC와 RSA 기반 다양한 공개키 암호 프로토콜의 하드웨어 구현에 응용될 수 있다. 저면적 구현을 위해 내부 유한체 연산회로는 32 비트의 데이터 패스로 설계되었으며, 워드 기반 몽고메리 곱셈 알고리듬, 타원곡선 점 연산을 위해서는 자코비안 좌표계, 그리고 모듈러 곱의 역원 연산을 위해서는 페르마 소정리를 적용하였다. 설계된 하드웨어 가속기를 FPGA 디바이스에 구현하여 EC-DH 키교환 프로토콜과 RSA 암호·복호 둥작을 구현하여 하드웨어 동작을 검증하였다. 180-nm CMOS 표준 셀 라이브러리로 합성한 결과, 50 MHz 클록 주파수에서 20,800 등가게이트와 28 kbit의 RAM으로 구현되었으며, Virtex-5 FPGA 디바이스에서 1,503 슬라이스와 2개의 BRAM으로 구현되었다.
본 논문에서는 실시간 SAR (synthetic aperture radar) 영상 생성을 위한 RDA (range Doppler algorithm)의 FPGA 기반 가속화 기법을 제안한다. RDA의 연산 과정인 거리 및 방위 압축 연산을 가속하기 위한 시스토릭 어레이 구조 기반 정합 필터와 RCM (range cell migration)을 보상해 주기 위한 고속의 sinc 보간 연산기의 하드웨어 구조를 제시하고, Xilinx Alveo FPGA에 다채널 커널 형태로 구현하여 가속을 진행하였다. 제안된 구조의 하드웨어를 사용하여 4096×4096 크기의 영상 생성시간을 측정한 결과, Nvidia RTX3090 GPU를 사용하여 SAR 영상을 생성하는 시간보다 약 2배 가속이 가능함을 확인하였다. 또한, 제안된 가속 하드웨어는 60,247개의 CLB LUT, 103,728개의 CLB register, 20개의 block RAM tile과 592개의 DPS로 구현 가능하며, 최대 동작속도는 312 MHz임을 확인하였다.
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[게시일 2004년 10월 1일]
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