Planar lightwave circuits (PLCs) provide various important devices for optical wavelength division multiplexing (WDM) systems, subscriber networks and etc. This paper reviews the recent progress and future prospects of PLC technologies including arrayed-waveguide grating multiplexers, optical add/drop multiplexers, programmable dispersion equalizers and hybrid optoelectronics integration technologies.
In this paper, we propose a new technique of estimating tail of steady-state queue length distribution; Pr(Q>q), fo ATM multiplexer. Pr(Q>q) is a fundamental measure of network congestion. Assessing Pr(Q>q) properly is crucial for design and control of ATM networks. Data traffic pattern of high-speed networks is highly correlated and bursty. Estimating Pr(Q>q) is very difficult because of correlation and burstiness. We estimate entropy(rate-function) using large deviation principles and threshold bootstrap. Simulation studies are conducted to compare the performance of an existing method and our new method.
현재 국내에서는 NMEA 프로토콜 멀티플렉서를 개발한 사례 및 제품이 없어, 외국의 고비용 장비를 수입하여 사용하거나, 멀티 포트를 이용하여 NMEA 프로토콜을 전송하는 프로그램을 소프트웨어 적으로 구현하여 사용하고 있다. 이러한 방법은 고비용이 지출되거나, 각 응용프로그램마다 별도의 처리 부분을 작성해야하는 문제점이 있다. 또한, NMEA 프로토콜을 출력하는 각각의 장비들은 제조 회사 및 플랫폼이 다르므로 이중의 자원낭비 및 손실 등을 초래할 수 있다. 본 논문에서는 이를 보완하기 위하여 신뢰성 있는 처리방법과 고성능의 단일 하드웨어 모듈로서 독립적으로 동작할 수 있고 최적화된 큐의 설계를 이용하여 모듈의 메모리 효율을 높이며, 주요 입력 센서 장비인 자이로콤 파스, 에코 사운드, GPS 등의 장비들과 실시간 통신의 높은 신뢰성을 유지할 수 있는 NMEA 프로토콜 멀티플렉서를 구현에 대하여 제안하였다.
DVR 시스템은 다수의 카메라를 지원하고 채널당 30프레임의 영상을 실시간으로 받을 수 있어야 한다. 따라서 Full-HD급 Multiplexer와 별도의 하드웨어 압축 Codec을 사용하는데, 본 논문에서는 이들을 사용하지 않고 FPGA와 CPU가 가지고 있는 GPU를 이용하여 4채널 Full-HD급 PC기반 DVR의 설계 및 구현 방법에 대하여 기술한다. Multiplexer와 H/W Codec을 사용하지 않는 기존의 방법으로는 실시간으로 채널당 20프레임 정도의 영상을 획득하는 단점을 가지고 있다. FPGA를 이용하여 다채널의 영상을 실시간으로 획득하는 시스템을 설계하였으며, 소프트웨어로는 Intel Media SDK를 이용하여 영상 압축을 구현하였다. 구현된 제품의 성능 평가 결과, 제시한 요구 성능을 모두 만족하였고, 하드웨어 압축 코덱디바이스를 제거함으로써 시스템의 실용성을 확인 하였다.
Kim, Sang-Duk;Ku, Dae-Sung;Yun, Jung-Hyun;Lee, Jae-Gyu;Kim, Jong-Bin
대한전자공학회:학술대회논문집
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대한전자공학회 2002년도 ITC-CSCC -1
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pp.1-4
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2002
The numerical alaysis of optical device, silicabased device, are presented. The purpose of this paper is to simulate and to design a 8-channel optical wavelength division multiplexer(OWDM) based on Mach-Zehnder Interferometer(MZI) with wavelength spacing between channels Δλ=0.8 nm at central wavelength λ=1.55 ${\mu}{\textrm}{m}$. In initial condition fur simulating, we assumed as follows. A channel waveguide is made from silica based P-doped SiO2 core layers in order to coupling with a fiber easily and its core dimension was 6 ${\mu}{\textrm}{m}$$\times$6 ${\mu}{\textrm}{m}$. The core and clad index of channel waveguide were 1.455 and 1.444, separately, at λ=1.55 ${\mu}{\textrm}{m}$. Where, the separation between channel waveguides in coupling region was 3 ${\mu}{\textrm}{m}$. As a result of analysis, a group mode index of channel waveguide was 1.4498370, was gained by Hermite-Gaussian Method(HGM). Also, the channel spacing was determined by the waveguide arm length difference and was Δλ=0.8 nm as like a proposed condition. The central wavelength of a designed-multiplexer was activated about wavelength λ=1.55 ${\mu}{\textrm}{m}$, and we certificated that it can be used to 8-channel optical wavelength division multiplexer/demultiplexer.
본 논문에서는 EQM(Engineering Qualification Model)급 Ku 대역 위성 중계기용 입력 멀티플렉서 설계 및 결과에 대하여 언급하였다. 각 채널은 Circulator Chain구조를 이용하여 분리되었으며, 채널 대역내에서의 진폭 변화와 군지연 변화를 최소화하기 위하여 각각의 채널은 채널필터 외부에 등화기를 사용하였다. 위성중계기의 무게와 부피를 최소화하기 위하여 채널필터와 등화기 모두 이중모드로 설계하였다. 채널별 주파수 선택도를 높이기 위하여 채널 필터는 8차 타원 응답형으로 설계하였으며, 등화기는 2차 반사형으로 설계하였다. 온도 변화에 따른 특성 변화를 최소화하기 위하여 필터와 등화기의 공동(cavity), 슬롯, 튜닝나사는 INVAR36을 사용하여 제작하였다. 제작한 입력 멀티플렉서는 진동 시험, 열진공 시험, EMC 시험을 실시하였으며 시험결과 Ku 대역 위성 중계기에 적용 가능한 성능을 나타내었다.
디지털 회로설계 기술에서 사용되는 CMOS는 양자 터널링 현상 등으로 인해 집적도의 한계에 다다르고 있다. 이를 대체할 수 있는 양자점 셀룰러 오토마타(QCA : Quantum-dot Cellular Automata)는 적은 전력 소모와 빠른 스위칭 속도 등으로 많은 장점이 있음으로 CMOS의 많은 디지털 회로들이 QCA 기반으로 제안되었다. 그중에서도 멀티플렉서는 D-플립플롭, 레지스터 등 다양한 회로에 쓰이는 기본 회로로써 많은 연구가 되고 있다. 하지만 기존의 멀티플렉서는 공간 효율성이 좋지 않다는 단점이 있다. 따라서, 본 논문에서는 셀 간 상호작용을 이용하여 새로운 다층구조 멀티플렉서를 제안하고, 이를 이용하여 D-래치를 제안한다. 본 논문에서 제안하는 멀티플렉서와 D-래치는 면적, 셀 개수, 지연시간이 개선되었으며, 이를 이용하여 큰 회로를 설계할 시 연결성과 확장성이 우수하다. 제안된 모든 구조는 QCADesigner를 이용해 시뮬레이션하여 동작을 검증한다.
본 논문은 회색(Gray-scale) 이미지를 기반으로 (2, 2) 비밀 공유(Secret Sharing) 계획을 제안한다. 일반적으로 비밀 공유 방법은 비밀 이미지를 두개이상의 이미지 (그림자 이미지: Shadow Image)로 분배한 후, 그림자 이미지를 참가자(비밀 공유하는 사람)에게 나누어준다. 이 후 참가자들이 비밀을 보기위해 k(k
A광섬유 용융인장방법에 의해서 100GHz 채널간격을 갖는 DWDM용 8채널 광다중화기를 제작하였다. 8채널 광다중화기는 전광섬유형 Mach Zehnder 간섭계(MZI)를 3단으로 다단 연결하여 제작되었으며, 광다중화기 채널별 출력파장의 삽입손실을 균일하게 하기 위하여 파장에 대한 삽입손실변화가 적은 파장무의존형 커플러(WFC)를 이용하여 전광섬유형 MZI를 제작하였다. 광다중화기를 구성하는 광섬유형 MZI를 제작함에 있어서 경로차에 따른 출력 파장간격의 변화를 시뮬레이션을 통하여 알아보았고 다단연결에 의한 광다중화기 구현방법을 논의하였다. 전용 제작 장치를 이용하여, 전광섬유형 MZI를 제작하였으며, 미세한 파장을 저절하기 위해서, $CO_2$ 레이저를 이용하였다. 제작된 8채널 광다중화기는 평균 삽입 손실 2.1dB, 5.5dB에서의 통과대역폭이 0.8nm 이며, 25dB의 채널 Crosstalk를 갖는 특성을 얻을 수 있었고, 편광의존손실은 0.06dB 였다.
Quantum-dot cellular automata (QCA) has shown great potential in the nanoscale regime as a replacement for CMOS technology. This work presents a specific approach to static random-access memory (SRAM) cell based on 2:1 multiplexer, 4-bit SRAM array, and 32-bit SRAM array in QCA. By utilizing the proposed SRAM array, a single-layer 16×32-bit SRAM with the read/write capability is presented using an optimized signal distribution network (SDN) crossover technique. In the present study, an extremely-optimized 2:1 multiplexer is proposed, which is used to implement an extremely-optimized SRAM cell. The results of simulation show the superiority of the proposed 2:1 multiplexer and SRAM cell. This study also provides a more efficient and accurate method for calculating QCA costs. The proposed extremely-optimized SRAM cell and SRAM arrays are advantageous in terms of complexity, delay, area, and QCA cost parameters in comparison with previous designs in QCA, CMOS, and FinFET technologies. Moreover, compared to previous designs in QCA and FinFET technologies, the proposed structure saves total energy consisting of overall energy consumption, switching energy dissipation, and leakage energy dissipation. The energy and structural analyses of the proposed scheme are performed in QCAPro and QCADesigner 2.0.3 tools. According to the simulation results and comparison with previous high-quality studies based on QCA and FinFET design approaches, the proposed SRAM reduces the overall energy consumption by 25%, occupies 33% smaller area, and requires 15% fewer cells. Moreover, the QCA cost is reduced by 35% compared to outstanding designs in the literature.
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[게시일 2004년 10월 1일]
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