We carried out anodic aluminum oxide (AAO) on a Si and a sapphire substrate. For anodic oxidation of Al two types of specimens prepared were Al(0.5 $\mu\textrm{m}$)!Si and Al(0.5 $\mu\textrm{m}$)/Ti(0.1 $\mu\textrm{m}$)$SiO_2$(0.1 $\mu\textrm{m}$)/GaN(2 $\mu\textrm{m}$)/Sapphire. Surface morphology of Al film was analyzed depending on the deposition methods such as sputtering, thermal evaporation, and electron beam evaporation. Without conventional electron lithography, we obtained ordered nano-pattern of porous alumina by in- situ process. Electropolishing of Al layer was carried out to improve the surface morphology and evaluated. Two step anodizing was adopted for ordered regular array of AAO formation. The applied electric voltage was 40 V and oxalic acid was used as an electrolyte. The reference electrode was graphite. Through the optimization of process parameters such as electrolyte concentration, temperature, and process time, a regular array of AAO was formed on Si and sapphire substrate. In case of Si substrate the diameter of pore and distance between pores was 50 and 100 nm, respectively. In case of sapphire substrate, the diameter of pore and distance between pores was 40 and 80 nm, respectively
Transactions on Electrical and Electronic Materials
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제5권3호
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pp.113-119
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2004
Structural and optical properties of as-synthesized, Ga$_2$O$_3$-coated, and Al$_2$O$_3$-coated GaN nanowires are examined in this paper. GaN nanowires were synthesized by thermal evaporation of ball-milled GaN powders in an NH$_3$ atmosphere. The thermal annealing of the as-synthesized GaN nanowires in an argon atmosphere allows their surfaces to be oxidized, leading to the formation of 2nm-thick Ga$_2$O$_3$ layers. For the oxidized GaN nanowires, the distances between the neighboring lattice planes are shortened, and an excitonic emission band is remarkably enhanced in intensity, compared with the as-synthesized GaN nanowires. In addition, the as-synthesized GaN nanowires were coated cylindrically with Al$_2$O$_3$ by atomic layer deposition technique. Our study suggests that the Al$_2$O$_3$-coating passivates some of surface states in the GaN nanowires.
Flexible opto-electronic devices are developed on the insulating layer deposited stainless steel (STS) substrates. The silicon dioxide ($SiO_2$) material as the diffusion barrier of Fe and Cr atoms in addition to the electrical insulation between the electronic device and STS is processed using the plasma enhanced chemical vapor deposition method. Noble silver (Ag) films of approximately 100 nm thickness have been formed on $SiO_2$ deposited STS substrates by E-beam evaporation technique. The films then were annealed at $650^{\circ}C$ for 20 min using the rapid thermal annealing (RTA) technique. It was investigated the variation of the surface morphology due to the interaction between Ag films and $SiO_2$ layers after the RTA treatment. The results showed the movement of Si atoms in silver film from $SiO_2$. In addition, the structural investigation of Ag annealed at $650^{\circ}C$ indicated that the Ag film has the material property of p-type semiconductor and the bandgap of approximately 1 eV. Also, the films annealed at $650^{\circ}C$ showed reflection with sinusoidal oscillations due to optical interference of multiple reflections originated from films and substrate surfaces. Such changes can be attributed to both formation of $SiO_2$ on Ag film surface and agglomeration of silver film between particles due to annealing.
Double-walled carbon nanotubes (DWCNTs) were grown with vertical alignment on a Si wafer by using catalytic thermal chemical vapor deposition. This study investigated the effect of pre-annealing time of catalyst on the types of CNTs grown on the substrate. The catalyst layer is usually evolved into discretely distributed nanoparticles during the annealing and initial growth of CNTs. The 0.5-nm-thick Fe served as a catalyst, underneath which Al was coated as a catalyst support as well as a diffusion barrier on the Si substrate. Both the catalyst and support layers were coated by using thermal evaporation. CNTs were synthesized for 10 min by flowing 60 sccm of Ar and 60 sccm of H2 as a carrier gas and 20 sccm of C2H2 as a feedstock at 95 torr and $750^{\circ}C$. In this study, the catalyst and support layers were subject to annealing for 0~420 sec. As-grown CNTs were characterized by using field emission scanning electron microscopy, high resolution transmission electron microscopy, Raman spectroscopy, and atomic force microscopy. The annealing for 90~300 sec caused the growth of DWCNTs as high as ~670 ${\mu}m$ for 10 min while below 90 sec and over 420 sec 300~830 ${\mu}m$-thick triple and multiwalled CNTs occurred, respectively. Several radial breathing mode (RBM) peaks in the Raman spectra were observed at the Raman shifts of 112~191 cm-1, implying the presence of DWCNTs, TWCNTs, MWCNTs with the tube diameters 3.4, 4.0, 6.5 nm, respectively. The maximum ratio of DWCNTs was observed to be ~85% at the annealing time of 180 sec. The Raman spectra of the as-grown DWCNTs showed low G/D peak intensity ratios, indicating their low defect concentrations. As increasing the annealing time, the catalyst layer seemed to be granulated, and then grown to particles with larger sizes but fewer numbers by Ostwald ripening.
탄소나노튜브는 지금까지의 많은 연구를 통해 다양한 분야에 대한 응용 가능성이 확인되었으며, 그 중에서도 특히 탄소나노튜브를 이용한 전계방출표시소자(carbon nanotube field emission display, CNT-FED)는 상용화를 눈앞에 두고 있는 상황이다. 본 연구에서는 탄소나 노튜브를 합성할 수 있는 여러 가지 방법 중에서 열화학기상증착법(thermal chemical vapor deposition, thermal CVD)을 이용하여 유리기판 위에 탄소나노튜브를 합성하였다. Electron beam evaporation으로 유리기판 위에 전극층으로 Cr을 150nm를 증착하고 연속하여 촉매층인 Invar(Fe-53%Ni-6%Co 합금)를 10nm의 두께로 형성하였다. 사진식각으로 Cr층을 line 패턴한 후 Cr line 내의 Invar층을 line 및 dot 패턴하였다. 나노튜브 합성을 위해 480-58$0^{\circ}C$까지 진공분위기 또는 질소 분위기에서 20분간 승온한 후 CO(150sccm)와 H$_2$(1200sccm)를 주입하여 20분간 성장시키고 질소 분위기에서 냉각시켰다. 성장된 탄소나노튜브는 SEM, TEM, Raman spectroscopy 등을 통하여 구조 및 형상분석을 하였다. 진공승온의 경우 탄소불순물인 a-C이 많은 양 증착 되었으며 탄소나노튜브는 온도에 따라 1-5$\mu\textrm{m}$의 두께로 성장하였으나, 질소분위기 승온의 경우는 a-C이 거의 증착되지 않았으며 나노튜브의 두께가 10-20$\mu\textrm{m}$였다. 본 연구에서는 diode구조를 갖는 탄소나노튜브 에미터의 수명예측을 위해 여러 가지 가속측정조건에서 전계방출 특성을 연구하였다. Anode와 cathode 간의 간격을 400$\mu\textrm{m}$로 유지한 diode 구조에 대해 $10^{-6}$ torr 이하의 진공에서 전계방출을 측정하였다. 100 line의 에미터를 60Hz의 주파수에서 1/100 duty로 구동하였으며, duty비 증가에 따라 pulse의 on-time을 고정하고 frequency를 변화시켰다. dc까지 duty비가 증가됨에 따라 방출전류의 양이 선형적으로 증가하였다. 전압을 일정하게 고정시키고 각 duty비에서 시간에 따라 방출전류를 측정한 결과 duty비가 높을수록 방출전류가 시간에 따라 급격히 감소하였다. 각 duty비에서 방출전류의 양이 1/2로 감소하는 시점을 에미터의 수명으로 볼 때 duty비 대 에미터 수명관계를 구해 높은 duty비에서 전계방출을 시킴으로써 실제의 구동조건인 낮은 duty비에서의 수명을 단시간에 예측할 수 있었다.
[ $CeO_2$ ]has been widely used for single buffer layer of coated conductor because of superior chemical and structural compatibility with $ReBa_2Cu_3O_{7-{\delta}}$(Re=Y, Nd, Sm, Gd, Dy, Ho, etc.). But, the surface of $CeO_2$ layer showed cracks because of the large difference in thermal expansion coefficient between metal substrate and deposited $CeO_2$ layer, when thickness of $CeO_2$ layer exceeds 100 nm on the biaxially textured Ni-3%W substrate. The deposition rate has been limited to be less than 6 $\AA$/sec in order to get a good epitaxy. In this research, we deposited $CeO_2$ single buffer layers on biaxially textured Ni-3%W substrate with 2-step process such as thin nucleation layer(>10 nm) with low deposition rate(3 $\AA$/sec) and thick homo epitaxial layer(>240 nm) with high deposition rate(30 $\AA$/sec). Effect of deposition temperature on degree of texture development was tested. Thick homo epitaxial $CeO_2$ layer with good texture without crack was obtained at $600^{\circ}C$, which has ${\Delta}{\phi}$ value of $6.2^{\circ}$, ${\Delta}{\omega}$ value of $4.3^{\circ}$ and average surface roughness(Ra) of 7.2 nm within $10{\mu}m{\times}10{\mu}m$ area. This result shows the possibility of preparing advanced Ni substrate with simplified architecture of single $CeO_2$ layer for low cost coated conductor.
In this work, we investigated simple Aㅣ/TCO/a-Si:H(n)/c-Si(p)/Al hetero-junction solar cells prepared by low temperature processes, unlike conventional thermal diffused c-Si solar cells. a-Si:H/c-Si hetero-junction solar cells are processed by low temperature deposition of n-type hydrogenated amorphous silicon (a-Si:H) films by plasma-enhanced chemical vapor deposition on textured and flat p-type silicon substrate. A detailed investigation was carried out to acquire optimization and compatibility of amorphous layer, TCO (ZnO:Al) layer depositions by changing the plasma process parameters. As front TCO and back contact, ZnO:Al and AI were deposited by rf magnetron sputtering and e-beam evaporation, respectively. The photovoltaic conversion efficiency under AMI.5 and the quantum efficiency on $1cm^2$ sample have been reported. An efficiency of $12.5\%$ is achieved on hetero-structure solar cells based on p-type crystalline silicon.
Thin films of pp(ST-Co-VA) were fabricated by plasma deposition polymerization (PVDPM) technique. Properties of the plasma polymerized pp(ST-Co-VA) thin films were investigated for application to semiconductor device as insulator. Thickness, dielectric property, composition of the pp(ST-Co-VA) thin films were investigated considering the relationship with preparation condition such as gas pressure and deposition time. In order to verify the possibility of application to organic thin film transistor, a pentacene thin film was deposited on the pp(ST-Co-VA) insulator by vacuum thermal evaporation technique. Crystalline property of the pentacene thin film was investigated by XRD and SEM, FT-IR. Surface properties at the pp(ST-Co-VA)/pentacene interface was investigated by contact angle measurement. The pp(ST-Co-VA) thin film showed a high-k (k=4.6) and good interface characteristic with pentacene semiconducting layer, which indicates that it would be a promising material for organic thin film transistor (OTFT) application.
Microcrystalline Si films have been deposited by using five W-wire filaments of 0.5 mm diameter for hot-wire chemical vapor deposition (HWCVD). We compared the HWCVD grown films with the film exposed to transformer couple plasma system for the modification of seed layer. W-wire filament temperature was maintained below 1600$^{\circ}C$ to avoid metal contamination by thermal evaporation at the filament. Deposition conditions were varied with H$_2$dilution ratio, with and without plasma treatment. From the Raman spectra analysis, we observed that the film crystallization was strongly influenced by the H$_2$dilution ratio and weakly depended on the distance between the wire and a substrate. We were able to achieve the crystalline volume fraction of about 70% with an SiH$_4$/H$_2$ratio of 1.3%, a wire temperature of 1514$^{\circ}C$, a substrate separation distance of 4cm, and a chamber pressure of 38 mTorr. We investigated the influence of ${\mu}$c-Si film properties by using a plasma treatment. This article also deals with the influence of the H$_2$dilution ratio in crystallization modification.
Carbon nitride($CN_x$) thin films were deposited on quartz substrates using reactive RF magnetron sputtering system at uarious deposition conditions and investigated dielectric characteristics. Samples for capacitance measurements were of the MIM(Metal-Insulator-Metal) type devices. Aluminum film electrodes were prepared by a vacuum thermal evaporation method before and after the deposition of carbon nitride films. Capacitances were measured by a FLUKE PM6306 RCL Meter at room temperature. Current-voltage(I-V) characteristics and resistivity were measured by a CATS CA-EDA semiconductor test and analyzer. The carbon nitride films showed ${\alpha}-C_3N_4$ and ${\beta}-C_3N_4$ etc. peaks through Raman and FTIR. Observed surface of film and side structure using SEM(Scanning Electron Microscope), and measured thickness of film by ${\alpha}-step$. We can find that the dielectric constant was the lowest value in 50% nitrogen ratio and the resistivity was the highest value in 70% nitrogen ratio.
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[게시일 2004년 10월 1일]
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