• 전자공학회논문지D
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• 제36D권4호
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• pp.1-7
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• 1999

다양한 이동통신 시스템의 기지국과 중계기 장비에서 입·출력 신호성분의 모니터링을 위한 다양한 형태의 방향성 결합기가 요구된다. 본 논문의 서로 평행한 세 선로로 구성된 방향성 결합기는 서로 다른 결합도를 갖고, 한 결합포트에 부정합이 발생하였을 때 다른 결합포트에 영향을 주지 않는 독립성을 갖는 장점이 있다. 본 논문에서는 비대칭 결합선로를 이용하여 2개의 서로 다른 결합도를 갖는 이중 방향성 결합기의 새로운 해석방법과 설계시 필요한 우 및 기 모드의 임피던스를 구할수 있는 수식을 제시하였다. 유도된 수식을 이용하여 국내에서 운용중인 PCS 대역인 1.7∼2GHz의 주파수 영역에서 각각 20dB와 30dB의 결합도를 갖는 이중 방향성 결합기를 설계, 제작하여 원하는 결합도와 약 40dB의 SHB은 지향성을 얻었고, 측정결과와 시뮬레이션 결과가 잘 일치됨을 보였다.

• 한국전자파학회:학술대회논문집
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• 한국전자파학회 2001년도 종합학술발표회 논문집 Vol.11 No.1
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• pp.180-183
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• 2001

본 논문에서는 N개의 평행 결합선로를 이용한 3dB 결합기를 해석하였으며, 유도된 식에 의하여 최소의 단수와 크기로 3dB 결합기를 설계하였다. 기존의 Spectral Domain상에서 N단 평행 결합선로의 복잡한 관계식 유도를 S 파라미터 관계식으로 간단히 유도 하였으며, 유도된 식의 타당성을 위해 실제 제작 검증하였다. 제작된 결합기는 Loose coupling의 평행 결합 선로의 광대역 특성을 그대로 이용하기 때문에 Lange Coupler와 같은 높은 임피던스와 Tight coupling을 구현 할 필요가 없으며, wire bonding도 용이하게 된다. 최소의 단수로 구현하기 위해 RT/Duroid의 R06006과 같은 높은 유전율과 두꺼운 기판을 사용하여 2단으로 3dB 구현이 가능하게 하였다. 제작결과 3.6GHz에서5.5GHz로 대략 42%(0.5dB imbalance) 정도의 광대역특성을 가지고 위상오차도 1$^{\circ}$내외의 결합기를 구현할 수 있었고 격리도 특성 또한 대역 내에서 15dB 내외의 특성을 보였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2000년도 하계학술대회 논문집 A
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• pp.458-460
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• 2000

In this paper, we analyze the inductive coupling between overhead power transmission lines and neighbouring gas pipelines or other conductors, when they parallel to a line section in a phase-to-earth fault is assumed on the transmission line. A numerical procedure employing the finite-element method(FEM) is used in conjunction with Faraday's law, in order to predict the current in a faulted transmission line as well as the induced voltages across points on a pipeline running parallel to the faulted line and remote earth. The results lead to conclusion that may be useful to power system engineers.

• 한국항행학회논문지
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• 제27권1호
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• pp.57-62
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• 2023

본 논문은 이중 모드 SIR(stepped-impedance resonator)과 평행 결합선로를 이용한 3중-대역 대역통과 필터를 제안한다. 제안된 필터는 단락 종단을 갖는 inter-digital 및 comb-line 형태의 평행 결합선로와 개방형 스터브를 갖는 U-자형 SIR로 구성되었다. 개방형 스터브가 있는 2개의 U-자형 SIR은 첫 번째와 세 번째 통과 대역을 만들고, 중앙의 평행 결합선로 공진기는 두 번째 통과 대역을 만든다. 5개의 공진기와 평행 결합선로 구조의 우/기모드 입력 임피던스를 해석하여 3중-대역 대역통과 필터의 산란 파라미터를 유도하였다. 유도된 산란 파라미터를 이용하여 새로운 3중-대역 대역통과 필터를 설계하고 제작하였다. 제작된 필터는 0.2×0.19 λ_g²의 작은 크기를 가지며, 측정 결과는 높은 대역 격리도를 보여 주고 있다.

• 한국전자파학회논문지
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• 제14권10호
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• pp.1004-1010
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• 2003

본 논문에서는 유한한 도체 두께를 갖는 결합선로를 이용하여 1/4파장 역방향 방향성 결합기를 설계하였다. 방향성 결합기를 구성하는 유한 도체 두께를 갖는 결합선로를 해석하기 위한 방법으로 간단하고 빠른 수치해석 방법인 모드정합법을 사용하였다. 본 논문의 해석 결과는 도체 두께를 고려한 역방향 방향성 결합기의 설계가, 도체 두께를 고려하지 않고 설계한 경우 기존에 알려졌던 단점들인 약한 결합특성, 낮은 지향성, 그리고 비현실적인 결합선로의 폭을 극복할 수 있음을 보여준다. 또한, 수치해석 결과로부터 l/4파장 역방향 방향성 결합기에서는 도체 두께의 고려로 강한 결합특성을 만드는 것이 가능하지만, 결합길이가 약간 길어진다는 사실을 확인하였다. 본 논문에서 해석한 유한한 도체 두께는 역방향 방향성 결합기의 새로운 설계 변수로서 사용이 가능하며, 아울러 다양한 마이크로파 집적회로의 설계에도 응용이 가능함을 보여준다.

• ETRI Journal
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• 제26권6호
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• pp.520-534
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• 2004

As the density of memories increases, unwanted interference between cells and the coupling noise between bit-lines become significant, requiring parallel testing. Testing high-density memories for a high degree of fault coverage requires either a relatively large number of test vectors or a significant amount of additional test circuitry. This paper proposes a new tiling method and an efficient built-in self-test (BIST) algorithm for neighborhood pattern-sensitive faults (NPSFs) and new neighborhood bit-line sensitive faults (NBLSFs). Instead of the conventional five-cell and nine-cell physical neighborhood layouts to test memory cells, a four-cell layout is utilized. This four-cell layout needs smaller test vectors, provides easier hardware implementation, and is more appropriate for both NPSFs and NBLSFs detection. A CMOS column decoder and the parallel comparator proposed by P. Mazumder are modified to implement the test procedure. Consequently, these reduce the number of transistors used for a BIST circuit. Also, we present algorithm properties such as the capability to detect stuck-at faults, transition faults, conventional pattern-sensitive faults, and neighborhood bit-line sensitive faults.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1999년도 하계학술대회 논문집 A
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• pp.436-439
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• 1999

This paper present a study on the interference levels on the communication lines, which are parallel to the electrified rails. The interference study is carried out using a circuit model approach. First, the self and shunt impedances of all the conductors in the rail system and the mutual impedances between different conductors are computed. Several different scenarios are analyzed, including the load condition and a few fault conditions with different fault locations. The induced potentials on the communication cables are computed. The effect of the buried ground wires is also analyzed by comparing the results with and without the presence of the ground wires. The results presented in the paper can be used as a reference for estimating interference levels in similar rail systems.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1998년도 하계학술대회 논문집 C
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• pp.949-951
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• 1998

Because of the zero sequence mutual coupling of parallel lines, the distance calculation performed by a distance relay is incorrect. To achieve correct operation, the relay has to use not only the measured quantities of faulty line, but also the zero sequence current of healthy line. But the zero sequence current of the healthy line cannot be always measured. Therefore, we propose the neural network method to estimate the zero sequence current and the criterion to determine whether faulty line or not.

• 대한전기학회논문지:전력기술부문A
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• 제50권3호
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• pp.146-152
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• 2001

This paper describes an accurate fault location algorithm based on sequence current distribution factors for a double-circuit transmission system. The proposed method uses the voltage and current collected at only the local end of a single-circuit. This method is virtually independent of the fault resistance and the mutual coupling effect caused by the zero-sequence current of the adjacent parallel circuit and insensitive to the variation of source impedance. The fault distance is determined by solving the forth-order KVL(Kirchhoff's Voltage Law) based distance equation. The zero-sequence current of adjacent circuit is estimated by using a zero-sequence current distribution factor and the zero-sequence current of the self-circuit. Thousands of fault simulation by EMTP have proved the accuracy and effectiveness of the proposed algorithm.

• 대한전기학회논문지:전력기술부문A
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• 제52권7호
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• pp.393-400
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• 2003

This paper discusses how to implement and verify a software model of the digital relay that can be added to real time digital simulator(RTDS) model library and is then subjected to the same outputs as the actual relay. The software model is stand-alone and can be used with real relays. It is also possible to conduct interactive real-time tests when the system effects of the relay action need to be investigated. The characteristics of mho type and the quadrilateral type, which is commonly used in recently developed relays, are modeled in this paper. Single circuit line and double circuit line system are used for model verification. The transmission lines are each 100 km in length and are modeled as distributed parameter lines but not frequency dependent. The transmission lines in the single circuit system are modeled as ideally transposed line. The mutual coupling data with the parallel line was taken account in the transmission lines for the double circuit system. The main CTs and PTs are included and operated in their linear region during the tests. For the purpose of testing the relay model accuracy the faults have been applied at various points on the protected line. Its accuracy is assessed against theoretical values.