• 한국정보처리학회논문지
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• 제6권12호
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• pp.3634-3641
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• 1999

ATM 네트워크 상에서 기존의 LAN 환경의 데이터 서비스를 제공하기 위한 대표적인 프로토콜은 ATM Forum에서 제안한 LAN Emulation과 IETF에서 제안한 IPOA이다. 본 논문에서는 ATM환경에서 TCP/IP의 성능을 분석하기 위하여 현재 널리 사용되고 있는 LAN Emulation과 IPOA를 ATM LAN 상에 구현하여 각각의 성능을 비교 분석하였으며, 또한 기존의 Ethernet 환경에서의 성능과 비교하였다. 성능 비교를 위한 파라미터로는 전송지연시간, 전송률, CPU 사용률, CPU 사용률에 대한 데이터 전송률 등을 사용하였다. ATM LAN에서의 클라이언트와 서버간의 대용량 데이터 전송을 통한 성능 비교 결과 LAN Emulation과 IPOA는 Ethernet에 비하여 월등한 성능을 보였고 IPOA가 LAN Emulation에 비하여 적은 전송지연시간 및 높은 전송률을 제공하였으며, CPU 사용률에 대한 데이터 전송률에서도 IPOA가 우수한 결과를 보였다.

• 한국기록관리학회지
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• 제14권3호
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• pp.55-82
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• 2014

우리나라 공공기록의 디지털 컴포넌트를 장기보존하면서 다양한 기능성을 충분히 재현해내기 위해서는 에뮬레이션 전략이 필요하다. 이를 위해 이 연구에서는 먼저 대표적인 해외의 에뮬레이션 프로젝트인 CAMiLEON, KB, Planets, KEEP 등에 대한 사례를 통해 디바이스 에뮬레이션, 운영체제 에뮬레이션, 애플리케이션 에뮬레이션 등의 전형적인 에뮬레이션 방안을 비교분석하였다. 다음으로 우리나라 공공기관의 디지털 컴포넌트 포맷 현황을 살펴본 결과 아래아한글문서와 엑셀문서가 전체 디지털 컴포넌트의 90프로에 가까운 비율을 보인다는 점과 파일의 확장자와 실제 내부 포맷이 상이하게 관리되고 있기도 하다는 점을 발견하였다. 아래아한글문서와 엑셀문서 등 주요 포맷들이 문서보존포맷으로 변환되어 보존될 경우 상실하게 되는 기능성과 렌더링 특성을 조사하였으며, 운영체제 에뮬레이터와 애플리케이션 에뮬레이터 프로토타입을 개발하여 이들 문서의 기능성을 손실없이 재현해 보여줄 수 있음을 확인하여 에뮬레이션 전략의 가능성을 보여주고 있다.

• 정보와 통신
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• 제13권3호
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• pp.61-70
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• 1996

본 논문에서는 ATM Forum에서 제안하고 있는 LAN 에뮬레이션 서비스 구조를 소개하였다. LAN 에뮬레이션은 기존의 방대한 LAN 응용 소프트웨어들을 ATM 망에서 그대로 사용하기 위하여 ATM 망에서 기존의 비연결형 LAN 서비스를 에뮬레이트하는 MAC 계층 서비스를 제공한다. LAN 에뮬레이션에 의하여 ATM 망상에는 논리적인 오버레이 망인 에뮬레이트된 망이 형성되는데, LAN 에뮬레이션 서비스는 에뮬레이트된 LAN의 각 종단 시스템에 설치되는 LAN 에뮬레이션 클라이언트(LEC)들의 집합과 세 가지의 논리적 서비스 요소들로 구성된다. 이 세 가지의 논리적 서비스 요소들은 LAN 에뮬레이션 구성 서버(LE 서버), Broadcast and Unknown 서버(BUS)라고 불리우며, LF, 클라이언트는 이 세 가지 서버가 제공하는 서비스를 이용하여 기존 LAN과 ATM망과의 상호 연동 및 ATM 망에서의 LAN 응용간 투명한 통신을 지원한다.

• Journal of the Optical Society of Korea
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• 제12권2호
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• pp.69-78
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• 2008

EPONs are a low cost, high speed solution to the bottleneck problem of broadband access networks. To support point-to-point and shared LAN emulation, EPONs use the multi-point control protocol (MPCP), which uses logical link identification (LLID) forframe tagging and filtering between the OLT and ONUs. In this paper, ONU-based multicast or multiple shared LAN emulation for IPTV services is proposed using logical group identification (LGID). Using ONUbased VLAN services, EPONs can support separate and secure connections between providers and subscribers in a simple manner. Also, differentiated IPTV channel packages can be delivered through EPONs by implementing ONU-based VLAN and IGMP snooping mechanisms.

• 대한전자공학회논문지SD
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• 제39권2호
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• pp.91-103
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• 2002

다수의 FPGA로 구성된 에뮬레이터에서 FPGA간의 연결구조와 신호의 전송방법은 에뮬레이터의 확장성과 검증속도를 결정하는 중요한 요소이다. 기존의 에뮬레이터는 검증 대상이 되는 회로의 크기가 커짐에 비례하여 에뮬레이션의 속도가 현저하게 느려지는 문제점이 있다. 본 논문에서는 자원이용률을 극대화할 수 있을 뿐만 아니라 에뮬레이션의 속도도 크게 높일 수 있는 새로운 에뮬레이터 구조를 제안한다. 제안되는 에뮬레이터는 계층적인 환형 토폴로지 구조를 가지고 파이프라인의 환형으로 FPGA들을 연결하여 FPGA의 핀한곌르 극복하고, 이와 같은 연결구조를 이용하여 다양한 IP들의 통합도 매우 용이하게 함으로써 설계검증 난이도가 설계자의 검증 능력을 쉽게 초과할 수 있는 시스템 수준에서의 검증도 최소한 수십 ㎒ 속도의 에뮬레이션으로 효과적으로 가능하게 한다.

• 한국컴퓨터정보학회논문지
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• 제17권2호
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• pp.1-11
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• 2012

최근 들어 ARM 구조에서 가상화를 구현하기 위해 다양한 연구들이 진행되었다. 현재의 ARM 구조는 전통적인 에뮬레이션 방법인 "trap-and-emulation"으로 가상화 할 수 없기 때문에, 게스트 커널 수행 시간에 가상화 민감 명령어를 탐지하여, 이를 직접 수행하는 대신 가상화 에뮬레이션 한다. 일반적으로 가상화 에뮬레이션은 이진 변환 또는 인터프리테이션 방법으로 구현한다. 본 연구는 인터프리테이션 방법을 기반으로 하는 가상화 에뮬레이션의 성능 향상에 관한 것이다. 인터프리테이션은 명령어 페치, 명령어 디코딩, 그리고 명령어 수행의 단계로 이루어진다. 본 논문에서는 게스트 커널의 컴파일 시간에 모든 가상화 민감 명령어를 디코딩하여, 게스트 커널의 수행 시간에 인터프리테이션 시간을 줄이는 방법을 제안한다. 본 연구의 방법은 인터프리테이션 기반의 가상화 방법에서 에뮬레이션 코드를 간단하게 하고, 에뮬레이션 성능을 향상시킨다.

• 전자공학회논문지C
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• 제36C권10호
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• pp.17-28
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• 1999

본 논문에서는 ASIC 설계 회로를 빠른 시간 내에 구현 및 검증할 수 있는 에뮬레이션 시스템 ACE(ASIC Emulator)를 제안한다 ACE는 EDIF 번역기, 라이브러리 변환기, 기술 맵퍼, 회로 분할기, LDF 생성기를 포함하는 에뮬레이션 소프트웨어와 에뮬레이션 보드, 논리 분석기를 포함하는 에뮬레이션 하드웨어로 구성된다. 기술 맵퍼는 회로 분할과 논리 함수식 추출, 논리 함수의 최소화, 논리 함수식의 그룹핑의 세 과정으로 이루어지며, 같은 기본 논리 블록에 할당되는 출력의 적항과 변수들을 많이 공유하게 하여 기본 논리 블록 수와 최대 레벨 수를 최소화한다. 에뮬레이션 보드의 배선 구조와 FPGA 칩이 갖는 제한 조건들을 만족시키면서 서로 다른 칩 사이에 연결된 신호선 뿐만 아니라 서로 다른 그룹 사이에 연결된 신호선 수의 최소화를 목적 함수로 하는 새로운 회로 분할 알고리듬을 제안한다 여러 FPGA 칩으로 구성된 에뮬레이션 보드는 완전 그래프와 부분 그래프를 결합한 새로운 배선 구조로 회로의 크기에 관계없이 칩 사이의 지연 시간을 최소화하도록 설계하였다. 논리 분석기를 이용하여 구현된 회로에서 검증을 원하는 내부신호에 대한 파형을 PC의 모니터로부터 관측할 수 있다. 제안한 에뮬레이션 시스템의 성능을 평가하기 위하여 상용 회로중 하나인 화면4분할기 회로를 에뮬레이션 보드상에 설계하여 동작 시간과 기능을 확인한 결과, 14.3MHz의 실시간 동작과 함께 기능이 완전함을 확인할 수 있었다.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2003년도 하계종합학술대회 논문집 II
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• pp.859-862
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• 2003

This paper proposes an emulation environment for SoC designs using small number of large gate-count FPGA's and a PC system. To overcome the pin limitation problem in partitioning the design when the design size overwhelms the FPGA gate count, we use bus splitter modules that replicate on-chip bus signals in one FPGA to arbitrary number of other FPGA's with minimal pin count. The proposed scheme is applied to the emulation of 2 million gate multimedia processing chip using two Xilinx Viretex-2 6000 FPGA devices in 6.6MHz operating frequency. An ARM core, memories, camera and LCD display are modeled in software using dual 2GHz Pentium-III processors. This scheme can be utilized for more than 2 FPGA's in the same ways as two FPGA case without losing emulation speed.

• 한국정밀공학회:학술대회논문집
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• 한국정밀공학회 2003년도 추계학술대회 논문요약집
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• pp.261-261
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• 2003

• 한국정보통신학회논문지
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• 제14권10호
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• pp.2180-2186
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• 2010

무기체계의 현대화 및 복잡화에 따라 현대전 상황에서의 플랫폼 및 운용자에 대한 생존성 확보를 필요로 하게 되었다. 현대 전장의 복합 및 다중 위협상황 무기체계에 대응하기 위하여 다수의 무기체계 플랫폼에서 생존체계를 함께 탑재하게 된다. 생존체계는 무기체계 플랫폼을 위협하는 위협들을 탐지/식별하며 효율적인 대응을 통하여 운용자로 하여금 정확한 상황인지를 가능하게 하고 플랫폼의 생존 능력을 향상시킨다. 생존체계가 보유하여야 할 중요 성능 인자는 복합 및 다중 위협에 대한 처리를 통하여 생존성을 확보하는 것이다. 이에 본 논문에서는 레이다, 레이저, 미사일 단일 위협상황을 조합한 복합 위협상황을 다룸으로 하여 생존체계가 보유하여야 하는 위협통합 알고리즘을 제시하고, 복합 위협상황을 Emulation하는 시스템을 실험실 환경에서 구현하여 위협통합 알고리즘에 대한 성능을 검증하였다. 이를 통해 생존체계가 플랫폼 탑재 이전에 성능 및 신뢰성을 확보할 수 있는 방안에 대하여 제시한다.