As the internet communication is prevalent in recent years, it becomes quite possible to monitor and control some mechanical plants from the remote place through the TCP/IP communication. Such a concept is expected to be applied to many industrial systems for easy maintenance and trouble shooting as well as various kinds of expensive test equipments for sharing. In this research, remote data monitoring and speed control for a DC-motor is implemented and tested through TCP/IP communication with embedded micro-controllers. It showed the possibility of reliable remote control system design utilizing the internet communication.
This paper describes the finite element model for predicting the fundamental performance of embedded steel column base connections under monotonic and cyclic loading. Geometric and material nonlinearities were included in the proposed finite element model. Bauschinger and pinching effects were considered in the simulation of embedded column base connections under cyclic loading. The degradation of steel yield strength and accumulation of plastic damage can be well simulated. The accuracy of the finite element model is examined by comparing the predicted results with independent experimental dataset. It is demonstrated that the finite element model accurately predicts the behaviour and failure models of the embedded steel column base connections. The finite element model is extended to carry out evaluations and parametric studies. The investigated parameters include column embedded length, concrete strength, axial load and base plate thickness. Moreover, analytical models for predicting the initial stiffness and bending moment strength of the embedded column base connection were developed. The comparison between results from analytical models and those from experiments and finite element analysis proved the developed analytical model was accurate and conservative for design purposes.
임베디드 기기에서 플래시 메모리의 사용량이 증가하고, 임베디드 기기가 여러 computing 환경에서 점점 중요한 위치를 점함에 따라 임베디드 파일 시스템의 보안이 중요한 문제가 된다. 또한 임베디드 기기의 경우 휴대성이 좋은 반면 분실의 위험도 크고, 분실한 경우 기기 내부의 플래시 메모리에 중요 정보가 있다면 사용자에게 큰 손실을 야기할 수 있다. 이처럼 다양한 상황에서 임베디드 기기 내부의 플래시 파일 시스템의 보안성을 향상시키기 위해 암호화 플래시 파일 시스템을 설계 및 구현 하였다. 이를 위해 현재 많이 사용되는 YAFFS 파일 시스템을 수정하였다. 수정된 YAFFS 암호화 파일 시스템을 통해 임베디드 기기의 보안성을 한 층 강화할 수 있다.
가상화는 최근 활발한 연구가 진행되고 있는 시스템 소프트웨어 분야 중 하나이다. 범용 컴퓨터 시스템을 위한 가상화 분야에는 이미 상용화제품들도 다수 존재하는 반면, 임베디드 시스템의 특성을 고려한 가상화에 대한 연구는 상대적으로 미미한 실정이다. 본 논문에서는 임베디드 시스템의 각 하드웨어 자원을 여러 논리적인 하드웨어 자원들로 나누고, 이를 다수의 가상 머신들로 재구성하는 가상 머신 모니터를 설계하고 구현하였다. 제안된 가상 머신모니터는 하나의 임베디드 시스템 상에 다수의 실시간 운영체제들을 동시 수행하는 것을 가능하게 한다. 실제의 임베디드 시스템 하드웨어 상에서 구현된 가상 머신 모니터에 대해 다양한 성능 측정 실험을 수행하였다. 성능 평가결과를 통해 제안된 가상 머신 모니터가 실제의 임베디드 시스템 응용 분야에 적용이 가능함을 보였다.
본 논문에서는 입베디드세스템에 기초를 둔 시스템온칩을 구성하는 방법을 제안하였다. 제안한 방법은 이전의 방법에 비해 좀 더 콤팩트하고 효과적이다. 이 방법은 높은 수행시뮬레이션을 요구하고 하드웨어/소프트웨어 통합설계 툴을 사용하여 구현을 위한 실행 가능한 규격화된 적절함을 요구한다. 시스템 인터페이스 처럼 이미 존재하고 있는 부품의 재사용은 지원되지만, 작업 이후는 단지 하드웨어/소프트웨어 통합설계 툴의 프로그램에 의해 수행되어진다. 실제 설계 흐름은 모든 프로세스를 통하여 요구되는 구현으로부터 모든 설계 단계 사이의 궤환을 허용하게끔 설명되어진다. 향후 좀 더 진보된 임베디드시스템에 기초를 둔 시스템온칩을 구성하는 방법이 요구된다.
The purpose of this study is to develop the model of course evaluation design for CEA(Course-Embedded Assessment), which is focused on course level for assessment reliability. This study was conducted by the process of model development and validation according to Richey & Klein(2007)'s model development methodology. The model of this study was comprised with the three steps of learning objectives based on course outcome, assessment design and goal achievement analysis of course, which were explained by specific design principles. Also, this model was validated by two steps, which one was on the inner validation and the other was the outer validation(Richey & Klein, 2007). Considerations for designing the model of course evaluation have been suggested and a few implications were discussed.
This paper describes the implementation of a digital audio effect system-on-a-chip (SoC), which integrates an embedded digital signal processor (DSP) core, audio codec intellectual property, a number of peripheral blocks, and various audio effect algorithms. The audio effect SoC is developed using a software and hardware co-design method. In the design of the SoC, the embedded DSP and some dedicated hardware blocks are developed as a hardware design, while the audio effect algorithms are realized using a software centric method. Most of the audio effect algorithms are implemented using a C code with primitive functions that run on the embedded DSP, while the equalization effect, which requires a large amount of computation, is implemented using a dedicated hardware block with high flexibility. For the optimized implementation of audio effects, we exploit the primitive functions of the embedded DSP compiler, which is a very efficient way to reduce the code size and computation. The audio effect SoC was fabricated using a 0.18 ${\mu}m$ CMOS process and evaluated successfully on a real-time test board.
This study investigated the thermal insulation of an air-cell pack embedded jacket and down jackets to understand the potential of air-cell pack as a filler for winter outdoor wear. A thermal manikin measured the thermal insulation of the following jackets: HD (heavy down jacket, total weight (Tw) 750g, goose down weight (Dw) 350g), LD (light down jacket, Tw 560g, Dw 140g), AF (air-cell pack embedded jacket, Tw 490g, trunk goose down in LD was replaced to air cell), F (film jacket, Tw 469g, but removed the air in the air-cell pack from the AF), and Control (control jacket, Tw 438g, removed the air-cell pack film from the F). Thermal insulations of each experimental condition were measured in a static standing posture. Total thermal insulations (IT) were 1.29clo (HD), 1.23clo (LD), 1.16clo (AF), 1.20clo (F), and 1.08clo (Control). Body regional thermal insulation was higher in the chest and back than in the abdomen and hip in all conditions. The results suggest that an economical and versatile outdoor jacket with superior thermal insulation will be feasible if the air volume is properly controlled in air-cell pack embedded jackets in consideration of regional different distribution and used in combination with film and down.
본 고에서는 임베디드 시스템을 위한 새로운 이벤트 중심의 실시간 시스템의 디자인의 최적화에 대한 연구를 논하고자 한다. 이를 위해서는 대단위의 분산처리시스템을 만족하기 위한 종료시한 초과 처리기의 구현이 필수적이며, 이때 실시간 시스템에서의 타이밍을 조절하고 계측할 수 있는 종료시 한이 사용되어야 한다. 이러한 타이밍의 요소들은 보통 모델과 실제 시스템사이의 인터페이스에서 동작하는데, 여기서 실시간 시스템의 디자인을 위한 다양한 그래픽 언어들이 종료시한을 효과적으로 처리하도록 제고한다. 이 연구를 통하여 사용자수준에서의 임베디드 시스템을 위한 종료시한 초과 처리와 함께, RonRT라는 툴을 이용한 최적화된 종료시한 초과 처리기를 증명해 보이고자한다.
본 논문은 mobile platform에서 사용될 Multimedia 적용을 위한 embedded Processor의 기본 구조 연구에 관한 내용으로 MPEG4 응용에 적합한 processor의 기본 구조 그리고 mobile platform에 적용될 수 있는 energy efficiency를 고려한 구조설계를 주 내용으로 하고 있다. multimedia 응용 embedded processor의 기본 구현 구조 요소인 processor data path architecture(pipeline, branch prediction, multiple issue superscalar, function unit number)의 기본 구조 설정과 cache hierarchy와 그 구성의 적합한 예상구조를 설정하기 위해 본 논문에서는 multimedia 응용 프로그램인 MPEG4를 processor simulator의 test bench로 사용하여 다양한 구조에 대한 simulation을 수행하였다. 그리고 mobile platform 적용에 적합한 구조인지에 대한 문제를 energy efficiency관점에서 고찰하여 적용 가능한 기본 processor 구조를 설정하였다. 그리고 본 논문에서 제안된 기본 구조 연구는 mobile platform에 바로 적용이 가능하며 더 나아가 특정 응용 프로그램에 최적의 성능을 발휘할 수 있는 자동화 설계기반환경에서의 configurable processor 설계에서 그 기본 processor 구조로 사용될 수 있다.
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[게시일 2004년 10월 1일]
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