• 한국전자통신학회논문지
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• 제17권3호
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• pp.399-408
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• 2022

본 논문에서는 기본 모드 원리를 침해하는 과도 고장이 존재하는 입력/출력 비동기 순차 회로의 내고장성 교정 제어 시스템을 제안한다. 비동기 순차 회로의 과도 천이 과정에서 발생하는 비-기본 모드 고장을 극복하기 위해서는 고장에 의한 상태 천이가 종료되는 시점을 알아야 하며, 회로를 고장 상태로부터 원래 도달해야 하는 상태와 출력 등가적인 상태로 보내기 위한 교정 동작을 구현해야 한다. 본 논문에서는 이러한 고장 탐지 및 극복을 구현할 수 있는 출력 피드백 교정 제어기의 존재 조건을 규명한다. FPGA 실험을 통해 제안된 제어 시스템의 설계 과정을 제시하고 응용 가능성을 검증한다.

• 한국정보전자통신기술학회논문지
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• 제15권4호
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• pp.291-297
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• 2022

본 논문은 가전용 교류 전동기 구동을 위한 인버터 회로에 포함된 지능형 스위칭 모듈인 IPM 모듈에 대한 특성 및 신뢰성 계측 회로 설계 방법에 대한 연구이다. IPM은 전동기 구동기의 핵심 부품으로 그 스위칭 특성이 서보 구동 중에 일관되게 유지돼야 한다. 그 특성 중 스위치 온 특성을 결정하는 콜렉터-에미터간 도통 전압 Vce(on) 특성이 중요하다. 인버터 구성의 핵심 부품인 IPM은 여러 브랜드의 제품이 생산되고 있기 때문에 응용시스템의 최적 성능을 위해서는 IPM의 제품군에 따른 IGBT 스위치의 콜렉터-에미터간 도통 전압 Vce(on) 값을 측정하기 위한 방법 및 계측 평가 시스템이 필요하다. 제안된 방법은 제조사별 IPM이 전동기 구동회로에 장착된 상태에서 부하에 따른 Vce(on) 값을 계측 평가할 수 있는 새로운 방법으로 사용자 회사 입장에서는 중요한 설비가 될 수 있다.

• 전자공학회논문지SC
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• 제39권4호
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• pp.43-53
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• 2002

본 논문에서는 전하 공유와 글리치 문제를 최소화한 새로운 동적 D-플립플롭을 제안하고, 이를 이용하여 128/129 분주 프리스케일러(prescaler)를 설계한다. 전하 공유 문제와 글리치 문제를 최소화함으로써 회로 동작의 신뢰도를 향상시켰으며 스위칭 트랜지스터의 공유로 전류 path를 줄여 저전력 특성을 얻을 수 있다. 또한 제안된 동적 D-플립플롭은 안정된 edge-trigger 동작을 보장하도록 설계되었다. 제안된 플립플롭의 성능 평가를 위해 $0.6{\mu}m$ CMOS 공정을 이용하여 128/129 분주 프리스케일러를 구성하였다. 5V 공급전압에서 최대 1.97GHz의 주파수까지 동작함을 확인하였으며 이때의 전류 소모는 7.453mA였다.

• 항공우주기술
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• 제2권1호
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• pp.108-116
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• 2003

본 연구는 통신위성 전력제어장치(Power control&Distribution Unit)의 설계 및 해석에 관한 내용을 기술한다. 위성체 전력제어장치는 임무기간동안 각 서브시스템과 탑재체에 충분한 전력을 공급하여야 하며, 또한 우주환경 하에서 높은 신뢰성 및 성능이 요구된다. 전력제어 및 분배장치의 제어회로를 위해 버스전압검출 및 필터회로, 오차신호 증폭회로 그리고 SAS 및 BPC 오차신호 회로가 포함되었다. 설계된 제어보상회로에 대한 주파수 응답특성분석을 통해 각 회로의 위상여유와 이득이 분석되었다. 또한 배터리 충/방전을 위한 BPC회로 분석을 통해 배터리 충전 연속모드, 배터리 방전 연속/불연속 모드에서의 입출력 전달함수가 제시되었다.

• 전자공학회논문지
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• 제49권11호
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• pp.167-174
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• 2012

본 논문에서는 자동차 변속기 오일레벨을 측정하기 위한 초음파 오일레벨 측정기를 설계하고 실험을 통하여 유용성을 보였다. 측정기에 필요한 모든 디지털 회로를 FPGA 프로젝트 IDE상에서 하나의 FPGA를 이용하여 설계하여 측정기의 단순화와 고성능화를 이루었고, 측정기 개발 시간을 줄일 수 있었다. 또한, 전원회로와 저전압 초음파 에코신호 처리를 위한 아날로그 회로를 설계하고 시뮬레이션을 행하였다. 실험을 통하여, 설계된 측정기가 약 1mm 이내의 정확도를 가짐을 확인하였다.

• ETRI Journal
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• 제31권2호
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• pp.111-120
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• 2009

Network-on-chip (NoC) architecture provides a highper-formance communication infrastructure for system-on-chip designs. Circuit-switched networks guarantee transmission latency and throughput; hence, they are suitable for NoC architecture with real-time traffic. In this paper, we propose an efficient integrated scheme which automatically maps application tasks onto NoC tiles, establishes communication circuits, and allocates a proper bandwidth for each circuit. Simulation results show that the average waiting times of packets in a switch in $6{\times}6$6, $8{\times}8$, and $10{\times}10$ mesh NoC networks are 0.59, 0.62, and 0.61, respectively. The latency of circuits is significantly decreased. Furthermore, the buffer of a switch in NoC only needs to accommodate the data of one time slot. The cost of the switch in the circuit-switched network can be reduced using our scheme. Our design provides an effective solution for a critical step in NoC design.

• 대한전자공학회논문지SD
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• 제40권8호
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• pp.549-554
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• 2003

본 논문에서 단거리전용통신을 위한 차량탑재장치내의 수신단 전반부의 구성부품인 5.8GHz대역 LNA를 MMIC로 설계 및 구현하였다. 설계된 LNA는 두개의 능동소자와 매칭회로, 두개의 드레인 바이어스 회로로 구성되며, 3V의 단일공급전압에서 18mA의 소비전류로 동작한다. 중심주파수 5.8GHz에서 이득 13.4dB, NF 1.94dB, Input IP3-3dBm, S/sub 11/ - l8dB, S/sub 22/ - 13.3dB의 특성을 나타내며, 제작된 회로의 실제 크기는 1.2×0.7㎟ 이다.

• 한국전자통신학회논문지
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• 제15권4호
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• pp.779-784
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• 2020

본 논문에서는 기존에 제안한 노인성 난청으로 인한 청력도 감쇄를 보상하는 회로의 고주파 잡음 특성을 개선하고, 입체 음향을 지원하는 양 이(耳)형 보청 모듈을 설계·제작하였다. 고 이득 조건에서 경우에 따라 발생하는 기존 회로의 고주파 잡음 원인을 모의실험을 통해 분석하였다. 양 이 형 모듈에는 조절 대상 반대쪽 귀에는 음을 소거하여 보다 정확하게 오른쪽과 왼쪽 귀에 맞는 증폭 이득을 조절할 수 있도록 음 소거 스위치를 추가하였다.

• 한국정보통신학회논문지
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• 제4권1호
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• pp.67-76
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• 2000

본 논문에서는 INMARSAT 수신주파수인 1525-1545 MHz와 전세계 측위 시스템 수신주파수 15751 MHz 대역에서 초고주파용 수신장치로 사용되는 L-BAND(1525-1575 MHz)용 저잡음증폭기를 저항 결합회로를 사용하여 구현하였다. 사용된 저항 결합회로는 반사되는 전력이 정합 회로내의 저항에서 소모되므로 반사계수가 작아지고, 안정도도 개선되며, 또한 저잡음증폭기의 설계시 입력단 정합이 용이하였다. 저잡음증폭기의 구현에는 GaAs FET인 ATF-10136과 내부정합된 MMIC인 VNA-25를 이용하였으며, 알루미늄 기구물 안에 초고주파 회로와 자기 바이어스 회로를 함께 장착시켰다. 이렇게 제작된 저잡음증폭기는 32 dB의 이득, 0.8 dB 이하의 잡음지수와 18.6 dBm의 P1dB 출력을 얻었다.

• 한국인터넷방송통신학회논문지
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• 제23권4호
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• pp.137-142
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• 2023

SMPS(Switched Mode Power Supply, 전력공급장치) 회로설계 시 특별한 고찰 없이 지나치기 쉬운 부분이 스너버(snubber) 회로이다. 그러나 스너버(snubber) 회로에 따른 SMPS의 성능저하 및 SET 전체에 미치는 영향은 결코 무시할 수 없다. 또한 스위칭시 피크치 전압과 전류로부터 소자를 보호하고 on/off 스위칭시 손실을 줄여주기 위하여 스위치 양단에 스너버(snubber) 회로를 부가해준다. 따라서 본 논문에서는 스너버(snubber) 회로에 대한 충분한 이해를 위해 이론적 해석 및 실제 회로설계 때 설계자가 응용할 수 있는 실험식을 정리하여, 스너버(snubber) 회로의 최적화를 도모하고자 한다.