We present an all-fiberized power-scalable, sub-nanosecond mode-locked laser based on a frequency-shifted-feedback ring cavity comprised of an erbium-doped fiber, a downshifting acousto-optic modulator (AOM), and a bandpass filter (BPF). With the aid of the frequency-shifted feedback mechanism provided by the AOM and the narrow filter bandwidth of 0.45 nm, we generate self-starting, mode-locked optical pulses with a spectral bandwidth of ~0.098 nm and a pulsewidth of 432 to 536 ps. In particular, the output power is readily scalable with pump power while keeping the temporal shape and spectral bandwidth. This is obtained via the consolidation of bound pulse modes circulating at the fundamental repetition rate of the cavity. In fact, the consolidated pulses form a single-entity envelope of asymmetric Gaussian shape where no discrete internal pulses are perceived. This result highlights that the inclusion of the narrow BPF into the cavity is crucial to achieving the consolidated pulses.
본 논문에서는 단락 전송점을 갖는 소형 유전체 필터의 설계 방법을 제안한다. 이 방법은 회로망 변환을 이용하여 저지대역내에 감쇄극을 두는 방법으로 기존의 극점 합성 방법과 비교할 때 간단하면서도 빠른 설계를 할 수 있다. 또한 필터의 EM 결함 pattern의 설계의 문제점인 field simualtor의 계산시간을 줄이는 효과적인 설계방법을 제안한다. 이 방법은 집중회로영역과 EM영역사이에 선형 변환함수를 이용하고 회로영역에서 최적화를 수행하여 설계시간을 대폭 절약하였다. 감쇄극 필터의 예로 1900MHz대역에서 단락전송을 갖는 협대역 필터를 설계하고 제작하였다.
Super-RENS(super-resolution near-field structure) read-out 신호는 비선형 채널을 겪으면서 ISI(inter-symbol interference)의 영향으로 신호가 변형된다. 본 논문에서는 등화기의 측면에서 super-RENS 신호에 나타나는 비대칭성과 domain bloom 특성에 대해 살펴본다. Domain bloom은 광 레코드의 기록 과정에서 발생한다. 본 연구에서는 비대칭 심벌 변환 방식을 이용하여 비대칭 심벌들을 생성하며, 비선형 심벌과 선형 FIR(finite impulse response) 필터로 read-out 채널을 모델링한다. 이러한 비선형 채널의 등화는 채널의 선형 FIR 필터의 역필터를 찾은 다음 역필터로 등화된 신호를 심볼 변환 방식으로부터 전개된 결정 방식 테이블에 기초하여 판별하는 과정으로 진행된다. 제안하는 등화기를 raw BER(bit error ratio)의 관점에서 모의실험과 실제 super-RENS read-out 신호를 이용하여 분석하였다.
바이오 의약품 생산과정의 대부분 공정에서 분리막이 사용되고 있다. 분리막 공정은 다른 공정의 전처리, 공정 자체의 불순물 분리, 바이러스 제거, 목표 생성물 농도 조절 및 완충 용액 교환 등에 사용된다. 인체에 사용하는 바이오 의약품의 바이러스 오염은 심각한 임상 결과와 직결되는 민감한 문제이기 때문에 바이러스 필터는 제품의 효능과 안정성을 보장하기 위해 중요한 역할을 한다. 바이러스 필터는 일반적으로 표면 개질된 PVDF, PES, CRC 등 다양한 고분자로 만들어진 복합다층 구조를 가지고 있다. 제조업체에 따라 대칭(symmetric) 또는 비대칭(asymmetric) 등 다른 기공 구조와 형태를 가지고 있으며, 주름막, 평판 시트 또는 중공사 형태로 사용된다. 바이러스 필터는 Asahi Kasei 를 비롯해 Millipore, Pall, Sartorius 등 몇몇 해외 업체들이 독점적으로 국내에 공급하고 있다. 바이러스 필터를 대체하려면 검증작업을 통해 규제기관의 승인을 받는 등 상당한 시간과 비용이 소요된다. 최근 일본의 수출규제로 국산화가 중요해진 만큼 제거 성능 고도화 등 선제적으로 기술자립도를 높여가야 한다.
본 논문에서는 높은 효율의 GMR(guided-mode resonant) 컬러 필터를 제안하고 구현하였다. GMR 컬러 필터는 서로 보완적인 고정 격자와 이동 격자가 포함한 $Si_3N_4/air$ 층으로 구성하였다. 제안한 소자는 정확한 등가 전송선로 이론(RETT)에 기초한 수치 해석과 서브 파장 대역에서 동작하는 격자구조를 사용하여 설계하였다. 수치해석 결과, GMR 컬러 필터는 $0.45{\mu}m{\sim}0.55{\mu}m$ 범위에서 blue-green 컬러에 대하여 그리고 $0.6{\mu}m{\sim}0.7{\mu}m$ 범위에서 red 컬러에 대하여 약 35 nm의 동조특성을 보였다. 또한, 컬러 필터는 blue, green 그리고 red 컬러의 중심 주파수에서 각각 99%, 98%, 99%의 효율을 가지고 약 8 nm의 대역폭을 나타내었으며, 앞선 논문들에서 보고된 내용보다 더 높은 효율을 보여주었다.
Mokhtari, M.;Golshannavaz, S.;Nazarpour, D.;Aminifar, F.
Journal of Electrical Engineering and Technology
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제6권3호
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pp.293-301
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2011
This paper presents a novel theoretical method based on power analysis to obtain voltage reference values for an inverter-based compensator. This type of compensator, which is installed in parallel with the load, is usually referred to as the active filter. The proposed method is tailored to design the compensator in such a way that it can simultaneously balance the asymmetric load, as well as correct the power factor of the supply side. For clarity, a static compensator is first considered and a recursive algorithm is utilized to calculate the reactance values. The algorithm is then extended to calculate voltage reference values when the compensator is inverter based. It is evident that the compensator would be asymmetric since the load is unbalanced. The salient feature associated with the proposed method is that the circuit representation of system load is not required and that the load is recognized just by its active and reactive consumptions. Hence, the type and connection of load do not matter. The validity and performance of the new approach are analyzed via a numerical example, and the obtained results are thoroughly discussed.
In the paper, a new Constraint algorithm is proposed to solve the fan-in problem occurred in the encoding circuitry of an ADC. The Flash ADC architecture uses a Double-Base Number System(DBNS). The DBNS has been known to represent the Multidimensional Logarithmic Number System (MDLNS) used for implementing the multiplier accumulator architecture of FIR filter in Digital Signal Processing (DSP) applications. The authors use the DBNS with the base 2 and 3 in designing ADC encoder circuits, which is called as Double Base Integer Encoder(DBIE). A symmetric map is analyzed first, and then asymmetric map is followed to provide addition ready DBNS for DSP circuitry. The simulation results of the DBIE circuits in 6-bit and 8-bit ADC show the effectiveness of the Constraint algorithm with $0.18{\mu}m$ CMOS technology. The DBIE yields faster processing speed compared to the speed of Fat Tree Encoder (FAT) circuits by 17% at more power consumption by 39%.
Recently, as the fine dust is increased and the emission regulations of diesel engines are strengthened, interest in diesel soot filtration devices is rapidly increased. In particular, there is a demand for technology development for higher efficiency of diesel exhaust gas after-treatment devices. As part of this, many studies conducted to increase the exhaust gas treatment efficiency by improving the flow uniformity of the exhaust gas in the DPF and reducing the pressure drop between the inlet and outlet of disel particle filter (DPF). In this study, computational fluid dynamics (CFD) simulation was performed when exhaust gas flows into the canning reduction device equipped with a 13" asymmetric DPF in order to maintain the flow uniformity in the diesel exhaust system and reduce the pressure. In particular, a study was conducted to find the geometry with the smallest pressure drop and the highest flow uniformity by simulating the DPF I/O ratio, exhaust gas temperature, inlet-outlet pressure and flow uniformity according to the geometry and hole size of distributor.
본 논문에서 2008년에 발사될 통신해양기상 위성탑재용 Ka 대역 멀티플렉서의 인증모델 결과를 보였다. 이들은 위성통신에서 주파수 자원을 효율적으로 사용하기 위한 위성중계기용 입력 및 출력 멀티플렉서와 반사판 안테나를 송수신 대역에서 공용으로 상요하기 위한 급전용 다이플렉서이다. 4개의 주파수채널을 지닌 중계기 입력부에서 사용되는 입력 멀티플렉서는 높은 주파수 선택도 특성을 지닌 협대역 8차 타원형 필터와 2차 군지연등화기를 갖는 독립 채널 필터들로 이루어져 있다. 출력 멀티플렉서는 저손실 특성을 갖고, 무게 및 부피가 적은 매니폴드 형태가 이용되었다. 급전부에 사용되는 다이플렉서의 송수신 포트는 E 평면 T 접합부를 이용하여 분기되었고, 수신부 필터는 튜닝이 용이하도록 비대칭 유도성 아이리스를 이용한 필터가 적용되었다. 제작된 인증모델 멀티플렉서들은 요구 규격에 맞도록 전기적 성능시험, 진동시험, 기계적 충격시험, 열진공 시험, EMC 시험 등이 실시되었고, 시험결과 비행모델에 적용 가능한 성능을 보였다.
본 논문에서는 2차 전역통과 필터를 이용하여 입력정합을 수행하고, LC 병렬공진 회로를 이용하여 트랜지스터의 출력 리액턴스를 최소화하는 기법을 적용함으로써 2~6 GHz에서 동작하는 광대역 GaN 전력증폭기 MMIC를 설계 및 제작하였다. 광대역 손실정합을 위해 사용된 2차 전역통과 필터는 트랜지스터의 채널 저항 효과를 보상하기 위해 비대칭적 구조를 사용하였다. Win Semiconductors사의 $0.25{\mu}m$ GaN HEMT 파운드리 공정으로 제작된 MMIC 칩은 크기가 $2.6mm{\times}1.3mm$이며, 주파수 대역 내에서 약 13 dB의 평탄한 이득 특성과 10 dB 이상의 우수한 입력정합 특성을 보였다. 포화출력 조건에서 측정된 출력전력은 2~6 GHz에서 38.6~39.8 dBm의 값을 보였고, 전력부가효율은 31.3~43.4 %을 나타내었다.
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[게시일 2004년 10월 1일]
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