• The Transactions of the Korea Information Processing Society
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• v.6 no.6
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• pp.1656-1666
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• 1999

The more complex and large digital circuits become, the more important delay test becomes which guarantees that circuits operate in time. In this paper, the proposed algorithm is developed, which enable the fast indirect implication for efficient test pattern generation in sequential circuits of standard scan environment. Static learning algorithm enables application of a new implication value using contrapositive proposition. The static learning procedure found structurally, analyzes the gate structure in the preprocessing phase and store the information of learning occurrence so that it can be used in the test pattern generation procedure if it satisfies the implication condition. If there exists a signal line which include all paths from some particular primary inputs, it is a partitioning point. If paths passing that point have the same partial path from primary input to the signal or from the signal to primary output, they will need the same primary input values which separated by the partitioning point. In this paper test pattern generation can be more effective by using this partitioning technique. Finally, an efficient delay fault test pattern generator using indirect implication is developed and the effectiveness of these algorithms is demonstrated by experiments.

• Journal of the Institute of Electronics and Information Engineers
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• v.50 no.5
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• pp.102-111
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• 2013

In this paper, we proposed a $4{\times}4$ block parallel architecture of interpolation for high-performance H.264/AVC Motion Compensation in 4K UHD($3840{\times}2160$) video real time processing. To improve throughput, we design $4{\times}4$ block parallel interpolation. For supplying the $9{\times}9$ reference data for interpolation, we design 2D cache buffer which consists of the $9{\times}9$ memory arrays. We minimize redundant storage of the reference pixel by applying the Search Area Stripe Reuse scheme(SASR), and implement high-speed plane interpolator with 3-stage pipeline(Horizontal Vertical 1/2 interpolation, Diagonal 1/2 interpolation, 1/4 interpolation). The proposed architecture was simulated in 0.13um standard cell library. The maximum operation frequency is 150MHz. The gate count is 161Kgates. The proposed H.264/AVC Motion Compensation can support 4K UHD at 72 frames per second by running at 150MHz.

• Journal of the Korea Academia-Industrial cooperation Society
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• v.17 no.10
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• pp.719-724
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• 2016

This paper describes the performance improvement of an inrush current limiter to prevent damage or malfunctions in power converters due to the inrush current. When the power converter of military radar is operated, the circuit breaker of the power converter is often activated because the overcurrent flows through the circuit breaker of the power converter. Therefore, this study performed a cause analysis of the problem, which is a larger current flow than the intended current(250A). The operation principle of an inrush current limiter and SCR (Silicon Controlled Rectifier) used in the inrush current limiter was analyzed. As a result, the overcurrent flow through the circuit breaker was found to be due to dv/dt triggering of SCR. Based on cause analysis, this paper proposes a technique by adding the resistor in front of the SCR to prevent an unnecessary inrush current. Finally, the effectiveness of the improvement was verified by measuring the output current in the inrush current limiter. The power converter equipped with the improved inrush current limiter operated for more than 1 year without the circuit breaker of the power converter being activated.

• Journal of the Korea Convergence Society
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• v.9 no.11
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• pp.263-269
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• 2018

Asan Oeam village is a town that has been formed since about 500 years ago. It is a folk village centered on Yean Lee and designated as National Folk Cultural Property No. 236. However, the original shape of the thatch, which has regional characteristics, is disappearing. Therefore, I want to study the architectural characteristics of the house which is well preserved in the original shape. The Genjaegotaek is located in the center of the Oeam village. The composition of the house consists of a Munganchae, Salangchae, Anchae, Sadang. The Anchae is an 'ㄱ' shaped house, and it is shaped like a 'ㅁ' which is opened by facing. The wide yard in front of the Salangchae is made of strangely shaped rocks, a hundred-year-old pine, old pagodas, ponds, pavilion. Outside the main gate, there is an 'ㅡ' shape thatch on the west. The Galabjib of Geonjaegotaek is a servant house, and the shape is a ㄱ type. The plane remained well in its original shape, thatch is consisting of a kitchen-room-daecheong maru-room. A Galabjib of Geonjaegotaek can not represent all the thatch of a Oeam village. However, it is expected that this study will be used as a basic data when the study by the thatch in this area is conducted through the analysis of the type.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.45 no.12
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• pp.1-7
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• 2008

Magnetic Tunneling Junction (MTJ) has been used as a nonvolatile universal storage element mainly in memory technology. However, according to several recent studies, magneto-logic using MTJ elements show much potential in substitution for the transistor-based logic device. Magneto-logic based on MTJ can maintain the data during the power-off mode, since an MTJ element can store the result data in itself. Moreover, just by changing input signals, the full logic functions can be realized. Because of its programmability, it can embody the reconfigurable magneto-logic circuit in the rigid physical architecture. In this paper, we propose a novel 3-bit arbitrary magneto-logic circuit beyond the simple combinational logic or the short sequential one. We design the 3-bit magneto-logic which has the most complexity using MTJ elements and verify its functionality. The simulation results are presented with the HSPICE macro-model of MTJ that we have developed in our previous work. This novel magneto-logic based on MTJ can realize the most complex logic function. What is more, 3-bit arbitrary logic operations can be implemented by changing gate signals of the current drivel circuit.

• Information and Communications Magazine
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• v.14 no.12
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• pp.77-85
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• 1997

지금까지 access network에서의 xDSL의 위치를 살펴보고 DSL, HDSL, ADSL 및 VDSL을 중심으로 기술 및 최근의 표준화동향을 살펴보았다. ITU의 조사에 따르면 97년 기준으로 전세계 약 8억가구에 copper access line이 연결되어 있고 그중의 70%이상이 가정에 연결되어 있는데 증가추세도 북미의 경우 년3.5%, 서유럽과 태평양연안의 경우 년4.5%의 성장율을 보이고 있어 2000년경에는 10억가구에 다다를 전망이다. 미국은 97년기준 약 1억가구에 1억6000만 copper access line이 연결되어 있는데 Yankee Group이 조사한 바에 따르면 2000년을 기준으로 3백만가구에 ADSL/RADSL/SDSL이 연결되고 관련 revenue는 10억달러에 이를것으로 추산하고 있다. 전세계 xDSL 시장규모를 미국의 5배정도로 보면 2000년경에는 전세계 twist pair의 2%정도에 xDSL이 연결되어 ADSL/RADSL/SDSL 관련 세계시장규모가 50억달러에 이르고 시장성장률은 30%에 이를 것으로 보고 있다. 현재 이러한 xDSL의 표준화작업은 3장에서 언급한 바와 같이 ANSI T1, ETSI에서 주로 주도되고 있으나 ITU-T, IEEE, ADSL Forum, ATM Forum, DAVIC 등 다른 group과 활발한 liasion meeting 을 통해서도 협력안을 마련하려 노력하고 있다. 예를 들어 DAVIC은 long range(1.5Km이상) PMD규격으로 ADSL을, mid range($300m\sim1.5km$) PMD규격으로 VDSL을, short range(300m이하) PMD규격으로 CAP방식의 FTTC를 각각구정하여 xDSL을 수용하고 있다. Microsoft의 CEO인 Bill Gates가 'Bandwidth bottleneck. No question. that's the biggest obstacle.'이라고 천명한 바와 같이 정보사회로의 진전에 있어 bandwidth는 시급히 해결되어야 할 문제이다. 정보사회의 꿈을 실현하고자 1993년부터 시작된 In-formation Infrastructure의 구축노력이 그동안 다양하게 시도되어왔으나 숱한 우여곡절과 실패를 겪은 telco등의 서비스업자들이 이제는 너무 큰 꿈을 쫓기보다는 internet이라는 현실적인 시장에서 xDSL과 cablemodem을 바탕으로 차근차근 새로 시작하고 있다고 생각된다. 그동안 ADSL, Forum을 중심으로한 일부 technology evangelist들은 전세계 8억가구에 깔려있는 copper twist pair를 경제적인 'the last mile solution'으로 활용할 것을 줄기차게 주장해왔다. 그동안 xDSL은 VDSL이라는 차세대 대안을 제시하여 interim solution이라는 울타리를 벗어나는데 성공하였을 뿐만 아니라 IDSL, SDSL, RADSL등의 새로운 고객지향적 xDSL을 개발하여 선택의 폭을 넓혀주었다. xDSL vendor들간의 치열한 경쟁속에서 값싼 xDSL 시스템들이 속속 등장하고 있으며, DSLAM[8]과 같은 switch solution도 제시되어 기존의 copper twist pair를 이용해 값싸게 다양한서비스를 제공해 줄 수 있는 기틀을 마련한 것이 오늘날의 xDSL의 성공요인이라고 생각된다. 일찌기 Bell Atlantic의 CEO Ray Smith가 'Yes. ADSL is an interim solution that will be with us for forty years.'라고 간파한대로 xDSL은 fiber가 좀 더 값싼 해결책이 될 때까지 당분간 access network에서 확고한 자리를 구축할 것으로 보인다. 최근들어 우리나라의 초고속정보통신망도 ADSL 과 VDSL을 바탕으로 FTTH으로 진화하는 전략을 수립한것은 우리의 현실과 세계적인 추세를 반영한 일이라 여겨진다.

• Journal of the Korea Academia-Industrial cooperation Society
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• v.22 no.3
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• pp.415-421
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• 2021

This study analyzed the effect on the cooling performance of the channel shape of a heat sink for an insulated gate bipolar transistor (IGBT). A serpentine channel was used for this analysis, and the parameter for the analysis was the number of curves. The analysis was conducted using computational fluid dynamics with the commercial software ANSYS fluent. One curve in the channel improved the heat dissipation performance of the heat sink by up to 8% compared to a straight-channel heat sink. However, two curves in the channel could not improve the heat discharge performance further. Instead, the two curves caused a higher pressure drop, which induces parasitic loss for the pumping of coolant. The pressure drop of the two-curve channel case was 2.48-2.55 times larger than that of a one-curve channel. This higher pressure drop decreased the heat discharge efficiency of the heat sink with two curves. The discharge heat per unit pressure drop was calculated, and the result of the straight heat sink was highest among the analyzed cases. This means that the heat discharge efficiency of the straight heat sink is the highest.

• Proceedings of the Korean Vacuum Society Conference
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• 2016.02a
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• pp.259-259
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• 2016

반도체 산업 전반에 걸쳐 이루어지고 있는 연구는 소자를 더 작게 만들면서도 구동능력은 우수한 소자를 만들어내는 것이라고 할 수 있다. 따라서 소자의 미세화와 함께 트랜지스터의 구동능력의 향상을 위한 기술개발에 대한 필요성이 점차 커지고 있으며, 고유전(high-k)재료를 트랜지스터의 게이트 절연막으로 이용하는 방법이 개발되고 있다. High-k 재료를 트랜지스터의 게이트 절연막에 적용하면 낮은 전압으로 소자를 구동할 수 있어서 소비전력이 감소하고 소자의 미세화 측면에서도 매우 유리하다. 그러나, 초미세화된 소자를 제작하기 위하여 high-k 절연막의 두께를 줄이게 되면, 전기적 용량(capacitance)은 커지지만 에너지 밴드 오프셋(band-offset)이 기존의 실리콘 산화막(SiO2)보다 작고 또한 열공정에 의해 쉽게 결정화가 이루어지기 때문에 누설전류가 발생하여 소자의 열화를 초래할 수 있다. 따라서, 최근에는 이러한 문제를 해결하기 위하여 게이트 절연막 엔지니어링을 통해서 누설전류를 줄이면서 전기적 용량을 확보할 수 있는 연구가 주목받고 있다. 본 실험에서는 high-k 물질인 Ta2O5와 SiO2를 적층시켜서 누설전류를 줄이면서 동시에 높은 캐패시턴스를 달성할 수 있는 게이트 절연막 엔지니어링에 대한 연구를 진행하였다. 먼저 n-type Si 기판을 표준 RCA 세정한 다음, RF sputter를 사용하여 두께가 Ta2O5/SiO2 = 50/0, 50/5, 50/10, 25/10, 25/5 nm인 적층구조의 게이트 절연막을 형성하였다. 다음으로 Al 게이트 전극을 150 nm의 두께로 증착한 다음, 전기적 특성 개선을 위하여 furnace N2 분위기에서 $400^{\circ}C$로 30분간 후속 열처리를 진행하여 MOS capacitor 소자를 제작하였고, I-V 및 C-V 측정을 통하여 형성된 게이트 절연막의 전기적 특성을 평가하였다. 그 결과, Ta2O5/SiO2 = 50/0, 50/5, 50/10 nm인 게이트 절연막들은 누설전류는 낮지만, 큰 용량을 얻을 수 없었다. 한편, Ta2O5/SiO2 = 25/10, 25/5 nm의 조합에서는 충분한 용량을 확보할 수 있었다. 적층된 게이트 절연막의 유전상수는 25/5 nm, 25/10 nm 각각 8.3, 7.6으로 비슷하였지만, 문턱치 전압(VTH)은 각각 -0.64 V, -0.18 V로 25/10 nm가 0 V에 보다 근접한 값을 나타내었다. 한편, 누설전류는 25/10 nm가 25/5 nm보다 약 20 nA (@5 V) 낮은 것을 확인할 수 있었으며 절연파괴전압(breakdown voltage)도 증가한 것을 확인하였다. 결론적으로 Ta2O5/SiO2 적층 절연막의 두께가 25nm/10nm에서 최적의 특성을 얻을 수 있었으며, 본 실험과 같이 게이트 절연막 엔지니어링을 통하여 효과적으로 누설전류를 줄이고 게이트 용량을 증가시킴으로써 고집적화된 소자의 제작에 유용한 기술로 기대된다.

• Proceedings of the Korea Water Resources Association Conference
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• 2005.05b
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• pp.1026-1030
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• 2005

조력발전 건설사업에서 우선적으로 고려되어야 할 사항은 조수간만에 의해 외해부와 조지부 사이를 이동하는 해수를 적절히 소통시키는 것이다. 예를 들어, 단조지 단류식 발전으로 창조시에 발전을 행할 경우, 발전을 행하면서 높아진 조지내의 수위를 다음 발전을 위해서 낮아진 외해수위를 이용하여 효과적으로 배수시키지 못하면 그 시설은 발전효율이 낮아지게 된다. 즉, 수문구조물의 목적은 주어진 조건 하에서 계획된 유량을 충분히 그리고 안전하게 배제시키는 것이다. 본 연구에서는 수문구조물에 대한 물받이의 길이와 경사의 변화에 의한 외해 조위와 시화호 수위차 조건에 따른 유량계수를 구해 배수능력을 검토하고자 하였다. 이를 위해 시화호를 실험대상으로 하여 수리모형을 1:25의 축척비로 제작하였다. 시화방조제를 기준으로 외해부의 조위와 조지부의 수위차를 8가지의 실험조건으로 한 연구를 수행하였다. 유량계수를 산정하기 위하여 8개 실험조건을 계획에서 제시된 수위-조위 조건에서 수위차 및 통수유량을 분배하여 결정하였고, 유량계수 산정식에 따라 상류 흐름 안정지점에서 유속-면적법에 의해서 유량을 측정하였다. 유속은 8개 지점에 대해서 측정하였고, 각 측정지점에서의 측선은 $3\~5$개이며, 측점은 $3\~4$점법으로 수행하였다. 시화호와 외해의 수위차가 1.011m일 때의 수문을 통과하는 유량을 비교한 결과 실험 II와 III의 통과유량은 각각 $1,571m^3/s$ 및 $1,515m^3/s$ 의서 실험 I 의 $587m^3/s$에 비해 통수능이 많이 개선되었음을 알 수 있다. 그림 1은 수위차별 유량곡선을 나타내는 것으로, 실험 II에서의 수문의 통수능이 실험 I의 통수능보다 크게 나타남을 알 수 있었다.>일 때가 밸브를 $60\%$와 $80\%$ 개폐시켰을 때보다 $0.3kg/cm^2,\;0.29kg/cm^2$ 낮게 나타나 밸브를 전체 개방 했을 때 관로내의 수압이 상수설계기준에 적합한 수압을 유지함을 알 수 있다. 상수관로 설계 기준에서는 관로내 수압을 $1.5\~4.0kg/cm^2$으로 나타내고 있는데 $6kg/cm^2$보다 과수압을 나타내는 경우가 $100\%$로 밸브를 개방하였을 때보다 $60\%,\;80\%$ 개방하였을 때가 더 빈번히 발생하고 있으므로 대상지역의 밸브 개폐는 $100\%$ 개방하는 것이 선계기준에 적합한 것으로 나타났다. 밸브 개폐에 따른 수압 변화를 모의한 결과 밸브 개폐도를 적절히 유지하여 필요수량의 확보 및 누수방지대책에 활용할 수 있을 것으로 판단된다.8R(mm)(r^2=0.84)$로 지수적으로 증가하는 경향을 나타내었다. 유거수량은 토성별로 양토를 1.0으로 기준할 때 사양토가 0.86으로 가장 작았고, 식양토 1.09, 식토 1.15로 평가되어 침투수에 비해 토성별 차이가 크게 나타났다. 이는 토성이 세립질일 수록 유거수의 저항이 작기 때문으로 생각된다. 경사에 따라서는 경사도가 증가할수록 증가하였으며 $10\% 경사일 때를 기준으로 $Ro(mm)=Ro_{10}{\times}0.797{\times}e^{-0.021s(\%)}$로 나타났다.천성 승모판 폐쇄 부전등을 초래하는 심각한 선천성 심질환이다. 그러나 진단 즉시 직접 좌관상동맥-대동맥 이식술로 수술적 교정을 해줌으로써 좋은 성적을 기대할 수 있음을 보여주었다.특히 교사들이 중요하게 인식하는 해방적

• Korean Journal of Ecology and Environment
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• v.39 no.1 s.115
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• pp.93-99
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• 2006

Primary productivity was determined by using $^{13}C$ tracer according to different cell size of phytoplank-ton through in situ incubation experiments in upper stream of the Lake Shihwa. The average concentration of chlorophyll a was 14 ${\mu}g\;L^{-1}$ demonstrating an eutrophic water. The ratio of POC/Chl-a was lower than 30, reflecting that the origin of organic matter might be mainly phytoplankton. The primary productivity was 93.9 mgC m^{-2}\;d^{-1}$ at St. 1, which was about 40-fold lower than the average value of the lake (3,972 mgC m^{-2}\;d^{-1}$) determined by Choi et al. (1997) before opening of gate but it was higher than the average primary productivity (3.98 mgC m^{-2}\;d^{-1}$) reported by KOWACO in 1993 before constructing dam. The fractionated size (20 ${\sim}$ 53 ${\mu}m$) of phytoplankton community account for 51% of total primary productivity, indicating the highest assimilation rate. This study suggest that $^{13}C$ tracer methodology should be applied as a useful approach for the water ecological research in the future.