We had designed thermally controlled superconducting switches using a general nonlinear optimized algorithm with constraints and tested its performance. Objective function was to minimize the total volume of the superconducting switch. And constraints were to have designed resistance in normal status and temperature. In order to compare performance of the optimized superconducting switch, we made another one which had geometrically different parameters but had same structure and resistance value when the superconductor part is normal status by heater. Objective function converged very rapidly. As result, volume of the adiabatic part and total volume of the switch were reduced to more than 70% and 30% respectively. Also, even if same heater power was supplied with NiCr wire heater, the optimized superconducting switch had very fast On-OFF switching performance comparing with unoptimized switch.
In this paper, we consider the simple redundant structures with the function of hardware based active/standby control. The system includes two switch modules. The switch module is connected to a data bus, but only the active switch module has control of the data bus. The standby unit takes over the function of the active unit when the active unit failure or mode command are asserted. And this paper illustrate the high-speed router system and the overall redundant system architecture. The proposed redundant architecture for 80G Router system is verified and implemented with experiment.
In this study, We developed the microprocessor based controller for Auto Section Switch(ASS). This is installed at consumer's medium-high voltage(load capacity is below 4,000 kVA) switchgear. This function is cooperate with protection device of fault section and automatically dividing the section. And It is designed by Air putter type extinction structure and adopt the mechanism and breaking part module of existing Load Breaker Switch. In addition, We successfully conducted the operation test and checked main function of proto-type.
Theoretical average current and rms current equations are solved using the analytical method in the 3phase voltage-fed inverter. Experimental switch current equations are established by simulation and compared with theoretical equations. As a result of analysis, average and rms currents of switch devices are represented by a function as power factor and modulation index. Especially, equations of this paper are represented as a function of a single factor(K) equal to the product of the power factor and modulation index. Method that can find current levels of switch devices for inverter design and conduction loss of inverter in a simple and accurate manner is presented. Influences of modulation method on switch current are also studied.
Pan, Lei;Zhang, Junru;Wang, Kai;Wang, Beibei;Pang, Yi;Zhu, Lin
Journal of Power Electronics
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제18권1호
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pp.1-10
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2018
Recently, the nine-switch inverter has been proposed as a dual output inverter. To date, studies on the control strategies for NSIs have been mostly combined with their application. However, in this paper, a mathematical model and control strategy for nine-switch inverters has been proposed in view of the topology. A switching function model and equivalent circuit model of a nine-switch inverter have been built in ${\alpha}{\beta}$ coordinates. Then, a novel current observer with an improved integrator is proposed based on the switching function model, and a direct power control strategy is proposed. No current sensors are used in the proposed strategy, and only two voltage sensors are employed. The performance of the proposed control method is verified by simulation and experimental results.
멀티캐스트 트래픽의 특징은 한 노드에서 특정 다수노드로 셀을 전송하는 방법으로써 ATM 스위치의 중요한 기능으로 부각되고 있다. 그러나, 기존에 나와 있는 point-to-point 스위치로 멀티캐스트 기능을 수행할 경우 멀티캐스트 셀 뿐만 아니라 유니캐스트 셀도 복사망을 통과하게 되어 복사망에서 추가적인 부하가 발생된다. 이 추가적인 부하로 인하여 멀티캐스트 셀이 다른 셀과의 충돌로 셀이 손실되는 데드락 현상이 발생하여 전체 스위치 성능을 현저히 감소시킨다. 또한 입력 저장 스위치 (Input queued switch)구조는 전체 스위치의 성능을 저하시키는 HOL 블록킹(blocking)의 단점을 가지고 있다. 제안한 스위치 구조는 HOL 블록킹 및 데드락 현상을 줄이기 위하여 공유 메모리 스위치를 이용하였다. 스위치의 복잡도와 셀 처리 시간을 줄이고 처리율(throughput)의 향상을 위해 셀 형태에 따라 분리해서 경로 배정하는 방식과 제어부에서 최대 2N개의 셀들을 동시에 처리하는 스케줄링 기법을 이용하였다. 또한 특정 포트로 트래픽이 밀집되었을 때 발생하는 손실률을 줄이기 위하여 출력 메모리를 이용하였으며 메모리 효율성 향상을 위하여 입력 셀의 ?'?형태에 따라 셀들을 분리 저장하는 방식과출력 메모리에서 일정 시간이 지난 셀을 폐기하는 방식을 이용하였다. 제안한 스위치의 분석을 위하여 마코흐(Markov) 체인을 이용한 성능 해석을 실시하였고 버스트(burst) 트래픽 조건에서의 모의 실험을 통하여 제안한 방식과 기존의 방식간의 성능을 비교, 분석하였다.
한국식물학회 1998년도 The 12th Symposium on Plant Biotechnology Vol.12
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pp.83-96
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1998
The plant pigment proteins phytochromes are a molecular light sensor or switch for photomorphogenesis involving a variety of growth and developmental responses of plants to red and far-red wavelength light. Underscoring the photomorphogenesis mediated by phytochromes is the light signal transduction at molecular and cellular levels. For example, a number of genes activated by the phytochrome-mediated signal transduction cascade have been identified and characterized, especially in Arabidopsis thaliana. The light sensor/switch function of phytochromes are based on photochromism of the covalently linked tetrapyrrole chromophore between the two photoreversible forms, Pr and Pfr. The photochromism of phytochromes involves photoisomerization of the tetrapyrrole chromophore. The "photosensor" Pr-form ("switch off" conformation) of phytochromes strongly absorbs 660 nm red light, whereas the "switch on" Pfr-conformation preferentially absorbs 730 nm far-red light. The latter is generally considered to be responsible for eliciting transduction cascades of the red light signal for various responses of plants to red light including positive or negative expression of light-responsive genes in plant nuclei and chloroplasts. In this paper, we discuss the structure-function of phytochromes in plant growth and development, with a few examples of biotechnological implications.
In this paper, we propose the improved structure of fully interconnected ATM Switch to develop the small sized switch element and represent practical implementation of switch network. As the part II of the full study about structure and implementation of fully interconnected ATM Switch, this paper especially describes the implementation of an ATM switching element with 8 input port and 8 output port at 155 Mbits/sec each. The single board switching element is used as a basic switching block in a small sized ATm switch for ATM LAN Hub and customer access node. This switch has dedicated bus in 12 bit width(8 bit data + 4 bit control signal) at each input and output port, bit addressing and cell filtering scheme. In this paper, we propose a practical switch architecture with fully interconnected buses to implement a small-sized switch and to provide multicast function withoutany difficulty. The design of switching element has become feasible using advanced CMOS technology and Embedded Gate Array technology. And, we also represent Application Specific Integrated Circuit(ASIC) of Switch Output Multiplexing Unit(SOMU) and 12 layered Printed Circuit Board for interconnection network of switch.
본 논문은 완전 결합형 ATM 스위치의 성능 분석에 관한 연구결과를 제시하고자 한 내용의 II부로서, 버스티 트래픽 및 비균일 분포에 대한 성능 분석 결과를 포함하고 있다. 사용한 스위치 모델은 ETRI에서 제안한 완전 결합형 ATM 스위치로써 비교적 소규모용으로 설계되었으며 트래픽의 버스트 특성을 효과적으로 홉수하기 위해 2단 버퍼링 구조를 사용하며, 주소 기법은 비트 어드레싱 방식을 사용하여 별도의 기능 블럭 추가없이 멀티캐스팅 기능 구현을 용이하게 하였다. 모의실험을 위해 입력 트래픽 모델은 트래픽의 군집적(bursty) 성질을 포착할 수 있는 IBP 모델과 기존의 트래픽 모델로 사용되어 온 랜덤 트래픽 모델을 고려하였다. 또한 다양한 시나리오 구성을 위해 출력 포트 분포는 균일과 비균일 둘 다를 고려하고 멀티캐스팅 기능도 구현하였다. 본 논문에서는 다양한 환경 하에서 수행한 모의실험 결과를 제시하고 성능 분석을 수행하였다.
Avionic databuses fulfill a critical function in the connection and communication of aircraft components and functions such as flight-control, navigation, and monitoring. Ethernet-based avionic databuses have become the mainstream for large aircraft owning to their advantages of full-duplex communication with high bandwidth, low latency, low packet-loss, and low cost. As a new generation aviation network communication standard, avionics full-duplex switched ethernet (AFDX) adopted concepts from the telecom standard, asynchronous transfer mode (ATM). In this technology, the switches are the key devices influencing the overall performance. This paper reviews the avionic databus with emphasis on the switch architecture classifications. Based on a comparison, analysis, and discussion of the different switch architectures, we propose a new avionic switch design based on a time-division switch fabric for high flexibility and scalability. This also merges the design concept of space-partition switch fabric to achieve reliability and predictability. The new switch architecture, called space partitioned shared memory switch (SPSMS), isolates the memory space for each output port. This can reduce the competition for resources and avoid conflicts, decrease the packet forwarding latency through the switch, and reduce the packet loss rate. A simulation of the architecture with optimized network engineering tools (OPNET) confirms the efficiency and significant performance improvement over a classic shared memory switch, in terms of overall packet latency, queuing delay, and queue size.
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[게시일 2004년 10월 1일]
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