Cobalt silicidation at sidewall spacer edge of Metal-Oxide-Semiconductor Field-Effect Transistors (MOSFETs) with post annealing treatment for capacitor forming process has been investigated as a function of dopant species. Cobalt silicidation of nMOSFET with n-type Lightly Doped Drain (LDD) and pMOSFET with p-type LDD produces a well-developed cobalt silicide with its lateral growth underneath the sidewall spacer. In case of pMOSFET with n-type LDD, however, a void is formed at the sidewall spacer edge with no lateral growth of cobalt silicide. The void formation seems to be due to a retarded silicidation process at the LDD region during the first Rapid Thermal Annealing (RTA) for the reaction of Co with Si, resulting in cobalt mono silicide at the LDD region. The subsequent second RTA converts the cobalt monosilicide into cobalt disilicide with the consumption of Si atoms from the Si substrate, producing the void at the sidewall spacer edge in the Si region. The void formed at the sidewall spacer edge serves as a resistance in the current-voltage characteristics of the pMOSFET device.
Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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1998.06a
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pp.235-238
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1998
Ferroelectric $LiNbO_3$ thin films were grown directly on Si(100) substrates by 13.55MHz RF magnetron sputtering system using a ceramic target ($Nb_2O_5/Li_2C0_3$ = 51.4/48.6). Because high temperature process have to avoided to prevent degradation of the interface (insulator/Si), $LiNbO_3$ thin films were deposited below $300^{\circ}C$. After as-deposited films were performed RTA treatments in an oxygen ambient at $600^{\circ}C$ for 60s, electrical measurements performed films before and after anneal treatment. In high field region, the leakage current density of the films after annealing was deceased about 4order and the resistivity of these was increased to about 5\times 10^{11} \Omega \cdot cm$ at 500kV/cm. In accumulation region of C-V curve, we calculated dielectric constant of thin film $LiNbO_3$ as 27.9 which is close to that of bulk value.
Flexible opto-electronic devices are developed on the insulating layer deposited stainless steel (STS) substrates. The silicon dioxide ($SiO_2$) material as the diffusion barrier of Fe and Cr atoms in addition to the electrical insulation between the electronic device and STS is processed using the plasma enhanced chemical vapor deposition method. Noble silver (Ag) films of approximately 100 nm thickness have been formed on $SiO_2$ deposited STS substrates by E-beam evaporation technique. The films then were annealed at $650^{\circ}C$ for 20 min using the rapid thermal annealing (RTA) technique. It was investigated the variation of the surface morphology due to the interaction between Ag films and $SiO_2$ layers after the RTA treatment. The results showed the movement of Si atoms in silver film from $SiO_2$. In addition, the structural investigation of Ag annealed at $650^{\circ}C$ indicated that the Ag film has the material property of p-type semiconductor and the bandgap of approximately 1 eV. Also, the films annealed at $650^{\circ}C$ showed reflection with sinusoidal oscillations due to optical interference of multiple reflections originated from films and substrate surfaces. Such changes can be attributed to both formation of $SiO_2$ on Ag film surface and agglomeration of silver film between particles due to annealing.
Proceedings of the Korea Association of Crystal Growth Conference
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1998.06a
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pp.145-148
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1998
Fluoride({{{{ { CaF}_{2 } }}}}) films exhibited a cubic structure with similar lattice constant to that of Si and have sufficient breakdown electric field as gate dielectric material. Therefore, {{{{ { CaF}_{2 } }}}} are expected to replace conventional insulator such {{{{ { SiO}_{ 2},{Ta}_{2}{O}_{ 2} and{Al}_{2}{O}_{5}. However, {CaF}_{2}}}}} films showed hystereisis properties due to mobile charges in the film. To solve this problem we performed thermal treatment and achieves field. C-v results indicate a reduced hystereisis window of {{{{ }}}}ΔV =0.2v, LOW INTERFACE STATE {{{{{D}_{it}=2.0 TIMES {10}^{11}{cm}^{-1}{eV}^{-1}}}}} in midgap, and good WIS diode properties. We observed a preferential crystallization of(200) plane from XRD analysis. RTA treatment effects on various material properties of {{{{{CaF}_{2}}}}} are presented in this paper.
The reliability of fluorine doped silicon oxide (SiOF) films for intermetal dielectrics in multilevel interconnections of ultra-large scale integrated circuits (ULSIs) is investigated. SiOF films were deposited by electron cyclotron resonance plasma-enhanced chemical vapor deposition (ECRPECVD) using H-free source gases, i.e., SiF4 and O2. The effect of post plasma treatment on the moisture absorption and dielectric properties of SiOF films was carried out I terms of air exposure time, The reliability test of Cu/TiN/SiOF/Fi specimen was carried out in terms of temperature by rapid thermal annealing (RTA) in N2 ambient. After O2 plasma treatment,, no appreciable peak directly related to moisture absorption was detected. The capacitance-voltage (C-V) characteristics of the O2 plasma treated SiOF film showed that the film remained to hold the sound dielectric properties even after boiling treatment. The Cu/TiN/SiOF/Si system was found to be reliable up to $600^{\circ}C$.
Ti-silicide was deposited by sputtering the composite target($TiSi_{2.6}$) on single-Si wafers and oxide on them. The heat treatment temperatures by rapid thermal annealing(RTA) have been varied in the range of $600-850^{\circ}C$ for 20seconds. It was not until RTA temperature was $800^{\circ}C$ that a stable $TiSi_2$ was formed, and the value of resistivity of that phase was $27~29{\mu}{\Omega}-cm$, which seems a little higher than that formed by the reactive method. The result of x-ray diffraction peals showed that till $750^{\circ}C$, C49 $TiSi_2$ phase was dominant, but at $800^{\circ}C$, at last, the phase was transformed into a stable C54 $TiSi_2$ phase. And, the result of x-ray photoeletron spectroscopy(XPS) measurements showed that the composition ratio of Ti and Si was 2 1 in the case of specimens treated at $800^{\circ}C$, The surface roughness of $TiSi_2$, which was condidered a weak point, was improved to a superior value of $17{\pm}1nm$, therefore increasing the possibility of applying $TiSi_2$ to semiconductor devices.
We have studied the effect of heat treatment of multi-walled carbon nanotubes (MWNTs) as a counter electrode on the electro-chemical properties of dye-snsitized solar cells. MWNTs on the p-type Si substrate were synthesized by thermal chemical vapor deposition (CVD) using Fe catalysts. We prepared the two types of MWNTs samples with the different diameters. The rapid thermal annealing (RTA) treatment for the MWNTs was carried out at the growth temperature ($900^{\circ}C$) for 1 minute with $N_2$ gas atmosphere. The structural, electrical and electrochemical properties of MWNTs were investigated by field-emission scanning electron microscopy (FE-SEM), Raman spectroscopy, 2-point probe station and electrochemical impedance spectroscopy (EIS). The I(D)/I(G) ratio of heat-treated MWNTs in Raman spectra was considerably decreased. It was also found that the heat-treated MWNTs showed better redox reaction of iodide at the interface between MWNTs surface and electrolyte than that of as-grown MWNTs. The redox resistance value of heat-treated electrodes was measured to be much lower than that of as-grown electrode at the interface. As a result, the counter electrode using the heat-treated MWNTs showed better electrochemical properties.
$SrBi_2Ta_2O_9(SBT)$and$ZrO_2$thin films for MFIS structure(Metal-Ferroelectric-Insulator-Semiconductor) were deposited by RF magnetron sputtering method. In order to investigate the effect of heat treatment of insulator layers and MFIS structure, the insulator layers were heat treated from $550^{circ}C;to; 850^{\circ}C$in conventional furnace or RTA furnace under$O_2$and Ar ambient, respectively. After then, C-V characteristics and leakage current were measured. The capacitor with 20 nm thick $ZrO_2$layer treated at RTA$750^{circ}C;in;O_2$ atmosphere had the largest memory window. The C-V and leakage current characteristics of the$Pt/SBT(260nm)/ZrO_2(20nm)/Si$structure were better than those of$Pt/SBT(260nm)/Si$ structure. These results showed that$ZrO_2$films took a role of buffer layer effectively.
Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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2002.07a
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pp.326-329
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2002
In this paper, we investigated a feasibility of cerium oxide(CeO$_2$) films as a buffer layer of MFIS(metal ferroelectric insulator semiconductor) type capacitor. CeO$_2$ layer were Prepared by two step process of a low temperature film growth and subsequent RTA (rapid thermal annealing) treatment. By app1ying an ultra thin Ce metal seed layer and N$_2$ Plasma treatment, dielectric and interface properties were improved. It means that unwanted SiO$_2$ layer generation was successfully suppressed at the interface between He buffer layer and Si substrate. The lowest lattice mismatch of CeO$_2$ film was as low as 1.76% and average surface roughness was less than 0.7 m. The Al/CeO$_2$/Si structure shows breakdown electric field of 1.2 MV/cm, dielectric constant of more than 15.1 and interface state densities as low as 1.84${\times}$10$\^$11/ cm$\^$-1/eV$\^$-1/. After N$_2$ plasma treatment, the leakage current was reduced with about 2-order.
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[게시일 2004년 10월 1일]
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