• 제목/요약/키워드: Photoresist-coating

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Maskless lithography 응용을 위한 마이크로렌즈 어레이 개발 (Development of Microlens Array for Maskless Lithography Application)

  • 남민우;오해관;김근영;서현우;위창현;송요탁;양상식;이기근
    • 마이크로전자및패키징학회지
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    • 제16권4호
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    • pp.33-39
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    • 2009
  • 마스크리스 리소그래피(maskless lithography)에 응용하기 위한 마이크로렌즈 어레이(microlens array, MLA)가 석영의 습식 식각과 UV 접착제(UV adhesive)의 코팅을 바탕으로 개발되었다. 제작된 MLA의 초점거리는 ${\sim}45\;{\mu}m$ 정도였으며, 집광되는 광선의 초점은 ${\sim}1\;{\mu}m$로 측정되었다. MLA를 통과하며 초점을 맺은 빔(beam)의 크기 및 세기가 charge coupled device (CCD) 카메라와 빔 프로파일러(beam profiler)를 이용하여 각각 측정되었으며, 일정한 세기의 점들이 초점면에서 고르게 관찰되었다. 초점거리는 코팅된 UV 접착제의 두께에 따라 변화하였으며, UV 접착제의 두께가 두꺼울수록 짧아지는 경향을 보였다. 일반적인 마스크 얼라이너(mask aligner)를 이용한 MLA의 UV 포커싱(UV focusing)이 감광막(photoresist, PR) 상에서 실시되었으며, MLA를 통과한 빛이 감광막 위에 일정하게 집광되었다. 마스크 얼라이너와 MLA 사이의 거리 변화에 따라 감광막에 구현된 패턴 사이즈가 조절 되었다. 고온에서 오랜 시간이 지난 후에도 소자의 특성은 전혀 변함이 없었다.

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Copper Interconnection and Flip Chip Packaging Laboratory Activity for Microelectronics Manufacturing Engineers

  • Moon, Dae-Ho;Ha, Tae-Min;Kim, Boom-Soo;Han, Seung-Soo;Hong, Sang-Jeen
    • 한국진공학회:학술대회논문집
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    • 한국진공학회 2012년도 제42회 동계 정기 학술대회 초록집
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    • pp.431-432
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    • 2012
  • In the era of 20 nm scaled semiconductor volume manufacturing, Microelectronics Manufacturing Engineering Education is presented in this paper. The purpose of microelectronic engineering education is to educate engineers to work in the semiconductor industry; it is therefore should be considered even before than technology development. Three Microelectronics Manufacturing Engineering related courses are introduced, and how undergraduate students acquired hands-on experience on Microelectronics fabrication and manufacturing. Conventionally employed wire bonding was recognized as not only an additional parasitic source in high-frequency mobile applications due to the increased inductance caused from the wiring loop, but also a huddle for minimizing IC packaging footprint. To alleviate the concerns, chip bumping technologies such as flip chip bumping and pillar bumping have been suggested as promising chip assembly methods to provide high-density interconnects and lower signal propagation delay [1,2]. Aluminum as metal interconnecting material over the decades in integrated circuits (ICs) manufacturing has been rapidly replaced with copper in majority IC products. A single copper metal layer with various test patterns of lines and vias and $400{\mu}m$ by $400{\mu}m$ interconnected pads are formed. Mask M1 allows metal interconnection patterns on 4" wafers with AZ1512 positive tone photoresist, and Cu/TiN/Ti layers are wet etched in two steps. We employed WPR, a thick patternable negative photoresist, manufactured by JSR Corp., which is specifically developed as dielectric material for multi- chip packaging (MCP) and package-on-package (PoP). Spin-coating at 1,000 rpm, i-line UV exposure, and 1 hour curing at $110^{\circ}C$ allows about $25{\mu}m$ thick passivation layer before performing wafer level soldering. Conventional Si3N4 passivation between Cu and WPR layer using plasma CVD can be an optional. To practice the board level flip chip assembly, individual students draw their own fan-outs of 40 rectangle pads using Eagle CAD, a free PCB artwork EDA. Individuals then transfer the test circuitry on a blank CCFL board followed by Cu etching and solder mask processes. Negative dry film resist (DFR), Accimage$^{(R)}$, manufactured by Kolon Industries, Inc., was used for solder resist for ball grid array (BGA). We demonstrated how Microelectronics Manufacturing Engineering education has been performed by presenting brief intermediate by-product from undergraduate and graduate students. Microelectronics Manufacturing Engineering, once again, is to educating engineers to actively work in the area of semiconductor manufacturing. Through one semester senior level hands-on laboratory course, participating students will have clearer understanding on microelectronics manufacturing and realized the importance of manufacturing yield in practice.

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광영상 발생을 위한 화소형 위상격자의 설계 및 제작 (Design of pixelated phase gratings for optical image generation)

  • 이득주;김남;이권연;은재정
    • 전자공학회논문지A
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    • 제33A권5호
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    • pp.132-141
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    • 1996
  • The pixelated phase grating has been studied as a kind of diffraction gratings splitting and input beam into multiple spots. It consists of regular size cells which produce phase delays, and each cell provokes the phase delay up to sixteen levels. We have compared and analyzed the characteristics of multi-level phase gratings, laying streess on efficiency and resulted pattern. Experimental resutls obtained form fabricated grating have been presented, and the real-time method using a liquid-crystal spatial light modulator has been demonstrated through experiments. Gratings making meams with specific intensities have been designed and optical images have been generated by them. In order to specific intensities have been designed and optical images have been genrated by them. In order to decide the phase delay of each cell, optimization conditon consists of diffraction efficiency and target values. One period of phase gratings fabricated with surface relief was less than 256${\mu}m{\times}256{\mu}m$ and size of each cell was 1${\mu}m{\times}1{\mu}m$ surface relief grating has been made by coating photoresist on the glass plate, writing information pattern by Ar laser and developing it. in the experiment for real-tiem processing liquid-crystal display of epson video projector has been used.

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대류성 자기조립법을 통한 폴리스티렌 비드 대면적 단일층 형성에 미치는 공정 변수 효과 (Effect of Processing Parameters on the Formation of Large Area Self-Assembled Monolayer of Polystyrene Beads by a Convective Self-Assembly Method)

  • 서안나;최지환;변재철;김원목;김인호;이경석
    • 한국재료학회지
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    • 제25권12호
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    • pp.647-654
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    • 2015
  • Self-assembled monolayers(SAM) of microspheres such as silica and polystyrene(PS) beads have found widespread application in photonic crystals, sensors, and lithographic masks or templates. From a practical viewpoint, setting up a high-throughput process to form a SAM over large areas in a controllable manner is a key challenging issue. Various methods have been suggested including drop casting, spin coating, Langmuir Blodgett, and convective self-assembly(CSA) techniques. Among these, the CSA method has recently attracted attention due to its potential scalability to an automated high-throughput process. By controlling various parameters, this process can be precisely tuned to achieve well-ordered arrays of microspheres. In this study, using a restricted meniscus CSA method, we systematically investigate the effect of the processing parameters on the formation of large area self-assembled monolayers of PS beads. A way to provide hydrophilicity, a prerequisite for a CSA, to the surface of a hydrophobic photoresist layer, is presented in order to apply the SAM of the PS beads as a mask for photonic nanojet lithography.

Self-patterning Technique of Photosensitive La0.5Sr0.5CoO3 Electrode on Ferroelectric Sr0.9Bi2.1Ta2O9 Thin Films

  • Lim, Jong-Chun;Lim, Tae-Young;Auh, Keun-Ho;Park, Won-Kyu;Kim, Byong-Ho
    • 한국세라믹학회지
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    • 제41권1호
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    • pp.13-18
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    • 2004
  • $La_{0.5}Sr_{0.5}CoO_3$ (LSCO) electrodes were prepared on ferroelectric $Sr_{0.9}Bi_{2.1}Ta_2O_9$(SBT) thin films by spin coating method using photosensitive sol-gel solution. Self-patterning technique of photosensitive sol-gel solution has advantages such as simple manufacturing process compared to photoresist/dry etching process. Lanthanum(III) 2-methoxyethoxide, Stronitium diethoxide. Cobalu(II)2-methoxyethoxide were used as starting materials for LSCO electrode. UV irradiation on LSCO thin films lead to decrease solubility by M-O-M bond formation and the solubility difference allows us to obtain self-patternine. There was little composition change of the LSCO thin films between before leaching and after leaching in 2-methoxyethanol. The lowest resistivity of LSCO thin films deposited on $SiO_2$/Si substrate was $1.1{\times}10^{-2}{\Omega}cm$ when the thin film was ennealed at $740^{\circ}C$. The values of Pr/Ps and 2Pr of LSCO/SBT/Pt capacitor on the applied voltage of 5V were 0.51, 8.89 ${\mu}C/cm^2$, respectively.

Self-Patterning을 이용한 강유전체 $Sr_{0.9}Bi_{2.1}Ta_2O_9$와 산화물 전극 $La_{0.5}Sr_{0.5}CoO_3$의 박막 제조에 관한 연구 (A Study on Fabrication of $Sr_{0.9}Bi_{2.1}Ta_2O_9$ and $La_{0.5}Sr_{0.5}CoO_3$ Thin Films by Self-Patterning Technique)

  • 임종천;조태진;강동균;임태영;김병호
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2003년도 춘계학술대회 논문집 센서 박막재료 반도체 세라믹
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    • pp.116-119
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    • 2003
  • Self-patterning of thin films using photosensitive sol solution has advantages such as simple manufacturing process compared to photoresist/dry etching process. In this study, ferroelectric $Sr_{0.9}Bi_{2.1}Ta_2O_9$(SBT) and $La_{0.5}Sr_{0.5}CoO_3$(LSCO)thin films have been prepared by spin coating method using photosensitive sol solution. $Sr(OC_2H5)_2$, $Bi(TMHD)_3$ and $Ta(OC_2H)_5)_5$ were used as starting materials for SBT solution and $La(OCH_2CH_2OCH_3)_3$, $Sr(OC_2H_5)_2$, $CO(OCH_2CH_2OCH_3)_2$ were used for LSCO solution. Solubility difference by UV irradiation on LSCO thin film allows to obtain a fine patterning due to M-O-M bond formation. The lowest resistivity($4{\times}10^{-3}{\Omega}cm$) of LSCO thin films was obtained by annealing at $740^{\circ}C$.

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O2/SF6, O2/N2와 O2/CH4 플라즈마를 이용한 폴리카보네이트 건식 식각 (Dry etching of polycarbonate using O2/SF6, O2/N2 and O2/CH4 plasmas)

  • 주영우;박연현;노호섭;김재권;이성현;조관식;송한정;전민현;이제원
    • 한국진공학회지
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    • 제17권1호
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    • pp.16-22
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    • 2008
  • [ $O_2/SF_6$ ], $O_2/N_2$ 그리고 $O_2/CH_4$의 혼합 가스를 이용하여 폴리카보네이트의 플라즈마 식각을 연구하였다. 플라즈마 식각 장비는 축전 결합형 플라즈마 시스템을 사용하였다. 폴리카보네이트 식각은 감광제 도포 후에 UV 조사의 포토리소그래피 방법으로 마스크를 제작하여 실험하였다. 본 식각 실험에서는 $O_2$와 다른 기체와의 혼합비와 RIE 척 파워 증가에 따른 폴리카보네이트의 식각 특성 연구를 중심으로 하였다. 특히 건식 식각 시에 사용한 공정 압력은 100 mTorr로 유지하였으며 공정 압력은 기계적 펌프만을 사용하여 유지하였다. 식각 실험 후에 표면 단차 측정기, 원자력간 현미경 그리고 전자 현미경 등을 이용하여 식각한 샘플을 분석 하였다. 실험 결과에 의하면 폴리카보네이트 식각에서 $O_2/SF_6$의 혼합 가스를 사용하면 순수한 $O_2$$SF_6$를 사용한 것보다 각각 약 140 % 와 280 % 정도의 높은 식각 속도를 얻을 수 있었다. 즉, 100 W RIE 척 파워와 100 mTorr 공정 압력을 유지하면서 20 sccm $O_2$의 플라즈마 식각에서는 약 $0.4{\mu}m$/min, 20 sccm의 $SF_6$를 사용하였을 때에는 약 $0.2{\mu}$/min의 식각 속도를 얻었다. 그러나 60 %의 $O_2$와 40 %의 $SF_6$로 혼합된 플라즈마 분위기에서는 20 sccm의 순수한 $O_2$에 비해 상대적으로 낮은 -DC 바이어스가 인가되었음에도 식각 속도가 약 $0.56{\mu}m$/min으로 증가하였다. 그러나 $SF_6$ 양의 추가적인 증가는 폴리카보네이트의 식각 속도를 감소시켰다. $O_2/N_2$$O_2/CH_4$의 플라즈마 식각에서는 $N_2$$CH_4$의 양이 각각 증가함에 따라 식각 속도가 감소하였다. 즉, $O_2$$N_2$$CH_4$의 혼합은 폴리카보네이트의 식각 속도를 저하시켰다. 식각된 폴리카보네이트의 표면 거칠기 절대값은 식각 전에 비해 $2{\sim}3$ 배정도 증가하였지만 전자현미경으로 표면을 관찰 하였을 때에는 식각 실험 후의 폴리카보네이트의 표면이 깨끗한 것을 확인할 수 있었다. RIE 척 파워의 증가는 -DC 바이어스와 폴리카보네이트의 식각 속도를 거의 선형적으로 증가시켰으며 이 때 폴리카보네이트의 감광제에 대한 식각 선택비는 약 1:1 정도였다. 본 연구의 의미는 기계적 펌핑 시스템만을 사용한 간단한 플라즈마 식각 시스템으로도 $O_2/SF_6$의 혼합 가스를 사용하면 폴리카보네이트의 미세 구조를 만드는데 사용이 가능하며 $O_2/N_2$$O_2/CH_4$의 결과에 비해 상대적으로 우수한 식각 조건을 얻을 수 있었다는 것이다. 이 결과는 다른 폴리머 소재 미세 가공에도 응용이 가능하여 앞으로 많이 사용될 수 있을 것으로 예상한다.

SU-8 패시베이션을 이용한 솔루션 IZO-TFT의안정성 향상에 대한 연구 (Stability Enhancement of IZOthin Film Transistor Using SU-8 Passivation Layer)

  • 김상조;이문석
    • 전자공학회논문지
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    • 제52권7호
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    • pp.33-39
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    • 2015
  • 본 연구에서는 SU-8을 절연층으로 사용해 솔루션 공정을 바탕으로 하여 Indium Zinc Oxide(IZO) thin film transistor(TFT)의 안정성을 향상에 대해 연구하였다. 매우 점성이 강하며 negative lithography 용으로 사용되는 SU-8은 기계적, 화학적으로 높은 안정도를 가진다. 그리고 이 SU-8을 사용해 TFT층의 위에 스핀코팅을 사용해 절연막 층을 쌓고 photo lithography를 이용해 patterning을 하였다. SU-8층에 의한 positive bias stress(PBS)에 대한 전기적 특성 향상의 이유를 연구하기 위해 TFT에 X-ray photoelectron spectroscopy(XPS), Fourier transform infrared spectroscopy(FTIR) 분석을 시행하였다. SU-8을 절연층으로 한 TFT는 좋은 전기적 특성을 보였으며, 전류점멸비, 전자이동도, 문턱전압, subthreshold swing이 각각 $10^6$, $6.43cm^2/V{\cdot}s$, 7.1V, 0.88V/dec로 측정되었다. 그리고 3600초 동안 PBS를 가할 시 ${\Delta}V_{th}$는 3.6V로 측정되었다. 그러나 SU-8 층이 없는 경우 ${\Delta}V_{th}$는 7.7V 였다. XPS와 FTIR을 분석한 결과, SU-8 절연층이 TFT의 산소의 흡/탈착을 차단하는 특성에 의해 PBS에 강한 특성을 나타나게 함을 확인하였다.