In this paper, the design of robust DSC-PLL(Delayed Signal Cancellation Phase Locked Loop) is proposed for coping with frequency variation. This method shows significant performance for detection of fundamental positive sequence component voltage when the grid voltage is polluted by grid unbalance and frequency variation. The feedback frequency estimation of DSC-PLL is tracking the drift in the phase by unbalance and frequency variation. The robust DSC PLL is to present the analysis on method and performance under frequency variations. These compensation algorithms can correct for discrepancies of changing the frequency within maximum 193[ms] and improve traditional DSC-PLL. Linear interpolation method is adopted to reduce the discretized errors in the digital implementation of the PLL. For verification of robust characteristic, PLL methods are implemented on FPGA with a discrete fixed point based. The proposed method is validated by both Matlab/Simulink and experimental results based on FPGA(XC7Z030).
대한용접접합학회 2002년도 Proceedings of the International Welding/Joining Conference-Korea
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pp.803-808
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2002
A computer-aided alloy-designing technique to develop the insert metal for transient liquid phase (TLP) bonding was applied to high aluminum Ni-base superalloys. The main procedure of a mathematical programming method was to obtain the optimal chemical composition through rationally compromising the plural objective performances of insert metal by a grid-search which involved data estimation from the limited experimental data using interpolation method. The objective function Z which was introduced as an index of bonding performance of insert metal involved the melting point, hardness (strength), formability of brittle phases and void ratio (bonding defects) in bond layer as the evaluating factors. The contour maps of objective function Z were also obtained applying the interpolation method. The compositions of Ni-3.0%Cr-4.0%B-0.5%Ce (for ${\gamma}$/${\gamma}$/${\beta}$ type alloy) and Ni3.5%Cr-3.5%B-3%Ti (for ${\gamma}$/${\gamma}$ type alloy) which optimized the objective function were determined as insert metal. SEM observations revealed that the microstructure in bond layers using the newly developed insert metals indicated quite sound morphologies without forming microconstituents and voids. The creep rupture properties of both joints were much improved compared to a commercial insert metal of MBF-80 (Ni-15.5%Cr-3.7%B), and were fairly comparable to those of base metals.
가압 경수로의 주요 기기에서 발생할 수 있는 과도 2상 유동(Two-phase flow) 현상에 대한 해석을 수행하기 위해 원자로 기기 열수력 해석 코드를 개발 중에 있다. 개발 중인 기기 열수력 해석 코드는 지배 방정식으로 Two-phase, three-field model을 사용하고 있으며, 복잡한 기하학적 형상의 원자로 기기를 모사하기 위해 비정렬 격자계(Unstructured grid)를 활용하고 있다. 수치해석 기법으로는, 원자로 계통 해석코드 RELAP5가 사용 중이며 대부분의 원자로 내 2상 유동 조건에서 안정적이며 정확하다고 알려진 Semi-implicit 방법을 적용하였다. 그러나 기존의 Semi-implicit 방법은 1차원, 엇갈림격자(Staggered grid)에 대해 개발되었기 때문에, 이를 다차원, 비정렬, 비엇갈림 격자(Non-staggered grid)에 적용하기 위해 기존의 Semi-implicit 방법을 수정하였다. 본 논문에서는 Semi-implicit 방법의 대류항을 이차정확도를 갖도록 확장하였으며, 이차정확도에 의한 수치확산의 감소를 평가하기 위해 수행된 수치시험의 결과를 기술하였다. 이차정확도 및 일차정확도로 계산된 값을 해석해 또는 격자 수렴성 시험을 통해 평가해 본 결과, 이차정확도 계산시 수치 확산의 감소 확인하였다.
특정곡선을 고려한 ELM을 이송-확산방정식에 적용하여 그 결과를 Eulerian 기법(Stone-Brian, QUICKEST)과 비교하였다. 이송항의 계산을 위해서는 Lagrangian 보간법과 Cubic spline 보간법을 이용하였고 확산항의 계산에 있어서는 Crank-Nicholson 방법을 이용하였다. 수치모형의 적용결과는 다음과 같다. (1) Gaussian hill에의 적용:Lagrangian 보간법을 사용하여 계산한 경우가 가장 정확한 결과를 보였다. Cubic spline 보간법을 사용한 경우와 QUICKEST 방법의 경우에는 Peclet수가 50인 경우에 감쇠현상을 보였다. Stone-Brian방법은 Peclet수 10,50에서 위상오차가 발생하였다. (2) Advanced front에의 적용: 모든 방법이 Peclet수 1,4에서 정확한 결과를 얻었다. Peclet수가 50인 경우에 Lagrangian 보간법을 사용하여 계산한 경우와 Stone-Brian 방법은 증폭오차가 발생하였고 Cubic spline 보간법을 사용한 경우와 QUICKEST 방법의 경우는 수치진동 현상을 보였다.
대부분의 2차 및 3차 위상 보간을 사용하는 하모닉 합성 방법은 각각의 정현파 성분에 대해 샘플단위로 합성되기 때문에 구현하는데 있어 많은 연산량이 요구된다. 본 논문에서는 이러한 문제를 해결하기 위해 2차 및 3차 위상 항을 가지는 정현파 음성 및 오디오 모델을 위한 빠른 하모닉 합성 방법을 제안한다. 제안하는 빠른 하모닉 합성 방법은 2차 및 3차 위상함수의 계수를 하모닉과 독립적으로 강요함으로써 오버 샘플링 함수와 위상 변조 함수를 정의하고, Inverse Fast Fourier Transform(IFFT)을 이용한 합성식을 유도한다. 제안한 빠른 하모닉 합성 방법은 연산량과 Segment SNR(Segment Signal-to-Noise Ratio)을 코사인 함수를 이용한 합성 방법과의 비교를 통해 음질의 저하없이 연산량이 현저히 줄어드는 것을 확인할 수 있었다.
We develops a simulator to evaluate the performance of the autosyncronizer. The autosyncronizer is used to automatically syncronize magnitude, frequency, and phase of 3 phase signals of generator with respect to those of the utility grid. This autosyncronizer needs to be evaluated its performance to prevent malfunctions. To do this, 3 phase signals of generator and the utility grid are simulated and signals of the generator should be changed by ouput of the autosyncronizer with high precision. In this paper, we uses TMS320C31 to generate high precision sinusoidal 3 phase signals using Table Lookup method. In this process, it is very desirable to control magnitude, frequency, and phase of the signal with high precision and this is achieved by appropriate interpolation method. The resulted signal is well controlled and has low THD and could be used to evaluate the performance of the autosyncronizer.
본 논문에서는 OFDM 시스템에서 심볼 타이밍 옵셋이 존재하는 경우에도 채널 추정 성능의 열화가 발생하지 않는 파일럿 톤 기반의 채널 추정 기법을 제안한다. 제안된 채널 추정 기법은 기존의 보간법을 사용하여 채널을 추정하는 기법들과는 달리 크기와 위상에 대하여 최소의 계산량을 사용하여 각각 보간을 함으로써 채널 추정을 수행한다. 제안된 기법에서는 미세 심볼 타이밍 옵셋을 사전에 추정할 필요가 없으며, 위상을 보간하기 위하여 일반적으로 사용되는 삼각함수 연산을 사용하지 않기 때문에 복잡도를 크게 줄일 수 있다. 제안된 채널 추정 방식은 OFDM 시스템에서 존재하는 심볼 타이밍 옵셋에 영향을 받지 않기 때문에, OFDM 기반 통신시스템의 동기화 절차에서 미세 심볼 타이밍 옵셋 추정 과정의 생략, 상향링크에서 다중사용자의 심볼 타이밍 옵셋 추정 과정의 생략, 멀티 흡 릴레이 시스템에서의 채널 추정 등에 직접 이용될 수 있다. 모의실험을 통하여 제안된 채널 추정기법이 기존의 파일럿 톤 기반의 채널 추정 기법들에 비하여 심볼 타이밍 옵셋이 존재하는 상황에서 성능 개선이 크게 이루어짐을 확인한다.
본 논문은 OFDM 시스템에서 발생하는 높은 PAPR의 신호가 HPA를 통과할 때 발생하는 비선형 왜곡을 보상하고, 시간에 따른 HPA의 특성변화를 짧은 시간에 모델링하는 2ι분할보간을 적용한 전치왜곡방법을 제안한다. 제안한 전치왜곡방법은 HPA의 AM/AM 특성과 AM/PM 특성으로 구성한 LUT을 이용하여 전치왜곡이득 및 위상을 구하며, HPA 변화량을 반영하여 LUT을 갱신한다. 그리고, 전치왜곡이득과 위상을 정확히 구하기 위해서 LUT의 크기를 확장하는 대신에 비트천이와 덧셈소자를 이용하여 LUT 엔트리 사이값을 구하는 2ι분할보간을 적용함으로써 LUT의 크기를 확장하는 효과를 달성하여 계산량의 증가없이 SER 성능을 향상시키며, LUT의 갱신시간을 감소시킨다. AM/AM 선형 및 AM/PM 위상 차, 성상도, 심벌에러율 (SER) 그리고 평균제곱에러 (MSE) 관점에서 실험한 결과 16-QAM일 때 LUT 크기 32, 64-QAM일 때 LUT 크기 64에서 비선형 왜곡을 효과적으로 감소시킬 수 있었고, LUT 엔트리값을 신속히 갱신할 수 있음을 확인하였다.
본 논문에서는 고속 DDR3/DDR4 SDRAM을 위한 새로운 디지털 지연고정루프 (delay-locked loop: DLL)를 제안한다. 제안하는 디지털 DLL은 디지털 지연라인의 boundary switching 문제에 의한 jitter 증가 문제를 제거하기 위하여 위상보간 (phase interpolation) 방식의 파인지연라인 (fine delay line)을 채택하였다. 또한, 제안하는 디지털 DLL은 harmonic lock 문제를 제거하기 위하여 새로운 점진직 검색 (gradual search) 알고리즘을 사용한다. 제안하는 디지털 DLL은 1.1V, 38-nm CMOS DRAM 공정으로 설계되었으며, 0.25-2.0 GHz의 주파수 동작 영역을 가진다. 2.0 GHz에서 1.1 ps의 피크-투-피크 (p-p) 지터를 가지며, 약 13 mW의 전력소모를 가진다.
본 논문에서는 배열 안테나 기반의 MVDR (minimum variance distortionless response) 항 재밍 GPS (global positioning system) 수신기에서 안테나 경로 사이에 존재하는 이득, 위상, 지연 편차를 교정하기 위한 안테나 교정 기법을 제안한다. 제안하는 기법은 다중 안테나 시스템에서 안테나 경로들 사이의 이득, 위상, 지연 편차를 추정하고 이를 보상한다. 경로 간 이득, 위상, 지연 편차를 정확히 추정하기 위해 좋은 상관 특성을 갖는 파일럿 신호가 사용된다. 교차 상관에 기반하여 지연 편차가 먼저 추정되며 이후에 이득과 위상 편차가 추정된다. 정밀한 지연 편차 추정 및 보상을 위해 보간기법을 사용하는데 이산 푸리에 변환 (DFT) 기반의 보간기법으로 계산 복잡도를 감소시킨다. 제안된 기법은 MATLAB을 이용한 컴퓨터 모의실험을 통해 검증한다. 모의실험 결과에 따르면 제안하는 기법을 적용하면 이득, 위상 시간 지연 편차를 각각 0.01 dB, 0.05 도, 0.5 ns 이내로 줄일 수 있다.
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[게시일 2004년 10월 1일]
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