Single phase unidirectional transducer (SPUDT), 리플렉터, 웨이퍼 본딩 패키지로 구성된 표면탄성파 (surface acoustic wave, SAW) 기반 압력센서가 개발되어 졌다. Coupling of Mode (COM) 모델링에 의한 소자의 시뮬레이션 및 최적 설계 변수가 얻어졌다. Finite Element Methods (FEM)를 통해 주어진 압력에 따른 다이어프램 벤딩, 스트레인/스트레스 변화 및 SAW 속도변위가 미리 예측되어졌다. 유출된 최적 설계 변수를 이용 440 MHz SAW 기반 압력센서가 41o YX LiNbO3 기판 위에서 제작되어졌다. 고 S/N 비, 임펄스 리프렉션 피크, 작은 에러 피크가 관찰되어졌다. 측정된 S11 결과는 COM 모델링 및 FEM 시뮬레이션 결과와 일치함을 보였다.
본 논문에서는 PQR 순시전력 이론을 적용하여 3상 4선식 배전망에서 전원전압의 불평형 및 왜곡에 강인하게 동작하는 전력용 능동 필터의 제어기를 디지털적으로 설계한다. 인버터의 교류측 필터의 특성을 분석하고, 디지털 제어시스템이 내재적으로 갖고 있는 시간지연문제를 극복할 수 있는 우수한 성능의 제어기구조를 제안하며, 제어 이득을 설계한다. 전류 고조파 및 중성선 전류 고조파를 감소시키기 위하여 제어기 구조와 3중 비교삼각파 사용을 제안하고 제어 이득을 설계하였다. 디지털 구현이 용이한 삼각파 비교 PWM을 보상전류 제어 방식으로 채택하였다. 설계된 전력용 능동 필터를 PSiM 시뮬레이션을 통하여 검증하고 전류 응답성이 뛰어난 히스테리시스 PMW 결과와 비교 분석하였다.
본 논문에서는, IDWT(inverse discrete wavelet transform)를 효율적으로 구현하는 한 방법으로 홀수 탭(tap)의 선형위상 필터의 VLSI 구조를 제안한다. 제안한 필터 구조는 선형 위상 필터의 대칭 특성을 이용하여 대칭적인 위치에 있는 입력을 먼저 합한 다음 필터링을 수행한다. 이때 발생하는 전역 연결을 해결하기 위하여 입력의 흐름을 U자형으로 만듦으로써 국부적인 연결로 필터를 구현한다. 제안한 필터는 지연 소자부, 연산부, 덧셈부, 그리고 후처리부 등으로 이루어진다. 그리고, 각 부분들을 규칙적으로 배열하고, 국부적으로 연결함으로써 제안한 구조를 설계하기 때문에, 단순히 해당 부분들을 추가/삭제함으로써 임의의 선형 위상 IDWT 필터를 구현할 수 있다는 장점이 있다. 그리고, 제안한 필터를 직렬 연결 혹은 반순환적(semi-recursive) 구조로 배열함으로써 M 레벨 IDWT를 구현할 수 있음을 보인다. 본 논문에서 제안한 IDWT 구조는 기존의 구조들에 비해 간단하기 때문에 MPET-4 등 관련 분야에 효과적으로 적용될 것으로 기대된다.
본 논문에서는 디지털 위상동기루프에서 사용하는 고해상도와 넓은 입력 범위를 가지는 2 단계 시간-디지털 변환기(TDC)구조를 제안한다. 디지털 위상동기루프에서 디지털 오실레이터의 출력 주파수와 기준 주파수와의 위상 차이를 비교하는데 사용하는 TDC는 고해상도로 구현되어야 위상고정루프의 잡음 특성을 좋게 한다. 기존의 TDC의 구조는 인버터로 구성된 지연 라인으로 이루어져 있어 그 해상도는 지연 라인을 구성하는 인버터의 지연 시간에 의해 결정되며, 이는 트랜지스터의 크기에 의해 결정된다. 따라서 특정 공정상에서 TDC의 해상도는 어느 값 이상으로 높일 수 없는 문제점이 있다. 본 논문에서는 인버터보다 작은 값의 지연 시간을 구현하기 위해 위상-인터폴레이션 기법을 사용하였으며, 시간 증폭기를 사용하여 작은 지연 시간을 큰 값으로 증폭하여 다시 TDC에 입력하는 2 단계로 구성하여 고해상도의 TDC를 설계하였다. 시간 증폭기의 이득에 영향을 주는 두 입력의 시간 차이를 작은 값으로 구현하기 위해 지연 시간이 다른 두 인버터의 차이를 이용하여 매우 작은 값의 시간 차이를 구현하여 시간증폭기의 성능을 높였다. 제안하는 TDC는 $0.13{\mu}m$ CMOS 공정으로 설계 되었으며 전체 면적은 $800{\mu}m{\times}850{\mu}m$이다. 1.2 V의 공급전압에서 12 mA의 전류를 사용하며 0.357 ps의 해상도와 200 ps의 입력 범위를 가진다.
공간상에 존재하는 전자파를 측정, 분석하여 신호정보(SIGINT; SIGnal INTelligence)를 획득하기 위해서 가장 중요한 것이 전자파의 주파수 정보이다. 특히 레이다 및 미사일에서 방사되는 초고주파 대역의 주파수를 순시 측정하는 방법으로, 지연선로의 위상차를 측정하여 주파수정보를 디지털데이터를 출력하는 부품으로 디지털 주파수 판별기(Digital frequency Discriminator; DFD)가 있다. DFD는 100nSec 이하의 짧은 시간동안에 존재하는 고주파 신호에 대해서도 초고주파신호의 주파수 정보를 실시간으로 측정하여 제공해야 한다. 본 논문에서는 광대역 4 채널의 지연선로와 코릴레이터로 구성된 고주파 입력부와 I/Q신호를 처리하여 주파수 정보를 얻어내는 디지털 처리부 및 정확한 주파수 정보를 얻기 위한 주파수 보정부로 이루어진 DFD의 구현방안을 제안하고 아주 짧은 펄스 형태의 모의 레이다 신호를 입력하여 얻은 시험결과를 토대로 설계의 타당성을 확인한다.
This study presents a new sensorless commutation method for brushless direct current motors to replace Hall sensor signals with virtual Hall signals. The importance of the proposed method lies in the simultaneous elimination of the phase shifter and the low-pass filters, which makes the method simple and cost-effective. The method removes high ripple switching noises from motor terminals, thereby decreasing motor losses. The proposed method utilizes unfiltered line voltages with notches caused by current commutation. Hence, specific sign signals are defined to compensate for the effects of commutation noise. The proposed method is free from phase delay that originates from low-pass filters. The method directly produces virtual Hall signals, and thus, it can be interfaced with low-cost commercial commutation integrated circuits based on Hall sensors. Simulation and experimental results show the effectiveness and validity of the proposed method.
There are concern on possible health effects from exposure to electric and magnetic fields. One reflection of this concern is the considerable controversy, delay, and cost increases involved in the construction of utility lines and facilities. To meet such challenges, in this paper we investigated magnetic fields reduction techniqies such as general compaction, in-span compaction, cruciform, vertical, 3way splits phase, and 4way splits phase. As results, we found 1 spacer in-span compaction was appropriate in Korea in view of effectiveness and economy.
본 논문에서는 기존의 DLL 지연 시간 잠금 범위를 확장하기 위해 새로운 이중 루프 DLL을 제안하였다. 제안한 DLL은 Coarse_loop와 Fine_loop를 포함하고 있으며, 와부 클럭과 2개의 내부 클럭 사이의 초기 시간차를 비교하여 하나의 루프를 선택하여 동작하게 된다. 2개의 내부 클럭은 VCDL의 중간 출력 클럭과 최종 출력 클럭이며 두 클럭의 위상차는 $180^{\circ}$이다. 제안한 DLL은 일반적인 잠금 범위 밖에 있을 경우 Coarse_loop를 선택하여 잠금 범위 안으로 이전 시킨 후 Fine_loop에 의하여 잠금 상태가 일어난다. 따라서 제안한 DLL은 harmonic lock이 일어나지 않는 한 항상 안정적으로 잠금 과정이 일어날 수 있게 된다. 제안한 DLL이 사용하는 VCDL은 두 개의 제어 전압을 받아 지연 시간을 조절함으로 일반적인 다 적층 currentstarved 형태의 인버터 대신에 TG 트랜지스터를 이용하는 인버터를 사용하여 지연 셀을 구성하였다. 새로운 VCDL은 종래의 VCDL에 비하여 지연시간 범위가 더욱 확장되었으며, 따라서 제안한 DLL의 잠금 범위는 기존의 DLL의 잠금 범위보다 2배 이상 확장되었다. 본 논문에서 제안한 DLL 회로는 0.18um, 1.8V TSMC CMOS 라이브러리를 기본으로 하여 설계, 시뮬레이션 및 검증하였으며 동작 주파수 범위가 100MHz${\sim}$1GHz이다. 또한, 1GHz에서 제안한 DLL의 잠금 상태에서의 최대 위상 오차는 11.2ps로 높은 해상도를 가졌으며, 이때 소비 전력은 11.5mW로 측정되었다.
Flow of fluid has been studied in various fields of fluid engineering. To hydraulic engineers, the unsteady flow such as pulsation and liquid hammering in pipes has been considered as a serious trouble. So we are supposed to approach the formalized mathematical model by using more exact momentum equation for fluid transmission lines. Most of recent studies fur pipe line have been studied without considerations of variation of viscosity and temperature, which are the main factors of pressure loss causing the friction of fluid inside pipe line. Frequency response experiments are carried out with use of a rotary sinusoidal flow generator to investigate wave equation take into account viscosity and temperature. But we observed that measured value of gains are reduced as temperature increased. And it was respectively observed that the measured value of gains are reduced and line width of gain is broadened out, when temperature was high in the same condition. As we confessed, pressure loss and phase delay are closely related with the length, diameter and temperature of pipe line. In addition, they are the most important factors, when we decide the momentum energy of working fluid.
본 논문에서는 IMT-2000 소형 기지국 시스템 응용을 위한 광대역 특성을 갖는 위상 배열 안테나 시스템의 평판형, 소형 구조를 설계 및 구현하였다. 저비용, 단순 설계의 빔 형성망을 구성하기 위해 두 가지 방법이 제안되었다. 첫번째로 연속적으로 위상을 조정할 수 있는 새로운 소형 광대역 위상 천이기를 병렬 결합선로를 이용하여 설계하였으며, 둘째로는 위상 배열 안테나에서 기준 위상을 갖는 위상 천이기를 대체할 수 있는 등가적인 위상 지연기를 제안하였다. 또한 광대역 시스템 구현을 위해 광대역 위상 천이기와 함께 광대역 특성을 갖는 와이드 슬랏 안테나를 단위 안테나로 설계하였다. 따라서 설계된 위상 배열 안테나 시스템은 낮은 복잡도와 적은 공정 비용에도 불구하고 소형, 광대역, 그리고 넓은 빔 틸팅 각도를 갖도록 설계되었다. 제작된 3${\times}$l 선형 위상 배열 안테나 시스템은 와이드 슬랏 안테나의 접지면으로 충분한 1.6 λ${\times}$ l.6 λ의 소형 구조로 구현되었으며, 실험 결과 IMT-2000 대역 내에서 15 dB 이하의 S$_{11}$을 보였고, E평면 방사 패턴에서 -29$^{\circ}$에서 +30$^{\circ}$의 빔 스캔 각도를 나타내었다.다.
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[게시일 2004년 10월 1일]
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