• 한국전자통신학회논문지
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• 제2권4호
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• pp.199-202
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• 2007

본 논문에서는 UHF 대역(860~960 MHz의 수동 RFID 태그 안테나 제안하여 해석하였다. 제안한 안테나는 루프구조에 의한 UHF 대역 초소형 수동 RFID 태그 안테나이다. 제안한 안테나는 단일 평면 구조 형태로 인쇄 기판에 손쉽게 인쇄할 수 있어 생산비 절감을 통한 대량 생산이 용이하며, Pareto 유전자 알고리즘과 IE3D 시뮬레이션 툴로 최적화하여 안테나의 크기를 소형화 하였다. 최적화 한 RFID 태그 안테나의 성능을 검증하기 위하여 몇 개의 표본 안테나를 제작하고 반사 손실, 복사 효율, 복사 패턴 등을 측정하였다. 상용태그 와 고정형 리더 시스템을 이용하여 제작된 태그 안테나의 인식 거리를 측정하였고, 약 1~3 m의 인식거리를 가지는 것을 확인하였다.

• 한국전자파학회논문지
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• 제16권9호
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• pp.872-882
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• 2005

본 논문에서는 수식적 방법을 통하여 수동 RFID 태그 안테나의 동작 원리를 설명하였고, 유도 결합 방식을 이용하여 커패시티브한 태그 칩을 부가적인 정합 회로 없이 장착할 수 있는 UH F대역 초소형 수동 RFID 태그 안테나를 제안하였다. 제안한 안테나는 단일 평면 구조 형태로 PET 기판에 손쉽게 인쇄할 수 있어 생산비 절감을 통한 대량 생산이 용이하며, Pareto 유전자 알고리즘과 IE3D 시뮬레이션 툴로 최적화하여 안테나의 크기를 kr=0.27($2 cm^2$)까지 소형화하였다. 최적화 한 RFID 태그 안테나의 성능을 검증하기 위하여 몇 개의 표본 안테나를 제작하고 반사 손실, 복사 효율, 복사 패턴 등을 측정하였다. 상용 태그 칩과 고정형 리더 시스템을 이용하여 제작된 태그 안테나의 인식 거리를 측정하였고, 약 $1{\~}3 m$의 인식 거리를 가지는 것을 확인하였다.

• 한국전자파학회:학술대회논문집
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• 한국전자파학회 2005년도 종합학술발표회 논문집 Vol.15 No.1
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• pp.241-244
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• 2005

본 논문에서는 UHF 대역 수동형 RFID 태그 안테나의 최적 설계에 필요한 요소들과 전파 음영 문제를 최소화 할 수 있는 다중 리더 안테나 방식에 대하여 분석하였다. 또한, 칩 설계시 RCS 특성이 우수한 칩 임피던스 범위를 설정해 보았으며, 등방성 방사패턴을 갖는 태그 안테나의 필요성과 설계 예를 보였다.

• 한국컴퓨터정보학회논문지
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• 제18권2호
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• pp.69-76
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• 2013

RFID 시스템에서 리더간 간섭은 일정한 서비스 영역에서 제한된 주파수를 사용하기 때문에 발생하며 수동형 태그의 가독율을 떨어뜨리는 주요 원인이 된다. 그러므로 제한된 주파수 자원 환경에서 가독율을 최대화하려면 리더간 주파수 간섭을 최소화시켜야 한다. 본 논문에서는 RFID 리더간 주파수 간섭 최소화 문제를 FDM/TDM 혼합방식의 제약만족문제로 모델링하고 기존의 백트래킹 탐색 알고리즘을 적용하여 각각의 리더에게 최적의 채널을 할당한다. 제약 만족 문제의 해를 구하기 위해서 백트래킹을 이용한 깊이우선탐색을 실행하는데 이 때 탐색되는 노드의 순서를 효과적으로 배열하는 변수 순서화 방법이 중요하다. 본 논문의 실험에서 적용된 변수 순서화 알고리즘들은 그래프 채색에 효과적인 것으로 알려져 있다. 제안한 제약만족문제 모델의 성능을 입증하기 위하여 수동형 UHF RFID 시스템 환경에서 시뮬레이션하여 간섭조건을 만족하면서 각각의 리더에게 최적의 채널을 할당한다.

• 한국통신학회논문지
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• 제34권12A호
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• pp.925-932
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• 2009

최근에 온도관리가 필수조건인 신선식품의 유통관리 분야에서 전지 지원 수동형 센서태그에 대한 요구가 크게 증대되고 있다. ISO/IEC18000-6REV1은 산업체에서 널리 사용되고 있는 EPCglobal Class1 Generation2 규격의 RFID 태그와 호환되는 전지 지원 수동형 센서태그를 지원하는 표준을 규정하고 있다. 본 논문에서는 전지 지원 수동형 센서태그를 지원하는 리더 모뎀을 FPGA로 설계하였으며, ISO/IEC18000-6REV1에서 정의하는 센서 데이터 처리기능을 개발하였다. 모뎀의 송신 블록은 표준에서 규정하는 성형필터(pulse shaping filter)를 지원하며, RF출력 신호는 표준에서 권고하는 스펙트럼 마스크를 만족한다. 태그의 신호를 수신하는 모뎀의 수신 블록은 심벌 타이밍 동기에 널리 사용되는 Gardner TED(Timing Error Detection) 방법을 이용하였으며, 동기 방식으로 설계된 수신기는 FM0, Miller-2, Miller-4, 그리고 Miller-8 신호를 모두 수신할 수 있다. 본 논문에서는 표준화가 진행중인 ISO/IEC18000-6REV1 규격을 만족하는 모뎀과 센서태그용 리더 시스템을 개발하여 센서태그 및 수동형 태그를 무선 환경에서 안정적으로 인식하였으며, 임베디드 리눅스 기반 플랫폼에서 센서 프로토콜을 구현하여 센서 데이터를 실시간으로 처리하였다.

• 한국통신학회논문지
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• 제32권12A호
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• pp.1311-1319
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• 2007

본 논문에서는 UHF 대역 RFID 수동형 태그의 디지털 회로부 구현을 위한 VHDL 설계과정을 보인다. 태그의 동작은 EPCglobal Class1 Gen2 표준을 지원하며 합성과 구현과정을 거친 타이밍 시뮬레이션 결과를 통해 검증하였다. 수 미터의 인식거리로 인해 Frame-Slotted Aloha를 사용하는 환경에서, 단위시간당 태그 인식률을 향상시키기 위해서는 리더 명령에 대한 빠른 처리와 응답을 할 수 있는 디지털 회로 설계가 필요하다. 본 설계는 Pipeline 처리 구조를 기반으로 직렬 입력 신호에 대한 응답지연의 최소화를 목표로 하였다. 또한, 효율적인 다중 접속 명령들의 처리와 태그의 데이터 전송 속도의 오차를 낮추기 위해 리더의 Preamble과 PIE 디코딩을 위한 샘플링 과정을 제안하였다. FPGA 검증을 위한 Place & Route 후 다중 태그 상황을 감안한 테스트 벤치 시뮬레이션 결과, 표준상의 최대 송수신 데이터 전송 속도에서 디코딩 및 인코딩 을 위한 최소 요구 시간 보다 빠른 처리 결과를 확인 할 수 있었다.

• Journal of Electrical Engineering and Technology
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• 제6권6호
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• pp.817-823
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• 2011

This paper introduces an efficient voltage multiplier circuit for improved voltage gain and power efficiency of radio frequency identification (RFID) tags. The multiplier is fully integratable and takes advantage of both passive and active circuits to reduce the required input power while yielding the desired DC voltage. A six-stage voltage multiplier and an ultralow power voltage regulator are designed in a 0.13 ${\mu}m$ complementary metal-oxide semiconductor process for 2.45 GHz RFID applications. The minimum required input power for a 1.2 V supply voltage in the case of a 50 ${\Omega}$ antenna is -20.45 dBm. The efficiency is 15.95% for a 1 $M{\Omega}$ load. The regulator consumes 129 nW DC power and maintains the reference voltage in a 1.1% range with $V_{dd}$ varying from 0.8 to 2 V. The power supply noise rejection of the regulator is 42 dB near a 2.45 GHz frequency and performs better than -32 dB from 100 Hz to 10 GHz frequencies.

• 대한전자공학회논문지SD
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• 제44권1호
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• pp.16-21
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• 2007

본 논문은 기존의 전압 체배기를 개선하여, 전압발생 효율과 전류 구동능력을 향상시킨 이중 경로 전파 전압 체배기를 제안하고 제작하여 특성을 측정하였다. 제안된 회로는 종래의 회로에 비하여 4개의 다이오드가 추가로 필요하나, 이로 인한 면적증가는 무시할 수 있는 수준이다. 시뮬레이션 결과에 의하면, 제안된 회로의 출력 전력은 종래회로에 비하여 약 2배 정도 향상되었다. 제작된 칩의 측정결과로부터 제안된 회로의 전압이득은 부하전류를 구동하지 않는 조건에서, 종래 회로보다 약 51% 정도 향상되었다. 제안된 회로는 UHF 대역 주파수 이상의 RFID 태그와 수동형 센서의 전압 체배기로써 사용하기에 적합하다.

• 한국전자파학회지:전자파기술
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• 제15권2호
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• pp.32-43
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• 2004

RFID 시스템에서 태그는 리더와 전자기 에너지 교환에 의해 동작을 하며 배터리를 사용하는 active 형 태그와 배터리를 사용하지 않는 passive형 태그로 크게 구분된다. 또한 태그는 자체 회로구조에 의해 harmonic 태그, anharmonic 태그, sequenced amplifier 태그로 나뉜다. Passive 태그에서는 리더의 반송파 backscatter 방식을 이용하여 동작을 하며 active 태그는 자체 발진회로에 의해 태그정보를 송신한다. 태그의 변조방식으로 PSK, FSK, ASK 등을 사용하며 변조방법에 따라 회로 구성과 프로토콜 설계가 달라진다. 또한 리더의 전파 신호를 정류하기 위하여 렉테나(rectenna)가 필요하다. 본 논문에서는 태그의 분류, 동작, 구조 등에 관한 일반적인 내용을 기술하였다. 특히 UHF 대역 이상의 태그 기술 최근 추세가 안테나 부분을 제외하고 CMOS one chip화 하는 수준으로서 900 MHz UHF 대역, 2.45 GHz RFID 칩이 상용화 되어 있다. 칩의 내부구조와 태그의 변조방식에 의거한 동작에 관한 개괄적인 내용을 서술하였다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2009년도 춘계학술대회
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• pp.671-674
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• 2009

본 논문에서는 수동형 UHF RFID 태그 칩에 사용되는 저전력, 저면적 256b 비동기식 EEPROM을 설계 하였다. 먼저 EEPROM의 저전력 특성을 얻기 위해 1.8V의 공급전압을 사용하였고, 저전압 특성을 갖는 N-type Schottky Diode를 사용하여 Dickson Charge pump를 설계하였다. 그리고 주변회로에서의 저면적 설계를 위해 비동기식 인터페이스 방식과 Separate I/O 방식을 사용하였다. 그리고 DC-DC 변환기의 면적을 줄이기 위하여 Schottky Diode를 사용한 Dickson Charge Pump를 설계하였다. $0.18{\mu}m$ EEPROM 공정을 이용하여 설계된 16 행 ${\times}$ 16 열의 어레이를 갖는 256b EEPROM의 레이아웃 면적은 $311.66{\times}490.59{\mu}m^2$이다.