The effect of hydrogen in the alumina gate insulator on the bottom gate oxide thin film transistor (TFT) with an InGaZnO film as the active layer was investigated. TFT with more H-containing alumina films (TFT A) fabricated via atomic layer deposition using a water precursor showed higher stability under positive and negative bias stresses than that with less H-containing alumina deposited using ozone (TFT B). While TFT A was affected by the pre-vacuum annealing of GI, which resulted in $V_{th}$ instability under NBS, TFT B did not show a difference after the pre-vacuum annealing of GI. All the TFTs showed negative-bias-enhanced photo instability.
Park, Sung-Bin;Park, Byung-Heung;Seo, Chung-Seok;Jung, Ki-Jung;Park, Seong-Won
한국방사성폐기물학회:학술대회논문집
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한국방사성폐기물학회 2005년도 Proceedings of The 6th korea-china joint workshop on nuclear waste management
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pp.39-50
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2005
Electrolytic reduction of uranium oxide to uranium metal was studied in a $LiCl-Li_{2}O$ molten salt system. The reduction mechanism of the uranium oxide to a uranium metal has been studied by means of a cyclic voltammetry. Effects of the layer thickness of the uranium oxide and the thickness of the MgO on the overpotential of the cathode and the anode were investigated by means of a chronopotentiometry. From the cyclic voltamograms, the decomposition potentials of the metal oxides are the determining factors for the mechanism of the reduction of the uranium oxide in a $LiCl-3\;wt{\%} Li_{2}O$ molten salt and the two mechanisms of the electrolytic reduction were considered with regards to the applied cathode potential. In the chronopotentiograms, the exchange current and the transfer coefficient based on the Tafel behavior were obtained with regard to the layer thickness of the uranium oxide which is loaded into the porous MgO membrane and the thickness of the porous MgO membrane. The maximum allowable currents for the changes of the layer thickness of the uranium oxide and the thickness of the MgO membrane were also obtained from the limiting potential which is the decomposition potential of LiCl.
The TiCrN Coatings haying three kinds of Compositions of $Ti_{36}$$Cr_{26}$$N_{38}$ , $Ti_{31}$$Cr_{35}$$N_{34}$ / and $Ti_{14}$$Cr_{52}$$N_{34}$ were deposited on STD 61 steel substrate by arc ion plating and were oxidized between 700 and 100$0^{\circ}C$ to identify the oxide scales formed on the coatings. The oxide scales were then analyzed using EPMA, XRD and GAXRD. During oxidation, the coatings consisting of TiN and CrN phases were reduced to TiO2 and $Cr_2$$O_3$, respectively. Titania tended to form at the outer oxide layer, whereas chromia tended to form at the inner oxide layer, owing to the different oxygen affinity. The substrate elements as well as coating elements diffused outwardly toward the oxide layer due to the concentration gradient. The growth of oxide from the TiCrN coatings was schematically expressed on the basis of thickness measurement of the reacted and unreacted coatings. The Cr element showed its stronger role to keep the TiCrN coatings from oxidation, when compared with Ni.
Hafnium Oxide (HfOx) has been attracted as a promising gate dielectric for replacing SiO2 in gate stack applications. In this paper, Metal-Oxide-Semiconductor (MOS) capacitor with solution processed HfO2 high-k material as a dielectric were fabricated. The solvent using $HfOCl2{\cdot}8H2O$ dissolve in 2-Methoxy ethanol was prepared at 0.3M. The HfOx layers were deposited on p-type silicon substrate by spin-coating at $250^{\circ}C$ for 5 minutes on a hot plate and repeated the same cycle for 5 times, followed by annealing process at 350, 450 and $550^{\circ}C$ for 2 hours. When the annealing temperature was increased from 350 to $550^{\circ}C$, capacitance value was increased from 337 to 367 pF. That was resulted from the higher temperature of HfOx which have more crystallization phase, therefore dielectric constant (k) was increased from 11 to 12. It leads to the formation of dense HfOx film and improve the ability of the insulator layer. We confirm that HfOx layer have a good performance for dielectric layer in MOS capacitors.
In this paper, the AC breakdown properties to investigate the electrical properties of gate oxide layer in MOSFET was studied. 5 inch arsenic epi-wafer is selected as an experimental specimen, the power MOSFET of a general MOS structure was made. In order to analyze the physical properties of the specimen, the SIMS(secondary ion mass spectroscopy) was used. As the experimental condition, the experiment al of the AC breakdown characteristics was performed when the thickness of gate oxide layer is $600[\AA]$ and $800[\AA]$, the resistivity is $1.2[\Omega{\cdot}cm]$, $1.5[\Omega{\cdot}cm]$ and $1.8[\Omega{\cdot}cm]$, and the diffusion time is 110[min] and 150[min] in temperature $30[^{\circ}C]{\sim}100[^{\circ}C]$. From the analysis result of the SIMS spectrum, it is confirmed that the dielectric strength is decreased by contribution of the impurities ad dition as increasing in thickness of the gate oxide layer in MOSFET.
The properties of the IZTO thin films on the glass were studied with a variation of the $SiO_2$ buffer layer thickness. $SiO_2$ buffer layers were deposited by plasma-enhanced chemical vapor deposition (PECVD) on the glass, and the In-Zn-Tin-Oxide (IZTO) thin films were deposited on the buffer layer by RF magnetron sputtering. All the IZTO thin films with the $SiO_2$ buffer layer are shown to be amorphous. Optimum $SiO_2$ buffer layer thickness was obtained through analyzing the structural, morphological, electrical, and optical properties of the IZTO thin films. As a result, the IZTO surface roughness is 0.273 nm with a sheet resistance of $25.32{\Omega}/sq$ and the average transmittance is 82.51% in the visible region, at a $SiO_2$ buffer layer thickness of 40 nm. The result indicates that the uniformity of surface and the properties of the IZTO thin film on the glass were improved by employing the $SiO_2$ buffer layer and the IZTO thin film can be applied well to the transparent conductive oxide for display devices.
$Ti_{1-x}$$Al_{ x}$N thin films as barrier layer for memory devices application were deposited by reactive magnetron sputtering. The crystallinity, micro-structure, oxidation resistance and oxidation mechanism of films were investigated as a function of Al content. Lattice parameter and grain size of thin films were decreased with increasing the Al content Oxidation of the film with higher Al content is slow and then, total oxide thickness is thinner than that of lower Al content film. Oxide layer formed on the surface is AlTiNO layer. Oxidation of $Ti_{1-x}$ /$Al_{x}$ N barrier layer is diffusion limited process and thickness of oxide layer with oxidation time increased with a parabolic law. The activation energy of oxygen diffusion, Ea and diffusion coefficient, D of $Ti_{0.74}$ /X$0.74_{0.26}$N film is 2.1eV and $10^{-16}$ ~$10^{-15}$$\textrm{cm}^2$/s, respectively. $_Ti{1-x}$ /$Al_{x}$ XN barrier layer showed good oxidation resistance.
Kim, Eung-Soo;Cho, Won-Ju;Kwon, Hyuk-Choon;Kang, Shin-Won
대한전자공학회:학술대회논문집
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대한전자공학회 2002년도 ITC-CSCC -1
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pp.365-368
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2002
We investigated the influence of RTP annealing of multi-layered metal films deposited on oxides layer. Two types of oxides, BPSG and P-7205, were used as a bottom layer under multi-layered metal film. The bonding was not good in metal/BPSG/Si samples because adhesion between metal layer and BPSG oxide layer was poor by interfacial reaction during RTP annealing above 650$^{\circ}C$. On the other hand bonding was always good in metal/ P-TEOS /Si samples regardless of annealing temperature. We observed the interface between oxide and metal layers using AES and TEM. The phosphorus and oxygen profile in interface between metal and oxide layers were different in metal/BPSG/Si and metal/P-TEOS/Si samples. We have known that the properties of interface was improved in metal/BPSG/Si samples when the sample was annealed below 650$^{\circ}C$.
Ge is a promising candidate to replace Si in MOSFET because of its superior carrier mobility, particular that of the hole. However Ge oxide is thermodynamically unstable. At elevated temperature, GeO is formed at the interface of Ge and GeO2, and its formation increases the interface defect density, degrading its device performance. In search for a method to surmount the problem, we investigated Ge oxidation through an inert capped oxide layer. For this work, we prepared low doped n-type Ge(100) wafer by removing native oxide and depositing a capping layer, and show that GeO2 interface can be successfully grown through the capping layer by thermal oxidation in a furnace. The thickness and quality of thus grown GeO2 interface was examined by ellipsometry, XPS, and AFM, along with I-V and C-V measurements performed at 100K to 300K. We will present the result of our investigation, and provide the discussion on the oxide growth rate, interface state density and electrical characteristics in comparison with other studies using the direct oxidation method.
We fabricated conductive zinc oxide (ZnO) thin film at low temperature by UV-enhanced atomic layer deposition. The atomic layer deposition relies on alternate pulsing of the precursor gases onto the substrate surface and subsequent chemisorption of the precursors. In this experiment, diethylzinc (DEZ) and $H_2O$ were used as precursors with UV light. The UV light was very effective to improve the conductivity of the ZnO thin film. The thickness, transparency and resistivity were investigated by ellisometry, UV-visible spectroscopy and Four-point probe.
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[게시일 2004년 10월 1일]
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