스퍼터링 방법으로 FM/M/FM의 다층박막을 증착한 다음 초소형 박막 인덕터를 제작하기 위하여 반도체 공정을 대체할 수 있는 레이저 미세가공 기술을 개발하였다. TE $M_{00}$ 모드로 발진하는 CW Nd:YAG 레이저를 active Q-switching 하여 펄스폭이 200 ns인 극 초단 레이저 펄스를 얻었다. 레이저 미세가공 조건을 반복율 5 kHz, 펄스 당 에너지 5 mJ/pulse로 최적화 하여 분해능이 20 $\mu\textrm{m}$인 line patterning을 얻었다.
본 논문에서는 정현파형 브러시리스 직류 전동기의 속도제어를 위해 두 개의 스위칭 라인에 의해 구성된 채터링 둔감영역을 갖는 가변구조 속도제어기를 설계한다. 슬라이딩 모드 과정중 과도상태에서 발생하는 고주파 채터링을 저주파로 한정시키기 위해 데드 존(Dead Zone) 함수의 도입을 제안하고, 정상상태에서의 채터링 감소 및 정상상태 오차를 제거하기 위해서는 제어입력에 지변이득을 적용한다. 제안된 데드 존 함수는 두 개의 스위칭 함수로 구성된 슬라이딩 영역을 표시하며 이 영역에 시스템의 상태가 존재 시 제어구조를 비례-적분 제어기로 변경하여 채터링이 발생하지 않으며 이 영역의 이탈 시만 가변구조제어를 적용하므로 채터링이 발생하게되어 과도상태의 고주파 채터링을 저주파로 감소시킬 수 있다. 설계된 속도 제어기에 대해 컴퓨터 시뮬레이션과 실험을 통하여 그 성능을 보인다.
제한된 전원으로 동작해야 하는 센서 노드의 수명 연장을 위하여, 에너지 효율적인 센서 노드의 동작에 대한 많은 연구가 진행되었다. 그들 중에는 주기적으로 무선 송수신 모듈을 활성화 / 비활성화 하면서 정보전달을 위하여 인접 노드가 깨어나는 시점에 대한 정보를 필요로 하는 기법들이 존재한다. 클락 동기는 이러한 기법들에서 무선 송수신 모듈의 활성화 / 비활성화 스케줄링을 위하여 필수적인 요소이다. 본 논문에서는 센서 망에서 전역 클락 동기를 위하여 제안된 비동기 평균 알고리즘을 기반으로 주기적인 무신 송수신 모듈 활성화 / 비활성화 기법에서의 클락 동기 방법을 제안한다. 구체적으로 본 논문은 (1) 초기 자율적인 망 구성 시점에 필요한 신속한 클락 동기 방법과 (2) 에너지 소모를 최소화한 주기적인 클락 동기 방법 및 (3) 두 가지 동기 방법들 간의 전환 시점 판단 방법을 제안한다. 시뮬레이션을 통하여 제안한 방법의 클락 오차 범위와 교환되는 메시지 수를 분석한다.
본 논문에서는 간단한 회로구조와 높은 효율을 갖는 스위칭 방식의 E급 주파수 체배기에 대한 연구를 수행하였다. 주파수 체배는 능동소자의 비선형성에 의해 발생하는데 본 논문에서는 FET 능동소자를 간단한 스위치 및 기생소자 성분 모델로 근사하여 특성을 해석하고자 하였다. FET를 입력에 의해 동작하는 스위치 및 기생소자로 모델링하고 E급 주파수 체배기의 정합소자 값을 유도하였다. ADS시뮬레이터를 이용하여 출력 전압과 전류 파형 및 효율을 시뮬레이션하고 기생성분에 따른 변화를 연구하였다. 기생 커패시턴스, 저항, 인덕턴스에 의한 영향을 시뮬레이션하였으며 입력주파수 2.9GHz, 바이어스전압 2V일 때, 출력주파수 5.8GHz에서 기생커패시턴스가 0pF에서 1pF으로 변화함에 따라 드레인효율은 98%에서 28%로 감소하여 기생커패시턴스 CP가 FET의 기생 성분 중 가장 큰 영향을 끼친 것을 확인했다.
본 논문은 백터제어기법을 적용한 철도차량용 1.2MVA전동차 구동시스템의 개발에 관한 것이다. 벡터제어를 위해서는 출력 전압의 크기와 위상을 순시적으로 제어해야한다. 전동차 구동시스템에서는 DC링크 단의 전압 이용률을 최대로 하기 위해 고속 운전 영역에서는 1펄스 모드를 사용한다. 따라서 고속 운전 영역에서는 토크성분 전류와 지송성분 전류를 독립적으로 술시 에어해야 하는 백터제어기법을 정용할 수 없다. 이에, 본 연구에서는 저속이 운전영역에서는 순시 토크 제어가 가능한 벡터제어를 적용하고, 고속 운전 영역에서는 슬립 주파수제어를 적용하는, 백터 제어와 스칼라 제어의 병용제어 기법을 제안하였다. 또한 운전영역에 따라 이들 두 제어방법이 부드럽게 전환되도록 하는 제어기법이 제시되었다. 제안되 제어기법을 4대의 210kW 유도전동기를 구동하는 1.2MVA 전동차 견인 구동시스템에 적용하여 그 효용성을 알아보았다.
In recent years, some converter structures and analyzing methods for the voltage regulation of stand-alone self-excited induction generators (SEIGs) have been introduced. However, all of them are concerned with the three-phase voltage control of three-phase SEIGs or the single-phase voltage control of single-phase SEIGs for the operation of these machines under balanced load conditions. In this paper, each phase voltage is controlled separately through separated converters, which consist of a full-bridge diode rectifier and one-IGBT. For this purpose, the principle of the electronic load controllers supported by fuzzy logic is employed in the two-different proposed converter structures. While changing single phase consumer loads that are independent from each other, the output voltages of the generator are controlled independently by three-number of separated electronic load controllers (SELCs) in two different mode operations. The aim is to obtain a rated power from the SEIG via the switching of the dump loads to be the complement of consumer load variations. The transient and steady state behaviors of the whole system are investigated by simulation studies from the point of getting the design parameters, and experiments are carried out for validation of the results. The results illustrate that the proposed SELC system is capable of coping with independent consumer load variations to keep output voltage at a desired value for each phase. It is also available for unbalanced consumer load conditions. In addition, it is concluded that the proposed converter without a filter capacitor has less harmonics on the currents.
본 논문에서는 반얀망(banyan network)을 적용한 ATM(Asynchronous Transfer Mode) 스위치에서의 스루풋을 크게 감소시키는 셀들간의 내부 충돌을 제거하기 위한 새로운 기법을 제안하고 그 성능을 평가한다. 제안한 기법은 반얀망을 구성하는 SE(Switching Element)와 이들 SE간을 연결하는 내부 링크의 규칙적 연결 특성을 이용하여, 초기 반얀망 스위치에 도착한 셀들간의 내부 충돌 여부를 확인하고, 충돌이 확인된 셀들에 대해 새로운 입력 포트 주소를 재할당 함으로써, 모든 셀들의 충돌 없는 전송이 가능하도록 한다. 제안한 기법을 위하여, 초기 입력된 셀들의 스테이지(stage)별 전송 주소 및 이들 각 셀에 대해 충돌이 가능한 입, 출력 포트 주소를 비교할 수 있는 충돌 확인 테이블을 구성하여, 셀들이 각 스테이지를 거쳐 최종 목적 주소까지 전송되는 과정에서의 중간 경로 공유 여부를 확인하여 충돌/비충돌 여부를 결정한다. 충돌 셀로 분류된 셀들은 이들 충돌 셀들을 제외된 비충돌 셀들로 구성한 스테이지별 충돌 확인 테이블을 ORing한 입력 주소 할당 테이블을 통해 내부 충돌이 없는 입력 주소를 재할당한다. 제안한 기법은 C 언어로 구현된 NBPG 시뮬레이터를 통하여 그 성능을 평가한다.
A design and control method of DC/DC converter, which can control variable DC-link voltage to drive a fuel cell electric vehicle (FCEV), is proposed in this study. Given that a fuel cell has low-voltage and high-current characteristics, the required voltage for operating motor must be output through the DC/DC boost converter in the system to drive an FCEV. The proposed converter can choose the output voltage of battery or fuel cell in consideration of the driving mode, as well as control DC-link voltage in accordance with the back electromotive force. The switching lag-time to prevent shortage of pulse-width modulation inverter arms makes distorted current waveform caused by voltage distortion. Through this control method, the proposed converter can reduce the output voltage distortion and current ripple of the inverter, thereby reducing the distorted torque. Simulations and experimental results are presented to verify the reliability of the proposed DC/DC converter.
ATM은 패킷 데이터 서비스 통신에 적합한 통신방식으로 데이터, 음성, 영상 등의 서비스를 동시에 지원할 수 있다. 이러한 ATM의 QoS를 보증하기 위해서는 패킷 데이터를 전송하는 소스 비율에 대해 네트워크 초과적조 조건을 조절하는 것이 필요하는데 대부분의 제어알고리즘이 임계값을 기반으로 한 피드백 제어방식이다. 그러니 실시간 음성 트레픽과 같은 서비스는 네트워크 상에서 데이터 서비스 동안에 동적인 연결이 설정되고 종료될 수 있으므로 피드벡 제어정보가 지연된다면 고속으로 서비스된 음성 데이터에 대한 품질은 소스의 목적지 사이의 시간 지연으로 인해 손실될 수 있다. 본 논문에서는 제시된 최소평균제곱오차에 근거를 둔 제어 알고리즘은 예시적인 피드백 제어로 피드백 제어를 위해 미지함수의 기울기와 버퍼크기를 이용하여 미래의 버퍼크기를 예측하려 하였으며 시뮬레이션 질과 본 논문에서 제시한 제어 알고리즘은 효과적임이 증명되었다.
The invention of VHDL(Very High Speed Integrated Circuit Hardware Description Language), Technical language of Hardware, is a kind of turning point in digital circuit designing, which is being more and more complicated and integrated. Because of its excellency in expression ability of hardware, VHDL is not only used in designing Hardware but also in simulation for verification, and in exchange and conservation, composition of the data of designs, and in many other ways. Especially, It is very important that VHDL is a Technical language of Hardware standardized by IEEE, intenational body with an authority. The biggest problem in modern circuit designing can be pointed out in two way. One is a problem how to process the rapidly being complicated circuit complexity. The other is minimizing the period of designing and manufacturing to survive in a cutthroat competition. To promote the use of VHDL, more than a simple use of simulation by VHDL, it is requested to use VHDL in composing logical circuit with chip manufacturing. And, by developing the quality of designing technique, it can contribute for development in domestic industry related to ASIC designing. In this paper in designing SMPS(Switching mode power supply), programming PWM by VHDL, it can print static voltage by the variable load, connect computer to chip with byteblaster, and download in Max(EPM7064SLCS4 - 5)chip of ALTER. To achieve this, it is supposed to use VHDL in modeling, simulating, compositing logic and product of the FPGA chip. Despite its limit in size and operating speed caused by the specific property of FPGA chip, it can be said that this method should be introduced more aggressively because of its prompt realization after designing.
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[게시일 2004년 10월 1일]
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