목 적: 언어발달장애를 주소로 내원하는 소아들을 대상으로 청성뇌간반응(ABR)을 선별검사로 시행함으로써 그 원인을 조기 발견하고 조기 치료함으로써 이들의 장애를 최소화하고 언어발달 과정에 도움을 주고자 본 연구를 시행하였다. 방 법 : 1999년 1월부터 2001년 12월까지 3년 동안 경북대학교병원 소아과에 언어발달장애를 주소로 내원한 18개월 이상 소아 139례를 대상으로 하여 청성뇌간반응(ABR)을 시행하였으며 이들의 임상진단과 ABR 이상에 따라 분류하였다. 결 과 : 전체 139례 중 ABR 검사상 이상소견을 보인 환아는 15례(10.8%)였으며 전반적 발달장애 7례, 발달성 언어장애 4례, 기타 4례로 나타났으며 이상소견을 보인 환아 중 7례는 전음성 난청이었으며 8례는 감각신경성 난청이었다. 또한 ABR 검사상 정상을 보인 18개월에서 7세 사이의 I파 및 V파의 평균잠복기 및 표준편차는 각각 $1.40{\pm}0.13$, $5.57{\pm}0.26$이었으며, I-V의 정점간 잠복기는 $4.18{\pm}0.24$였다. 중등도 이상의 감각신경성 난청환아의 4례에서 보청기를 착용하였으며 이들을 추적 관찰하였다. 결 론: 언어발달장애를 주소로 내원하는 소아들에게 선별검사로서의 ABR은 반드시 필요한 것으로 생각되며 이것을 통해 감각신경성 난청을 조기 발견하고 감각 신경성 난청의 경우 보청기를 사용하여 조기 치료함으로써 이들의 신경학적 발달 및 사회적 적응에 도움을 줄 수 있을 것이다.
난타는 북과 같은 타악기를 이용한 "두드리기"라는 뜻으로 한국 전통 음악인 사물놀이의 리듬이다. 말소리 산출이 제한된 아이들을 위해 난타 프로그램이 개발되어 적용되었다. 또한, 이 연구는 언어 리듬을 이용한 난타 프로그램의 효과에 대한 증거를 제공한다. 난타 음성 리듬 중재 프로그램은 말리듬을 이용하여 개발되었다. 난타 프로그램은 청각 자극, 다양한 소리와 박자, 리듬을 제공했으며, 리듬과 함께 호흡, 발성, 조음의 세 단계로 구성되어 있다. 말소리 목록이 제한된 6명의 아이들이 이 연구에 참여했다. 아동들에게 소리와 박자를 탐색하고 소리와 박자를 자유롭게 표현하도록 하였다. 또한, 리듬과 함께 단어를 모방하고 모방하는 단어에서 음절의 길이를 늘림으로써 다양한 말소리를 산출하도록 격려하였다. 매 회당 40분 동안 주 2회씩 총 15회의 세션이 실시되었다. 중재 효과를 조사하기 위해 치료 전후 취학전 아동의 수용언어 및 표현언어 발달척도(PRES)와 수용-표현 어휘력 검사(REVT) 점수를 비교하였다. Wilcoxon rank test 결과, 중재 후 PRES에서 수용언어 점수(p=.027)와 표현언어 점수(p=.024) 및 수용어휘력(p=.028)과 표현어휘력 (p=.028) 점수가 유의하게 향상되었음을 보여주었다. 난타 리듬 컨트롤 프로그램은 수용적이고 표현적인 어휘와 언어 발달에 상당한 긍정적인 영향을 미쳤다. 이러한 발견들은 리듬 컨트롤 프로그램이 제한된 음성 소리 생성을 가진 어린이들의 언어 발달과 어휘 향상에 유용할 수 있다는 것을 암시한다.
본 연구는 정상 및 불안 집단 대학생을 대상으로 하나 또는 그 이상의 부정적 어휘를 포함하는 서술어의 의미추론 과정에서 정서유형 및 부정어휘 출현의 정도가 과제처리 속도에 미치는 영향을 알아보고자 수행되었다. 정서 3유형, 자극 2유형 그리고 부정어휘 횟수 3유형을 피험자 내 변인으로, 벡(Beck) 불안척도로 구분된 불안수준을 피험자 간 변인으로 혼합반복측정 설계를 적용하여 피험자 반응시간에 대해 분석한 결과, 정서유형과 자극의 종류 그리고 부정어휘 횟수에 대한 주효과를 확인하였으며, 불안수준 x 부정어 횟수에서 상호작용이 발견되었다. 긍정적 정서에 비해 부정적 정서에서, 비언어 자극보다는 언어 자극 환경에서 과제처리에 더 효율적이었지만, 부정어휘 변인에서는 그 횟수의 증가가 정상집단의 신속한 반응과 불안집단의 지연된 반응으로 분기되면서 부정어휘처리 반응시간의 지체로 나타났다. 또한 유입 정서유형 및 자극의 종류와 상관없이 불안수준은 과제처리 속도를 지연시키는 요인으로 확인되었다. 아울러 추후 연구를 위한 함의와 한계를 논의하였다.
According to it, a final goal of this study sets up 'Renovation of the Red brick architecture' and development of theoretical foundation and substantial conservation about Red brick architecture through historical records must be settled without delay. Firstly, it analyzes related terminology and adjusts brick architecture's history and features for architectural authenticity about Red brick architecture. It would study production and construction process of brick in korea. From analysis of records, brick of traditional meaning is 'Jeondol' and western brick of modern meaning is 'Red brick'. 'Brick' defines a common designation. This study shows definition of words based on documents published until 19th century and a korean language and architecture terms dictionary. In view of this results, the meaning of brick which combines different types extensively uses 'Chu', 'Jeon', 'Byeok' according to the purpose of use and the current of the times. In case of 'Jeon', it uses jointly different types such as '塼', '磚', '甎'. but '塼' is frequently used. Even though these words like 'byeok' used individual or combination types until the late 19th century, there is no use because of japanese terms in japanese colonial. After liberation, it was the term of the traditional brick. Brick is generally used through modern times. In an unabridged Korean language dictionary, it defines this term as orthodox korean '壁乭' and '?乭'. At that time of japanese colonial, 'Yeonwa(煉瓦)' used in combination with brick. Due to influence it, it partly uses until now but it is not in common use. Also, a Korean language dictionary contains transcription of 'Yeonwa' with same definition as 'Byeokdol'. In the other side, it results from translating japanese into Korean. It would make exact definition of 'Yeonwa'.
Journal of Advanced Marine Engineering and Technology
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제25권2호
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pp.375-382
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2001
In this study, an adapted Turbo Coding Algorithm for reducing communication error of a fire detection system for marine vessels, especially image transmission via power lone. Because it is necessary that this system communicate larger and faster than previous method, this study carried out enhancement a decoding speed by adaptation CRC with Turbo Code Algorithm, improvement of metric method, and reduction of decoding delay by using of Center-to-Top method. And the results are as follows: (1) Confirmed that a Turbo Code is so useful methods for reducing communication error in lots of noise environments. (2)Proposed technology in this study speed increasing method of Turbo Coding Algorithm proves 2 times faster than normal Turbo Code and communication error reducing as well in the board made by VHDL software & chips ALTERA company.
Proportional Integral Derivative (PID) controller tuning is an area of interest for researchers in many areas of science and engineering. This paper presents a new algorithm for PID controller tuning based on a combination of bacteria foraging and particle swarm optimization. BFO algorithm has recently emerged as a very powerful technique for real parameter optimization. To overcome delay in an optimization, combine the features of BFOA and PSO for tuning the PID controller. This new algorithm is proposed to combine both the algorithms to get better optimization values. The real time prototype model of paper machine is designed and controlled by using PIC microcontroller embedded with the programming in C language.
Mental retardation(MR) is one of the most common developmental disabilities, which is characterized by deficits in intellectual and adaptive functions. Most children with MR have cognitive limitation in the mild range. With respect to the etiology, it is believed that genetic and environmental factors are interrelated and show variable pictures. Most children with MR present with speech and language delay during the early years. The diagnosis can be made by clinical features and neuropsychological tests of intelligence and adaptive functioning. The treatment is limited, but many associated problems are amenable to multidisciplinary interventions. The article will review the recent advances in the management of MR and other neurodevelopmental disorders in children.
한국시뮬레이션학회 2001년도 The Seoul International Simulation Conference
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pp.354-358
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2001
Cosim (Hardware and Software Co-Simulator) is a JavaBeans-based simulation tool fur validating systems architecture and estimating performance of web applications. Cosim has four components: Modeler, Translator, Engine and Scenario. Users start from Modeler to describe systems architecture in UML(Unified Modeling Language) deployment diagram, and then specify hardware & software performance parameters such as execution delay, network topology, and frame size. All information specified on Modeler are sent to Translator, and then automatically converted to Java programs. Scenario is responsible to run the Java program and produce results in text reports and graphs. Developers can reduce development time and cost by validating systems architecture of web applications before the actual deployment.
The present paper explores rationales for the process-oriented approach to teaching writing and their implications for EFL writing classes. The product-oriented traditional approach to writing has put too much emphasis on linguistic aspects of writing. It fails to see the enormous complexity of the act of composing. In the process-oriented paradigm, writing is regarded as a messy process leading to clarity and the writer discovers meaning instead of merely' finding an appropriate structure in which to package ideas already developed from the beginning. Based on the underlying assumptions, some suggestions are made for EFL writing classes. Firstly, practitioners should be aware that writing is a recursive activity in which the writer moves backward and forwards between drafting and revising, with stages of re-planning in between. Secondly, writing teachers should help the student writers build an awareness of themselves as a writer and encourage their sense of confidence in writing. Lastly, students should be encouraged to pay their attention to content revision at first, and delay editing changes until the last draft.
This paper proposes on-chip instruction and data cache memories on RISC reduced instruction set computer) architecture which supports fast instruction fetch and data read/write, and enables RISC processor under research to obtain high performance. In the execution of HLL(high level language) programs, heavily used local scalar variables are stored in large register file, but arrays, structures, and global scalar variables are difficult for compiler to allocate registers. These problems can be solved by on-chip Instruction/Data cache. And each cycle of instruction fetch, pad delay causes the lowering of the processors's performance. Cache memories are designed in CMOS technology and SRAM(static-RAM), that saves layout area and power dissipation, is used for instruction and data storage. To speed up and support RISC processor's piplined architecture efficiently, hardwired logic technology is used overall circuits i cache blocks. The schematic capture and timing simulation of proposed cache memorises are performed on Apollo DN4000 workstation using Mentor Graphics CAD tools.
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[게시일 2004년 10월 1일]
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