• 제목/요약/키워드: LC tank circuit

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LC-Tank 매칭 회로를 적용한 RFID 리더용 이중대역 저잡음 증폭기 설계 (A Design of Dual Band LNA for RFID Reader Using LC-tank Matching Circuit)

  • 이제광;고재형;김군태;김형석
    • 정보통신설비학회논문지
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    • 제9권4호
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    • pp.153-157
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    • 2010
  • In this paper, a dual band LNA (Low Noise Amplifier) with a LC-tank matching circuit is designed for 912MHz and 2.45GHz RFID reader. The operating frequency is decided by the LC-tank resonance. The simulated results demonstrate that S21 parameter is 11.683dB and 5.748dB at 912MHz and 2.45GHz, respectively, and the S11 are -10.796dB and -21.261dB, the S22 are -7.131dB and -14.877dB at the same frequencies. The measured NF (Noise Figure) is 0.471 and 1.726 at 912MHz and 2.45GHz, respectively.

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소스 피드백을 이용한 무선랜용 이중대역 저잡음 증폭기 설계 (Design of Dual Band LNA for Wireless LAN Using Source Feedback)

  • 전현진;최금성;구경헌
    • 대한전자공학회논문지TC
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    • 제44권7호통권361호
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    • pp.23-28
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    • 2007
  • 본 논문에서는 무선 랜용 이중대역 GaAs FET 저잡음 증폭기를 설계하기 위하여 인덕턴스 소스 피드백을 이용하고 입력 단에는 이중대역 LC 공진회로를 이용하였으며, 출력단에는 Cheyshev 필터의 임피던스 변환 회로를 이용하였다. 이중대역 증폭기의 입출력정합회로 설계에 필요한 기법 및 수식들을 유도하였으며 설계된 증폭기를 제작하여 측정한 결과 시뮬레이션 결과와 유사한 측정치를 얻을 수 있었다.

InGaP/GaAs HBT 공정을 이용하여 향상된 탱크 구조와 LC 필터링 기술을 적용한 차동 LC 전압 제어 발진기 설계 (Differential LC VCO with Enhanced Tank Structure and LC Filtering Techniques in InGaP/GaAs HBT Technology)

  • 이상열;김남영
    • 한국전자파학회논문지
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    • 제18권2호
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    • pp.177-182
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    • 2007
  • 본 논문은 InGaP/GaAs HBT 공정을 통해 제작한 적응성궤환 잡음제거시스템용 낮은 위상잡음을 갖는 LC 차동 전압제어 발진기를 제안합니다. 전압제어 발진기는 필터링 기술을 포함한 향상된 공진 탱크 구조를 갖습니다. 비대칭 인덕터 대칭 캐패시터 구조로 제안된 전압제어 발진기의 출력 가변 범위는 207 MHz입니다. 출력 전력은 balun과 케이블 손실을 포함하여 -6.68 dBm입니다. 10 kHz, 100 kHz, 1 MHz에서의 위상잡음은 각각 -102.02, -112.04 그리고 -130.4 dBc/Hz입니다. 이 전압제어 발진기는 총 $0.9{\times}0.9mm^2$ 면적 내에 집적화되었습니다.

Optimized Phase Noise of LC VCO Using an Asymmetrical Inductance Tank

  • Yoon Jae-Ho;Shrestha Bhanu;Koh Ah-Rah;Kennedy Gary P.;Kim Nam-Young
    • Journal of electromagnetic engineering and science
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    • 제6권1호
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    • pp.30-35
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    • 2006
  • This paper describes fully integrated low phase noise MMIC voltage controlled oscillators(VCOs). The Asymmetrical Inductance Tank VCO(AIT-VCO), which optimize the shortcoming of the previous tank's inductance optimization approach, has lower phase noise performance due to achieving higher equivalent parallel resistance and Q value of the tank. This VCO features an output power signal in the range of - 11.53 dBm and a tuning range of 261 MHz or 15.2 % of its operating frequency. This VCO exhibits a phase noise of - 117.3 dBc/Hz at a frequency offset of 100 kHz from carrier. A phase noise reduction of 15 dB was achieved relative to only one spiral inductor. The AIT-VCO achieved low very low figure of merit of -184.6 dBc/Hz. The die area, including buffers and bond pads, is $0.9{\times}0.9mm^2$.

WDM 방식을 이용한 DPLL 구현에 관한 연구 (A Study on the DPLL Implementation using the WDM Phase Detector)

  • 이상목;정재훈;최상태;한일송
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 1987년도 전기.전자공학 학술대회 논문집(II)
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    • pp.950-953
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    • 1987
  • A wave difference method(WDH) phase detector for timing recovery is designed in the digital subscriber loop receiver. This paper describes the architecture and experimental results of the WDM, tankless timing extraction PLL. The results show that the designed WDM timing extraction circuit have stable jitter performance without the use of high precision LC tank circuit.

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InGaP/GaAs HBT 기술을 이용한 GPS대역 LC-VCO 설계에 관한 연구 (Design of a LC-VCO using InGap/GaAs HBT Technology for an GPS Application)

  • 최영구;김복기
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2006년도 추계학술대회 논문집 Vol.19
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    • pp.127-128
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    • 2006
  • The proposed differential LC cross-coupled VCO is implemented in InGap/GaAs HBT process for an adaptive Global Positioning system(GPS) application. Two filtering capacitors are used at the base of output buffer amplifiers at the both sides of the core m order to improve phase noise characteristics. The VCO produced a phase noise of -133 dBc/Hz at 3MHz offset frequency from the carrier frequency of 1.489GHz and the second harmonic suppression is significantly suppresed up to -49dBc/Hz in simulation result. The three pairs of BC diodes are integrated m the tank circuit to increase the VCO Tunning range.

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보조회로를 이용한 3상 ZCS 인버터에 관한 연구 (A Study on the Three Phase ZCS(Zero Current Switching) Inverter using Auxiliary Circuit)

  • 배진용;김용;백수현;김필수;최근수;이택기
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2003년도 추계학술대회 논문집 전기기기 및 에너지변환시스템부문
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    • pp.209-212
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    • 2003
  • This paper proposes a soft-transition control strategy for a three phase ZCS(Zero Current Switching) inverter circuit. Each phase leg of inverter circuit consists of an LC resonant tank, two main switches, and one auxiliary switches. This paper presents design consideration via a study example of a three phase prototype inverter for motor drives. A simple device tester with zero current switching capability is proposed to select eligible auxiliary switches. The principle of operation, feature and design considerations are illustrated and verified through the experiment with a 2.2kW 5kHz IGBT based experimental circuit.

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보조 스위치를 이용한 3상 ZCS 인버터에 관한 연구 (A Study on the Three Phase Inverter using Auxiliary Switches)

  • 배진용;김용;백수현;최근수
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2004년도 춘계학술대회 논문집 전기기기 및 에너지변환시스템부문
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    • pp.155-158
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    • 2004
  • This paper proposes a soft-transition control strategy for a three phase ZCS(Zero Current Switching) inverter circuit. Each phase leg of inverter circuit consists of an LC resonant tank, two main switches, and two auxiliary switches. This paper presents design consideration via a study example of a three phase prototype inverter for motor drives. A simple device tester with zero current switching capability is proposed to select eligible auxiliary switches. The principle of operation, feature and design consideration is illustrated and verified through the experiment with a 2.2kW 5kHz IGBT based experimental circuit.

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LC형 다중 위상 PLL 이용한 40Gb/s $0.18{\mu}m$ CMOS 클록 및 데이터 복원 회로 (40Gb/s Clock and Data Recovery Circuit with Multi-phase LC PLL in CMOS $0.18{\mu}m$)

  • 하기혁;이정용;강진구
    • 대한전자공학회논문지SD
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    • 제45권4호
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    • pp.36-42
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    • 2008
  • 본 논문은 광통신-시리얼 링크를 위한 40Gb/s 클록 및 데이터 복원 회로의 설계를 제안한다. 설계된 본 회로는 다중 위상을 생성하는 LC 탱크 PLL을 이용하여 8개의 샘플링 클록을 생성하고 $2{\times}$ 오버샘플링 구조의 뱅-뱅 위상 검출기를 이용하여 데이터와 클록의 위상을 조정한다. 40Gb/s의 입력 데이터가 샘플링을 거쳐서 1:4 디멀티플렉싱되어 4채널에 10Gb/s 출력으로 복원되는 구조로서 디지털과 아날로그의 전원을 분리하여 설계가 진행되었다. 인덕터를 사용하여 칩면적은 $2.8{\times}2.4mm^2$을 차지하고 전력소모는 약 200mW이다. 0.18um CMOS공정으로 칩 제작후 측정결과 채널당 악 9.5Gb/s 출력이 측정되었다(직렬입력 약 38Gb/s 해당).

120kW급 탈황탈질용 MPC전원장치 개발 (Development of the 120kW Class MPC Power Supply for DeNOx and DeSox System)

  • 김수홍;권병기
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 2009년도 정기총회 및 추계학술대회 논문집
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    • pp.237-239
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    • 2009
  • This paper presents a new developed 160kV-120kW Class MPC (magnetic pulse compressor) power supply for DeNOx, DeSOx system. The circuit consists of N-series connected CCPS (capacitor charging power supply) and MPC Tank. The MPC power supply developed compared to the conventional LC resonant type has many advantage, it was verified reliability of a product by module, simulator and tank connection test. Now, the developed MPC power supply is installed POSCO sintering plant for DeSOx, DeNOx system.

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