• 제목/요약/키워드: Image chip

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The Design and Characteristic Analysis of a Digital Signal Transmission System Based on Power Line Communications

  • Kim, Ji-Hyoung;Yun, Ji-Hun;Kim, Yong-K.;So, Byung-Moon
    • Transactions on Electrical and Electronic Materials
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    • 제10권6호
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    • pp.222-226
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    • 2009
  • The objective of this study is to share multimedia contents included in existing digital devices and to solve the problems of an increase in installation fees and non-environmentally friendly interiors. This study designed a new digital signal transmitter and receiver using power line transmission and HDMI in order to solve the problems in the existing systems. The transmitter and receiver designed in this study used an AD9867BCPZ PLC chip in which the transmission came from digital signals originating in a PC, and the system architecture was configured so that the outputs signals were connected to a TV from the receiver. The experiment was implemented by adding a Video Test Generator, a USBPre external sound card, and Smaart Live 6 for analyzing the characteristics of the configured system. In the video test results, it was verified that communication was actively implemented, and the image quality showed a constant level from the measurement of the captured video. In the case of the sound, it was verified that more than 90% of the sound signals were normally transmitted and received from the examination of their phases and magnitudes. Thus, the performance of the system designed in this study was verified, which leads to the resolution of some of the problems found in current digital devices.

전류예측기를 이용한 10비트 저전력 전류구동 CMOS A/D 변환기 설계 (Design of a 10 bit Low-power current-mode CMOS A/D converter with Current predictors)

  • 심성훈;권용복;윤광섭
    • 전자공학회논문지C
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    • 제35C권10호
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    • pp.22-29
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    • 1998
  • 본 논문에서는 휴대용 영상신호처리 시스템에 집적화할 수 있는 전류예측기와 모듈형 기준전류원을 이용한 10비트 저전력 전류구동 CMOS A/D 변환기를 설계하였다. 전류예측기와 모듈형 기준 전류원을 사용함으로써 2단 플래시구조를 갖는 A/D 변환기에 비해 비교기와 기준전류원의 개수를 줄일 수 있게 되었고, 따라서 설계된 A/D변환기의 저전력 동작이 가능하였다. 설계된 10비트 저전력 전류구동 CMOS A/D 변환기는 0.6㎛ n-well single-poly triple metal CMOS 공정을 사용하여 제작되었다. +5V 단일 공급전압하에서 동작할 때 측정된 전력소모는 94.4mW이며, 아날로그 입력 전류범위는 16㎂에서 528㎂로 측정되었으며, INL과 DNL은 각각 ±1LSB, ±0.5LSB이하로 나타났다. 또한 10MSamples/s의 변환속도를 나타내었고, 제작된 10비트 전류구동 CMOS 4/D 변환기의 유효 칩면적은 1.8㎜ x 2.4㎜이다.

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W-Band 다이오드 검출기 설계 (Design of W-Band Diode Detector)

  • 최지훈;조영호;윤상원;이진구
    • 한국전자파학회논문지
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    • 제21권3호
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    • pp.278-284
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    • 2010
  • 본 논문에서는 저잡음 증폭기와 무바이어스 쇼트키 다이오드를 사용하여 W-Band에서 동작하는 밀리미터파 다이오드 검출기를 설계, 제작하였다. 향상된 감도 특성을 얻기 위해 다이오드 검출기는 검출기와 저잡음 증폭기로 구성된다. 저잡음 증폭기단은 발진을 제거하기 위해, 높은 저지 대역 특성을 갖도록 설계된 하우징에 저잡음 증폭기 MMIC 칩을 사용해 제작한다. 다이오드 검출기단은 단순한 구조를 사용하기 위해 무바이어스 쇼트기 다이오드를 사용하고, 저잡음 증폭기단과의 연결을 용이하도록 하기 위해 평면형으로 설계한다. 설계 및 제작된 W-band 검출기는 입력 전력 -45~-20 dBm의 변화에 대하여 20~500 mV의 출력 전압을 얻었다. 본 검출기는 수동 밀리미터파 영상 시스템에 적용할 수 있다.

SOP형 IC의 고 정밀 외관검사 시스템 구현 (Realization of a High Precision Inspection System for the SOP Types of ICs)

  • Tae Hyo Kim
    • 융합신호처리학회논문지
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    • 제5권2호
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    • pp.165-171
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    • 2004
  • 반도체 IC의 소형화와 고 밀도화에 따르는 소자의 외관적 불량을 육안으로 식별하는 것이 거의 불가능하며, 불량요소도 다양하여 고 정밀 비젼시스템의 도입이 필수적인 제조공정으로 자리매김 되고 있다. 특히 리드의 뜸 상태검사는 망상처리 알고리즘의 구현이 어려운 점이 있다. 따라서 본 논문에서는 칩의 면적이 1cm${\times}$0.5cm인 SOP형 IC의 불량을 검출하는 외관검사 시스템을 구현하고, 그 성능을 평가하고자 한다. 여러 가지 항목을 최적으로 검사하기 위하여 기하적 길이, 간격, 각도, 명도 및 위치보정 등을 이론적으로 전개하였고, 시스템 구성을 위해 인터페이스 회로를 설계하여 Handler와 결합하였다. 그 결과 초당 2개의 IC를 검사하고, 화소 당 20$\mu$m의 분해능을 가지는 계측 정밀도를 확인하였다.

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시청피로 저감형 S3D 영상 재생 시스템 구현 및 실시간 처리를 위한 알고리즘 연산량 분석 (Implementation of Stereoscopic 3D Video Player System Having Less Visual Fatigue and Its Computational Complexity Analysis for Real-Time Processing)

  • 이재성
    • 한국정보통신학회논문지
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    • 제17권12호
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    • pp.2865-2874
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    • 2013
  • 최근 박스 오피스 상위권 작품들의 상당수가 Stereoscopic 3D 상영을 병행하고 있으며 삼성, LG 등 세계 유수 가전업체들이 3DTV 판촉에 열을 올리고 있다. 그러나 사람마다 양쪽 눈동자 간격이 다르고 시청 거리와 위치도 개인마다 다르다는 점을 무시한 채 동일한 양안 시차로 제작된 3D 컨텐츠를 시청하게 될 경우 실세계에서 느끼는 입체감과 커다란 괴리가 발생하게 되어 극심한 시각 피로와 두통을 유발하게 된다. 이를 해결하기 위해 본 논문에서는 양안 시차와 시청 거리를 반영하여 입체 컨텐츠를 실시간으로 보정, 재생하는 S3D 렌더링 시스템을 제안 및 구현하고 그 연산 복잡도를 분석한다. 분석 결과 Optical Flow 알고리즘 블록은 한 프레임당 수행 시간이 최대 732초에 이르러 반드시 하드웨어 가속기 형태로 전용칩화할 필요가 있음을 확인하였고 Warping 알고리즘 처리 블록도 프레임당 최대 5.7초의 시간이 필요해 HD급 또는 1080p Full HD 화면 재생을 위해서는 함께 전용칩화 할 필요가 있음을 확인하였다.

고성능 루프내 필터를 위한 효율적인 SAO 하드웨어 설계 (Hardware Design of Efficient SAO for High Performance In-loop filters)

  • 박승용;류광기
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2017년도 추계학술대회
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    • pp.543-545
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    • 2017
  • 본 논문에서는 고성능 루프내 필터를 위한 SAO 하드웨어 구조 설계에 대해 기술한다. SAO는 루프내 필터 내부 모듈이며, 블록 단위 영상 압축 및 양자화 등에서 발생하는 정보의 손실을 보상하는 기술이다. 하지만, HEVC의 SAO는 픽셀 단위 연산을 수행하기 때문에 높은 연산 시간을 요구한다. 따라서 본 논문에서 제안하는 SAO 하드웨어 구조는 고속연산을 위해 $4{\times}4$ 블록 연산과 2단 파이프라인 구조를 기반으로 한다. SAO 연산을 위한 정보생성 및 offset 연산구조는 병렬구조로 설계하여 연산시간을 최소화 하였다. 제안하는 하드웨어 구조는 Verilog HDL로 설계하였으며, TSMC 칩 공정 130nm 및 65nm 셀 라이브러리로 합성을 진행하였다. 130nm에서 최대 동작 주파수는 476MHz이고, 전체 게이트 수는 163k이다. 65nm에서 최대 동작 주파수는 312.5MHz이고, 전체 게이트 수는 193.6k이다.

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인공위성용 서미스터의 온도측정 정확도 분석 (Accuracy analysis on the temperature measurement with thermistor)

  • 석병석;이윤기;이나영
    • 항공우주기술
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    • 제7권1호
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    • pp.115-120
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    • 2008
  • 인공위성에 사용되는 온도 측정 센서는 서미스터(Thermistor) 와 AD590이 주로 많이 사용되고 있다. AD590은 IC chip으로 서미스터에 비해 고가이며 $1^{\circ}C$ 온도 변화에 출력 전류가 약 $1{\mu}A$ 변하는 특성을 가진다. 이에 비해 서 미스터는 온도 변화에 따라 저항 값이 변하므로 외부에서 전류나 혹은 전압 stimulus를 인가해 주어야한다. 또한 일반적으로 AD590에 비해 저가이며 NTC(Negative Temperature Coefficient)와 PTC(Positive Temperature Coefficient) 두 가지 형태의 센서가 사용되고 있다. 고 정밀 저궤도 지구관측용 인공위성의 경우 온도에 따른 카메라 구조물의 변형이 최종 영상 품질에 영향을 미치게 되므로 고 품질의 영상획득을 위하여 카메라 구조물의 정밀 온도 제어가 필수적으로 요구되며 이를 구현하기 위해서 매우 정확한 온도측정 요구조건이 주어지게 된다. 저궤도 인공위성의 경우 카메라 시스템에 부착된 온도센서의 측정 정확도 요구조건이 $0.3^{\circ}C$ 까지 요구되는 경우도 있다. 본 논문은 저 궤도 인공위성에 적용된 서 미스터의 온도 측정 정확도에 대한 분석 내용을 나타내었다.

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ARM을 이용한 카메라 시스템 보드 개발에 관한 연구 (Development of Camera System Board Using ARM)

  • 최영규
    • 한국정보전자통신기술학회논문지
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    • 제11권6호
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    • pp.664-670
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    • 2018
  • 현대 사회는 감시의 눈이라 하는 CCTV가 일상생활 속에서 다양한 방법으로 영상데이터를 수집하기 위해 사용되고 있다. 치안 및 감시, 방범용으로 CCTV를 활용할 뿐만 아니라 자동차에 블랙박스 등 많은 분야에서 활용되고 있다. 본 논문에서는 STM32F407 ARM 칩을 기반으로 다양한 분야에 응용할 수 있는 카메라 시스템을 개발하기 위해 연구를 진행하였다. 카메라 시스템 개발을 위해 솔리드 웍스 환경에서 전체적인 구조를 3D를 기반으로 카메라 시스템을 모델링을 진행하였다. PCB 보드 설계는 카메라 시스템 모델링 파일에서 PCB 부품을 iges 파일로 추출하여 Altium Designer 툴에서 3D와 2D 보드로 변환하여 PCB 설계 진행함으로써 완성도 높은 조립성을 가질 수 있도록 진행하였다. 카메라 시스템 회로 및 PCB를 설계한 후, TRM(Thermal Risk Management) 툴을 활용해서 보드에서 발생하는 발열 시뮬레이션을 진행을 통해 대처할 수 있도록 함으로써 안정적인 시스템 구현에 관한 연구를 진행하였다.

여성 피트니스웨어 색채 분석 -2017 SS시즌을 중심으로- (Analysis of Women's Fitness Wear Colors -Focused on 2017 S/S-)

  • 김리라;주미영
    • 패션비즈니스
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    • 제23권2호
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    • pp.110-123
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    • 2019
  • This study aims to investigate the color characteristics of female fitnesswear by analyzing the status of color usage and color arrangement method of each item of female fitnesswear of sports brands. This study targeted eight global total sportswear brands. A total of 2956 colors of female sportswear were collected and analyzed from the homepage of each brand. As a result of analyzing the color of fitnesswear, first, the overall color of the fitnesswear showed high distribution centered on PB, Bk and R of low color tone, such as p and dkg. Moreover, bright tone colors were added for vitality and functional image of sports. Second, as a result of analyzing the color of each item, commonly, the PB, Bk and R had large proportions. Third, as a result of analyzing 2-color arrangements of fitnesswear, color arrangements including achromatic color had overwhelmingly higher frequency than color arrangements that had only chromatic colors. This shows that the color arrangement using achromatic color is important and has a higher preference. Fourth, as a result of extracting the representative color arrangement as color chip and comparing, the 2-color arrangement of female fitnesswear had the characteristics of the color arrangement of large area main color and small amounts of emphasized color centered on achromatic colors of Bk and W. This study is meaningful that it can be utilized as basic data for color planning of fitnesswear brands by subdividing female fitnesswear into 4 items and analyzing the color-tone and arrangement.

호환성 및 속도 향상을 위한 FPGA 기반 DDR 메모리 인터페이스의 최적화 (Optimization of FPGA-based DDR Memory Interface for better Compatibility and Speed)

  • 김대운;강봉순
    • 한국정보통신학회논문지
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    • 제25권12호
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    • pp.1914-1919
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    • 2021
  • 첨단산업의 발전에 따라 영상처리 하드웨어의 연구는 필수적이고, 실제 칩 동작을 위해서는 게이트 수준의 타이밍 검증이 필요하다. 이를 위해 주로 FPGA 기반 검증이 이루어지는데 기존에는 DDR3 메모리 인터페이스를 적용했지만, 최근에는 FPGA 스펙이 향상되면서 DDR4 메모리가 사용된다. 이 때 기존에 사용하던 메모리 인터페이스를 적용하면 CPU와 메모리의 성능 차이에 의한 신호들의 타이밍 불일치가 발생하기 때문에 사용할 수 없다. 본 논문에서는 기존 인터페이스 시스템 FSM의 State 최적화를 통해 문제를 해결하고, 이 과정에서 AXI Data Width 수정을 통해 데이터 읽기 속도를 2배 증가시킨다. 실제 사례 분석을 위해 Xilinx 사의 SoC보드 중 DDR3 메모리를 사용하는 ZC706과 DDR4 메모리를 사용하는 ZCU106을 사용한다.