본 논문에서는 유 무선 네트워 킹을 지원하는 TRS 중계기의 전체적인 RF 시스템들을 디지털 방식으로 제어 할 수 있는 고성능 병렬 제어 시스템을 구현하였다. 구현된 시스템은 순 역방향 LPA(Linear Power Amplifier), 순 역방향 LNA(Low Noise Amplifier), 채널카드, 직렬통신(RS-232), 유 무선 TCP/IP 통신의 제어를 담당하는 FPGA(Field Programmable Gate Array) 칩과 전체 시스템의 제어를 관장하는 마스터(Master) 마이크로프로세서, 순 역방향 스펙트럼 분석기(Spectrum Analyzer, SA)를 내장하여 현재 통신되고 있는 채널의 주파수 스펙트럼을 5KHz 단위의 해상도로 관찰할 수 있도록 하는 슬레이브 마이크로프로세서, 각각의 채널카드들을 개별적으로 감시하고 채널카드내의 주파수 합성기(Frequency Synthesizer)를 프로그래밍하기 위한 10개의 채널카드용 마이크로프로세서, 그리고 그 밖의 몇 가지 주변기기들과 회로들로 구성된다. 전체 시스템은 동작의 효율성과 병렬성을 비롯하여 구현의 적합성과 비용을 고려하여 H/W(Hardware) 및 S/W(Software) 부분으로 나누었고, H/W도 FPGA과 마이크로프로세서로 나누어서 최적화를 이루고자 노력하였다.
This paper describes the reduction of DB without degradation of speech quality in Corpus-based Speech synthesizer of Korean language. In this paper, it is proposed that the frequency of every unit in reduced DB should reflect the frequency of units in Korean language. So, the target population of every unit is set to be proportional to their frequency in Korean large corpus(780K sentences, 45Mega phonemes). Second, the frequent instances during synthesis should be also maintained in reduced DB. To the last, it is proposed that frequency of every instance should be reflected in clustering criterion and used as criterion for selection of representative instances. The evaluation result with proposed methods reveals better quality than using conventional methods.
This paper describes the reduction of DB without degradation of speech quality in Corpus-based Speech synthesizer of the Korean language. In this paper, it is proposed that the frequency of every unit in reduced DB reflect the frequency of units in the Korean language. So, the target population of every unit is set to be proportional to its frequency in Korean large corpus (780k sentences, 45Mega phones). Secondly, the frequent instances during synthesis should be also maintained in reduced DB. To the last, it is proposed that frequency of every instance be reflected in clustering criteria and used as another important criterion for selection of representative instances. The evaluation result with proposed methods reveals better quality than that using conventional methods.
For the core loss measurement under arbitrary waveform of magnetic induction, we have constructed a single sheet core loss measuring system which consists of yoke apparatus for single sheet of $10\;cm{\times}10\;cm$, arvitrary waveform synthesizer, B-feedback system, and two channel transient recorder. Using the constructed measuring system, we can measure core loss including higher harmonics up to 2 kHz. Core loss of non-oreinted electrical steel was increased exponentially when higher harmonic frequency was increased or amplitude of harmonic induction was increased.
In this paper, Self-Oscillating Mixer is designed by oscillator that was based on a general nonlinear input-output model for the subharmonic injection locked oscillator is analysed. We have designed and fabricated the Self-Oscillating Mixer for 5GHz by proposed subharmonic injection locked oscillator based frequency synthesizer structure that have characteristic of good frequency sensitivity, good phase noise. The design strategy leading to an optimized SILO with regards to its locking range is described and a test SOM circuit is demonstrated a 4dB conversion gain at 280MHz IF frequency from the carrier.
JSTS:Journal of Semiconductor Technology and Science
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제13권2호
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pp.170-183
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2013
This paper gives an overview of fractional-N phase-locked loops (PLLs) with practical design perspectives focusing on a ${\Delta}{\Sigma}$ modulation technique and a finite-impulse response (FIR) filtering method. Spur generation and nonlinearity issues in the ${\Delta}{\Sigma}$ fractional-N PLLs are discussed with simulation and hardware results. High-order ${\Delta}{\Sigma}$ modulation with FIR-embedded filtering is considered for low noise frequency generation. Also, various architectures of finite-modulo fractional-N PLLs are reviewed for alternative low cost design, and the FIR filtering technique is shown to be useful for spur reduction in the finite-modulo fractional-N PLL design.
본 연구에서는 광대역 CDMA의 특징과 광대역 CDMA 기술을 이용한 IMT-2000용 단말기에 요구되는 기술규격에 대해서 연구하고 제안하여, 제안된 규격을 만족하는 RF회로 및 이론적 모델을 분석하여 설계하였다. 본 연구에서 구현된 단말기의 RF회로는 3개의 부분으로 구성되어 평가되었다. 주파수합성부는 스왈로우 카운터와 고차 루프필터를 통해 스퓨리어스를 감소시켰다. 송신부의 출력은 50mW이며, 스퓨리어스특성은 5MHz옵셋에서 -40dB/30kHz이며, 전력제어범위는 -20dB이다. 환경 및 이론적설계에서 고려되어야 할 제안 특성들은 가능한 한 간단히 표현되었으나, 본 연구의 결과를 통해 광대역 CDMA 이동통신 시스템의 설계에 활용될 수 있을 것이다.
본 논문에서는 W-CDMA 이용한 10 [MHz]의 채널 대역폭을 갖는 다중채널 무선가입자망 단말기용 RF-모듈을 설계 제작하였다. RF-모듈은 송수신전단, 주파수합성기, 변복조기 및 전력제어회로로 구성하였다. 제작한 RF-모듈에 대한 시험결과 송신전력은 250 [mW], 통과대역내의 진폭과 위상왜곡을 측정한 전력의 평탄도는 ${\pm}1.5[dB]$를 얻었다. 또한 송신시 확산신호의 Chip Rate는 8.312 [Mcps]를 얻었고, 주파수합성기에 대한 측정결과는 RF 대역과 변복조를 위한 국부발진신호 주파수는 설계규격을 만족하였다. 수신전계강도특성과 AGC의 동작범위는 모두 60 [dB]로 만족하였고, RF-모듈과 기저대역과의 연동여부를 확인하기 위해 페이저도와 눈패턴을 측정한 결과 좋은 결과를 얻었다.
본 논문에서는 컴프레시브 RFID 신호를 탐지하기 위한 컴프레시브 수신기의 이론적 배경과 구체적 구현 방법, 그리고 분산 지연선과 chirp LO의 설계 방안에 대해 기술하였다. 컴프레시브 수신기의 주요 구성품 중 하나인 분산 지연선을 대역폭 6 MHz, 분산 지연 시간 $13{\mu}s$으로 설계하여 $LiNbO_3$ 재질 기반의 SAW(Surface Acoustic Wave) 기술을 통해 구현하였고, DDS(Direct Digital Synthesizer)를 이용하여 chirp LO를 구현하였다. 또한 RFID 리더에 내장되어 연동될 수 있도록 컴프레시브 수신기를 구성하였다. 시험 결과, 단일 신호 입력시 주파수 오차는 최대 25 kHz, 수신 감도는 -44 dBm, 500 kHz 간격으로 동시에 입력되는 6개의 신호에 대한 주파수 오차는 최대 75 kHz로서 제작된 컴프레시브 수신기가 밀집된 RFID 운영 환경에 적합함을 보였다.
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[게시일 2004년 10월 1일]
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