• 한국결정학회지
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• 제6권2호
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• pp.88-92
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• 1995

X-선을 이용한 초정밀 측정은 길이, 각도, 결정구조해석 등 많은 분야에서 응용되고 있다. 본 논문은 실리콘 결정을 이용한 초정밀 각도측정에 대한 결과이다. 실리콘 단결정 내부의 여섯 개의 [220] 격자면들은 60°의 사이각(정확도 ∼10-8 rad) 을 이루고 있으므로 육가기둥형의 다면체를 만들어 각도 표준물로 이용하였다. 이러한 각도교정용 실리콘 다면체(silicon polygon)를 사용하여 분해능이 0.36"인 회전엔코더(rotary encoder)의 정확도를 교정하였고, 그 결과를 기존의 회전눈금원판(indexing table)을 사용하여 교정한 결과와 비교하였다.

• 한국정밀공학회지
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• 제17권10호
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• pp.147-154
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• 2000

A new hardware compensation method reducing displacement measurement errors, caused by tilt of index scale in moire linear encoders, has been developed. In conventional moire linear encoders, the detectors are aligned perpendicular to the line of moire fringes this structure is very sensitive to an unwanted tilt of the gratings. In this paper, a newly designed grating, called a phase-modulated grating, is developed to compensate for non-orthogonal errors. By using the phase-modulated grating instead of a conventional index, it is possible to reduce non-orthogonal errors of moire linear encoders.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2001년도 하계종합학술대회 논문집(1)
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• pp.113-116
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• 2001

Reed-Solomon(RS) code is the most powerful burst error correcting code. In Ois paper, the architecture for the adaptive RS encoder adaptable for multi QoS requirements or time-varying channel environments has been designed. In the adaptive RS code, the message length k and the error correction capability t are allowed to be variable so that the block length n is also variable. We proposed the architecture of the adaptive RS encoder by designing the optimal structure of Galois fields multiplier with comparison of fixed multiplier and variable multiplier. The proposed architecture is implemented in VHDL and verified with the simulation tool

• 융합신호처리학회논문지
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• 제8권3호
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• pp.205-210
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• 2007

본 논문에서는 고속으로 아날로그 신호를 디지털 신호로 변환하기 위한 Flash A/D 변환기를 설계하였다. 해상도는 6-Bit로 설계하였으며, Flash A/D 변환기의 단점인 전력손실과 칩의 면적을 줄이기 위하여 CMOS 트랜지스터의 원리인 Threshold Inverter Quantization(TIQ) 구조를 이용하였다. TIQ로 동작시키기 위한 CMOS 트랜지스터 크기는 HSPICE의 반복적인 시뮬레이션 결과로 결정하였다. Flash A/D 변환기의 변환속도를 낮추는 Encoder 부분은 ROM이나 PLA 구조를 이용하지 않고 속도와 소비전력에서 우수하지만 설계과정이 복잡한 Fat Tree Encoder를 사용하였다. 제조공정은 Magna 0.18um CMOS에 Full Custom 방식으로 설계하였다. 시뮬레이션 결과 1.8 V 전원전압에 최대소비전력은 38.43 mW이며 동작속도는 2.7 GSPS를 얻을 수 있었다.

• 융합신호처리학회논문지
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• 제9권4호
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• pp.321-328
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• 2008

본 논문에서는 차세대 정지영상 압축 표준 JPEG2000 CODEC의 Wavelet 변환부와 양자화기의 하드웨어 구조를 제안하고 선계하였다. 본 논문의 칼라 2-D DWT 프로세서는 JPEG 2000 Hard-wired Encoder에 적용하기 위해 제안하였다. JPEG 2000DWT(Discrete Wavelet Transform)에서는 Daubechies 9/7 filter를 사용하였고 2-B DWT의 변환과 복원과정에서의 오차가 ${\pm}1$LSB 이내로 들어갈 수 있게 설계하였다. 기존에 설계되었던 filter의 하드웨어 구조에서 하드웨어 복잡도를 높이는 곱셈기를 사용하지 않고 shift-and-adder 구조를 사용하였다. 이것은 DWT 변환에서 가장 많은 연산을 차지하는 filter의 동작 속도를 향상시킬 수 있으며 하드웨어 복잡도도 낮출 수 있다. 본 시스템은 표준화된 하드웨어 설계 언어인 Verilog-HDL을 사용하여 설계하였고, Synopsys사의 Design Analyzer와 TSMC $0.25{\mu}m$ ASIC Library를 사용하여 검증하였다.

• 센서학회지
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• 제26권6호
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• pp.432-437
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• 2017

As 4.0 industry has been developed, research on a self-driving car technology and related parts of an automobile has been highly investigated recently. Particularly, a TAS(Torque Angle Sensor) module on steering wheel system has been considered as a key technology because of its precise angle, torque detection and high speed signal processing. The environmental assessment is generally required on the TAS module to examine high resolution of angle/torque detection. In the case of existing TAS module, angle detection errors has been occurred by back-lash on main and sub gear in addition to complicated structure caused by gears. In this paper, a structure of the TAS module, which minimizes the numbers of components and angle detection errors on the module compared with the existing TAS module, for vehicle steering system based on a Multi-track Encoder has been proposed. Also, angle detection signal processing board, and key technology of the TAS module were fabricated and evaluated. As a result of the experiments, we confirmed an excellent performance of the fabricated signal processing board for angle detection and an applicability of the fabricated angle detection board on the TAS module of vehicles by the environmental assessment an automobile standard.

• ETRI Journal
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• 제27권5호
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• pp.557-562
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• 2005

Low-density parity-check (LDPC) codes have recently emerged due to their excellent performance. However, the parity check (H) matrices of the previous works are not adequate for hardware implementation of encoders or decoders. This paper proposes a hybrid parity check matrix which is efficient in hardware implementation of both decoders and encoders. The hybrid H-matrices are constructed so that both the semi-random technique and the partly parallel structure can be applied to design encoders and decoders. Using the proposed methods, the implementation of encoders can become practical while keeping the hardware complexity of the partly parallel decoder structures. An encoder and a decoder are designed using Verilog-HDL and are synthesized using a $0.35 {\mu}m$ CMOS standard cell library.

• 한국통신학회논문지
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• 제32권3C호
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• pp.195-204
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• 2007

The cyclic redundancy check(CRC) code used to decide retransmission request in hybrid automatic repeat request(HRAQ) system can also be used to stop iterative decoding of turbo code if it is used as an error correcting code(ECC) of HARQ system. Thus a scheme to use CRC code for both iteration stop and repeat request in the HARQ system with turbo code based on the standard of cdma 2000 system is proposed in this paper. At first, the optimum CRC code which has the minimum length without performance degradation due to undetected errors is found. And the most appropriate turbo encoder structure is also suggested. As results, it is shown that at least 32-bit CRC code should be used and a turbo code with 3 constituent encoders is considered to be the most appropriate one.

• IEIE Transactions on Smart Processing and Computing
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• 제5권6호
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• pp.418-429
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• 2016

In this paper, we propose a hybrid Wyner-Ziv video coding structure that combines conventional motion predictive video coding and Wyner-Ziv video coding to eliminate the feedback channel, which is a major practical problem in applications using the Wyner-Ziv video coding approach. The proposed method divides a hybrid frame into two regions. One is coded by a motion predictive video coder, and the other by the Wyner-Ziv coding method. The proposed encoder estimates side information with low computational complexity, using the coding information of the motion predictive coded region, and estimates the number of syndrome bits required to decode the region. The decoder generates side information using the same method as the encoder, which also reduces the computational complexity in the decoder. Experimental results show that the proposed method can eliminate the feedback channel without incurring a significant rate-distortion performance loss.

• 한국음향학회지
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• 제38권6호
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• pp.670-677
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• 2019

음성 또는 음향 이벤트 신호에서 발생하는 배경 잡음은 인식기의 성능을 저하시키는 원인이 되며, 잡음에 강인한 특징을 찾는데 많은 노력을 필요로 한다. 본 논문에서는 딥러닝을 기반으로 다중작업 오토인코더(Multi-Task AutoEncoder, MTAE) 와 와설스타인식 생성적 적대 신경망(Wasserstein GAN, WGAN)의 장점을 결합하여, 잡음이 섞인 음향신호에서 잡음과 음성신호를 추정하는 네트워크를 제안한다. 본 논문에서 제안하는 MTAE-WGAN는 구조는 구배 페널티(Gradient Penalty) 및 누설 Leaky Rectified Linear Unit (LReLU) 모수 Parametric ReLU (PReLU)를 활용한 변수 초기화 작업을 통해 음성과 잡음 성분을 추정한다. 직교 구배 페널티와 파라미터 초기화 방법이 적용된 MTAE-WGAN 구조를 통해 잡음에 강인한 음성특징 생성 및 기존 방법 대비 음소 오인식률(Phoneme Error Rate, PER)이 크게 감소하는 성능을 보여준다.