• 제목/요약/키워드: Doppler processor

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노이즈에 둔감한 레이저 진동계측기용 실시간 신호처리 장치에 관한 연구 (A Study on the Robust Real-Time Signal Processor of a Laser Doppler Vibrometer for Noises)

  • 박승규;백성훈;김철중
    • 한국정밀공학회지
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    • 제16권1호통권94호
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    • pp.61-67
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    • 1999
  • A laser Doppler vibrometer based on the laser heterodyne interferometry is employed to measure the vibration velocity of vibrating objects. In this paper, we propose a real time analog signal processor of a laser Doppler vibrometer to reduce the degradation of Doppler signals mainly caused by environmental noises. In the proposed real time signal processor of an laser Doppler vibrometer, a pre-processor and a logical motion direction detector are designed to reduce the detection errors of the object motion direction. Also, a noise detection and rejection circuit is designed to reject the unfiltered noises.

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다중 DSP 보드를 이용한 프로그램 가능한 도플러 처리기 (A Programmable Doppler Processor Using a Multiple-DSP Board)

  • 신현익;김환우
    • 전자공학회논문지SC
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    • 제40권5호
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    • pp.333-340
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    • 2003
  • 도플러 처리(Doppler processing) 기능은 잔류(residue) 클러터(clutter)의 제거뿐만 아니라 위상정합누적(coherent integration)을 수행하므로, 펄스 도플러 레이더에 있어서 가장 핵심적인 역할을 수행한다. 디지털 신호처리기(DSP : digital signal processor)의 성능향상과 더불어 DSP를 이용한 구현이 점점 일반화 되어가고 있다. 도플러 처리기가 입력신호를 실시간으로 처리하기 위해서는, 다중 DSP를 이용한 병렬처리 개념이 일반적으로 사용되어야 한다. 본 논문에서는 아날로그 디바이스사의 ADSP21060 8개를 탑재한 Morocco-2 보드를 사용하여 MTI(moving target indicator)필터, 도플러 필터뱅크(DFB : Doppler filter bank) 및 제곱검출기(square-law detector) 등으로 구성된 프로그램 가능한 구조의 도플러 처리기를 구성하였다. 위상정합처리구간(CPI : coherent processing interval) 동안 수신된 입력데이터의 분배(distribution)시간, 출력데이터의 전송(transfer)시간 및 알고리즘 수행에 소요되는 연산시간 등을 수식으로 표현하여, 전체 처리시간과 도플러 처리기 구현에 소요되는 DSP의 수를 예측하였다. 또한 레이더 운용에 필요한 각종 타이밍신호 및 모의 표적신호를 발생할 수 있는 TSG(timing signal generator)를 이용하여 도플러 처리기의 실시간 연산기능을 확인하였다.

헬기탑재 펄스 도플러 레이다 신호처리기 개발 (A Helicopter-borne Pulse Doppler Radar Signal Processor Development)

  • 곽영길;전인평;최민수;황광연;이강훈;이재호
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2005년도 추계종합학술대회
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    • pp.443-446
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    • 2005
  • This paper presents the results of the design and implementation of the airborne pulse doppler radar signal processor using high multi-DSP for the multi-function radar capability such as short-range, midium-range, and long-range depending on the mission of the vehicle. Particularly, the radar signal processor is developed using two DSP boards in parallel for the various radar signal processing algorithm. The key algorithms include LFM chirp waveform-based pulse compression, MTI clutter filter, MTD processor, adaptive CFAR, and clutter map. Especially airborne moving clutter Doppler spectrum compensation algorithm such as TACCAR is implemented for the multi-mode airborne radar system. The test results shows the good Doppler spectral separation for the clutter and the moving target in the flight test environment using helicopter

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고속 Multi-DSP를 이용한 헬기탑재 펄스 도플러 레이다 신호처리기 개발 (A Helicopter-borne Pulse Doppler Radar Signal Processor Development using High Speed Multi-DSP)

  • 곽영길;최민수;전인평;황광연;이강훈;이재호
    • 한국전자파학회:학술대회논문집
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    • 한국전자파학회 2005년도 종합학술발표회 논문집 Vol.15 No.1
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    • pp.23-28
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    • 2005
  • An airborne radar is an essential aviation electronic system of the helicopter to perform various missions in all-weather environments. This paper presents the results of the design and implementation of the airborne pulse doppler radar signal processor using high multi-DSP for the multi-function radar capability such as short-range, midium-range, and long-range depending on the mission of the vehicle. Particularly, the radar signal processor is developed using two DSP boards in parallel for the various radar signal processing algorithm. The key algorithms include LFM chirp waveform-based pulse compression, MTI clutter filter, MTD processor, adaptive CFAR, and clutter map. Especially airborne moving clutter Doppler spectrum compensation algorithm such as TACCAR is implemented for the multi-mode airborne radar system. The test results shows the good Doppler spectral separation for the clutter and the moving target in the flight test environment using helicopter.

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교육용 합성구경레이더 프로세서(eSAR Processor)의 개발과 공개 (Development and Distribution of an Educational Synthetic Aperture Radar(eSAR) Processor)

  • 이훈열
    • 대한원격탐사학회지
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    • 제21권2호
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    • pp.163-171
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    • 2005
  • 합성구경레이더(Synthetic Aperture Radar) 원시 자료(raw data)를 range-Doppler 알고리듬을 이용하여 처리하는 교육용 공개 프로그램을 개발하였다 이 프로그램은 SAR 시스템에 따라 자료처리에 필요한 변수를 자유롭게 조절함으로써, 특정 SAR 시스템에 치우치지 않고 다양한 자료를 처리할 수 있도록 일반화된 알고리듬을 구현하였다. 저가 사양의 컴퓨터에서도 최소 단위의 영상을 선택적으로 처리할 수 있고 자료 처리 중간 단계별로 영상 출력이 가능하기 때문에, 프로그램 작동 상태와 SAR의 원리를 직접 확인할 수 있도록 하였다. 특히 Doppler 변수를 자료 처리 중간 단계의 영상을 보고 직접 구할 수 있도록 고안하여 교육적 효과를 높였다. 또한 자료 처리 알고리듬과 원시프로그램을 모두 공개함으로써, SAR 시스템 원리를 이해하고 응용하는데 도움을 주고자 한다. 이 논문에서는 프로그램의 원리와 작동 환경을 소개하고, ERS-1 원시 자료를 이용한 자료 처리의 예를 보였다.

무인기 탐지를 위한 멀티모드 레이다 신호처리 프로세서 설계 (Design of Multi-Mode Radar Signal Processor for UAV Detection)

  • 이승혁;정용철;정윤호
    • 한국항행학회논문지
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    • 제23권2호
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    • pp.134-141
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    • 2019
  • 레이다 시스템은 송신 파형에 따라 크게 PD (pulse Doppler) 레이다와 FMCW (frequency modulated continuous wave) 레이다로 구분되며, 송수신 특성에 따라 PD 레이다는 장거리 표적 검출에 유리한 반면, FMCW 레이다는 단거리 표적 검출에 적합한 특성을 갖는다. 이에 본 논문에서는 중/장거리 뿐 아니라 단거리 무인기 탐지를 위해 PD 레이다 시스템과 FMCW 레이다 시스템을 모두 지원 가능한 멀티모드 레이다 신호처리 프로세서 (RSP; radar signal processor)를 제안한다. 제안된 레이다 신호처리 프로세서는 Verilog-HDL을 이용하여 RTL 설계 후, Altera Cyclone-IV FPGA를 이용하여 구현 및 검증 되었다. 구현 결과, 총 19,623개의 logic elements, 9,759개의register, 그리고 25,190,400의 memory bit로 구현 가능함을 확인하였으며, 기존의 PD 레이다와 FMCW 레이다 신호처리 프로세서를 개별 구현한 경우에 비해 logic elements와 register 요구량이 약 43%와 39% 감소됨을 확인하였다.

신호자료 및 궤도정보를 이용한 Radarsat-1 도플러 정보 추출기법 연구 (Radarsat-1 Doppler Information Extraction Technique Using Both Received Echo Data and Orbital and Attitude Information of Satellite)

  • 고보연;나원상;이용웅
    • 대한원격탐사학회지
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    • 제19권6호
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    • pp.421-430
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    • 2003
  • Radarsat-1 위성으로부터 수신된 신호자료를 처리하여 영상을 생성하기 위해서는 도플러 정보(도플러 중심주파수(f$_{dc}$) 및 주파수 변화율 (f$_{r}$)를 정확하게 추정하는 것이 중요하다. 일반적으로 이들 정보들은 신호자료를 기반으로 하는 clutterlock 및 auto-focusing 기법이 사용되고 있으나 이들은 수신 신호만을 사용하여 추정하므로 SAR 프로세서 개발시 구현하기가 어려우며 계산 시간도 많이 걸리는 단점이 있다. 본 논문에서는 주어진 위성의 궤도 및 자세정보를 최대한 이용하며 수신신호 처리는 최소한이 되도록 하여 구현이 쉽고 계산상 이점이 있는 새로운 기법을 제안하였다. 실제 Radarsat-1 신호자료를 이용한 실험적용 결과, 본 기법이 실제 SAR 신호자료로부터 도플러 정보를 추출하는데 유용하게 사용될 수 있을 것으로 판단된다.

칼라 도플러 프로세서의 클러터 필터에 관한 연구 (Study on the clutter filter of color Doppler processor)

  • 방지훈;이기종;배무호
    • 대한의용생체공학회:학술대회논문집
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    • 대한의용생체공학회 1998년도 추계학술대회
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    • pp.68-69
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    • 1998
  • Discriminating the clutter signal from Doppler signal is the main function of CDP(color Doppler processor). Up to now, a general method of eliminating clutter signal is using IIR high pass filter. There are many filters that were introduced in other paper. In this paper, we propose the new method of filtering clutter signal. To the new method, we adopt an appropriate filter that can eliminate clutter filter most effectively.

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다중 DSP 구조의 Morocco-2 보드를 이용한 확장성을 갖는 펄스 도플러 레이다 신호처리기 구현 (Realization of the Pulse Doppler Radar Signal Processor with an Expandable Feature using the Multi-DSP Based Morocco-2 Board)

  • 조명제;임중수
    • 한국전자파학회논문지
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    • 제12권7호
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    • pp.1147-1156
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    • 2001
  • 본 논문에서는 레이다 수신신호의 거리 및 방위 방항 데이터의 위상 연속성을 유지하면서 프로세서간의 데이터 전송량을 최소화하는 레이다 신호처리기 구조를 제안하였다. 이는 레이다 기능 알고리듬의 추가나 운용 시나리오 변경 등에 의한 하드웨어 재구성이나 확장이 용이한 다중 DSP 구조의 프로그램 가능한 레이다 신호처리기 이다. 기능 알고리듬 수행 및 신호처리 결과 데이터 전송 소요시간을 측정하여 병열 분산처리 가능한 타스크 구조로 신호처리기를 설계함으로써, 레이다의 기능 알고리듬 수행시 프로세서간 데이터 교환을 필요없게 하였다. 레이다 신호처리기를 구현하기 위하여 아날로그 디바이스사의 ADSP-21060 프로세서가 탑재된 스리트럼사의 Morocco-2 보드와 병렬처리 소프트웨어 개발 도구인 APEX-3.2를 이용하였다.

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유체속도 측정을 위한 레이저 도플러 유속계의 구성에 관한 연구 (A Study on the Construction of LDV System for a Measurement of the Fluid Velocity)

  • 최종원;조재흥;정명세
    • 전자공학회논문지A
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    • 제28A권5호
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    • pp.361-369
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    • 1991
  • The optics and the signal processor of dual beam laser Doppler velocimeter(LDV) was fabricated. By using the dual beam and the forward scattering, the optics part of LDV was fabricated. And the signal processor of LDV was designed by the frequency counter type using new 11:6 period timing device in order to remove error signals, and was made of the reference clock of a 500 MHz ECL oscillator. Doppler frequencies from 10KHz to 70MHz can be measured using the signal processor. In the accuracy of the period counting part, from 1.81x10**-4% to 1.27% is estimated, and in the accuracy of the validation logic part, from 0.78% to 14.78% is estimated.

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