• 한국콘텐츠학회논문지
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• 제8권3호
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• pp.86-96
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• 2008

문자 일반의 체계적 발전의 토대는 기능성과 구조적 측면에서의 조형적 가치에 대한 인식으로 판단된다. 모아쓰기의 원리는 한글 타이포그래피의 핵심이라고 지칭할 수 있으며, 여기에 기능성과 조형성이 깊숙하게 자리잡고 있음을 판단할 수 있는데 이는 다양한 외부요인에 의한 조형적 변화는 물론 한글만의 특수한 자형결합의 원리로 인해 낱글자 내에서도 자음과 모음이 결합되어 공간구조가 발생하고 단어, 글줄, 단락으로 추가 결합되면서 이에 상응하는 제2, 제3의 공간 구조적 특성이 만들어지고, 이는 곧 타이포그래피의 핵심기능인 가독성에 지대한 영향을 미치게 된다. 이러한 맥락에서 볼 때 한글타이포그래피의 공간 구조적특성은 매우 중요한 요인으로 지적될 수 있는데, 우선 형태심리학적 시지각 법칙과 연관지어 검토하고, 이에 따른 네모틀 활자와 탈네모틀 활자를 비교하였다. 그리고 같은 문장의 글을 네모틀 활자와 탈네모틀 활자에 적용시키고 실험을 통해 기능성 즉, 가독성과 판독성을 검증하였다. 따라서 연구자는 한글 타이포그래피에서 공간 구조적 특성이 기능에 매우 많은 영향을 미치고 있는 것을 추출해 낼 수 있었으며 향후 디자인 관점에서 한글타이포그래피의 공간 구조적인 조형성은 커뮤니케이션의 기본개념인 소통과 유기적 관계를 형성함으로 조형적 원리에 입각한 한글 타이포그래피는 디자인뿐만 아닌 커뮤니케이션 환경에서 매우 중요한 요소임을 확인할 수 있었다.

• 한국콘텐츠학회:학술대회논문집
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• 한국콘텐츠학회 2006년도 춘계 종합학술대회 논문집
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• pp.204-210
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• 2006

현대인들의 생활에서 없어서는 안 되는 것 중의 하나가 바로 핸드폰이다. 핸드폰은 사람과 사람의 커뮤니케이션의 도구로서의 기능만이 있었다. 하지만 지금의 핸드폰의 기능에 있어 멀티미디어화 되어가고 있다. 음악을 듣고 사진도 찍고 게임도 한다. 2005년 1월 조사에 따르면 이동통신3사의 가입자의 수가 전체 인구 중 3,600만 명이었으나 2006년 1월 조사에 216만 명이 증가한 3,816명으로 나타났다. 핸드폰의 기능 중에 청소년들의 가장 선호하는 것이 모바일게임이다. 모바일게임은 핸드폰의 작은 액정 속에서 어디서나 쉽고 간단하게 사용 할 수 있는 점에서 많은 인기를 누리고 있다. 이에 전용 모바일 게임 폰이 나왔을 정도이다. 플렛폼의 통합으로 다양한 게임을 즐길 수 있게 되었다. 모바일게임 캐릭터는 대부분이 2등신 이다. 화면의 뷰(view)가 작기 때문에 4등신 이상으로 했을 때에 캐릭터의 감정표현이나 동작 표현에 있어 표현이 안 된다는 단점이 있다. 그러기 때문에 모바일 캐릭터의 표현이 2등신의 캐릭터로 많이 사용한다. 이번 연구에서는 이러한 캐릭터의 디자인요소인 캐릭터의 소재, 형태, 악세사리 동작의 프레임에 있어 어떻게 쓰이고 있는지에 관한 연구를 하였다.

• 한국전산구조공학회논문집
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• 제19권2호
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• pp.195-202
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• 2006

박판 구조물은 자동차를 비롯하여 항공기, 인공위성, 선박 등의 운송 수단과 건축물의 돔과 같이 효율적으로 활용되어지고 있으며 동시에 경량화를 필요로 하는 경우 널리 사용되는 구조물이다. 엔진, 변속기 등의 회전체의 부품을 보호하는 박판 구조물인 자동차 후드에서의 새로운 보강재 형상을 제시하였다. 자동차 후드는 엔진 룸에 장착되어 있는 회전체의 진동 영향을 민감하게 받아 공진현상이 발생할 우려가 있다. 따라서 설계하중을 지지할 강성을 가지며 동적 특성이 고려되어야 한다. 즉, 강성을 유지하면서 공진에 의한 진동도 고려해야 한다. 이는 곧 승차감과 직결된 중요한 문제이다. 그러므로 최적의 강성증대 설계결과를 얻기 위해서는 정적 동적 강성평가와 함께 고유진동수를 고려한 보강재의 최적설계가 도입되어야 한다. 본 연구에서는 고유진동수를 고려한 대표적인 박판 구조물인 자동차 후드의 보강재 위상을 구하고, 도출된 위상에서 보강재의 형상 최적 설계 후 제시된 보강재 단면의 최적 치수를 다구찌 방법을 이용한 직교 배열표상에서의 각 설계변수의 수준과 최적의 설계변수의 조건으로 구하였다.

• 지구물리와물리탐사
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• 제9권1호
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• pp.108-113
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• 2006

일반적인 물리탐사기법은 도심지 내에서 구조물, 전도성 지하매설물, 차량 등 인공 잡음으로 인하여 그 적용성에 많은 제약을 받는다. 특히 이 과업은 철도가 운행 중인 철로 하부의 지반 정보의 획득을 목적으로 하는데, 이를 위한 일반적인 물리탐사 적용이 어려웠으며 그 대안으로 선형배열 상시진동 탄성파탐사를 적용하였다. 상시진동 탐사(mircotremor survey)기법에는 철로를 운행하는 기차와 주변 도로의 차량에 의한 진동이 오히려 양호한 송신원으로 활용 될 수 있다. 선형배열 상시진동 탐사기법에서는 일반적인 굴절법 장비를 이용하여 일상적인 진동을 기록하고, 파동장의 변환을 수행하여 표면파의 분산곡선을 얻는다. 이후 발췌한 분산곡선에 대한 반복적인 수치모델링을 통하여 전단파 속도를 구한다. 이 과업에서는 기존 철로를 따라 하부의 터널심도까지의 전단파 속도를 전체 터널구간에 대하여 얻기 위하여 40 m 간격으로 선형배열을 이동하면서 자료를 획득하였다. 측선상의 시추를 통하여 회수한 코어를 이용한 실내시험을 통한 RMR 의 구성요소 중 하나인 일축압축강도와 전단파 속도와의 높은 상관관계를 확인하여 RMR이 전단파 속도와 연관성이 있음을 유추할 수 있었다. 시추공에서 수행한 SPS 검층에서 획득한 전단파 속도와 RMR의 비교한 결과 전단파 속도와 RMR이 높은 상관관계에 있음을 확인할 수 있었다. 상시진동 탐사기법을 통하여 획득한 전단파 속도 역시 RMR과의 양호한 상관관계를 나타냄을 알 수 있었다. 이러한 상관관계를 이용하여 도심지 철도터널 전체 구간에서 터널 설계시 필수적인 암반분류를 위한 RMR 추정이 가능하였다.

• 한국전자파학회논문지
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• 제21권2호
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• pp.121-128
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• 2010

본 논문에서는 부궤환 회로, 푸쉬풀 구조, 광대역 RF choke, 전송 선로 트랜스포머를 이용하여 30~512 MHz의 초광대역에서 동작하는 100 W 고효율 전력 증폭기를 설계하였다. 출력 전력을 향상시키고자 전송 선로를 이용한 트랜스포머에 병렬로 커패시터를 삽입하여 적절하게 로드 임피던스를 정합하였다. 제작한 광대역 전력 증폭기는 동작 주파수 대역에서 100 W 이상의 출력 전력과 $18.34{\pm}0.9\;dB$의 높고 고른 이득 특성을 보였다. one-tone 측정에서 2차 고조파는 -34 dBc 이하, 3차 고조파는 -12 dBc 이하의 선형성 특성을 보였으며, 출력 전력 100 W에서 약 40% 이상의 고효율 특성을 보였다.

• 정보처리학회논문지C
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• 제11C권6호
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• pp.731-738
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• 2004

디지털 콘텐츠의 이용 증가와 함께 디지털 콘텐츠의 저작권 보호 및 유통이 점점 부각되고 있으며 이를 위한 디지털 저작권 관리(DRM, digital rights management) 기술은 다양한 종류의 디지털 콘텐츠 뿐만 아니라 저작권 권리를 보호하기 위해 적용 가능하다. 뿐만 아니라, 디지털 방송 기술 도입과 개인용 비디오 녹화기와 같은 저장 장치의 등장으로 저장되는 디지털 방송 콘텐츠에 대한 보호 기술도 요구되어 지고 있다. 현재 방송 콘텐cm에 대한 보호 방법은 특정 채널에 대한 시청자의 접근을 제어하는 제한 수신 시스템(CAS, conditional access system)으로, 이것은 디지털 방송 콘텐츠의 자유로운 콘텐츠 2차배포를 제한시킨다. 본 논문에서는 불특정 다수를 대상으로 방송되는 방송 콘텐츠에 대한 저장과 사용을 제어하고 자유로운 2차배포(superdistribution)를 허용하기 위해 암호화와 라이센스를 이용하는 DRM의 개념을 적용하고 각 부분들의 기능 검증을 위한 구현 결과를 보인다. 본 논문의 구현 시스템은 시청자의 STB(Set-top box)에 방송콘텐츠의 녹화를 허용하고, 사용자에 의한 2차배포가 가능하다는 장점이 있다. 따라서, 콘텐츠 제공자와 소비자 모두에게 신뢰성 있는 콘텐츠 보호 및 유통환경을 제공가능하다.

• 한국가정과교육학회지
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• 제30권3호
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• pp.91-109
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• 2018

본 연구는 중학교 2009년 개정 기술·가정교육과정 내용에서 가정생활 영역에 속하는 '주거와 거주환경' 단원을 중심으로 하여 인성 교육 요소와 STAD 협동학습을 적용한 교수 ·학습 과정안을 개발하는 데 목적을 두고 있다. 연구목적을 이루기 위해 분석, 설계, 개발, 평가의 단계로 수행하였다. 먼저, 분석 단계에서는 선행 연구 고찰, 기술·가정교육과정 및 12종 교과서의 '주거와 거주환경' 내용을 분석하였다. 설계 단계에서는 선정한 인성교육 요소를 활용하여 교수·학습 과정안의 목표와 내용 구성, 차시별 활동내용, 학생평가자료, 학생용 활동 자료 및 교사용 자료 등을 설계하였다. 개발 단계에서는 '주거와 거주환경' 단원에 적용할 수 있는 총 8차시의 교수·학습 과정안, 학생 활동지, 개인학습지(형성평가지) 등을 개발하였다. 평가 단계에서는 개발한 교수·학습 과정안과 학습 활동지의 1차 타당도 평가를 가정교육학 전공 교수 1인과 가정 교육학 박사학위 소지자인 현장 중등교사 2인에게 받고, 2차 타당도 평가는 현직 가정과교사 7인으로부터 검토 받아 이를 바탕으로 교수·학습 과정안과 학습 활동지를 수정하여 최종적인 교수·학습 과정안을 완성하였다. 타당도 평가 결과, 개발된 교수·학습 과정안과 학습 활동지에 대한 타당도가 대체로 높은 수준에서 확보되었으며, 중학생을 대상으로 인성교육을 향상시키는데 적합하다고 볼 수 있다. 본 연구에서 인성교육 요소와 STAD 협동학습을 적용하여 개발된 교수·학습 과정안이 현장 교사들 및 교육과정 개발자에게 유용한 자료로 활용되기를 기대한다.

• 한국전자파학회논문지
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• 제27권5호
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• pp.445-453
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• 2016

본 논문은 3GPP LTE(Long Term Evolution)-TDD(Time Division Duplexing) 표준을 기반으로 NI(National Instruments)의 USRP RIO SDR(Software Defined Radio) 플랫폼을 이용해 28 GHz 밀리미터파 대역에서 HD 비디오를 무선으로 송수신하는 1T-1R(1 Transmitter-1 Receiver) 시스템을 설계 및 구현하였다. 해당 시스템은 Verilog로 설계한 LTE-TDD 송수신 모뎀을 USRP RIO에 내장된 Xilinx Kintex-7칩에 구현하여 USRP RIO를 베이스밴드로 사용하였으며, USRP RIO에서 송수신되는 신호는 자체 설계한 28 GHz RF 송수신 모듈로 업 다운 변환을 수행한 후 자체 설계한 $4{\times}8$ 서브 배열 안테나를 통해 최종적으로 HD 비디오 데이터를 통신하게 된다. USRP RIO와 Host PC의 통신 방식은 데이터 송수신시 발생되는 지연을 최소화하기 위해 PCI express(Peripheral Component Interconnect express)${\times}4$를 사용하였다. 구현한 시스템은 25.85 dBc 이상의 높은 EVM(Error Vector Magnitude) 성능을 보였으며, 실험환경 내 어디서든 HD 비디오를 성공적으로 송수신 하였다.

• 전자공학회논문지D
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• 제35D권10호
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• pp.39-50
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• 1998

넓은 통과대역과 좁은 천이대역폭을 갖는 디지털 필터는 이동통신 장비의 CODEC이나 의료장비등에 사용된다. 이러한 주파수 특성을 갖는 디지털 필터는 다른 주파수 특성의 디지털 필터에 비해 계수 및 내부신호의 양자화 영향을 크게 받기 때문에 긴 워드 길이가 요구되며 이로 인해 칩의 면적 및 소모 전력이 증가한다. 본 논문에서는 이러한 주파수 특성을 갖는 디지털 필터의 저전력 구현을 위하여 CPL (Complementary Pass-Transistor Logic), 격자 웨이브 디지털 필터와 수정된 DIFIR (Decomposed & Interpolated FIR) 알고리듬을 이용한 설계 방법을 제시한다. CPL에서의 단락전류 성분을 줄이기 위하여 PMOS 몸체효과, PMOS latch 및 weak PMOS를 이용하는 3가지 방법에 대해 시뮬레이션을 통하여 비교한 결과 전파지연, 에너지 소모 및 잡음여유 면에서 PMOS latch를 사용하는 방법이 가장 유리하였다. 통찰력을 가지고 CPL 회로를 최적화하기 위해 CPL 기본구조에 대해 시뮬레이션 결과로부터 전파지연과 에너지 소모에 대한 경험식을 유도하여 트랜지스터의 크기를 정하는데 적용하였다. 또한 필터계수를 CSD (Canonic Signed Digit)로 변환하고 계수 양자화 프로그램을 이용하여 필터계수의 non-zero 비트수를 최소화시켜 곱셈기를 효율적으로 구현하였다. 알고리듬 측면에서 하드웨어 비용을 최소화하기 위해 수정된 DIFIR 알고리듬을 사용하였다. 시뮬레이션 결과 제안된 방법의 전력 소모가 기존 방법보다 38% 정도 감소되었다.

• 대한전자공학회논문지SD
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• 제46권12호
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• pp.1-9
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• 2009

가산기는 기본적인 산술 연간 장치로써, 산술 연산 시스템 전체의 속도 및 전력소모에 결정적인 역할을 한다. 단일 비트 전가산기의 성능을 향상시키는 문제는 시스템 성능 향상의 기본적인 요소이다. 주 논문에서는 기존의 모듈 I과 모듈III를 거쳐 출력 Cout을 갖는 XOR-XNOR 구조와는 달리 모듈 I을 거치지 않고 입력 A, B, Cin에 의해 모듈III를 거쳐 출력 Cout을 갖는 새로운 구조를 이용한다. 최대 5단계의 지연단계를 2단계로 줄인 전가산기를 제안한다. 따라서 Cout 출력속도가 향상되어 리플캐리 가산기와 같은 직렬연결의 경우 더욱 좋은 성능을 나타내고 있다. 제안한 1Bit 전가산기는 static CMOS, CPL, TFA, HPSC, TSAC 전가산기에 비해 좋은 성능을 가지고 있다. 가장 좋은 성능을 나타내는 기존의 전가산기에 비해 4.3% 향상된 지연시간을 가지며 9.8%의 향상된 PDP 비율을 갖는다. 제안한 전가산기 회로는 HSPICE 툴을 이용하여 $0.18{\mu}m$ CMOS 공정에서 전력소모 및 동작속도를 측정하였으며 공급전압에 따른 특성을 비교하였다.