• 대한전자공학회논문지SD
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• 제46권5호
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• pp.32-38
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• 2009

FFT(Fast Fourier Transform) 프로세서는 OFDM(Orthogonal Frequency Division Multiplexing) 시스템에서 사용된다. 근래에는 광대역과 이동성에 대한 요구가 높아짐에 따라 큰 포인트를 가지는 FFT 프로세서의 연구가 필요하다. FFT 포인트 수가 증가할수록 회전인자가 저장된 메모리가 차지하는 면적은 증가한다. 본 논문에서는 Radix-2, $2^2,\;2^3,\;2^4$ 알고리즘의 회전인자 인덱스 생성 방법을 제안한다. 제안한 회전인자 인덱스 생성기(Twiddle Factor Index Generator : TFIG)는 간단하게 카운터와 양수곱셈기로만 구성된다. 각각의 R2SDF(Radix-2 Single-Path Delay Feedback), $R2^2SDF,\;R2^3SDF,\;R2^4SDF$ 1024포인트 FFT 프로세서에 ROM 크기를 1/8N로 줄인 회전인자 계수 생성기(Twiddle Factor Coefficient Generator : TFCG)를 설계하여 제안한 알고리즘을 검증하였다. $R2^4SDF$의 TFCG 경우 면적, 전력에서 각 57.9%, 57.5%정도의 이득을 얻었다.

• 한국방재학회:학술대회논문집
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• 한국방재학회 2007년도 정기총회 및 학술발표대회
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• pp.29-32
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• 2007

Damages induced typhoons have been increased and super-typhoons have occurred frequently. In our study, we propose a storm risk assessment technique based on CFD for the industrial structures and equipment located in the coastal regions. Inflow wind speeds are obtained through the information of geography and meteorology in considering regions before pressures of wind-environment and structures corresponding to different winds are calculated with wind speed multiplier and pressure coefficient. The results are applicable to evaluate a warning wind speed or regions vulnerable to debris in a considering region and to examine the safety of structures and their exteriors.

• 한국정보전자통신기술학회논문지
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• 제11권3호
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• pp.270-276
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• 2018

This paper presents a low area 256-point pipelined FFT architecture, especially for IEEE 802.16a WiMAX systems. Radix-24 algorithm and single-path delay feedback (SDF) architecture are adopted in the design to reduce the complexity of twiddle factor multiplication. A new cascade canonical signed digit (CSD) complex multipliers are proposed for twiddle factor multiplication, which has lower area and less power consumption than conventional complex multipliers composed of 4 multipliers and 2 adders. Also, the proposed cascade CSD multipliers can remove look-up table for storing coefficient of twiddle factors. In hardware implementation with Cyclone 10LP FPGA, it is shown that the proposed FFT design method achieves about 62% reduction in gate count and 64% memory reduction compared with the previous schemes.

• 대한전기학회논문지:시스템및제어부문D
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• 제50권12호
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• pp.584-589
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• 2001

This paper presents an implementation method of multi-channel synchronized phasor measurement device, which is based on the ASIC implementation of the sliding-DFT. A time-shared multiplier structure is proposed to minimize the number of gates required for the implementation. The design is verified by the timing simulation of its operation. The effect of coefficient approximation in the recursive implementation of the sliding-DFT is analytically derived and verified with the computer simulations.

• 한국전산유체공학회지
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• 제14권4호
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• pp.101-108
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• 2009

We present a new finite-element scheme for direct numerical simulation of particle suspensions in simple shear flow of a viscoelastic fluid in 3D. The sliding tri-periodic representative cell concept has been combined with DEVSS/DG finite element scheme by introducing constraint equations along the domain boundary. Rigid body motion of the freely suspended particle is described by the rigid-shell description and implemented by Lagrangian multipliers on particle boundaries. We present the bulk rheology of suspensions through the numerical examples of single-, two- and many-particle problems, which represent a large number of such systems in simple shear flow. We report the steady bulk viscosity and the first normal stress coefficient, which show shear-thickening behavior for both properties.

• Geomechanics and Engineering
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• 제31권5호
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• pp.505-518
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• 2022

This study introduces soil resistance multipliers at locations encompassed by the zone of influence of the helix plate to consider the added lateral resistance provided to the helical pile. The zone of influence of a helix plate is a function of its diameter and serves as a boundary condition for the modified soil resistance springs. The concept is based on implementing p-multipliers as a reduction factor for piles in group action. The application of modified p-y springs in the analysis of helical piles allows for better characterization and understanding of the lateral behavior of helical piles, which will help further the development of design methods. To execute the proposed method, a finite difference program, HPCap (Helical Pile Capacity), was developed by the authors using Matlab. The program computes the deflection, shear force, bending moment, and soil resistance of the helical pile and allows the user to freely input the value of the zone of influence and Ω (a coefficient that affects the value of the p-multiplier). Results from ten full-scale lateral load tests on helical piles embedded at depths of 3.0 m with varying shaft diameters, shaft thicknesses, and helix configurations were analyzed to determine the zone of influence and the magnitude of the p-multipliers. The analysis determined that the value of the p-multipliers is influenced by the ratio between the pile embedment length and the shaft diameter (D_p), the effective helix diameter (D_h-D_p), and the zone of influence. Furthermore, the zone of influence is recommended to be 1.75 times the helix diameter (D_h). Using the numerical analysis method presented in this study, the predicted deflections of the various helical pile cases showed good agreement with the observed field test results.

• 한국지반환경공학회 논문집
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• 제11권3호
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• pp.17-22
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• 2010

본 연구에서는 풍화토 지반에 설치된 수평하중을 받는 H-pile 무리말뚝의 하중분담특성 및 상호작용계수(p-multiplier)를 분석하였다. 말뚝의 배열($2{\times}3$, $3{\times}3$), 말뚝의 간격(2D, 4D, 6D), 그리고 지반밀도(상대밀도:40%, 80%)를 고려한 수평재하 실험을 실시한 결과 다음과 같은 결과를 얻을 수 있었다. 무리말뚝내 각각의 말뚝에 작용된 평균수평하중은 말뚝의 수가 감소할수록 평균수평저항력이 증가하는 것으로 나타났다. 말뚝간격과 지반밀도에 따라 단말뚝과 무리말뚝의 p-y곡선을 분석한 결과 말뚝간격이 2D에서 6D로 증가함에 따라 무리말뚝의 상호작용계수값이 느슨한 지반의 경우 0.85~0.94(앞열말뚝), 0.57~0.79(중간말뚝), 0.60~0.71(후열말뚝), 조밀한 지반의 경우 0.76~0.82(앞열말뚝), 0.58~0.73(중간말뚝), 0.53~0.70(후열말뚝)의 값을 각각 나타냈다. 이와같이 단말뚝과 무리말뚝간 상호작용계수는 말뚝간격이 증가할수록 그 값이 증가함을 알 수 있었으며, 또한 앞열의 무리말뚝이 중간 및 후열말뚝들보다 보다 큰 상호작용계수 값을 나타냈다.

• 전자공학회논문지C
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• 제35C권9호
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• pp.49-56
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• 1998

본 논문에서는 온도에 의존하지 않는 전압 감시회로에서 바이어스 회로에 대한 설계 방법을 제안한다. 제안한 방법을 실현하기 위하여 비교기를 구성하는 트랜지스터의 순방향 전압과 V/sub T/(Thermal Voltage) 그리고 저항 등의 서로 다른 온도계수 차이를 이용한다. 즉, 전압 감시회로에서 각각 다른 온도계수를 갖는 소자를 이용하여 서로 상쇄되도록 바이어스회로를 실현한다. 그리고 전압 감시회로의 기준전압은 비교기를 구성하는 트랜지스터의 순방향 전압 차(△V/sub BE/)를 이용하여 구현한다. 이 기준전압과 저항 및 V/sub BE/ 멀티플라이어를 이용하여 전압 감시회로의 검출전압을 설계한다. 제안한 회로의 동작검증을 위해 IC로 제작하였다. HP4145B와 온도 Chamber를 이용하여 특성을 평가한 결과, 온도변화율이 -0.01 %/℃ ∼ -0.025 %/℃의 양호한 특성을 얻었다.

• 전자공학회논문지SC
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• 제39권6호
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• pp.34-42
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• 2002

본 논문에서는 전압검출기에 사용되는 온도에 무관한 검출 전압원을 제안한다. 검출 전압원이 절대온도 영도(Zero degree)에서 실리콘 밴드갭 전압의 m배가 되도록 설계한다. 검출 전압원의 온도계수는 트랜지스터 이미터-베이스 사이의 서로 다른 면적을 가진 다이오드에 생성된 비선형 전압인 ${\Delta}V_{BE}$의 오목한 온도계수와 트랜지스터 순방향 전압인 $V_{BE}$의 볼록한 비선형 온도계수의 합으로 다이오드의 온도계수를 적절히 선택함으로서 거의 제로의 온도계수를 실현한다. 또한 검출 전압원의 값이 ${\Delta}V_{BE}$, $V_{BE}$ 멀티플라이어 회로 및 저항을 이용하여 변화될 수 있도록 설계하였다. 제안한 검출 전압원의 성능을 평가하기 위해, $6{\mu}m$ 바이폴러 기술로 조립된 1.9V용 IC를 제작하여 검출 전압원의 동작특성과 온도계수를 측정하였다. 또한 검출 전압원의 값이 공정에 의해 변화되는 요인을 줄이기 위해 트리밍 기술, 이온 임플란테이션과 이방성 에칭을 도입하였다. 제작된 IC에서 검출 전압원은 -30$^{\circ}C$~70$^{\circ}C$의 온도범위에서 29ppm/$^{\circ}C$의 안정된 온도계수를 얻을 수 있었다. 그리고 전압검출기의 소비전류는 1.9V 공급전압에서 $10{\mu}A$이다.

• 대한기계학회논문집B
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• 제41권3호
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• pp.171-181
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• 2017

2상 횡 유동은 응축기, 증발기와 원자력의 증기 발생기와 같은 열교환기의 튜브와 셀 사이에 존재한다. 공기/물의 2상 유동에 놓인 관군에 작용하는 항력을 실험적으로 평가하였다. 2상 유동에 놓인 관군은 정사각형 배열이다. 피치 직경 비는 1.35이었고, 실린더의 직경은 18 mm이다. 관군에 유동방향으로 작용하는 항력을 측정하여 항력계수와 2상 유동 감쇠비를 계산하였다. 2상 유동 감쇠비는 균질 2상 유동의 이론식을 사용하여 구하여 실험의 결과와 비교하였다. 압력과 항력의 상관계수를 실험결과를 고려하여 평가하였다. 상관계수는 이론적으로 항력을 계산할 때에 사용된다. 질량유량을 증가할수록 측정된 항력으로부터 구한 항력계수와 감쇠비가 균질 유동의 이론적 결과와 잘 일치함을 보이고 있다. 결과적으로 충분히 큰 질량 유량의 기포 유동인 경우에는 감쇠비를 균질 유동에 근거한 이론식으로 계산할 수 있다.