• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2011년도 춘계학술대회
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• pp.132-135
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• 2011

본 논문에서는 IEEE 802.11n 무선 랜 표준의 3가지 블록길이(648, 1296, 1944)와 4가지 부호율(1/2, 2/3, 3/4, 5/6)을 지원하는 다중모드 LDPC 복호기를 설계하였다. 하드웨어 복잡도를 고려하여 layered 복호방식의 블록-시리얼(부분병렬) 구조로 설계하였으며, 최소합 알고리듬의 특징을 이용한 검사노드 메모리 최소화 방법을 고안하여 적용함으로써 기존방법에 비해 검사노드 메모리 용량을 약 47% 감소시켰다. 설계된 회로는 FPGA 구현을 통해 하드웨어 동작을 검증하였으며, $0.18-{\mu}m$ CMOS 셀 라이브러리로 합성한 결과 219,100 게이트와 45,036 비트의 메모리로 구현되었고, 50 MHz@2.5V로 동작하여 164~212 Mbps의 성능을 갖는 것으로 평가되었다.

• 한국통신학회논문지
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• 제36권4A호
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• pp.414-422
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• 2011

모바일 WiMAX 표준 IEEE 802.16e의 블록길이 2,304 비트, 부호율 1/2을 지원하는 LDPC(low-density parity-check) 복호기를 설계하였다. 설계된 LDPC 복호기는 최소-합(min-sum) 알고리듬과 layered 복호를 기반으로 $96{\times}96$ 크기의 부행렬을 병렬로 처리하는 부분병렬 구조를 갖는다. 최소-합 알고리듬의 특징을 이용하여 메모리 용량을 감소시킬 수 있는 새로운 방법을 고안하여 적용함으로써 검사노드 메모리 용량을 기존의 방법보다 46% 감소시켰다. Verilog HDL로 설계된 LDPC 복호기를 $0.18{\mu}m$ CMOS 셀 라이브러리로 합성한 결과 174,181개의 게이트와 52,992 비프의 메모리로 구현되었으며, Eb/No=2.1dB의 AWGN 채널에 대해 평균 비트 오율 (BER)는 $4.34{\times}10^{-5}$이고, 100 MHz@1.8-V로 동작하여 약 417 Mbps의 성능을 갖는다.

• 한국전산구조공학회논문집
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• 제30권2호
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• pp.127-135
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• 2017

멀티코어 CPU와 BLAS, LAPACK을 구현한 최적 수치라이브러리, 직접 희소 솔버의 대중화 등 PC나 워크스테이션 수준에서도 대규모 유한요소 모델을 해석할 수 있도록 컴퓨팅 환경이 급속도로 변화되었다. 이 논문에서는 멀티코어 CPU를 갖는 공유 메모리 구조에 대한 병렬 유한요소 프로그램 설계시 고려사항으로 (1) 최적화된 수치라이브러리의 사용, (2) 최신 직접 희소 솔버의 사용, (3) OpenMP를 이용한 병렬 요소 강성 행렬의 계산, (4) 희소행렬 저장방식의 일종인 triplet을 이용한 어셈블 기법 등을 제시하였다. 또한 대규모 수치모델을 통해 많은 시간이 소요되는 작업을 기준으로 병렬화 효과를 검토하였다.

• 정보처리학회논문지D
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• 제16D권1호
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• pp.83-92
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• 2009

현실 세계의 복잡한 비즈니스 로직들이 프로그램 내부에 투영되면서 시스템의 복잡도는 갈수록 높아지고 있다. 이러한 높은 복잡도를 가지는 프로그램도 그 생명주기 동안 재공학을 거쳐야 하는 것은 필연적일 것이다. 다양한 목적으로 가해지는 재공학 작업에서 그 작업의 대상이 되는 핫 스팟 예측은 매우 중요하다. 일반적으로 레거시 시스템의 재공학 작업은 UML과 코드 분석을 기반으로 예측한다. 또한 그 예측 단위는 클래스 혹은 유닛(함수) 단위가 된다. 그러나 함수 내부의 코드의 량이 갈수록 커져가고 있고 더 미세한 핫 스팟을 찾기 위하여 클래스 단위의 탐색보다 더 미세한 부분의 탐색이 필요하다. 본 논문에서는 AOP를 이용한 문장 단위의 핫 스팟 검출 기법을 제안한다. 기존의 기법에서 요구하던 핫 스팟 검출을 위한 UML과 코드 분석, 또한 이 둘 사이의 일치성과 관계없이 동적으로 AOP를 이용하여 레거시 시스템의 실행 정보를 기록하는 동적 이벤트 로그 데이터를 생성한다. 이를 바탕으로 핫 스팟을 예측하고 슬라이싱하는 방법을 제안하였다.

• 융합보안논문지
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• 제19권1호
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• pp.97-101
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• 2019

운영 체제의 코어에 Intel PT가 포함된 경우, 크래시 발생 시 디버거는 프로그램 상태를 검사할 수 있을 뿐만 아니라 크래시를 발생시킨 제어 플로우를 재구성할 수 있다. 또한, 커널 패닉 및 기타 시스템 정지와 같은 상황을 디버그하기 위해 실행 트레이스 범위를 전체 시스템으로 확장할 수도 있다. 2세대 PT인 WinIPT 라이브러리는 Windows 10 (버전 1809/Redstone 5)에서 제공하는 IOCTL 및 레지스트리 메커니즘을 통해 프로세스 별 및 코어 별 트레이스를 실행할 수 있는 추가 코드가 포함된 Intel PT 드라이버를 포함하고 있다. 즉 기존 1세대 PT에서 비정규화된 방식으로만 제한적인 접근이 가능했던 PT 트레이스 정보를 2세대 PT에서는 운영 체제에서 제공하는 IOCTL 및 레지스트리 메커니즘을 통해 프로세스 별 및 코어 별 트레이스를 실행할 수 있게 되었다. 본 논문에서는 1/2세대 PT를 이용하여 윈도우 환경에서 PT 데이터 패킷의 수집 저장 디코딩 및 악성코드 검출을 위한 방법을 비교 설명하였다.

• 한국컴퓨터정보학회논문지
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• 제27권4호
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• pp.231-239
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• 2022

본 연구에서는 비전공자들을 대상으로 한 웹서비스 개발 교육의 어려움을 k-mooc 강의에 게시된 수강생들의 질의응답을 통해 분석하고 이를 개선하기 위한 방법들을 제안한다. 질의 응답 분석을 통해 비전공자들은 웹서비스 개발 강좌를 수강하면서 주로 익숙하지 않은 도구 사용, 클라우드 서비스의 비용 문제, 서버 환경 설정, 코드 작성에서 어려움을 보이는 것으로 확인되었다. 이를 해결하기 위해 클라우드 서비스의 모델 중 하나인 BaaS (Backend as a Service)를 활용해 서버 비용에 대한 문제와 서버 환경의 복잡도를 낮출 수 있는 방법을 제안한다. 또한 리액트 라이브러리를 사용하여 긴 코드를 작은 단위로 모듈화하여 한번에 작성해야 할 코드 길이를 줄일 수 있다는 것을 보였다. 마지막으로 피그마를 활용해 얻은 디자인 산출물을 활용하여 동작하는 웹 애플리케이션을 구현함으로 IT 비전공자들도 쉽게 학습할 수 있는 개선안을 제안한다.

• 한국인터넷방송통신학회논문지
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• 제22권4호
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• pp.165-170
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• 2022

외부에서 보내는 시간을 줄이고 동네마트를 주로 이용하는 중년층, 노년층들과 동네마트 관리자들을 위한 장보기 시스템을 개발하였다. 이 앱은 직접 장보기 기능과 온라인 장보기 기능이 주요 기능이며 안드로이드에서 Zxing라이브러리를 이용한 QR코드와 카카오 API를 이용한 카카오맵을 이용해 개발되었다. 또한 리사이클러뷰와 그래프를 통해 회원이 필요로 하는 결제 통계와 게시판 글 등의 정보를 가독성 있게 제공한다. 이 시스템을 통해 회원들은 QR코드를 이용한 직접구매 방식과 지도를 통한 배달 방식을 통해 마트를 이용할 때의 피로감을 줄이고 마트 관리자로서는 인력낭비를 줄임으로서 효율적으로 관리할 수 있다. 또한 마트 관리자로서는 소비자들이 늘어나 더 많은 물품을 판매할 수 있을 것이다.

• 한국연소학회:학술대회논문집
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• 한국연소학회 제26회 KOSCO SYMPOSIUM 논문집
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• pp.57-62
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• 2003

A general procedure of obtaining reliable one-step kinetics model for hydrocarbon mixture from the fully detailed chemistry is described iin this study. One-step theoretical formulation of the induction parameter model IPM uses a theoretical reconstruction of the induction time database obtained from a detailed kinetics library. Non-dimensional induction time calculations is compared with that of detailed kinetics. The IPM was latter implemented to fluid dynamics code and applied for the numerical simulation of detonation wave propagation. The numerical results including the numerical smoked-foil record show the all the details of the detonation wave propagation characteristics at the cost around 1/100 of the detailed kinetics calculation.

• 한국해양공학회지
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• 제13권3호통권33호
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• pp.3-11
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• 1999

Optimum design of mooring dolphin is numerically investigated. Design optimization problem of moring dolphin is first formulated. Geometry and cross sections of piles are used as design variables. Design objective is the total weight of steel piles of mooring dolphin, and the constraints of stress, penetration depth, lower and upper bounds on design variables are imposed. Based on the design variable linking and fixing, several class of design variations are sought. For the numerical optimization, both PLBA(Pshenichny - Lim - Belegundu - Arora) program and DNCONF subroutine code in IMSL library are used. For a dolphin structure with 20 steel piles, vertical and inclined, optimum designs for different cases are successfully obtained, which can be applied for the mooring of a very large floating structure.

• International Journal of Internet, Broadcasting and Communication
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• 제12권3호
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• pp.87-94
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• 2020

Recently, computer hardware is evolving toward increasing the number of computing cores, not increasing the clock speed. In order to use the performance of parallelized hardware to the maximum, the running program must also be parallelized. However, software developers are accustomed to sequential programs, and in most cases, write programs that operate sequentially. They also have a lot of difficulty designing and developing software in parallel. We propose a method to automatically convert a sequential C/C++ program into a parallelized program, and develop a parallelization tool that supports it. It supports open multiprocessing (OpenMP) and parallel patterns library (PPL) as a parallel framework. Perfect automatic parallelization is difficult due to dynamic features such as pointer operation and polymorphism in C/C++ language. This study focuses on verifying the conditions of parallelization rather than focusing on fully automatic parallelization, and providing advice to developers in detail if parallelization is not possible.