• Title/Summary/Keyword: Circuit noise

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Effects of White Noises on Gait Ability of Hemiplegic Patients during Circuit Balance Training

  • Jang, Na-Young;Kim, Gi-Do;Kim, Bo-Kyoung;Kim, Eun-Hee;Koo, Ja-Pung;Shin, Hee-Joon;Choi, Seok-Joo;Choi, Wan-Suk
    • 국제물리치료학회지
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    • 제3권1호
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    • pp.370-377
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    • 2012
  • This study examines the effects of different environments on the application of hemiplegia patients circuit balance training. Group 1 performed circuit balance training without any auditory intervention Group 2 performed training in noiseless environments and Group 3 performed training in white noise environments. First, among lower extremity muscular strength evaluation items, maximum activity time(MAT) was not significantly different(p>.05). Maximum muscle strength(MMS) increased significantly in Group 3(p<.01), there was no significant difference in MMS among the groups. Average muscle strength(AMS) indexes also significantly increased in Group 3(p<.01), there was no significant difference in AMS among the groups. Second, among balancing ability evaluation items, Berg's balance scale(BBS) scores significantly increased in all groups(p<.05), BBS scores were significantly difference among the groups. Based on the results, Group 1, 2 and Group 1, 3 showed significant increases (p<.05). Functional reach test(FRT) values significantly increased in Group 2, 3(p<.05), and there was no significant difference in FRT values among the groups. Timed up and go(TUG) test values significantly decreased in Group 2, 3(p<.05), and there was no significant difference in TUG test values among the groups. Third, among walking speed evaluation items, the time required to walk 10m significantly decreased in all groups(p<.05), and there was no significant difference in the values among the groups. Average walking speeds showed significant increases in Group 1, 3(p<.05), and there was no significant difference in the values among the groups. Based on the results of this study, noise environments should be improved by either considering auditory interventions and noiseless environments, or by ensuring that white noise environments facilitate the enhancement of balancing ability.

전기철도 시스템의 9~150 kHz 대역에서의 RFI 노이즈 전달 경로 분석 (Analysis on the RFI Noise Path of Electrical Railway System in the Frequency Range of 9 kHz to 150 kHz)

  • 권석태;정연춘
    • 한국전자파학회논문지
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    • 제23권12호
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    • pp.1373-1379
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    • 2012
  • 철도 시스템에서 방사하는 9~150 kHz 대역의 자기장 복사 방출은 철도 시스템 주변의 무선 설비 등에 영향을 주어 통신 성능의 저하나 오동작을 초래할 수 있다. 본 논문에서는 전기 철도 시스템에서 방사하는 9~150 kHz 주파수 대역의 전자파 노이즈에 대한 등가 회로 모델을 소스 및 전달 경로 분석을 통하여 제안하고, 철도차량의 견인 구동 시스템과 변전 시스템에서 발생하는 수 kHz의 스위칭 노이즈가 급전선과 선로의 루프 회로를 통하여 방사됨을 확인하였다. 또한, 실제의 구리-국수 간 중앙선 철도의 RC Bank의 효과를 분석하여 이러한 회로 등가 모델의 유효성을 검증하였고, 급전선과 선로 사이에 적정한 용량의 커패시터를 장하함으로써 효과적으로 설계 대책이 가능함을 보였다.

디지털 스위칭 노이즈를 감소시킨 베타선 센서 설계 (A Study on the Design of a Beta Ray Sensor Reducing Digital Switching Noise)

  • 김영희;김홍주;차진솔;황창윤;이동현;라자 무하마드 살만;박경환;김종범;하판봉
    • 한국정보전자통신기술학회논문지
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    • 제13권5호
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    • pp.403-411
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    • 2020
  • 기존에 진성난수 생성기를 위한 베타선 센서 회로의 아날로그 회로와 비교기 회로에 사용되는 파워와 그라운드 라인은 서로 공유하므로 비교기 회로의 디지털 스위칭에 의해 발생되는 파워와 그라운드 라인에서의 전압강하가 CSA를 포함한 아날로그 회로의 출력 신호 전압이 감소하는 원인이었다. 그래서 본 논문에서는 디지털 스위칭 노이즈의 source인 비교기 회로에 사용되는 파워와 그라운드 라인을 아날로그 회로의 파워와 그라운드 라인과 분리하므로 CSA(Charge Sensitive Amplifier) 회로를 포함한 아날로그 회로의 출력신호전압이 감소되는 것을 줄였다. 그리고 VREF(=1.195V) 전압을 VREF_VCOM과 VREF_VTHR 전압으로 변환해주는 전압-전압 변환기 회로는 PMOS current mirror를 통해 IREF를 구동할 때 PMOS current mirror의 드레인 전압이 다른 경우 5.5V의 고전압 VDD에서 channel length modulation effect에 의해 각각의 current mirror를 통해 흐르는 구동 전류가 달라져서 VREF_VCOM과 VREF_VTHR 전압이 감소하는 문제가 있다. 그래서 본 논문에서는 전압-전압 변환기 회로의 PMOS current mirror에 PMOS 다이오드를 추가하므로 5.5V의 고전압에서 VREF_VCOM과 VREF_VTHR의 전압이 down되지 않도록 하였다.

통신회선의 잡음전압 기준 및 측정법 (Psophometeric Noise Voltage of Telecommunication Lines and Test methods)

  • 황종선;김영민;이경욱;김재준
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2001년도 추계학술대회 논문집 Vol.14 No.1
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    • pp.617-620
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    • 2001
  • The protection of communication lines against harmful effects from electricity lines is very important with the rapid development of communications network. This paper is introduced the reference of noise voltage and the test methods of foreign countries. Further we will also present study measurement equipment for telecommunications noise voltage and circuit noise phenomenon.

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24㎓ 2단 저잡음 증폭기의 설계 및 제작 (Design and Fabrication of two-stage Low Noise Amplifier for 24㎓)

  • 한석균
    • 한국정보통신학회논문지
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    • 제7권7호
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    • pp.1374-1379
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    • 2003
  • In this paper, twoㆍstage low noise amplifier(LNA) for 24㎓ is designed and fabricated using NE450284C HJ-FET of NEC CO. In order to get noise figure and input VSWR to be wanted it is considered input VSWR and noise figure simultaneously in matching-circuit designing. The fabricated two-stage low noise mph u has the gai of 16.6㏈, input VSWR of 1.6, and output VSWR under 1.5.

통신회선의 잡음전압 기준 및 측정법 (Psophometeric Noise Voltage of Telecommunication Lines and Test methods)

  • 황종선;김영민;이경욱;김재준
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2001년도 추계학술대회 논문집
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    • pp.617-620
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    • 2001
  • The protection of communication lines against harmful effects from electricity lines is very important with the rapid development of communications network. This paper is introduced the reference of noise voltage and the test methods of foreign coutnreis. Further we will also present study measurement equipment for telecommunications noise voltage and circuit noise phenomenon.

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1V 미만 전원 전압에서 저 위상잡음에 적합한 차동 콜피츠 전압제어 발진기 회로 (A Differential Colpitts-VCO Circuit Suitable for Sub-1V Low Phase Noise Operation)

  • 전만영
    • 한국전자통신학회논문지
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    • 제6권1호
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    • pp.7-12
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    • 2011
  • 본 논문은 1 V 미만의 전원 전압에서 저 위상잡음을 갖는 발진 신호의 발생에 적합한 차동 콜피츠 전압제어 발진기 (VCO: Voltage Controlled Oscillator) 회로를 제안한다. 제안된 회로는 전류원으로 인덕터를 사용함으로써 1 V 미만의 전원 전압에서 저 위상잡음의 발진을 보다 용이하게 한다. 공진기 손실을 보다 줄이기 위하여 단일 콜피츠 발진기의 두 개의 궤환 커패시터 중의 하나를 바렉터 (varactor)로 대체하였다. $0.18{\mu}m$ RF CMOS 기술을 사용하는 포스트 레이아웃 (post-layout) 시뮬레이션 결과는 0.6 V에서 0.9 V 사이의 전원 전압에서 제안된 회로가 1MHz 오프셋 주파수에서 나타내는 위상잡음은 널리 알려진 교차 결합 전압제어 발진기의 위상잡음보다 적어도 7 dBc/Hz 이상 낮음을 보여준다.

자기 부상계의 변위추정 회로설계에 관한 연구 (A Study on the Gap Estimation Circuit Design of the Magnetic Levitation System)

  • 김창화;하영원;심성효;양주호
    • 동력기계공학회지
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    • 제1권1호
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    • pp.144-153
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    • 1997
  • The magnetic levitation system is utilized in the magnetic bearing of high-speed rotor because of little friction, no lubrication, no noise and so on. The magnetic levitation system need the feedback controller for the stabilization of system, and gap sensors are generally used to measure the gap. The use of gap sensors brings out the increase of the number of troublesome, and the decrease of the control performance because of the dislocation between the measurement point and the control point. This paper presents the design of the gap estimation circuit for the sensorless method proposed by authors in the magnetic levitation system. We made the gap estimation circuit which was composed of both the superposition circuit and the measuring circuit. And we investigated the validity of the usefulness of the proposed sensorless method in the magnetic levitation system through results of actual experiment.

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윈치드럼 구동제어 회로설계 (Circuit Design of Drive Control for Winch Drum)

  • 조상훈;양승윤;박래석
    • 한국군사과학기술학회지
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    • 제5권1호
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    • pp.45-58
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    • 2002
  • In this paper, we designed the circuit of drive control for towing winch. It is composed of reference voltage circuit for driving voltage reference, low pass filter circuit for noise reduction, dead zone circuit for initial transient input, and driving circuit for drum direction/velocity control. Also it is realized a drive control circuit for towing winch drum in accordance with PWM(pulse width modulation) method to suit it's purpose of a large capacity driving system. The performance of the designed circuit is analyzed by experiments and the appliablity for driving the towing winch drum satisfactorily is evaluated through a various testing.

A Reconfigurable 4th Order ΣΔ Modulator with a KT/C Noise Reduction Circuit

  • Yang, Su-Hun;Seong, Jae-Hyeon;Yoon, Kwang-Sub
    • JSTS:Journal of Semiconductor Technology and Science
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    • 제17권2호
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    • pp.294-301
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    • 2017
  • This paper presents a low power ${\Sigma}{\Delta}$ modulator for an implantable chip to acquire a bio-signal such as EEG, DBS, and EMG. In order to reduce a power consumption of the proposed fourth order modulator, two op-amps utilized for the first two integrators are reconfigured to drive the second two integrators. The KT/C noise reduction circuit in the first two integrators is employed to enhance SNR of the modulator. The proposed circuit was fabricated in a 0.18 um CMOS n-well 1 poly 6 metal process with the active chip core area of $900um{\times}800um$ and the power consumption of 830 uW. Measurement results were demonstrated to be SNDR of 76 dB, DR of 77 dB, ENOB of 12.3 bit at the input frequency of 250 Hz and the clock frequency of 256 kHz. FOM1 and FOM2 were measured to be 41 pJ/step and 142.4 dB, respectively.