• 대한전자공학회논문지TC
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• 제45권5호
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• pp.21-29
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• 2008

본 논문은 IEEE802.11n 시스템의 반송파 주파수 옵셋 추정 알고리즘을 제안한다. IEEE802.11n 시스템은 다중 송수신 안테나 시스템이므로 종래의 단일 송수신 안테나 시스템에 적용되는 알고리즘과는 다르게 다중 수신부에서 적용 가능한 결합 기법을 고려하여 적용하여야 한다. 따라서 본 논문에서는 IEEE802.11n 과 같은 다중 수신 안테나 시스템에서 적용 가능한 수신기 결합 구조의 반송파 주파수 옵셋 추정 알고리즘을 제안하고, 제안하는 선택적 결합 반송파 주파수 옵셋 추정 알고리즘이 종래의 알고리즘보다 SNR 10dB에서 채널 B 인 경우에 1/10, 채널 D 인 경우에 1/2 의 MSE 오류로 추정이 가능함을 확인하였다.

• 대한조선학회논문집
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• 제56권1호
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• pp.66-74
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• 2019

In the field of shipbuilding design, the use of 3D CAD is becoming commonplace, and most of the large shipyards are conducting 3D design. However at the production site, workers are still working on 2D drawings rather than 3D models. This tendency is even worse in small-scale shipyards and block manufacturing shops. Particularly, in a manufacturing shop that is engaged in the outsourcing of blocks, it may not be possible to provide 3D model. However, the demand for 3D models in the production field is steadily increasing. Therefore, it would be helpful if 3D model could be generated from a 2D drawing. In this paper, we propose a method to extract template and unfolded surface shape information from shell template offset drawing using computer vision technology. Also a 3D surface model was reconstructed and visualized from the extracted information. The result of this study is thought to be helpful in the work environment where 3D model information can not be obtained.

• International Journal of Internet, Broadcasting and Communication
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• 제15권3호
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• pp.122-128
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• 2023

This paper proposes two kinds of single-balanced direct conversion quadrature receivers using selfoscillating LMVs in which the voltage-controlled oscillator (VCO) itself operates as a mixer while generating an oscillation. The two LMVs are complementary coupled and series coupled to generate the quadrature oscillating signals, respectively. Using a 65 nm CMOS technology, the proposed quadrature receivers are designed and simulated. Oscillating at around 2.4 GHz frequency, the complementary coupled quadrature receiver achieves the phase noise of -28 dBc/Hz at 1KHz offset and -109 dBc/Hz at 1 MHz offset frequency. The other series coupled receiver achieves the phase noise of -31 dBc/Hz at 1KHz offset and -109 dBc/Hz at 1 MHz offset frequency. The simulated voltage conversion gain of the two single-balanced receivers is 37 dB and 45 dB, respectively. The double-sideband noise figure of the two receivers is 5.3 dB at 1 MHz offset. The quadrature receivers consume about 440 μW dc power from a 1.0-V supply.

• Journal of electromagnetic engineering and science
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• 제17권2호
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• pp.98-104
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• 2017

This work describes the development and comparison of two phase-locked loops (PLLs) based on a 65-nm CMOS technology. The PLLs incorporate two different topologies for the output voltage-controlled oscillator (VCO): LC cross-coupled and differential Colpitts. The measured locking ranges of the LC cross-coupled VCO-based phase-locked loop (PLL1) and the Colpitts VCO-based phase-locked loop (PLL2) are 119.84-122.61 GHz and 126.53-129.29 GHz, respectively. Th e output powers of PLL1 and PLL2 are -8.6 dBm and -10.5 dBm with DC power consumptions of 127.3 mW and 142.8 mW, respectively. Th e measured phase noise of PLL1 is -59.2 at 10 kHz offset and -104.5 at 10 MHz offset, and the phase noise of PLL2 is -60.9 dBc/Hz at 10 kHz offset and -104.4 dBc/Hz at 10 MHz offset. The chip sizes are $1,080{\mu}m{\times}760{\mu}m$ (PLL1) and $1,100{\mu}m{\times}800{\mu}m$ (PLL2), including the probing pads.

• 한국전자파학회논문지
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• 제23권11호
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• pp.1280-1287
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• 2012

3.2~6.5 GHz 광대역 특성을 갖는 YTO(YIG Tuned Oscillator) 모듈을 설계 및 제작하였다. 위상 잡음 특성을 개선하기 위해 샘플링 믹서를 이용한 offset PLL(Phase Locked Loop) 구조로 설계하였다. 이 방식은 샘플링 믹서, 위상 비교기, 루프 필터, 전류 드라이버 회로, YTO로 구성된다. 측정 결과, 4.5 GHz에서 위상 잡음은 수식으로 도출한 값과 유사한 10 kHz offset 주파수에서 -100 dBc/Hz를 얻었다. 제작된 YTO 모듈의 위상 잡음은 동작 주파수 대역에서 기존 PLL 구조에 비해 10 dB 이상 우수함을 확인하였다.

• Journal of Advanced Marine Engineering and Technology
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• 제22권1호
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• pp.52-66
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• 1998

An experimental study on the flow characteristics was performed for a two-dimensional turbulent wall attaching offset jet at different oblique angles to a surface. The flow characteristics were investigated by using a split film probe with the modified Stock's calibration method. The jet mean velocity, turbulent intensity, wall static pressure coefficient profiles, and time-averaged reattachment point were measured at the Reynolds number Re (based on the nozzle width, D) ranging from 17700 to 53200, the offset ratio H/D from 2.5 to 10, and the inclined angle .alpha. from 0.deg. C to 40.deg. C. The Correlations between the maximum pressure position, minimum pressure position, and reattachment point and offset ratios, and inclined angles are presented.

• 한국정보통신학회논문지
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• 제5권4호
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• pp.653-660
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• 2001

본 논문에서는 주파수합성기에서 가장 큰 잡음원인 VCO 및 각 단에서 발생하는 위상잡음 의 offset주파수에 따른 변화를 예측하기 위해 2303.15MHz의 주파수합성기를 설계하고 Lascari의 예측방법 을 이용하여 모델링 하였다. 또한, VCO에서 발생되는 여러 중첩 형태로 된 위상잡음중 저주파대역에서 문제가 되는 1/f noise를 3차 시스템에서 분석하였다. 3차 시스템에서는 해석이 복잡하므로 수학적인 분석을 통하여 1/f noise를 예측한다는 것이 어렵지만 pseudo-damping factor의 도입으로 3차 시스템에서의 1/f noise variance의 해석이 용이 하도록 시도하였고 이를 2차 시스템과 비교.분석하였다. 그 결과, tcxo의 경우 위상잡음이 루프 통과 전 10 kHz offset 주파수에서 -160dBc/Hz, 루프 통과 후 -162.6705dBc/Hz, 100 kHz offset 주파수에서 -180dBc/Hz, 루프 통과 후 -560dBc/Hz로 VCO의 위상잡음에 비해 offset주파수에 따라 루프 통과 후 급격히 감쇠 됨을 알 수 있었다. 2차와 3차 시스템에서의 잡음대역폭과 그 variance factor를 연관하여 3차 시스템에서 의 variance가 2차 시스템의 variance보다 크게 발생함을 알 수 있었다.

• 한국항행학회논문지
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• 제6권1호
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• pp.52-62
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• 2002

본 논문에서는 출력단에 Wilkinson 전력결합기 또는 T 접합 전력결합기를 사용한 20 GHz Push-Push FET 유전체 공진기 발진기를 설계 제작하고 그 특성을 조사 연구하였다. 기본 주파수 10 GHz를 억제하고 제 2 고조파 주파수를 이용하는 20 GHz Push-Push 발진기를 $TE_{01{\delta}}$ 모드의 유전체 공진기와 GaAs MESFET를 두께 H = 20 mil(${\varepsilon}_r$=2.52) 테프론기판 위에 장착하는 구조로 설계하고 제작하였다. Wilkinson 전력결합기를 이용하여 제작된 발진기는 20 GHz에서 출력 전력이 5.67 dBm, 기본 주파수 억압특성은 -29.33 dBc, 위상 잡음은 100 kHz offset에서 -105.5 dBc/Hz 특성을 나타내었으며, T 접합 전력결합기 이용하여 제작된 발진기는 20 GHz에서 출력 전력이 -1.17 dBm, 기본 주파수 억압특성은 -17.84 dBc, 위상 잡음은 100 kHz offset에서 -102.2 dBc/Hz 특성을 나타내었다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제7권2호
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• pp.67-75
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• 2007

To improve low sense margin at low voltage, we propose a negatively driven sensing (NDS) scheme and to solve the problem of WL-to-BL short leakage fail, a variable bitline reference scheme with free-level precharged bitline (FLPB) scheme is adopted. The influence of the threshold voltage offset of NMOS and PMOS transistors in a latch type sense amplifier is very important factor these days. From evaluating the sense amplifier offset voltage distribution of NMOS and PMOS, it is well known that PMOS has larger distribution in threshold voltage variation than that of NMOS. The negatively-driven sensing (NDS) scheme enhances the NMOS amplifying ability. The offset voltage distribution is overcome by NMOS activation with NDS scheme first and PMOS activation followed by time delay. The sense amplifier takes a negative voltage during the sensing and amplifying period. The negative voltage of NDS scheme is about -0.3V to -0.6V. The performance of the NDS scheme for DRAM at the gigabit level has been verified through its realization on 1-Gb DDR2 DRAM chip.

• 한국전자파학회:학술대회논문집
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• 한국전자파학회 2003년도 종합학술발표회 논문집 Vol.13 No.1
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• pp.87-90
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• 2003

In this paper, A feedforward linear power amplifier is analyzed for imperfect signal cancellation and negative feedback for basestaion of IMT2000 band. the distortion generatied by the error amplifier is reduced using an imperfect signal cancellation for a 1-carrier WCDMA source by 4.3dB at 2.5MHz offset and 6dB at 5MHz offset of IMSR(intermodulation signal power ratio) compared to a perfect signal cancellation system. additionally, An imperfect signal cancellation using negative feedback improved 1.3dB and 8.2dB at 2.5MHz and 5MHz offset of IMSR compared to an imperfect signal cancellation.