• 한국전자파학회논문지
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• 제22권8호
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• pp.784-789
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• 2011

본 논문에서는 UHF RFID 리더에서의 오토트랜스포머를 이용한 가변 송신 누설 신호 제거기를 제안하였다. 제안된 송신 누설 신호 제거기는 오토트랜스포머와 디지털 가변 캐패시터, 가변 저항, 보상 증폭기로 구성되었으며, 0.13 ${\mu}m$ 1-폴리 6-메탈 RF CMOS 공정을 사용하여 설계되었다. 시뮬레이션 결과, 제안된 구조는 송신단에서 수신단으로 신호가 전송될 때 55 dB 이상의 송신 누설 신호 제거도를 보이며, 2.5 dB의 수신 삽입 손실을 갖는다. 송신 누설 신호 제거 회로는 825 MHz에서 985 MHz까지 디지털 주파수 조정이 가능하며, CMOS 공정으로 집적될 수 있다.

• 한국전자통신학회논문지
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• 제10권1호
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• pp.13-20
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• 2015

종래의 LDMOS를 사용한 전력증폭기는 AB-급 및 도허티 방식으로 60MHz 대역폭의 협대역에서 55%의 효율을 보여주고 있으나, 기지국의 전력증폭 모듈의 RRH의 적용에 따라 100MHz이상의 대역확장과 60%이상의 고효율 전력증폭기를 요구하고 있으므로, 본 연구에서는 LDMOS FET를 이용한 J-급 전력증폭기를 설계하여 200MHz대역에서 60%이상의 고효율 특성을 나타내었다. 설계한 J-급 전력증폭기는 2차 고조파 부하가 순수한 리액턴스 성분만을 포함하고 작은 양호도 Q 값을 갖도록 출력단 정합회로를 최적화 시켰다. 측정결과 WCDMA 주파수 대역을 포함한 2.06~2.2GHz에서 연속파 신호를 입력하였을 때 62~70%의 전력 부가효율(PAE)의 특성을 갖는 10W급 J-급 전력증폭기를 구현하였다.

• 한국전자파학회논문지
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• 제24권6호
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• pp.613-622
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• 2013

본 논문에서는 ISM 13.56 MHz 대역 무선 전력 전송을 위한 인덕티브 클램핑 class-E 전력증폭기를 설계 및 실험하여 특성을 분석하였다. 구현된 전력증폭기는 수신 안테나가 회전체에 붙는 경우와 같이 송수신 안테나 간의 정합 상태가 변화하는 시스템에서 부정합 상태에서 전력증폭기에 공급되는 전류를 줄여 트랜지스터를 손상시키지 않고 안정적으로 동작하도록 하는 인덕티브 클램핑 방식으로 설계되었으며, 정합 회로를 이용하여 기존의 class-E 전력증폭기보다 고조파 성분에 대한 Filtering 특성을 개선하였다. 구현된 전력증폭기의 입력 주파수는 13.56 MHz, 입력 전력 25 dBm, 동작 전압 DC 28 V에서 측정한 결과, 출력 전력은 43 dBm, 기본 주파수 성분과 2차 고조파 신호 간의 출력 전력 차이 55 dBc 이상, 소모 전류 830 mA으로 전력부가 효율(power added efficiency)은 85 %로 높게 측정됐다. 마지막으로, 수신 안테나를 회전체에 부착하고 구현된 전력증폭기로 송수신 안테나로 전력을 송출하는 실험을 진행하였으며, 송신 안테나의 부정합 상태에는 소모 전류가 420 mA까지 줄어들어 트랜지스터가 손상되지 않는 것을 확인하였다.

• 한국전기전자재료학회논문지
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• 제17권2호
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• pp.162-170
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• 2004

A 900MHz CMOS RF power amplifier with digitally controllable output power has been proposed and designed with 0.6${\mu}{\textrm}{m}$ standard CMOS technology. The designed power amplifier was composed of digitally controllable switch mode pre-amplifiers with an integrated 4nH spiral inductor load and class-C output stage. Especially, to compensate the 1ow Q of integrated spiral inductor, cascode amplifier with a Q-enhancement circuit is used. It has been shown that the proposed power control technique allows the output power to change from almost 3dBm to 13.5dBm. And it has a maximum PAE(Power Added Efficiency) of almost 55％ at 900MHz operating frequency and 3V power supply voltage.

• 한국인터넷방송통신학회논문지
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• 제13권6호
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• pp.55-61
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• 2013

본 논문은 음성합성에서 사용되는 오디오 부호기/복호기 설계 및 구현을 기술한다. 설계된 회로는 원래 음성 샘플대신에 연속되는 음성 샘플의 차를 부호화하는 방식으로 압축율은 4:1 이다. FPGA를 이용해서 각각의 기능을 검증하고, $0.35{\mu}m$ 표준 CMOS 공정을 이용하여 칩으로 제작해서 성능을 측정하였다. 시스템 클럭 주파수는 16.384MHz를 사용한다. THD(Total Harmonic Distortion)+n은 주파수에 따라서 -40dB에서 -80dB 값을 지니고, 전력 소모는 전원 전압 3.3V에서 80mW로써, 고음질과 저전력 소모를 요구하는 모바일 응용에 적합하다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2008년도 추계종합학술대회 B
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• pp.842-845
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• 2008

본 논문은 RFID 시스템을 이용하여 기숙사 사생의 인적 정보 관리, 출입관리, 식당 이용 관리 등의 기능을 가지는 기숙사 관리 시스템을 제안한다. 제안하는 기숙사 관리 시스템은 RFID 하드웨어 시스템과 미들웨어, 응용프로그램으로 구성된다. RFID 하드웨어 시스템은 근접 거리에 적합한 13.56MHz 대역의 주파수를 사용하고, 미들웨어는 RFID 하드웨어 시스템의 입력 값을 RS-232c 통신방식으로 받아들여 응용프로그램을 전달하며, 응용프로그램은 RFID의 고유한 태그 값을 데이터베이스화하여 처리한다. 제안하는 기숙사 관리 시스템을 설계 제작하여 대덕대학 생활관에 설치하여 실험한 결과 유용성을 확인하였다.

• 전자통신동향분석
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• 제13권6호통권54호
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• pp.46-55
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• 1998

인텔사의 Xeon 프로세서 버스에 정합한 입출력 구동기를 선정하고자, Xeon 프로세서의 구동기술인 AGTL+를 조사하고 AGTL+와 GTL+ 구동기의 혼용 가능성을 분석하였다. GTL+(NTL)을 AGTL+와 함께 사용하고자 할 때 배선 토폴로지, 터미네이션, 댐핑저항 값에 따른 신호 및 시간 특성을 시뮬레이션 하였다. 시뮬레이션의 결과로 80 MHz 이하의 버스속도에서는 Xeon 프로세서 네 개와 GTL+(NTL) 구동기를 혼용하여 안정적으로 동작시킬 수 있음을 보였다.

• 한국통신학회논문지
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• 제41권11호
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• pp.1574-1579
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• 2016

본 논문은 무인항공기 비행시간 향상을 위해 RF 무선 전력 획득 기술을 이용한 self-powered 센서 노드 회로에 관해 설계 연구하였다. 제안하는 센서 노드는 두 가지 경우가 만족하였을 때 동작한다. 마스터 노드의 입력 RF ID와 센서 노드의 ID가 같을 경우와 RF 무선 전력 획득 시스템이 히스테리시스 스위치에 의해 동작될 때다. 마스터 노드의 출력은 263 MHz에서 26 dBm을 사용하였다. RF 전력을 DC 전력으로 변환하는 최대 효율은 마스터 노드에서 2미터 떨어진 지점(4-6 dBm)에서 55 %이다. 최대 RF 무선 전력 획득 범위는 마스터 노드와 센서 노드의 거리가 약 13 m 이다. 센서 노드의 MCU 및 수신기와 온도 센서와 같은 부하의 소비 전력은 10 msec 동안 5.0 V에서 평균 15 mA이다.

• 전자공학회논문지 IE
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• 제45권4호
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• pp.74-79
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• 2008

본 논문은 교도소 출입문의 모든 개폐 현황과 정보를 온라인 네트워크를 통하여 중앙의 통제실에서 실시간으로 확인할 수 있도록 하고, 실별, 층별로 위치한 다수의 출입문 개폐동작을 개별 또는 병렬로 동시에 동작할 수 있도록 하는 중앙통제에 의한 양방향 제어시스템을 구성하였다. 현재 사용 중인 125kHz대 RFID기술의 단점을 보완하기 위해서 13.55MHz대 RFID 기술을 적용하여 보안 및 신뢰성 문제를 해결하였으며, 비정상적으로 문이 열릴 경우 경광등 및 경보음을 울리도록 하는 온라인 통제 및 관리 시스템을 개발하였다.

• 대한전자공학회논문지SD
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• 제46권11호
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• pp.48-55
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• 2009

본 논문에서는 차세대 100-Gb/s급 광통신 시스템을 위한 3-병렬 Reed-Solomon (RS) 디코더 기반의 고속 Forward Error Correction (FEC) 구조를 제안한다. 제안된 16채널 RS기반 FEC 구조는 4개의 신드롬 계산 블록이 1개의 Key Equation Solver (KES) 블록을 공유하는 3-병렬 4채널 RS 기반 FEC 구조 4개로 구성되어 있다. 제안하는 100-Gb/s RS 기반 FEC는 1.2V의 공급전압의 $0.13{\mu}m$ CMOS 공정을 이용하여 구현하였다. 구현 결과 제안된 RS기반 FEC 구조는 300MHz의 동작 주파수에서 115-Gb/s 의 데이터 처리율을 가지며, 기존의 RS 기반 FEC 구조에 비해 높은 데이터 처리율과 낮은 하드웨어 복잡도를 보여주고 있다.