• 제목/요약/키워드: 하강신호

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근사 S-파 궤적을 이용한 심전도의 기저선 변동 제거에 관한 연구 (A study on eliminating baseline wander of ECG using approximated S-wave contour)

  • 주장규;이기영
    • 한국정보전자통신기술학회논문지
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    • 제1권2호
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    • pp.33-38
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    • 2008
  • 심전도의 기저선 변동은 심전도의 P-파 및 Q,-, R-, S-파를 검출하기 어렵게 하는 원인이 된다. 본 연구에서는 기울기추적파를 이용하여 심전도의 기저선 변동을 제거하는 두 가지 방법에 대하여 제시하고 비교하였다. 첫 번째 방법은 이미 제안된 것으로 상승기울기에 의한 기울기추적파를 이용하여 기저선을 제거하는 방법이고 둘째 방법은 제안할 근사적인 S파의 궤적을 적용하는 방법이다. 이 두 가지 방법 모두 기울기추적파를 이용한 방법이지만, 전자는 상승기울기 추적파와 ECG와의 차신호를 구하는 방법이고, 후자는 하강기울기 추적파에서 얻은 근사적인 S파의 궤적을 이용하여 기저선을 제거하는 방법이다. 이 방법들을 판별하기 위하여 MIT/BIH 데이터베이스의 심전도를 대상으로 실험하였다.

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새로운 저전력 전가산기 회로 설계 (A Novel Design of a Low Power Full Adder)

  • 강성태;박성희;조경록;유영갑
    • 전자공학회논문지SC
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    • 제38권3호
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    • pp.40-46
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    • 2001
  • 본 논문에서는 10개의 트랜지스터를 이용한 새로운 저전력 전가산기의 회로를 제안한다. 회로는 six-transistor CMOS XOR 회로를 기본으로 하여 XOR 출력뿐만 아니라 XNOR 출력을 생성하며, 전가산기를 구성하는 트랜지스터의 수를 줄임과 동시에 단락회로를 없앰으로써 저전력 설계에 유리하게 하였다. 실측 회로의 크기 평가를 위해서 0.65 ${\mu}m$ ASIC 공정으로 의해 레이아웃을 하고 HSPICE를 이용해서 시뮬레이션을 하였다. 제안한 가신기의 셀을 이용하여 2bit, 8bit 리플 캐리 가산기를 구성하여 소비 전력, 지연 시간, 상승시간, 하강시간에 대한 시뮬레이션 결과로 제안한 회로를 검증하였다. 25MHz부터 50MHz까지의 클럭을 사용하였다. 8bit 리플 캐리 전가산기로 구현하였을 때의 소모되는 전력을 살펴보면 기존의 transmission function full adder (TFA) 설계보다는 약 70% 정도, 그리고 14개의 transistor (TR14)[4]를 쓰는 설계보다는 약 60% 우수한 특성을 보이고 있다. 또한 신호의 지연시간은 기존의 회로, TFA, TR14 보다 1/2배 정도 짧고, 선호의 상승시간과 하강 시간의 경우는 기존 회로의 2${\sim}$3배 정도 빠르게 나타났다.

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W-band Synthetic Aperture Radar 영상 복원을 위한 엔트로피 기반의 6 Degrees of Freedom 추출 (Entropy-Based 6 Degrees of Freedom Extraction for the W-band Synthetic Aperture Radar Image Reconstruction)

  • 이혁빈;김덕진;김준우;송주영
    • 대한원격탐사학회지
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    • 제39권6_1호
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    • pp.1245-1254
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    • 2023
  • 77 GHz frequency modulation continuous wave radar를 이용한 W-band synthetic aperture radar (SAR) system에 대한 연구가 활발히 진행되고 있다. 고해상도의 W-band SAR 영상을 복원하기 위해서는 스테레오 카메라 또는 라이다(LiDAR)에서 획득한 point cloud를 6 degrees of freedom (DOF)의 방향에서 변환하여 SAR 영상 신호처리에 적용하는 것이 필요하다. 하지만 서로 다른 센서로부터 획득한 영상의 기하구조가 달라 정합하는데 어려움을 가진다. 본 연구에서 SAR 영상의 엔트로피(entropy)에 따른 경사 하강법을 이용하여 point cloud의 6 DOF를 구하고 최적의 depth map을 추출하는 기법을 제시한다. 구축한 W-band SAR system으로 주요 도로 환경 객체인 나무를 복원하는 실험을 수행하였다. 엔트로피에 따른 경사 하강법을 이용하여 복원한 SAR 영상이 기존의 레이더 좌표에서 복원한 SAR 영상보다 mean square error는 53.2828 감소했고, structural similarity index는 0.5529 증가한 것을 보였다.

유도전동기의 고장 진단을 위한 효과적인 특징 추출 방법 (An Effective Feature Extraction Method for Fault Diagnosis of Induction Motors)

  • 흥 뉘엔;김종면
    • 한국컴퓨터정보학회논문지
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    • 제18권7호
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    • pp.23-35
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    • 2013
  • 본 논문은 고장 분류 시스템을 위해 진동 신호로부터 특징 벡터를 자동적으로 추출하는 효과적인 기법을 제안한다. 기존의 멜-주파수 캡스트럼 계수는 진동신호의 노이즈에 민감하여 분류 정확도를 감소시키는 단점이 있다. 이러한 문제를 해결하기 위해 본 논문은 4단계 필터 뱅크로 구성된 스펙트럴 엔벨로프 캡스트럼 계수 분석을 제안하며, 4단계는 (1) 모든 진동 신호의 스펙트럴 엔벨로프를 기술하기 위한 선형 예측 코딩 알고리즘 사용 단계, (2) 일반적인 스펙트럴 모양을 얻기 위해 모든 엔벨로프의 평균화 단계, (3) 평균 엔벨로프와 그 주파수의 최대값을 찾기 위한 기울기 하강 방법 사용 단계, (4) 엔벨로프의 주파수 사이의 거리로부터 계산된 중앙값을 얻는데 사용되는 비 중첩 필터 뱅크 단계로 구성된다. 이4-단계필터뱅크는 특징벡터를 추출하기위해 캡스트럼 계수 계산에 사용된다. 마지막으로 유도전동기의 결함 형태를 구분하기 위해 이러한 특수 파라미터를 사용하는 다중 계층 서포트 벡터 머신을 사용한다. 모의실험 결과, 제안하는 방법은 약 99.65%의 분류 성능을 보이며, 동시에 기존 방법들보다 우수한 성능을 보인다.

바이폴라 집적된 저전압구동 광연결 수신기 (Bipolar Integrated Optical Link Receiver with Low Supply Voltage)

  • 장지근;이상열
    • 마이크로전자및패키징학회지
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    • 제10권4호
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    • pp.9-14
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    • 2003
  • 바이폴라 기술로 1.8V 구동전압에서 10Mbps 이상의 높은 데이터 전송율을 갖는 새로운 광연결 수신기를 제작하였다. 10Mbps 입력신호 (duty ratio=50%, $V_{IL}$(저준위 입력전압) =0.5V, $V_{IH}$(고준위 입력전압) = 1.5V)에 대한 제작된 소자의 평균 출력 전압은 $V_{OL}$(저준위 출력전압) = 0V, $V_{OH}$(고준위 출력전압) = 1.15V로 나타났으며, 1.5V 고준위 입력전압 아래에서 평균 소비전류는 4.6mA로 나타났다. 또한 출력파형에서 duty ratio는 52.6%, 상승시간($t_r$)과 하강시간($t_f$)은 각각 9.5ns와 6.8ns로 나타났으며 전파지연차($t_{PHC}-t_{PLH}$)와 jitter는 각각 11.7ns와 4.3ns로 나타났다.

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LDMOS FET를 이용한 L-대역 고속 펄스 고전력 증폭기 설계 (Design of L-Band High Speed Pulsed High Power Amplifier Using LDMOS FET)

  • 이희민;홍성용
    • 한국전자파학회논문지
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    • 제19권4호
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    • pp.484-491
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    • 2008
  • 본 논문에서는 LDMOS FET를 이용하여 스위칭 방식의 L-대역 고속 펄스 고전력 증폭기를 설계하고 제작하였다. 이를 위해 LDMOS FET의 드레인 전원을 스위칭하기 위한 고전압 스위칭 회로를 제안하였다. LDMOS FET를 이용한 펄스 고전력 증폭기는 단일 전원을 사용하고, 소자 특성상 이득과 출력이 높기 때문에 기존의 GaAs FET를 사용한 증폭기에 비해 구조가 간단하며, 사용 전압($V_{ds}=26{\sim}28\;V$)에 비해 최대 허용 전압(65 V)이 $2{\sim}3$배 높아 스위칭 방식에 적합하다. LDMOS FET를 이용하여 제작된 1.2 GHz 대역 100 W 펄스 증폭기는 펄스 폭이 2 us, PRF가 40 kHz의 출력 신호에서 상승 시간이 28.1 ns, 하강 시간이 26.6 ns로 측정되었다.

배터리 전압 강하를 고려한 드론 모터 속도 제어기 개발 (Development of a Motor Speed Controller of Drones Considering Voltage Drop of Battery)

  • 이성희;윤보람;김덕엽;김황수;이우진
    • 정보과학회 논문지
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    • 제44권6호
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    • pp.601-606
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    • 2017
  • 최근 드론 산업의 발전으로 일상생활 중에서도 드론을 비행하는 모습을 자주 관찰할 수 있다. 이러한 드론에 주로 사용되는 리튬폴리머 배터리는 사용 시간이 흐름에 따라 배터리의 전압 강하가 일어나 동일한 드론 조종 신호에도 드론 모터의 속도가 불안정해지는 문제점이 발생한다. 드론 모터 속도의 불안정은 고도 유지를 불가능하게 하여 드론 기체가 상승과 하강을 반복하게 된다. 이러한 문제를 해결하기 위해서 기존의 방법은 배터리 방전에 따른 보상기를 추가하거나 시스템 제어 모델을 변경하였다. 하지만 이러한 기법은 하드웨어로 구현된 모듈을 사용하거나 모터 종류 및 실험 결과에 종속적으로 구현되기 때문에 드론 기체에 사용되는 모터에 맞게 새로운 모듈이 구현되어야하는 문제점이 있다. 따라서 본 논문에서는 이러한 문제를 해결하기 위해 드론의 펌웨어에 배터리 전압 강하를 고려하는 모터 속도 제어기를 구현하여 드론의 비행 안정성을 확보한다.

순차바이어스를 이용한 반도체 레이더용 SSPA 설계 (A Design for Solid-State Radar SSPA with Sequential Bias Circuits)

  • 구융서
    • 한국정보통신학회논문지
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    • 제17권11호
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    • pp.2479-2485
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    • 2013
  • 본 논문에서는 순차 바이어스를 이용한 반도체 레이더용 SSPA를 설계 하였다. 전력증폭기의 상승/하강 바이어스 지연에 의해 발생되는 신호의 왜곡을 제거하기 위하여 가변확장 펄스 생성기를 적용하였다. 최적화된 임피던스 매칭회로는 GaN-전력 소자의 높은 효율을 갖기 위하여 로드-풀 방식을 통한 마이크로파 특성 측정으로 설계되었다. 설계된 SSPA는 X밴드 반도체 레이더에 적용하기 위하여 전치 증폭기, 구동 증폭기 그리고 주 증폭기의 3개의 단으로 구성되었다. 그 결과로 200W 출력 펄스 최대 53.67dBm을 가지고 평균 52.85dBm의 SSPA를 만들 수 있었다. 본 논문에 제시된 반도체 펄스 압축 레이더 트랜시버 모듈의 최적화 설계는 추가적인 디지털 레이더에 대한 연구를 통해 소형화와 동작향상이 가능하다.

이동 로봇의 경로 추종을 위한 웨이블릿 신경 회로망 기반 일반형 예측 제어에 관한 연구 (A Study on Wavelet Neural Network Based Generalized Predictive Control for Path Tracking of Mobile Robots)

  • 송용태;오준섭;박진배;최윤호
    • 한국지능시스템학회논문지
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    • 제15권4호
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    • pp.457-466
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    • 2005
  • 본 논문에서는 다중 입$\cdot$출력을 갖는 이동 로봇의 경로 추종을 위해 웨이블깃 신경 회로망에 기반한 예측 제어 방법을 제안한다. 제안된 방법에서 상태 예측기로는 학습 능력이 뛰어난 신경 회로망의 특성 및 웨이블릿 분해의 특성을 합성한 웨이블릿 신경 회로망을 사용한다. 예측기는 경사 하강법을 사용하여 웨이블릿 신경회로망의 출력에 대한 실제 이동 로봇의 상태 오차를 최소화하도록 학습된다. 또한 이동 로봇의 제어 신호인 직진 속도 및 각속도는 추종하고자 하는 기준 경로에 대한 이동 로봇의 예측 상태 오차를 이용하여 정의된 비용 함수를 최소화하도록 구해진다. 컴퓨터 모의 실험에서 변화되는 기준 경로에 대한 경로 추종 성능을 통해 제안한 예측 제어 시스템의 적용 가능성 및 효율성을 보인다.

P/N-CTR 코드를 사용한 SSN과 누화 잡음 감소 I/O 인터페이스 방식 (The SSN and Crosstalk Noise Reduction I/O Interface Scheme Using the P/N-CTR Code)

  • 김준배;권오경
    • 대한전자공학회논문지SD
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    • 제38권4호
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    • pp.302-312
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    • 2001
  • 칩과 칩 사이의 전송 속도가 증가함에 따라, 누화 및 스위칭 잡음에 의한 시스템의 성능 저하가 심각해지고 있다. 본 논문에서 제안하는 인터페이스는 한 심벌 펄스의 상승/하강 에지 위치에 데이터를 엔코딩하고, 천이 방향이 반대인 P-CTR과 N-CTR (positive/Negative Constant Transition Rate)을 사용하며, P-CTR 드라이버 2개 묶음과 N-CTR 드라이버 2개 묶음을 교대로 배치하여 버스를 구성한다. 제안하는 P/N-CTR 코드 인터페이스에서는 임의의 한 배선에 대해서 양옆의 이웃한 배선 신호가 동시에 같은 방향으로 스위칭하는 경우가 발생하지 않기 때문에 최대 누화 잡음과 최대 스위칭 잡음을 기존의 I/O 인테페이스 보다 감소시킬 수 있다. 제안하는 인터페이스 방식의 잡음 감소 특성을 검증하기 위하여 다양한 배선 구조와 여러 비트 폭의 버스 구조에 적용하고, 0.35㎛ SPICE 파라미터를 이용한 HSPICE 시뮬레이션을 수행하였다. 제안한 인터페이스는 기존의 인터페이스와 비교하여 32 비트 미만의 버스에서는 최대 누화 잡음이 최소26.78 % 감소하고, 누화는 50 % 감소한다.

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