NGS 기술의 발달로 시퀀싱 비용이 급격히 하락됨에 따라 대규모 크기의 유전체 염기 서열해독을 소규모의 실험실에서 수행할 수 있게 되었다. 디노버 어셈블리는 표준 유전체가 없는 새로운 종을 시퀀싱하는 경우 리드들의 염기 서열 정보를 이용하여 재구성함으로써 원래의 전체 시퀀스를 복원하는 것이다. 최근 이와 관련된 많은 연구 결과가 보고되고 있으나, 충분한 분석 노하우와 명확한 가이드라인 등이 공개되어 있지 않기 때문에 이들 연구에서 제시하는 동일한 어셈블리 수행 과정 및 분석 툴들을 사용하더라도 만족할만한 수준의 어셈블리 결과를 얻지 못하는 경우가 발생한다. 본 연구에서는 이러한 문제점을 해결하기 위하여 NGS 기술과 디노버 어셈블리 기술을 이용하여 아직 밝혀지지 않은 생물체의 전체 DNA의 염기 서열을 밝히기 위한 일련의 과정들을 단계별로 소개하고, 각 단계에서 필요로 하는 공개용 분석 툴의 장단점을 분석하여 제시한다. 이러한 과정별 단계를 구체적으로 설명하기 위하여 본 연구에서는 350Mbp 크기의 개 회충 게놈을 응용 사례로 사용한다. 또한 디노버 어셈블리 과정을 통해 새롭게 어셈블리된 시퀀스와 다른 유사 종과의 상동성 분석을 수행하여 어셈블리된 시퀀스에서의 유전자 영역 추출과 추출된 유전자의 기능을 예측한다.
본 연구는 국내 무인항공기산업과 같은 신성장동력산업의 국제적 기술 경쟁력 확보와 시장성 확보 및 산업성장이 가능한 미래유망 기술을 도출하는 방법론을 제시하는 것이다. 이에 본 연구는 KrKwic, Excel, NetMiner등의 분석 툴을 활용하여 무인항공기산업 분야의 특허데이터를 대상으로 동시출현 단어를 활용한 소셜네트워크분석과 하위그룹분석, 인지지도분석 방법을 제시하였다. 그 결과, '비행조정 기술', '피아식별 기술' 등은 향후 유망한 기술로 선정하여 집중 투자할 필요성이 큰 기술이라 볼 수 있었다.
국내 마이크로그리드는 실증단지, 도서지역, 캠퍼스, 산업단지등에 구축되고 있다. 특히 산업단지는 수용가의 전기에너지 이용 효율화와 신재생에너지 전원을 활용한 전력거래를 위해 마이크로그리드를 구축하는 추세이다. 본 논문에서는 ESS(Energy Storage System) 복합운영을 통한 비용절감과 전력거래 수익창출 실증을 위하여 나주혁신도시 동수산업단지 내계통과 연계된 제조업체(태산, 범한, 하이옥스)에 구축되는 마이크로그리드 경제성을 분석한다. 경제성 분석 툴인 HOMER를 이용하여 각 업체별 PV(PhotoVoltaic) 및 ESS용량에 따른 순 현재비용과 1[kWh]당 발전단가를 산출한다. 경제성 분석을 위해 각 제조업체의 최근 1년간 부하량과 산업용 전기요금기준, 기업체 소재지의 기후조건에 따른 태양광발전량, 각 기업체 마이크로그리드 실제구축비용을 입력하고, 공인할인율 5.5[%]와 유류비 1500[원/ℓ]를 기준으로 경제성을 분석한다. 분석을 바탕으로 개별 제조업체 부하 특성에 부합한 마이크로그리드 분산전원 및 설비 용량 선정과 운영방안을 제안한다.
개발 프로젝트의 소프트웨어 개발에 있어서 통합 개발환경의 역할은 매우 중요하다. 다수의 개발자가 각기 다른 모듈을 개발하면 컴파일과 디버깅, 그리고 통합과 테스트, 배포 등의 과정을 거치면서 제품이 완성된다. 하지만, 개발 과정에서의 버그나 각종 이슈 등은 소프트웨어 제품의 품질저하 및 요구사항 불만족 등의 문제를 발생시키게 되었고, 해당 문제를 회피하고 품질 향상을 위해 자동화 테스트의 필요성이 증가되었다. 본 연구에서는 통합 개발환경에서의 테스트 자동화를 통해 개발 프로세스 전 과정에서의 품질향상을 위한 4가지 관점의 테스트 자동화 모듈을 제안한다. 각 자동화 모듈은 데브옵스(DEVOPS) 방법으로 구현된 통합빌드프레임워크의 툴 체인 형태로 연결되어 구동된다.
최근 날씨와 주야 조건에 상관없이 지구 관측을 수행할 수 있는 영상레이더 탑재체가 활발하게 연구되고 있다. 한국항공우주연구원은 2013년 한국 최초의 영상레이더 위성인 다목적실용위성5호를 성공적으로 개발 및 발사하였으며 현재 영상레이더 차세대 시리즈 위성인 다목적실용위성6호를 개발하고 있다. 본 논문은 영상레이더 탑재체의 설계와 분석을 위하여 필수적인 영상레이더 탑재체 시스템 성능 분석 시뮬레이터의 개발에 관한 것이다. 시스템 성능 분석 시뮬레이터는 안테나 패턴 생성 시뮬레이터와 시스템 성능 분석 시뮬레이터, 그리고 영상 품질 분석 시뮬레이터로 이루어진다. 영상레이더시스템 성능 분석 시뮬레이터의 시뮬레이션 결과로부터 영상레이더 설계 단계에서 위성용 영상레이더 탑재체의 설계 및 분석 툴로써 적용 가능할 것으로 기대한다.
ZBrush의 ZSphere는 캔버스에 추가가 가능하며, 무엇보다도 움직임이 자유로운 기하학적 오브젝트로서 ZSphere를 기존의 ZSphere에 추가할 수 있다는 점이다. 예를 들어 중간단계의 구형체에서 뽑아내어 팔 같은 것을 생성할 수 있다. 이러한 방식으로 팔다리가 여러 개인 캐릭터를 쉽게 만들어 낼 수 있는 것이다. 본 논문은 ZSphere를 사용하여 하나의 Sphere로부터 여러 개의 Child Sphere를 만들어내고, 이것이 parent sphere가 되어 이를 기준으로 Child Sphere를 연결해 나가는 형식으로 형태를 만들어 가며 3D 캐릭터 형태를 쉽고 빠르게 잡아가도록 모델링 하였다. 3D 오브젝트를 추가하고 회전시키고 움직일 수 있기에 캔퍼스의 Z-depth와 원활한 상호작용이 이루어질 수 있다. 이러한 오브젝트를 스크린에 놓거나 페인팅을 하고 고정된 퍼스펙티브 이미지를 구축하고 Pixols을 스머지하며 3D오브젝트를 변형시키기 위하여 다양한 변형툴과 조각툴을 사용하였다. 완성된 character를 poly로 변환한 다음 Topology를 이용해 빠르게 면을 재구성 하는 방법으로 캐릭터를 설계하였다.
클라우드 사용자들에게 책임 있는 서비스를 제공하는 클라우드 서비스의 책임 추적성(accountability)은 서비스 정책 준수, 모니터링 및 감사(auditing), 로그 정보 기록(logging) 등과 같은 여러 가지 기술을 적용한다. 궁극적으로 데이터 처리, 서비스 제공 과정에서 발생되는 여러 가지 문제들에 대해 누가 책임이 있는지를 판단함으로써 신뢰되는 클라우드 서비스를 제공하는 것을 목적으로 한다. 먼저, 부가가치가 높은 콘텐츠 서비스 제공 시에 안전하고 신뢰되는 DRM 클라우드 서비스를 제공하기 위해 본 논문에서는 콘텐츠 및 DRM 클라우드 서비스 체인을 이루는 클라우드 에코 시스템을 제시한다. 또한 콘텐츠 소유자와 콘텐츠 사용자의 DRM 클라우드 서비스에 대한 요구사항을 분석하고, 책임 추적을 위해 기록해야 할 로그 정보 및 모니터링 툴 구조를 제안한다.
ZBrush의 ZSphere는 스크린에 추가가 가능하며, 무엇보다도 움직임이 자유로운 기하학적 오브젝트로서 ZSphere를 기존의 ZSphere에 추가할 수 있다는 점이다. 예를 들어 중간단계의 구형체에서 뽑아내어 다리 같은 것을 생성할 수 있다. 이러한 방식으로 팔다리가 여러 개인 캐릭터를 쉽게 만들어 낼 수 있는 것이다. 본 논문은 ZSphere를 사용하여 하나의 Sphere로부터 여러 개의 Child Sphere를 만들어내고, 이것이 parent sphere가 되어 이를 기준으로 Child Sphere를 연결해 나가는 형식으로 형태를 만들어 가며 3D 캐릭터 형태를 쉽고 빠르게 잡아가도록 모델링 하였다. 3D 오브젝트를 추가하고 회전시키고 움직일 수 있기에 캔퍼스의 Z-depth와 원활한 상호작용이 이루어질 수 있다. 이러한 오브젝트를 스크린에 놓거나 페인팅을 하고 고정된 퍼스펙티브 이미지를 구축하고 Pixols을 스머지하며 3D오브젝트를 변형시키기 위하여 다양한 변형툴과 조각툴을 사용하였다. 완성된 character를 poly로 변환한 다음 Topology를 이용해 빠르게 면을 재구성 하는 방법으로 캐릭터를 설계하였다.
본 논문은 하드웨어 자원이 제한되는 사물인터넷 시스템의 보안을 위하여 AES 기반의 효율적인 암호화칩 설계를 제안한다. ROM 기반의 S-Box는 메모리를 액세스하는데 많은 메모리 공간이 필요함과 동시에 지연문제가 발생하게 된다. 제안한 방법에서는 저면적/고성능의 암호화 칩 설계를 위해 합성체 기반의 고속 S-Box를 설계하여 보다 빠른 연산결과를 얻도록 한다. 또한, 각 라운드 변환과정 및 키 스케쥴링 과정에서 사용되는 S-Box를 공유하도록 설계하여 보다 높은 처리율 및 적은 지연을 갖도록 한다. 설계된 AES 암호프로세서는 Verilog-HDL를 사용하여 회로동작을 기술하였으며, Xilinx ISE 14.7 툴을 이용하여 논리 합성을 수행하였다. 또한, 설계 검증은 Modelsim 10.3 툴을 이용하였으며, Xilinx XC6VLX75T FPGA 소자를 사용하여 하드웨어 동작을 검증하였다.
본 논문에는 저전력 AES(Advanced Encryption Standard) 암호시스템을 구현하기 위한 합성체 기반의 경량 S-Box 구조 설계를 제안한다. 제안한 방법에서는 GF(((22)2)2) 상에서 사용면적 및 처리속도의 개선을 위해서 x2, λ, 그리고 GF((22)2) 등 3개의 모듈을 1개의 모듈로 통합한 단순 구조로 설계한다. 설계된 AES S-Box는 Verilog-HDL를 기반으로 하여 구조적 모델링을 하였으며, Xilinx ISE 14.7툴 상에서 Spartan 3s1500l FPGA 소자를 타켓으로 하여 논리합성을 수행하였다. 논리적인 동작을 검증을 위한 시뮬레이션은 Modelsim 10.3 툴을 이용하였으며, 시뮬레이션 결과를 통하여 설계된 S-Box가 정확히 동작함을 확인하였다.
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[게시일 2004년 10월 1일]
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