해상통신에서 운용되는 OFDM (Orthogonal Frequency Division Multiplexing)통신 단말기는 긴급재난시에도 동작하여야 하므로, 저전력으로 동작하여야 한다. 따라서 Digital Signal Processing (DSP) 동작하는 전압모드 Processor보다 저전력 동작이 가능한 전류모드 FFT (Fast-Fourier-Transform) Processor의 설계가 필요하게 되었다. IVC (Current-to-Voltage Converter)는 전류모드 FFT Processor의 출력 전류를 전압 신호로 바꾸는 디바이스로써, 저전력 OFDM 단말기 동작을 위해 IVC의 전력 손실은 낮아야 하고, FFT의 출력 전류가 전압신호에 대응이 될 수 있도록 넓은 선형적인 동작구간을 가져야 하며, 향후, FFT LSI와 IVC가 한 개의 칩으로 결합되는 것을 고려하면, 작은 크기의 chip size로 설계되어야 한다. 본 논문에서는 선형 동작 구간이 넓은 새로운 IVC를 제안한다. 시뮬레이션 결과, 제안된 IVC는 전류모드 FFT Processor의 출력 범위인 -100 ~100[uA]에서 0.85V~1.4V의 선형동작구간을 갖게 됨을 확인하였다. 제안된 IVC는 전류모드 FFT Processor와 더불어 OFDM을 이용한 저전력 해상 데이터통신 실현을 위한 선도 기술로 유용할 것이다.
완전 이식형 인공중이 시스템을 위한 음성 신호처리 및 제어 모듈을 소형 마이크로컨트롤러를 사용하여 저전력형으로 설계 하였다 설계된 모듈은 입력되는 음성신호를 난청자의 역치에 맞추어 이득을 조정하는 등의 신호처리를 수행함과 동시에 체내 이식부의 제어를 수행하게 된다. 설계된 마이크로컨트롤러는 전원이 켜지면 사용자의 청력 손실에 맞추어서 주파수별로 차등 되는 이득을 주도록 실시간으로 음성신호를 처리하게 된다. 그러나 체외에서 제어신호가 입력될 경우 수신된 제어 신호에 의해 마이크로컨트롤러는 인터럽트 서브루틴을 수행하여 전원 제어, 볼륨 조절과 같은 제어 명령을 수행한 후 다시 음성 신호를 처리하도록 하였다. 설계된 모듈을 구현한 후 구현된 시스템의 동작을 실험을 통하여 확인하였다.
최근 많은 광대역 유무선 통신 응용분야에서 OFDM(Orthogonal Frequency Division Multiplexing) 방식을 표준기술로 채택하고 있다. OFDM 방식의 고속 무선 데이터 통신을 위한 FFT 프로세서는 일반적으로 DSP(Digital Signal Processing)로 구현되었으나, 큰 전력 소비를 필요로 한다. 따라서, OFDM 통신방식의 단점인 전력문제를 보완하기 위해서 전류모드 FFT LSI가 제안되었고, 저소비전력 전류모드 FFT LSI를 동작시키기 위해서는 전류모드를 전압모드로 바꾸는 VIC(Voltage to Current Converter) 그리고 다시 전류모드를 전압모드로 바꾸어 주는 IVC(Current to Voltage Converter)가 필요하다. 그러나, OP-AMP로 구현되는 종래의 IVC는 회로규모가 크고, 전력소비가 크며, LSI 내에 크고 정확한 높은 저항을 필요로 한다. 또한 전류모드신호처리에서 많이 이용되는 Current Mirror 회로 등의 출력단자로부터 전류신호를 입력받은 경우, 입력단자간의 전위차가 발생하며, DC offset 전류가 발생하는 등의 문제점을 갖는다. 따라서 본 연구에서는 저전력 동작이 가능하고, 향후, single chip 응용이 가능한 IVC를 $0.35{\mu}m$ 공정에서 설계함으로서, $0.35{\mu}m$ 공정에서의 전류모드 FFT LSI의 전압모드 출력이 가능해졌다 설계된 IVC는 FFT LSI의 출력이 디지털신호로 환산한 ${\pm}1$인 점을 감안하여, 전류모드 FFT LSI의 출력이 $13.65{\mu}A$ 이상일 때에 3.0V의 전압을 출력하고, FFT LSI의 출력이 $0.15{\mu}A$ 이하일 때에 0.5V 이하의 전압을 출력하도록 하였으며, IVC의 총 소비전력은 약 1.65mV이하로 평가되었다.
전력분석공격은 스마트카드와 같은 저전력 보안장치에 대한 매우 강력한 공격방법이나, 측정된 전력신호와 암호알고리듬 실행 시 추정되는 중간 값과의 상관도를 연산하는 시점이 시간적으로 일치되어야 가능하다. 보안장치에 랜덤클럭을 적용하면 측정된 전력신호 분석 시점이 서로 일치하지 않게 되므로 랜덤클럭이 전력분석 공격에 대한 방어대책으로 사용된다. 본 논문에서는 전력분석공격에서 랜덤클럭 전력신호에 대한 일정피치 기반의 시간적 정렬 방법을 제안한다. 제안방법은 랜덤클럭이 적용된 보안 장치로부터 측정된 전력신호를 일정한 크기를 갖는 기준피치에 맞추어 시간 축 상의 위치와 크기를 정렬하므로 랜덤 클럭 방어대책을 공격할 수 있는 새로운 방법이다. 마지막으로, 랜덤클럭이 적용된 스마트카드 환경에서 실행된 AES 블럭 암호화 알고리듬에 대하여 제안된 방법을 적용하여 그 공격 가능성을 검토한다.
원격 무선 네트워크 환경에서의 무인 센서 신호처리기의 임무 수행을 위해서는 한정된 전력 자원으로 인해 무인 원격 센서 무선운용 상황에 적합한 신뢰성 있는 저전력 매체 접속 제어 기법이 요구된다. 저전력 무선 네트워크에서 효과적인 신호 전송을 위해서는 CSMA/CA, X-MAC을 일반적으로 고려한다. 본 논문에서는 고정 노드로 구성되는 무선 네트워크에서 노드 제어를 위한 이동 노드의 망 참여/탈퇴가 유동적인 망 형태에서의 신속한 데이터 전달 및 소모 전력 최소화 달성이 가능한 저전력 성능이 향상된 LP-MAC 동작 기법을 제안한다. 고정노드는 망 자율구성을 수행하여 망에 수시로 참여/탈퇴하는 이동 노드로의 빠른 정보 전달을 위해 비동기 방식으로 동작한다. 이동 노드가 망에서 탈퇴할 경우, 망 전체 운용모드가 소모 전력의 최소화를 위한 동기모드로 천이됨으로써 최소 전력 운용이 가능한 매체접속 제어 기법이다.
TBM 디스크 커터의 마모량을 실시간 계측하기 위해서는 센서를 이용해 계측을 자동화하는 것뿐만 아니라, 계측된 데이터를 후방의 정보처리시스템에 안정적으로 전송하는 것도 중요하다. 본 연구에서는 TBM 커터헤드에 설치된 센서로부터 챔버 후방에 설치된 수신기로 데이터를 무선 전송할 때 저전력 블루투스(Bluetooth Low Energy, BLE) 기술의 활용 가능성을 검토하였다. 실험실 모사 실험을 통해 송신기의 신호강도, 송신기와 수신기 사이의 거리, 챔버 공간에 채워진 물질의 종류에 따라 변화하는 수신기의 신호 수신 강도(Received Signal Strength Index, RSSI)의 특성을 분석하였다. 송신기의 신호강도를 0 dBm 이상으로 설정하면 실험에서 고려한 모든 이격거리 조건과 챔버의 상태 조건에서 데이터를 무선 전송할 수 있었다.
본 논문에서는 무선 통신 시스템의 중간주파수 처리 단을 디지털로 신호 처리하는 DDC(Digital Down Converter)의 저전력 아키텍처를 제안한다. FIR 필터의 계산량을 줄이기 위해서 개발된 Interpolated FIR 필터가 DDC의 데시메이션 필터로 널리 사용되고 있다. 본 논문은 이와 같은 Interpolated FIR 필터의 개념이 IIR 필터에도 적용될 수 있음을 보이고, 전력 소모와 구현 면적이 기존의 Interpolated FIR 구조보다 더욱 감소된 Interpolated IIR 필터 구조를 제안하였다. CDMA IS-95 DDC 사양의 데시메이션 필터를 FIR 구조, Interpolated FIR 구조, IIR 구조, Interpolated IIR 구조로 구현하여 이 4가지 구조들의 전력소모와 구현 면적을 비교하였으며 제안된 Interpolated IIR 구조가 기존의 Interpolated FIR 구조에 비하여 15.2%의 소모전력 감소와 35.3%의 구현면적의 감소를 달성할 수 있음을 보인다.
본 논문에서는 모바일 초음파(mobile ultrasound) 영상신호의 빔포밍 알고리즘에서 요구되는 고성능 및 저전력을 만족시키는 매니코어 프로세서에 대한 디자인 공간 탐색 방법을 소개한다. 매니코어 프로세서의 디자인 공간 탐색을 위해 매니코어의 각 프로세싱 엘리먼트(Processing Element, PE)당 초음파 영상신호 데이터의 수를 변화시키는 실험을 통해 실행시간, 에너지 효율 및 시스템 면적 효율을 측정하고, 측정된 결과를 바탕으로 최적의 매니코어 프로세서 구조를 선택하였다.
최근 추적 레이더는 다양한 환경에서 여러 가지 제약을 받지 않고 운용이 가능한 소형 추적 레이더 개발의 필요성을 확인하였다. 또한 소형 추적 레이더의 성능은 기존 추적 레이더와 동등 이상을 요구한다. 이런 소형 추적 레이더는 기존 추적 레이더의 소형화와 저전력화를 통해 구현할 수 있다. 본 논문에서는 소형 추적 레이더를 위한 신호처리기의 역할과 기능을 정의하고, 소형 추적 레이더를 위한 신호처리기를 구현하기 위해 필요한 디바이스 사용의 최소화를 통한 소형화와 소비 전력의 효율을 높이기 위한 방안을 제안하였다. 소형화에 대한 방안으로 상용 DDC, 통신 controller등의 디바이스 기능을 FPGA에 구현하여 소형 추적 레이더를 위한 신호처리기를 설계하였다. 또한 효율이 좋은 Switching regulator를 사용한 전원부의 설계로 저전력 신호처리기를 설계하였다. 마지막으로 구현한 소형 추적 레이더를 위한 신호처리기의 성능시험과 소형 추적 레이더에 신호처리기를 적용한 도플러 추적 시험, 거리 추적 시험으로 신호처리기를 검증하였다.
본 논문에서 설계된 시스템은 ${\pm}2.5\;V$ 또는 +5 V의 환경에서 40 MS/s의 샘플링 속도로 약 70 mW의 정전력을 소비하는 고속 신호 처리용 CMOS 10 비트 파이프라인 A/D 변환기이다. 제안된 A/D 변환기는 각 단 사이의 신호를 빠르게 처리하고, 비교기 옵셋에 대한 넓은 보정 범위를 허용하기 위해 단당 1.5 비트 구조를 사용하였다. 고속 저전력 파이프라인 A/D 변환기의 설계를 인해 특별한 성능을 가진 연산 증폭기를 필요로 함에 따라 기존의 폴디드-캐스코드 구조를 기본으로한 이득 향상 구조의 연산 증폭기를 설계하였다. 특히, 연산 증폭기 자동 설계 도구인 SAPICE의 자체 개발로 최적의 성능을 가진 연산 증폭기를 구현하였다. 그리고 신호 비교 시에 소비되는 전력을 감소시키기 위해 정전력을 거의 소비하지 않는 비교기를 채용하였다. 제안된 A/D 변환기는 $1.0{\mu}m$ n-well CMOS 공정을 이용하였으며 ${\pm}0.6$ LSB의 DNL, +1/-0.75 LSB의 INL, 그리고 9.97 MHz의 입력 신호에 대해 56.3 dB의 SNDR의 특성을 보였다.
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[게시일 2004년 10월 1일]
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