• 제목/요약/키워드: 이산 PI 제어

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풍력 발전기 피치 제어를 위한 퍼지 PI 제어기 (A Fuzzy PI Controller for Pitch Control of Wind Turbine)

  • 천종민;김진욱;김홍주;최영규;김무림
    • 드라이브 ㆍ 컨트롤
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    • 제15권1호
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    • pp.28-37
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    • 2018
  • When the wind speed rises above the rated wind speed, the produced power of the wind turbines exceeds the rated power. Even more, the excessive power results in the undesirable mechanical load and fatigue. A solution to this problem is pitch control of the wind turbines. This paper presents a systematic design method of a collective pitch controller for the wind turbines using a discrete fuzzy Proportional-Integral (PI) controller. Unlike conventional PI controllers, the fuzzy PI controller has variable gains according to its input variables. Generally, tuning the parameters of fuzzy PI controller is complex due to the presence of too many parameters strongly coupled. In this paper, a systematic method for the fuzzy PI controller is presented. First, we show the fact that the fuzzy PI controller is a superset of the PI controller in the discrete-time domain and the initial parameters of the fuzzy PI controller is selected by using this relationship. Second, for simplicity of the design, we use only four rules to construct nonlinear fuzzy control surface. The tuning parameters of the proposed fuzzy PI controller are also obtained by the aforementioned relationship between the PI controller and the fuzzy PI controller. As a result, unlike the PI controller, the proposed fuzzy PI controller has variable gains which allow the pitch control system to operate in broader operating regions. The effectiveness of the proposed controller is verified with computer simulations using FAST, a NREL's primary computer-aided engineering tool for horizontal axis wind turbines.

전압 리플 추정을 고려한 단상 PWM 컨버터의 순시치 제어 (Instantaneous Control of a Single-phase PWM Converter Considering the Voltage Ripple Estimate)

  • 김만기;이우철;현동석
    • 전력전자학회논문지
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    • 제2권2호
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    • pp.29-34
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    • 1997
  • 본 논문에서는 단상 PWM 컨버터의 입력전류 제어계와 출력전압 제어계의 안정한 PI 이득을 설계하고 DSP를 이용하여 순시 제어기를 구현한다. DC link 전압 제어기는 연속영역에서 설계하여도 무방하나 입력전류 제어계는 이산화 영향을 무시할 수 없으므로 입력전류 제어계를 연산 시간을 고려하여 이산 영역에서 전달 함수를 구하여 설계한다. 또한 리플전압 추정 루틴을 통하여 실제 커패시터의 정전용량을 알아내는 알고리듬을 제시하고 이 알고리듬에 의하여 DC link 정전 용량을 과도상태에서도 추정해 낼수 있음을 보인다. 실험에 의하여 입력역률 99%와 부하급변시 전압 변동률 $\pm$5% 이하의 결과를 얻었다.

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외란 관측기 기반의 이산시간 전동기 추종제어 (Discrete Time Tracking Control of Motor Based on Disturbance Observer)

  • 전용호;강정욱
    • 한국전자통신학회논문지
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    • 제16권3호
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    • pp.511-518
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    • 2021
  • 전동기의 좋은 추종 성능을 얻기 위해서는 외란 관측기가 포함되어 외란에 대응할 수 있는 제어기를 설계하는 것이 필요하다. 전동기의 외란 관측기는 1차 저역통과 필터를 기반으로 부하 토크과 역기전압을 추정하도록 설계하였다. 외란 관측기와 제어기의 상호관계를 비교하고, 개선된 제어 성능을 얻기 위하여 PI 제어기와 IP 제어기를 설계하였다. 설계된 관측기와 제어기의 성능을 확인하고자 120 [W]급의 BLDC 전동기에 적용하였다. 그 결과 오버슈트가 줄어들며, 정상상태 오차가 영으로 수렴하는 것을 확인할 수 있다.

리산시스템을 위한 최적출력 P&PI궤환 (Optimal Output P and PI Feedback for Discrete Time Systems)

  • 신현철;변증남
    • 대한전자공학회논문지
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    • 제17권6호
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    • pp.38-43
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    • 1980
  • 시간에 따라 변하지 않는 선형 다변수 시스템의 출력 궤환 제어를 이산시간계에서 최적화 하기 위한 필요 조건을 유도했다. Quadratic performance index를 사용했다. 결과는 출력의 비례적분 궤환의 최적이득을 구하는 데에도 쉽게 적용할 수 있다. 예제를 들어 최적 궤환이 득을 구했다.

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유리차수 적분을 이용한 전동기 속도제어 (Motor Speed Control Using the Fractional Order Integral)

  • 전용호;강정욱
    • 한국전자통신학회논문지
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    • 제16권3호
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    • pp.503-510
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    • 2021
  • 본 연구는 유리 차수 미분의 수학적인 방법을 시스템의 응답을 제어하는 제어기에 적용하고자 한다. 따라서 제어기로 구성하기 위해서는 유리수 지수에 대한 적분기를 이산시간으로 변환하여 설계한다. IP 제어기는 오차에 대한 적분제어기를 구성하고 비례제어기는 시스템 출력만 적용하는 구조이다. 유리 차수 적분기를 IP 제어기의 적분제어기에 활용함으로 제어기를 설계한다. 먼저 PI 제어기와 IP 제어기의 성능을 비교하고, 설계된 제어기를 전동기의 속도 제어에 적용한다. 그 결과 전동기의 출력상태인 속도가 균일하며 정밀한 제어 성능을 얻을 수 있었다. 정상상태의 속도오차가 0.1 [%] 이내 이고, 오버슈트가 없는 정밀하며 균일한 속도 제어 성능을 가짐을 확인할 수 있었다.

병렬 구조의 직접 디지털 주파수 합성기의 설계 (A practial design of direct digital frequency synthesizer with multi-ROM configuration)

  • 이종선;김대용;유영갑
    • 한국통신학회논문지
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    • 제21권12호
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    • pp.3235-3245
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    • 1996
  • 이산스펙트럽(Spread Spectrum) 통신 시스템에 사용되는 DDFS(Direct Digital Frequency Synthesizer)는 짧은 천이시간과 광대역의 특성을 요구하고, 전력소모도 적어야 한다. 이를 위해서 본 연구의 DDFS는 파이프라인 구조의 위상 가산기와 4개의 sine ROM을 병렬로 구성하여, 단일 sine ROM으로 구성된 DDFS에 비해 처리 속도를 4배 개선하였다. 위상 가산기의 위상 잘림으로 나빠지는 스펙트럼 특성은 위상 가산기 구조와 같은 잡음 정형기를 사용하여 보상하였고, 잡음 정형기의 출력 중 상위 8-bit만을 sine ROM의 어드레스로 사용하였다. 각각의 sine ROM은 사인 파형의 대칭성을 이용하여, 0 ~ $\pi$/2 사인 파형의 위상, 진폭 정보를 저장함으로 0 ~ 2$\pi$ 사인 파형의 정보를 갖는 sine ROM에 비해 크기를 크게 줄였고, 어드레스의 상위 2-bit를 제어 비트로 사용하여 2$\pi$의 사인 파형을 조합했다. 입력 클럭을 1/2, 1/4로 분주하여, 1/4 주기의 낮은 클럭 주파수로 대부분의 시스템을 구동하여, 소비 전력을 감소시켰다. DDFS 칩은 $0.8{\mu}$ CMOS 표준 공정의 게이트 어레이 기술을 이용ㅇ하여 구현하였다. 측정 결과 107MHz의 구동 클럭에서 안정하게 동작하였고, 26.7MHz의 최대 출력 주파수를 발생시켰다. 스펙트럼 순수도(Spectral purity)는 -65dBc이며, tuning latency는 55 클럭이다. DDFS칩의 소비 전력은 40MHz의 클럭 입력과 5V 단일 전원을 사용하였을 때 276.5mW이다.

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