• 한국음향학회지
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• 제37권2호
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• pp.110-117
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• 2018

본 논문에서는 음성/오디오 부호화기를 위한 저지연 윈도우 스위칭 MDCT(Modified Discrete Cosine Transform) 방법을 제안한다. 윈도우 스위칭 알고리즘을 사용하여 신호의 특성이 빨리 변하는 전이 구간에서 음질 저하를 개선하고, 저지연 TDAC(Time Domain Aliasing Cancellation)를 사용하여 알고리즘 지연을 1/2로 줄일 수 있는 MDCT 방법을 제안한다. 제안된 윈도우 스위칭 방법은 기존 윈도우 스위칭 알고리즘이 다른 길이의 중첩합(overlap-add)을 사용하는 것과 달리, 일정한 길이의 중첩합을 사용하여 알고리즘 지연을 1/2로 줄일 수 있었고, 신호의 특성에 따라 윈도우의 종류를 2개로 줄여 프레임 상태를 표현하는 정보 비트를 1 bit 감소시킬 수 있었다. 제안한 알고리즘을 MDCT 기반의 음성/오디오 부호화기인 ITU-T(International Telecommunication Union - Telecommunication) G.729.1 부호화기에 적용하여 성능을 확인하였으며, 알고리즘 지연을 절반으로 감소시키면서 동일한 음질을 유지할 수 있었다.

• E2M - 전기 전자와 첨단 소재
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• 제6권4호
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• pp.330-338
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• 1993

Channel의 폭과 길이가 15 x 15.mu.m, 15 x 1.5.mu.m, 1.9 x 1.7.mu.m인 비휘발성 SNOSFET EEPROM 기억소자를 CMOS 1 Mbit 설계규칙에 의하여 제작하고 체널크기에 따른 $I_{D}$- $V_{G}$특성 및 스위칭 특성을 조사하여 비교하였다. 게아트에 전압을 인가하여 질화막에 전하를 주입시키거나 소거시킨 후 특성을 측정한 결과, 드레인전류가 적게 흐르는 저전도상태와 전류가 많이 흐르는 고전도상태로 되는 것을 확인하였다. 15 x 15.mu.m의 소자는 전형적인 long channel특성을 나타냈으며 15 x 1.5.mu.m, 1.9 x 1.7.mu.m는 short channel특성을 보였다. $I_{D}$- $V_{G}$ 특성에서 소자들의 임계 문턱전압은 저전도상태에서 $V_{W}$=+34V, $t_{W}$=50sec의 전압에서 나타났으며 메모리 윈도우 폭은 15 x 15.mu.m, 15 x 1.5.mu.m, 1.9 x 1.7.mu.m의 소자에서 각각 6.4V, 7.4V, 3.5V였다. 스위칭 특성조사에서 소자들은 모두 논리스윙에 필요한 3.5V 메모리 윈도우를 얻을 수 있었으며 논리회로설계에 적절한 정논리 전도특성을 가졌다.특성을 가졌다.다.다.

• 대한전자공학회논문지SD
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• 제42권8호
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• pp.35-42
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• 2005

본 논문에서는 전력소모 감소 및 강건성 (robustness) 향상을 위한 새로운 구조의 플립-플롭을 제안한다. 가변 샘플링 윈도우 플립-플롭(Variable sampling window flip-flop, VSWFF)은 입력 데이터에 따라 샘플링 윈도우의 폭을 변화시켜 강인한 데이터-래치 동작을 제공할 뿐 아니라 더욱 짧은 hold time을 갖는다. 또한, 이 플립-플롭은 입력 스위칭 행위(input switching activity)가 큰 경우에 기존의 저전력 플립-플롭보다 내부 전력소모를 감소시킬 수 있다. 클럭 진폭 감쇄형 가변 샘플링 윈도우 플립-플롭(Clock swing-reduced variable sampling window flip-flop, CSR-VSWFF)은 작은 스윙 폭의 클럭을 사용함으로써 클럭분배망(clock distribution network)의 전력소모를 감소시킬 수 있다. 기존의 클럭 진폭 감쇄형 플립-플롭(Reduced clock swing flip-flop, RCSFF)과 달리, 제안된 플립-플롭은 공급전압만으로 동작하므로 고전압의 발생 및 분배로 인한 설계 상의 비용증가를 제거한다. 시뮬레이션 결과, 기존의 플립-플롭과 비교하여 더욱 좁은 샘플링 윈도우에서도 불변의 지연값(latency) 을 유지하고 전력-지연 곱(power-delay product, PDP)이 개선됨을 확인하였다. 제안된 플립-플롭의 성능을 평가하기 위하여 $0.3\mu m$ CMOS 공정기술을 이용하여 테스트 칩을 설계하였으며, 실험 결과, VSWFF는 입력 스위칭 행위가 최대일 때 전력소모가 감소하며 CSR-YSWFF를 이용하여 설계된 동기 카운터는 부가 고전압의 사용 없이 전력소모가 감소됨을 확인하였다.

• 한국산업정보학회논문지
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• 제18권5호
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• pp.81-92
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• 2013

인공위성은 태양전지판 전개, 통신 안테나 전개, 관측 장비에 대한 오염방지 덮개, 추진계의 파이로테크닉 밸브 및 리튬-이온 셀 모듈 바이패스 장치 등 다수의 분리장치들을 포함하고 있다. 파이로테크닉 회로로 동작되는 분리장치의 기폭제들은 단발성으로 동작되기 때문에 기폭제 구동은 성공적 임무 수행을 위해 필수 요소이다. 파이로테크닉 회로는 안전을 위한 스위칭 네트워크를 포함해야 한다. 일반적인 스위칭 네트워크는 기폭제 점화 동안 스위칭 과도상태 전류를 취급하기 위해 높은 정격 전류 용량의 점화 스위치로 구성되는 단점이 존재한다. 파이로테크닉 회로는 기폭제가 메인버스에서 점화되면 버스에서 요구되는 첨두 전력을 감소시킬 수 있는 전력 조절 기능을 필요로 한다. 본 논문은 기폭제 점화 동안 스위칭 과도상태 전류를 취급하기 위해 높은 정격 전류 용량의 점화 스위치로 구성되는 단점을 극복하기 위해 점화 스위치를 작동시키기 위한 점화 명령에 동조된 파이로테크닉 회로를 설계한다. 파이로테크닉 회로는 점화스위치들이 점화 전류를 전달만 하고 스위칭을 하지 않는 것을 보증하기 위해 점화 명령에 동조되어 전류 제한된 윈도우 펄스 점화 전류를 제공한다. 전류 제한된 윈도우 펄스 점화 전류는 스위칭 네트워크에서 낮은 정격 전류 용량과 가벼운 무게의 스위치 사용을 가능하게 한다. 파이로테크닉 회로의 전류 제한 기능은 기폭제에 공급하는 전압을 감소시키고 첨두 버스 전력을 감소시키는 전력 조절 효과를 제공한다. 정지궤도위성 개발에 적용하기 위해 파이로테크닉 회로는 개발 모델에서 시험하여 기능을 검증하였다.

• 한국음향학회:학술대회논문집
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• 한국음향학회 1998년도 학술발표대회 논문집 제17권 2호
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• pp.23-26
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• 1998

This paper presents a technique to enhance TDAC in the AC-3 algorithm. To reduce block boundary noise without decreasing the performance of transform coding, new special window adopted. They improves the defect of the AC-3 algorithm that could not properly cancel aliasing in the tansient period. In addition, a fast MDCT calculation algorithm based on a fast Fourier Transform, is adopted.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2004년도 전력전자학술대회 논문집(1)
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• pp.325-329
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• 2004

본 논문은 하이브리드 전기자동차의 12V보조배터리 충전용 DC-DC 컨버터의 최적설계에 관한 것으로 하이브리드 전기자동차의 특성상 DC-DC 컨버터는 최대부하의 $30\%\~70\%$ 정도의 비교적 낮은 부하영역에서 주로 동작하므로 이에 따른 적절한 설계가 요구된다. 따라서 DC-DC 컨버터의 주 동작영역에서 효율이 높도록 주요 설계요소인 스위칭 주파수와 고주파 변압기의 누설인덕턴스를 적절히 선정하고 코아의 윈도우 면적을 최소화하는 최적설계에 관한 연구이다.

• 정보처리학회논문지C
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• 제8C권6호
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• pp.793-805
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• 2001

기존 우선 순위 시스템에서는 우선 순위가 높은 패킷이 시스템에서 우선적으로 서비스를 받고 우선 순위가 낮은 패킷은 우선 순위가 높은 패킷이 없을 경우에만 서비스 받도록 되어있다. 그러나 입력 큐잉 시스템에서는 HOL(Head of Line)경쟁에 의해서 우선 순위가 높은 패킷이라도 차단 될 확률이 높다. 따라서 우선 순위가 높은 패킷이 차단됐을 경우라도 우선 순위가 낮은 패킷을 서비스 해 줌으로써 전체적으로 스윗칭 성능을 향상 시킬 수 있다. 본 논문은 고속 스위칭 시스템에서의 우선순위 기반 방식의 성능 분석을 하였다. 스윗칭 시스템 분석은 HOL(Head of line)경쟁 현상에 대한 우선순위 스케쥴링이 미치는 영향을 고려 하였다. 또한 이러한 제어방식을 기반으로 시스템의 최대 처리율, 큐잉 분포현상을 도출 하였다. 입력단 간에 서비스 의존도 때문에 스윗칭 시스템의 정확한 분석은 어려우나 상호 의존성을 갖는다는 가정과 흐름제어 규정을 두어 분석을 하였다. 각각의 입력단에서 보여주는 서비스 향상을 평가 하기위해 큐잉 시스템을 이용 하였다. 윈도우 방식을 고려하지 않고 우선순위 방식에서 정확한 결과를 구하기 위하여 Chen과Guerin[1]가 사용한 방식을 확장 하였다. 더욱이 시스템 구현과 운영 관점에서 우선순위 스윗칭 시스템에 적용하기 위하여 새로운 윈도우 제어방식을 제안한다. 그러므로 우선순위가 낮은 패킷은 지연시간과 처리율을 향상 시킬 수 있다. 성능 향상을 위해 결과치를 비교하여 등가 큐잉시스템을 사용하여 윈도우 방식을 분석 하였다.

• 한국정보통신학회논문지
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• 제7권2호
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• pp.269-275
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• 2003

저전압 프로그래밍이 가능한 플래시메모리를 실현하기 위하여 0.35$\mu\textrm{m}$ CMOS 공정 기술을 이용하여 터널링산화막, 질화막 그리고 블로킹산화막의 두께가 각각 2.4nm, 4.0nm, 2.5nm인 SONOS 트랜지스터를 제작하였으며, SONOS 메모리 셀의 면적은 1.32$\mu$$m^2$이었다. 질화막의 두께를 스케일링한 결과, 10V의 동작 전압에서 소거상태로부터 프로그램상태로, 반대로 프로그램상태에서 소거상태로 스위칭 하는데 50ms의 시간이 필요하였으며, 최대 메모리윈도우는 1.76V이었다. 그리고 질화막의 두께를 스케일링함에도 불구하고 10년 후에도 0.5V의 메모리 윈도우를 유지하였으며, 105회 이상의 프로그램/소거 반복동작이 가능함을 확인하였다. 마지막으로 부유게이트 소자에서 심각하게 발생하고있는 과도소거현상이 SONOS 소자에서는 나타나지 않았다.

• 전자공학회논문지SC
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• 제45권3호
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• pp.51-58
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• 2008

본 논문은 반도체를 이용한 열화방지형 파워폴딩 제어기 설계에 관한 연구이다. 파워기술은 자동차용 사이드 미러 접이 콘트롤러, 와이퍼 콜트롤러, 안테나 콘트롤러, 파워윈도우 콘트롤러 등에 사용되고 있는 모터제어기술로 기존의 제어 방식은 DC 모터, 스위칭 소자 그리고 Relay 등을 조합한 방식을 채택하고 있다. 그러나 이러한 방식은 동작에 대한 신뢰성 및 내구성, 노이즈 등의 문제점을 극복하는데 한계를 갖고 있다. 따라서 본 논문에서는 모터의 동작을 감시하기 위한 방법으로 부하감지부에서 Motor의 Brush Noise를 감지하도록 하였고, R, C 충 방전 시정수에 의한 정밀시간 제어 방법으로 모터의 열화현상을 최소화하였다. 그리고 스위칭 소자로 반도체 소자인 MOSFET를 사용함으로써 동작의 안정성과 수명의 한계를 극복할 수 있는 제어장치를 설계하였다. 연구결과 모터의 반복 동작시간, Cut-off Time, 동작전압 범위, 전원 발생 노이즈 등에서 최대 11배 이상 향상된 효과를 얻을 수 있었다.

• 대한전자공학회논문지TC
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• 제41권9호
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• pp.73-80
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• 2004

본 논문에서는, 고성능 결함 감내 셀 스위치인, 사이클릭 벤얀 망의 셀 순서의 무결성 문제를 해결하기 위한 셀 재배열 버퍼를 제시한다. 사이클릭 벤얀 스위치는, 편향 자기 경로제어를 사용하여, 입력 정합과 출력 정합 사이에 다중 경로들을 제공함으로써, 높은 신뢰성을 제공하고, 스위치의 내부 링크들의 혼잡 문제를 해결한다. 그런데, 이러한 다중 경로들은 길이가 서로 다를 수 있다 따라서 셀들이 입력 정합에 도착한 순서와 다르게 출력 정합에 도달할 수 있다. 제안된 셀 재배열 버퍼는 이러한 셀 순서의 무결성 문제를 해결하는 일종의 하드웨어 슬라이딩 윈도우 메커니즘이다. 본 장치 구성의 주요 비용은 슬라이딩 윈도우를 구성하는 하드웨어 비용이다. 따라서 필요한 슬라이딩 윈도우의 크기를 계산하기 위해서, 비균일 주소 분포를 가진 트래픽 부하 하에서 스위치를 시뮬레이션하여, 셀들이 스위치를 통과할 때 발생하는 지연 분포를 분석을 하였다. 이 분석을 통하여, 적은 양의 범용 메모리와 제어 논리를 사용하여, 셀 순서의 무결성 문제를 해결하는 셀 재배열 버퍼를 만들 수 있다는 사실을 밝혔다. 본 논문에서 제시한 셀 재배열 버퍼는 다른 다중 경로 스위칭 망들을 위해서도 사용될 수 있다.