계통 연계 인버터 제어 시 계통 전압과 동상인 계통 전류를 공급해주기 위해, 계통 전압의 위상 값을 알아내야 한다. 계통 전압에 고조파가 존재하지 않을 시에 이 위상값은 정확하지만, 고조파 존재 시에 위상 값은 오차가 생긴다. 이 오차는 동기 좌표계 PI 제어기의 지령치에 기본파 외의 고조파를 함유하게 만든다. 그 결과, 계통에 공급하는 계통 전류에 고조파를 함유하게 만든다. 본 논문은 3차 필터를 이용하여 고조파가 존재하는 3상 계통 전압에도 불구하고 기본파의 위상 값만을 추출해내는 PLL을 설계한다. 주파수 응답 이론에 근거하여 해석적으로 필터 변수를 정하며, 이를 검증하기 위하여 모의 실험을 수행한다.
본 논문에서는 JPEG Pleno에서 표준 데이터세트로 제공되고 있는 랜덤 위상 홀로그램의 압축 방법을 제시한다. 일반적으로 영상의 노이즈 성분은 압축의 효율을 크게 떨어트린다. 스페클 노이즈가 심한 홀로그램의 경우 일반 영상에 비해 압축률 대비 화질이 좋지 않다. 홀로그램의 시각화를 위한 랜덤 위상의 추가는 스페클 노이즈와 더블어 홀로그램의 압축 효율을 더욱이 떨어트린다. 랜덤 위상 홀로그램에 웨이블릿 기반의 다중 필터링 방법을 적용한다. 다중 필터링 방법은 홀로그램의 특성을 고려하여 에너지 집중도를 최대한 높이는 방법이다. 에너지 집중도가 높을수록 압축 효율이 좋은 Zero-Tree 방식의 압축을 통해 홀로그램을 압축하고 압축률 대비 정량적 화질평가로 그 효율을 분석한다.
본 논문은 플랫트 딜레이 특성의 올패스 필터의 합을 이용한 로우패스 필터를 제시하였다. 이 필터는 병렬 구조의 올패스 필터로 구성하였고, 일반적인 아날로그 필터는 위상과 지연을 조정하는 것이 불가능하지만, 제시한 필터를 이용하면 위상과 지연을 조정하는 것이 용이하다는 장점을 가지고 있다. 그리고 통과대역 폭과 크기 특성, 군지연 특성과 차단 주파수를 비교 분석하였다. 아울러, 원하는 차단 주파수를 얻기 위해서 가중치를 인가하여, 융통성 있는 차단 주파수와 군지연 특성을 얻었다.
Digital IF(Intermediate Frequency) 처리단과 같은 고속과 저전력을 요구하는 필터에서 덧셈기만을 사용하여 CSD(Canonical Signed Digit)형의 필터계수들을 구현하는 구조가 널리 연구되고 있다. 본 논문에서는 선형위상 FIR(Finite Impulse Response) 필터의 CSD형 필터계수들을 최소의 덧셈으로 구현할 수 있는 아키텍처를 제안한다. 1과 -1로 이루어진 필터계수 표에서 공통패턴을 공유함으로서 덧셈의 수를 줄이는 방법이 이미 연구되었다. 본 논문은 비트 shift, 비트 add, 비트 반전을 통하여 인공의 공통패턴을 만들어서 이미 존재하는 공통패턴에 합류시킴으로서 덧셈의 수를 더욱 줄일 수 있는 방법을 제안한다. CDMA 이동통신 단말기의 IF단에 사용되는 사양의 디지털 필터를 73탭의 CSD형 계수로 구현하여 9.2%의 덧셈 감소의 효과가 있음을 보였다.
유효 굴절을 전달 매트릭스 방법을 이용하여 위상 천이 회절격자 필터의 구조상의 비이상성의 영향을 살펴봄으로써 이 필터의 제작성을 검토하였다. 계산 결과, 위상 천이 오차나 회절결자 주기의 랜덤 변이는 이들 오차에 따른 공진 파장의 변화가 필터의 투과 대역폭 이내에 있어야 함을 알 수 있었다. ITU 기준에 따른 파장과 대역폭을 기준으로 할 때, 이는 상대 오차가 0.1% 이내여야 함을 의미하며, 이 정도의 허용 오차는 회절격자의 제작에 큰 부담으로 작용한다. 필터 끝면 반사는 투과대역의 ripple을 증가시키므로 ripple을 0.25dB 이하로 줄이려면 반사율이 1% 이하로 되어야 한다. 또 위상 천이 필터는 다중 반사에 따른 공진현상을 이용하기 때문에 도파로 손실은 증배되어 나타남을 보였으며, 도파로 손실이 1dB/cm로 낮아도 약 0.2dB의 투과 손실이 나타났다. 이 연구 결과는 파장 다중화 방식 협대역 투과 필터를 설계하고 제작하는데 있어 기본 자료로서 중요한 의미를 가진다.
EFPI (extrinsic Fabry-Perot interferometer) 센서를 이용해 복합재료의 파손 신호를 취득하기 위해서는 파손 신호에 비해 상대적으로 낮은 주파수의 열적, 기계적 정적 변형에 의해 발생하는 위상 변화를 보상해 주는 기술이 필요하다. 또한 센서의 민감도를 최적화하기 위해 출력 신호의 위상을 Quadrature 지점에 유지시켜야 한다. 본 논문에서는 EFPI 센서 시스템의 출력 신호위상을 일정하게 유지시킬 수 있는 안정화 제어 시스템을 개발하였다. 안정화 제어 시스템은 광대역 파장 레이저 광원, 가변 F-P (Fabry-Perot) 필터 그리고 필터를 제어한 수 있는 전자 회로시스템으로 구성하였다. 개발된 시스템의 위상 제어 성능을 평가하기 위해 복합재료 시편의 인장 실험을 수행하여 인장 변형에 의해 발생하는 위상 변화를 개발된 시스템을 이용해 Quadrature 지점에 일정하게 유지할 수 있음을 보였다. 또한 연필심 파손 실험을 통해 개발된 시스템이 파손 신호를 잘 취득할 수 있음을 확인하였다.
이 논문은 전하펌프를 추가하여 루프필터에서 공정에 따라 값이 크게 변하는 저항을 없앤 새로운 구조의 위상고정루프를 보여준다. 두 번째 전하펌프가 기존의 루프 필터 저항 역할을 하도록 하였다. 두 개의 전하펌프 출력은 공정 변화에 같은 방향으로 움직이므로 위상고정루프의 동작이 공정 변화 영향을 적게 받게 된다. 공정 조건(SS/TT/FF)에 따른 시뮬레이션 결과는 제안된 구조가 공정 변화에 무관하게 동작함을 보여주고 있다. 제안된 구조는 1.8V $0.18{\mu}m$ CMOS 공정의 파라미터를 이용하여 HSPICE로 시뮬레이션을 수행하였고 회로의 동작을 검증하였다.
본 논문에서는 Early-late detector, Duty-rate modulator, 그리고 LSI(Lock Status Indicator)를 사용하여 작은 크기와 빠른 위상고정 시간을 갖는 위상고정루프를 제안하였다. 제안된 위상고정루프는 작은 용량을 가진 하나의 커패시터를 사용하게 됨으로써 칩의 크기를 결정하는 루프필터의 크기가 작아지게 되어 크기를 최소화 하였다. 기존의 전하펌프와 달리 2개의 전하펌프를 사용하여 하나의 커패시터를 사용하더라도 2차 루프필터를 사용 한 것과 같은 전압파형을 만들어 줌으로써 위상을 고정시킬 수 있다. 2개의 전하펌프는 UP, DN신호 위상의 빠르기를 감지해주는 Early-late detector와 일정한 비율의 파형을 만들어주는 Duty-rate modulator에 의해 제어된다. LSI회로를 사용함으로써 빠른 위상고정시간을 얻을 수 있다. 제안된 위상고정루프는 1.8V $0.18{\mu}m$ CMOS 공정을 사용하여 설계하였고, Hspice 시뮬레이션을 통해 회로의 동작을 검증하였다.
본 논문에서는 C-band용 주파수체배기를 위상잡음 특성이 우수한 SRD를 이용하여 설계, 제작하였다. 1.13GHz의 신호를 체배기에 인가하여 5체배함으로써 5.65GHz대 신호를 얻는 방법을 이용하였다. 또한 원하는 5체배 신호만을 얻기위해서 출력단에 사용되는 대역통과 필터를 기존에 많이 사용되는 Coupled Line 필터 대신에 Microstrip Ring 공진 필터를 사용하는 방식을 이용하였다.
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[게시일 2004년 10월 1일]
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