• 한국인터넷방송통신학회논문지
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• 제23권4호
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• pp.115-119
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• 2023

현재의 인공지능에서 사용되는 자연어 처리 모델은 거대하여 실시간으로 데이터를 처리하고 분석하는 것은 여러가지 어려움들을 야기하고 있다. 이런 어려움을 해결하기 위한 방법으로 메모리를 적게 사용해 처리의 효율성을 개선하는 방법을 제안하고 제안된 모델의 성능을 확인하였다. 본 논문에서 제안한 모델의 성능평가를 위해 적용한 기법은 BERT[1] 모델의 어텐션 헤드 개수와 임베딩 크기를 작게 조절해 큰 말뭉치를 나눠서 분할 처리 후 출력값의 평균을 통해 결과를 산출하였다. 이 과정에서 입력 데이터의 다양성을 주기위해 매 에폭마다 임의의 오프셋을 문장에 부여하였다. 그리고 모델을 분류가 가능하도록 미세 조정하였다. 말뭉치를 분할 처리한 모델은 그렇지 않은 모델 대비 정확도가 12% 정도 낮았으나, 모델의 파라미터 개수는 56% 정도 절감되는 것을 확인하였다.

• 스마트미디어저널
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• 제12권4호
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• pp.47-57
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• 2023

육각 그리드(hexagonal grid) 구조는 지리정보시스템에서 공간정보 데이터를 처리하고 표현하기에 우수하여 많은 연구가 이루어지고 있다. 육각 그리드를 이용한 시각화는 다른 그리드 표현 방법 대비 시인성이 높지만, 이에 표현된 공간정보 데이터에 따라 양적 정보와 그리드 간 데이터 차이를 효과적으로 전달하는 데 어려움이 있다. 따라서, 본 연구에서는 육각 그리드 외곽에 그림자를 생성하여 시각적으로 육각 그리드를 강조하는 방법을 제안한다. 이를 위해 강조하고자 하는 육각 그리드들의 최외곽 선분들을 오프셋 시키고, 그 정보를 바탕으로 베지어 곡선을 생성하여 최종적인 그림자 형상을 결정한다. 그림자는 육각 그리드에서 멀어질수록 서서히 옅어진다는 특성을 활용하여, 그림자의 가장자리로 갈수록 투명도를 가변적으로 적용한다. 제안하는 방법을 이용하여 하나의 육각 그리드뿐만 아니라 여러 개의 육각 그리드가 주어지더라도 그림자 영역을 효과적으로 생성할 수 있음을 보였으며, 사용자 인터페이스의 입력에 따라 다양한 그림자 형상을 생성할 수 있다. 서울특별시의 행정구 중 용산구에 제안하는 방법을 활용하여 그림자를 생성한 후 시각적으로 강조한 결과를 보인다.

• 전기전자학회논문지
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• 제26권1호
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• pp.10-18
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• 2022

정확한 SOC 추정은 배터리 운영 전략을 제시하는 중요한 지표로 많은 연구가 진행되었다. 기존 연구에서 검증을 위해 주로 사용되던 시뮬레이션 방식은 실제 BMS 환경처럼 실시간 SOC를 추정하기 어렵다. 따라서 본 논문에서는 실시간 배터리 SOC 추정이 가능한 임베디드 시스템을 구현하고 검증 과정에서 발생 가능한 문제 분석을 목표로 한다. 2개의 라즈베리파이 보드로 구성된 환경은 Simscape 배터리에서 측정된 데이터로 EKF 기반 SOC 추정을 진행한다. 검증 단계에서는 온도에 따라 달라지는 배터리 특성을 고려하여, 다양한 주변 온도에서 결과를 확인하였다. 또 임베디드 환경에서 발생하는 오프셋 오류와 패킷 손실에 대비하여, 문제 상황에서 SOC 추정 성능을 검증하였다. 이를 통해 안정범위의 5%내의 오차를 갖는 실시간 SOC 추정이 가능한 임베디드 시스템 구현을 위한 전략을 제시한다.

• 전기전자학회논문지
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• 제28권3호
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• pp.303-309
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• 2024

본 논문에서는 밀리미터파 대역 5G(5th generation) 특화망을 위하여 대규모 사무공간이나 공장 등에 사설망 통신서비스를 제공할 수 있는 고이득 위상배열 안테나를 제안한다. 본 안테나는 1×2의 직렬 배열을 부배열로 8개 단자로 구성된 4×4 배열 구조를 가졌으며, 높은 부엽특성을 구현하기 위하여 개별 방사부의 크기를 조정하는 전력 테이퍼링(Tapering)과 함께 짝수 행의 배열을 1λ_g 만큼 이격하는 오프셋(offset) 배열구조를 적용하여 22.3 dB의 높은 부엽레벨(SLL: Side-lobe level)과 18.1 dBi의 고이득 특성을 구현하였다. 또한, 목적하는 빔 조향범위인 수평(Azimuth) 방향 ±45°, 수직(Elevation) 방향 ±10°에서 최소 15.2 dBi와 17.4 dBi의 이득특성을 구현하여, 넓은 서비스 영역 내에서 원활한 통신서비스가 제공되도록 하였다.

• 정보처리학회논문지D
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• 제19D권2호
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• pp.161-186
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• 2012

최근 플래시 메모리의 꾸준한 용량 증가와 가격 하락으로 인해 대용량 SSD(Solid State Drive)가 점차 대중화 되고 있다. 하지만, 플래시 메모리는 하드웨어적인 제약사항이 존재하며, 이러한 제약사항을 보완하기 위해 FTL(Flash Translation Layer)이라는 특별한 미들웨어 계층을 필요로 한다. FTL은 플래시 메모리의 하드웨어적인 제약사항을 효율적으로 운용하기 위해 필요한 계층으로서 파일 시스템으로부터의 논리적 섹터 번호(logical sector number)를 플래시 메모리의 물리적 섹터 번호(physical sector number)로 변환해주는 역할을 한다. 특히, 플래시 메모리의 여러 제약사항 중 "쓰기 전 지우기(erase-before-write)"는 플래시 메모리 성능 저하의 주요한 원인이 되고 있으며, 이와 관련하여 로그블록 기반의 여러 연구들이 활발히 진행되어 왔지만, 대용량의 플래시 메모리를 효율적으로 운용하기 위해서는 몇몇 문제점들이 존재한다. 로그블록 기반의 FAST는 넓은 지역에 임의쓰기(random writing)가 빈번하게 발생하면 데이터 블록 내 사용되지 않은 섹터들로 인해 효율적이지 못한 합병 연산이 발생한다. 즉, 효율적이지 못한 블록 쓰레싱(thrashing)이 빈번하게 발생하고, 플래시 메모리의 성능을 저하시킨다. 로그블록은 덮어쓰기(overwriting) 발생 시 일종의 캐쉬처럼 운영되며, 이러한 기법은 플래시 메모리 성능 향상에 많은 발전을 주었다. 본 연구에서는 임의쓰기에 대한 성능 향상을 위해 로그 블록만을 캐쉬처럼 운영하는 것이 아니라 플래시 메모리 전체를 캐쉬처럼 운용하고, 이를위해 별도의 오프셋이라는 매핑 테이블을 운용하여 플래시 메모리 성능 저하의 주요한 원인이 되는 합병연산과 삭제연산을 줄였다. 새로운 FTL은 XAST(eXtensively-Associative Sector Translation)이라 명명하며, XAST에서는 공간지역성과 시간지역성에 대한 기본적인 이론을 바탕으로 오프셋 매핑 테이블을 효율적으로 운용한다.

• 대한원격탐사학회지
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• 제34권6_4호
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• pp.1479-1488
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• 2018

2017년 9월 3일 북한에서 발생한 인공지진 신호가 기상청 지진관측망에 관측되었다. 진앙은 풍계리 핵실험 지역으로 지금까지의 실험 중 가장 강력한 실험이었다. 직접적 접근이 제한되는 상황에서 6차 핵실험에 의한 주변 지표변화 연구를 위해 고해상도 위성 자료를 활용하였다. 우선, 지표변위 관측을 위해 ALOS-2 위성 자료를 활용하여 레이더 간섭기법(InSAR: SAR Interferometry)을 적용하였다. 하지만 6차 핵실험 주변 지역의 대규모 지표변위와 강한 진동으로 인해 낮은 긴밀도(coherence) 값을 지니며 레이더 간섭도가 생성되지 않았다. 이는 강한 진동으로 인한 표면의 변화와 레이더 간섭도가 생성 가능한 최대 지표변위 관측 범위보다 큰 변위가 발생했기 때문으로 추정되며 이러한 한계를 극복하기 위해 오프셋 트래킹(Offset Tracking) 방법을 활용하였다. 오프셋 트래킹 방법은 6차 핵실험 전 후 위성 영상레이더의 강도 영상(Intensity)에 대한 교차상관기법(Cross-Correlation)을 이용하는 것으로 상관관계 추정을 위해 사용된 윈도우 크기에 따라 결과가 달라지는 단점이 존재한다. 본 연구에서는 32부터 224까지 16단계로 윈도우 크기를 변화시키고 그 결과의 통계적 처리 후 지표변위를 생성하였다. 그 결과, 6차 핵실험 장소를 기준으로 만탑산 서쪽 지역에서 최대 3 m의 지표변위를 관측하였다. 또한, 고해상도 광학 영상을 활용하여 6차 핵실험에 의한 산사태 및 함몰지역으로 추정되는 지역을 확인하였다. 이러한 현상은 매우 강력한 지하 핵실험에 의한 것으로 판단되며 기존 음파 및 지진파를 이용한 핵실험 분석뿐만 아니라 고해상도 위성영상을 활용하여 비접근 지역에 대한 보조 분석 자료로 활용이 가능 할 것이다.

• 한국전자파학회논문지
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• 제24권3호
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• pp.219-232
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• 2013

본 논문에서는 손과 같은 물체가 안테나에 접근하였을 때 이탈된 공진 주파수와 임피던스를 자동으로 복원하여 무선기기의 송수신 성능을 항상 최적의 상태로 유지하도록 할 수 있는 UHF 특정 소출력 무선주파수 대역(425 MHz)의 소형 마이크로스트립 안테나를 설계, 제작하였다. 반파장 마이크로스트립 방사체의 양쪽 끝단을 접지면 쪽으로 폴딩하여 소형화하고, 역시 방사체와 접지면 사이에 바랙터 다이오드에 의한 캐패시턴스를 장하한 다음, 각각 역바이어스 전압 조절에 의한 용량을 비대칭적으로 변화시킴으로써, -30 dB 이하의 일률적인 반사 손실을 유지하면서 395 MHz에서 455 MHz까지 연속적인 공진 주파수 조절이 가능한 전압 제어 안테나를 설계하였다. RF 모듈로부터 시험 신호를 안테나에 송출하여, 부정합에 의해 안테나로부터 되돌아 온 반사 신호 레벨을 RSS(Receive Signal Strength) 검출 회로와 오프셋 증폭기를 통하여 마이크로콘트롤러에 입력하고, 그 레벨이 최소가 되도록 안테나의 바이어스 전압을 자동 조절하는 펌웨어를 설계, 시스템을 완성하여 시험한 결과, 손, 금속판, 유전체 등의 물체를 접근시켰을 때 틀어졌던 안테나의 특성이 수 초 이내에 완전하게 복원됨을 확인하였다.

• 대한전자공학회논문지TC
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• 제42권8호
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• pp.33-40
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• 2005

본 논문은 DS/CDMA 신호 환경에서 동작하는 배열 안테나 시스템에서 다이버시티 이득을 이용하여 동기 성능을 향상시키는 탐색기를 제안한다. 제안한 PN 동기 검출 방법은, 대부분의 CDMA 기반 신호 환경에서 각 안테나 소자에 유기되는 간섭자의 실수-부 성분과 허수-부 성분이 서로 독립적인 가우시안 채널로 모델링할 수 있다는 사실에 근거를 둔다. 제안한 PN 동기 검출 방법은, 모든 PN 위상 오프셋에서 동기 에너지 값을 구하기 위해, 다수의 수신 신호를 안테나 별로 수신기의 PN과 독립적으로 코릴레이션하여 non-코히런트하게 선형 결합하는 단계인 검색 (searching) 단계와 구한 동기 에너지 값을 락-검출기에서 설정한 최적 기준값과 비교하여 동기 성공 여부를 판단하는 증명 (verification) 단계로 이루어진 single-dwell 방식이다. 본 논문에서는 평균 PN 동기 획득 시간 (Mean Acquisition Time)을 결정짓는 중요한 요소인 다이버시티 이득의 영향에 대해서 분석한다 일반적으로, 평균 PN 동기 획득 시간은 배열 안테나 소자의 수가 증가할수록 감소한다고 알려져 있다. 그러나, 다이버시티 차수 증가에 의한 PN 동기 획득 성능 개선은 포화된다. 따라서, 배열 안테나 수신기에서는 수신기의 동작 SNR 범위와 목표 검출 확률 $P_D$ 및 오-경보 확률 $P_{FA}$를 고려하여, 평균 PN 동기 획득 시간을 최소화하기 위한 최적의 배열 안테나 설계가 필요하다. 제안한 PN 동기 검출 방법의 성능은 주파수 선택적 레일레이 페이딩 채널에서 분석하였으며, 기존 단일 안테나에서의 PN 동기 획득 방법보다 우수함을 검출 확률 $P_D$ 및 오-경보 확률 $P_{FA}$항목에서 검증하였다.

• 대한전자공학회논문지SD
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• 제42권12호
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• pp.53-60
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• 2005

본 논문에서는 저 전력 멀티미디어 응용을 위한 10b 100 MS/s $1.4\;mm^2$ CMOS A/D 변환기(ADC)를 제안한다. 제안하는 ADC는 해상도 및 속도 사양을 만족시키면서, 면적 및 전력 소모를 최소화하기 위해 기존의 다단 구조가 아닌 2단 파이프라인 구조를 사용하였다. 그리고 10 비트 해상도에서 1.2 Vp-p의 단일 및 차동 입력 신호 처리 대역폭을 넓히기 위해 입력 샘플-앤-홀드 증폭기에는 게이트-부트스트래핑 회로를 적용하며, 6 비트 해상도를 필요로 하는 두 번째 단의 flash ADC에는 오픈-루프 오프셋 샘플링 기법을 적용하였다. 또한 커패시터 등 소자 부정합에 의해 해상도에 크게 영향을 줄 수 있는 MDAC의 커패시터에는 3차원 완전 대칭 구조를 갖는 레이아웃 기법을 제안하였다. 기준 전류/전압 발생기는 온-칩으로 집적하여 잡음 에너지를 줄였으며, 필요시 선택적으로 다른 크기의 기준 전압을 외부에서 인가하도록 설계하였다. 제안하는 10b 시제품 ADC는 0.18 um CMOS 공정으로 제작되었고, 측정된 DNL 및 INL은 각각 0.59 LSB, 0.77 LSB 수준을 보여준다. 또한 100 MS/s의 샘플링 속도에서 SNDR 및 SFDR이 각각 54 dB, 62 dB 수준을 보였으며, 전력 소모는 56 mW이다.

• 대한전자공학회논문지SD
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• 제43권12호
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• pp.55-64
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• 2006

본 설계에서는 무선 랜 등 최첨단 무선 통신 및 고급영상 처리 시스템과 같이 고해상도와 높은 신호처리속도, 저전력 및 소면적을 동시에 요구하는 고성능 집적시스템 응용을 위해 기존의 보정기법을 사용하지 않는 14b 70MS/s 0.13um CMOS A/D 변환기(Analog-to-Digital Converts- ADC)를 제안한다. 제안하는 がU는 중요한 커패시터 열에 인접신호에 덜 민감한 3차원 완전 대칭 구조의 레이아웃 기법으로 소자 부정합에 의한 영향을 최소화하였고, 3단 파이프라인 구조로 고해상도와 높은 신호처리속도와 함께 전력 소모 및 면적을 최적화하였다. 입력 단 SHA 회로에는 Nyquist 입력에서도 14비트 이상의 정확도로 신호를 샘플링하기 위해 게이트-부트스트래핑 (gate-bootstrapping) 회로를 적용함과 동시에 트랜스컨덕턴스 비율을 적절히 조정한 2단 증폭기를 사용하여 14비트에 필요한 높은 DC전압 이득을 얻음과 동시에 충분한 위상 여유를 갖도록 하였으며, 최종 단 6b flash ADC에는 6비트 정확도 구현을 위해 2단 오픈-루프 오프셋 샘플링 기법을 적용하였으며, 기준 전류 및 전압 발생기는 온-칩으로 집적하여 잡음을 최소화하면서 필요시 선택적으로 다른 크기의 기준 전압 값을 외부에서 인가할 수 있도록 하였다. 제안하는 시제품 ADC는 0.13um CMOS 공정으로 요구되는 2.5V 전원 전압 인가를 위해 최소 채널길이는 0.35um를 사용하여 제작되었으며, 측정된 DNL 및 INL은 14비트 해상도에서 각각 0.65LSB, 1.80LSB의 수준을 보이며, 70MS/s의 샘플링 속도에서 최대 SNDR 및 SFDR은 각각 66dB, 81dB를 보여준다. 시제품 ADC의 칩 면적은 $3.3mm^2$이며 전력 소모는 2.5V 전원 전압에서 235mW이다.