본 논문에서는 현재 우리 나라의 초고속 국가기간전송망의 기본 전송장비인 2.5Gb/s SDH 전송시스템에 적용되어 2-선 양방향 선로 스위칭 링의 자기치유동작을 가능하게 하는 공간분할스위치 소자의 설계와 시스템에의 적용을 다룬다. Compass tool로 설계된 스위치 소자는 1.25Gb/s의 스위치 처리용량을 가지며 0.8$\mu\textrm{m}$ CMOS gate-array로 제작되었다. 제안된 스위치 소자는 2-선 양방향 전송선로 상에 장애가 발생했을 때 신속한 자기치유동작을 가능하게 한다. 스위치의 구조는 Add/Drop 제어부, Cross-point switch, 데이터 프레임 위상 정렬부, 비장착(Unequipped) 신호 프레이머부, 프로세서 접속부 등으로 구성된다. 제작된 2개의 스위치를 병렬구조로 구성하여 2.5Gb/s SDH 전송시스템에 적용하여 시험한 결과 임의의 광선로 장애 시 신호채널들의 링 스위칭 동작으로 즉시 복구가 가능함을 보여준다.
본 논문에서는 DS-CDMA 기반의 W-CDMA 상향링크 시스템에서 타사용자 간섭 및 다중 경로 간섭 신호를 효율적으로 제거할 수 있는 Multistage Adaptive Partial PIC를 설계하고 모의실험을 통해 그 성능을 분석하였다. 적응 방식은 연판정기의 가중치를 수신 신호에 따라 제어하는 방식이기 때문에 연판정의 효과를 극대화시킬 수 있고 더욱 정밀한 간섭 신호의 재생을 통해 검출 오류 포화 현상을 해결하여 우수한 성능을 얻을 수 있다. 결과적으로 Multistage Adaptive Partial PIC는 시변 특성의 다양한 채널환경에서 단순한 최적화 방법을 제공하고 기존 Multistage Partial PIC보다 적은 단계에서 최적성능을 보였다. 줄어든 단계이외에도 레이크 수신기의 출력단에서 간섭 신호를 제거하는 방식으로 설계하여 시스템의 복잡도를 대폭 줄였다. Multistage Adaptive Partial PIC를 사용함으로써 고속의 데이터 전송에서도 간섭 신호의 정밀한 재생과 효율적인 제거를 통해 초기 검출 오류로 인한 검출 오류 포화 현상을 해결하고 성능을 향상시킬 수 있음을 제시하였다.
본 논문에서는 계층간 교차 (Cross-Layer) 개념을 적용하여 터보 (Turbo) 부호화된 광 (Optical) 부호분할 다중접속 (CDMA : Code Division Multiple Access) 시스템의 네트워크 성능을 분석하고 실험하였다. 계층간 교차 개념은 물리 (Physical) 계층과 매체접근제어 (MAC : Medium Access Control) 계층을 고려하였다. 시스템은 펄스위치변조 (PPM : Pulse Position Modulation)를 적용한 강도변조/직접검파 (IM/DD : Intensity Modulation/Direct Detection) 방식의 광 시스템을 고려하였다. 그리고 시스템의 성능을 향상시키기 위해 병렬 연접된 길쌈부호 (PCCC : Parallel Concatenated Convolutional Code)로 이루어진 터보 부호를 사용하였다. 네트워크의 성능은 비트오류확률 (BEP : Bit Error Probabiliy) 측면에서 분석되었다. 모의실험 결과, 터보 부호는 적당한 부호화 및 복호화 복잡도에서 상당한 부호화 이득을 제공하는 것을 확인할 수 있었다. 또한 일정한 부호화율 (Code Rate)에서 인터리버 길이와 복호과정에서의 반복 복호 횟수를 증가시킬수록 시스템 성능이 향상되는 것을 확인하였다.
SMT(Simultaneous Multi Threading)구조는 여러 개의 독립적인 쓰레드들로부터의 명령어들을 이용하여, 이슈 슬롯을 채울 수 있도록 하는 쓰레드 레벨 병렬 성을 사용함으로서, 결국 프로세서의 성능을 향상시킨다. 독립적인 여러 개의 준비된 쓰레드들을 갖는다는 것은 실행 유닛들이 무용의 상태로 남아 있는 가능성을 줄일 수 있다는 의미이며, 이러한 사항은 결국 프로세서의 효율성을 증가 시키게 된다. SMT 프로세서에서 그러한 이점을 이용하기 위해서는, 이슈 유닛은 서로 다른 쓰레드들로부터의 여러 명령어들 간의 흐름을 제어해서, 그러한 명령어들 사이에서 충돌이 일어나지 않도록 해야 하지만, 이러한 사실로 인해 SMT 프로세서의 이슈 로직은 매우 복잡해지게 된다. 따라서, 본 논문에서 제안된 SMT 구조는 순차적 이슈와 완료 방식을 채택하여, 복잡한 레지스터 리네이밍이나 재순차 버퍼 등을 사용할 필요가 없이 비교적 간단한 스코어보드 어레이만을 사용하는 이슈 구조를 사용할 수 있게 하였다, 그러나, 여전히 SMT용 스코어보드 구조는 일반적인 단일 쓰레드의 범용 프로세서의 경우보다는 훨씬 더 복잡하고 많은 비용이 소요된다. 본 논문은 ARM 기본의 순차적 SMT 아키텍처 상에서의 최적의 스코어보드메커니즘에 대한 구현을 제안한다.
본 논문에서는 도파관의 차단 주파수 이상에서 평형 조건을 만족하는 CRLH(Composite Right-/Left-Handed) 직각 도파관이 설계되었다. 제안된 CRLH 도파관 구조는 특정 주파수에서 음의 유효 투자율 특성을 나타내는 하나의 단락 스터브와 음의 유효 유전율을 구현하는 두 개의 꼬인 형태의 H-plane 아이리스로 구성된다. 도파관 내부에 삽입된 꼬인 형태의 H-plane 아이리스는 단락 스터브와 아이리스 사이의 상호 작용을 최소화하여 RH(Right-Handed) 대역과 LH(Left-Handed) 대역의 밴드 갭을 조절하는 직렬 및 병렬 공진 주파수를 독립적으로 제어할 수 있으므로, 평형 조건을 만족하는 CRLH 도파관의 설계가 가능하다. 설계된 CRLH 도파관 구조의 해석을 위하여 교차 결합된 등가 회로가 제시되었고, 시뮬레이션 및 측정 결과로 부터 차단 주파수 이상에서 RH 대역과 LH 대역 사이에 밴드 갭이 존재하지 않는 평형 조건의 CRLH 전송선 특성을 확인하였다.
슈퍼스칼라 프로세서에서 명령어 수준 병렬성(Instruction Level Parallelism)을 적극적으로 활용하기 위해서는 명령들 사이에 존재하는 제어 종속관계 및 데이타 종속관계를 극복하는 것이 필수적이다. 데이타 값 예측은 하나의 명령 결과가 생성되기 전에 미리 결과 값을 예측하고 이 예측된 결과를 사용하여 데이타 종속관계가 있는 명령들을 투기적으로 실행(speculative execution)하는 기법이다. 본 논문에서는 동적 분류 능력을 갖는 혼합형 데이타 값 예측기를 제안한다. 제안된 예측기는 최근 값 예측기, 스트라이드 예측기 및 2 단계 예측기를 결합한 혼합형으로 구성되며, 예측되는 명령은 하드웨어에 의한 동적 분류에 의해 각 예측기로 할당된다. 각 명령들의 특성에 따라 각 예측기로 실행 시에 동적 분류됨으로써 각 예측기는 기존의 혼합형 방식보다도 더욱 효과적으로 활용될 수 있다. 제안된 방식의 타당성 검증을 위해 실행구동방식(execution-driven) 시뮬레이터를 사용하여 SPECint95 벤치마크를 시뮬레이션하여 비교한다. 실험 결과 Instruction Per Cycle 비교실험에서 2 단계 예측기 보다 0.36, 혼합형 예측기 보다 0.0l8의 성능을 보였고, 제안된 방식이 기존의 혼합형 방식보다 예측 정확도가 평균 16%가 향상되었고, 하드웨어 비용을 측정한 결과 45%의 감소효과를 얻었다.
최근 무선네트워크 기술은 이동 응용프로그램을 위해 이종통신망 연결패스 상에서 병렬로 스트라이핑 데이터 기술을 이용해 고속 데이터를 전달을 가능케 한다 [2]. 전통적으로 대역폭지연프로덕트(BDP) 기반에서 고속전송은 송신자 측에서 다중 TCP 소켓의 튜닝을 요구한다. 더욱이, 메모리와 네트워크 요구의 균형을 유지하는 ATBT같은 기술은 유선기반의 단일 소켓상에서 하나의 플로우만 가정하여 설계되었다. 그러므로 본 논문은 여러 무선 패스를 경유하는 이종 무선네트워크 상에서 고속전송을 가능케하는 스트라이핑 전송기술에 적합한 버퍼튜닝 기술을 제안한다. 제안 기술은 이동성, 링크손실, 대역폭변동성 등의 특징을 지닌 무선 멀티홈 모바일 호스트상에서 작동하는 전송계층에서의 자원관리기술이다. 실험을 통하여 유선기반의 ATBT를 본 환경에 적용한 것보다 메모리, 평균 전송량에 있어 제안 기술의 성능이 우수하다.
본 논문에서는 RISC 마이크로프로세서에 DSP프로세서를 추가하여 멀티미디어 기능이 강화된 응용에 알맞은 마이크로프로세서(YS-RDSP)를 제안한다. YS-RDSP는 최대 4개의 명령어를 동시에 병렬로 처리할 수 있다. 프로그램의 크기를 줄이기 위해 YS-RDSP는 16비트와 32비트의 두 가지 명령어 길이를 지원한다. YS-RDSP는 칩 하나로 RISC마이크로프로세서의 programmability 및 제어능력에 DSP의 처리능력을 제공하기 위하여 8-KByte ROM과 8-KByte RAM을 내장하고 있다. 칩 내에 있는 주변장치중 하나인 시스템 컨트롤러는 저전압 동작을 위한 3가지의 전압강하모드를 지원하며 SLEEP명령어는 CPU코어와 주변장치의 동작상태를 변환시킨다. YS-RDSP프로세서는 Verilog-HDL를 이용하여 하향식설계방식으로 구현되었고 C-언어로 작성된 사이클 단위 시뮬레이터를 이용하여 개선되고 검증되었다. 검증된 모델은 0.6um, 3.3V CMOS 표준 셀 라이브러리로 합성되었으며 자동화 P&R에 의해 10.7mm8.4mm코어 면적을 갖도록 레이아웃 되었다.
본 논문에서는 IEEE 802.11 기반의 군 전술 네트워크에서 신뢰성을 보장하면서 망 생존성 향상을 위해 저피탐 성능을 향상시킬 수 있는 멀티캐스팅 MAC 프로토콜을 제안한다. RTS-CTS 기법을 사용하는 IEEE 802.11 기반의 멀티캐스팅 MAC에서는 신뢰성을 보장하기 위해 송신측이 보낸 RTS와 DATA의 수신 확인을 위한 모든든 수신단말의 CTS와 ACK가 보내져야 한다. 제안하는 프로토콜에서는 연속적인 CTS와 ACK 대신 MC-DS/CDMA 기술을 이용하여 병렬적인 CTS와 ACK를 전송함으로써 전송 오버헤드를 낮출 수 있다. 또한 이 기법을 적이 아군의 신호를 탐지하려고 시도하는 전술환경에 적용시 코드를 통해 전송 파워를 제어함으로써 확산 이득을 통해 송신 단말은 다수의 수신 단말로부터 전송된 신호를 받을 수 있지만, 적 검파기에는 탐지 확률이 낮아짐으로 인해 저피탐 성능 역시 얻을 수 있는 장점이 있다. 제안하는 기법은 IEEE 802.11a 기반 시뮬레이션을 통해 기존에 연속적으로 CTS와 ACK를 전송하는 신뢰성 있는 멀티캐스팅 MAC 프로토콜보다 시스템 처리량, 메시지 전송 지연시간 저피탐 성능에서 신뢰성을 유지하면서 효율성과 생존성을 동시에 높일 수 있음을 보여준다.
본 논문은 접지면에 형성된 디펙트를 갖는 전송선로 구조인 DGS의 특성 및 등가회로를 구하고 디펙트의 크기에 따른 등가 집중소자 값을 추출하였으며, DGS에 집중소자를 달아주어 그 영향을 살펴보았다. 제시된 DGS는 아령 모양의 디펙트로 아였으며, 병렬 단락 공진기에 적용하였다. 침 형태의 집중소자인 저항, 인덕터, 커패시터를 각각 달아주어 주파수 특성을 살펴보았다. 또한 실험결과 Q factor와 공진 주파수가 DGS에 달아준 외부소자에 의해 제어됨을 보였다.
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[게시일 2004년 10월 1일]
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