• 한국게임학회 논문지
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• 제20권3호
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• pp.35-44
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• 2020

본 연구에서는 현재 운영 중인 코딩교육 플랫폼인 코딩퍼즐 시스템에서 학습자들이 직접 손으로 조작할 수 있는 탠저블 블록형태로 제작된 코딩퍼즐 입력용 명령어들의 배치를 증강현실 환경에서 제한 시간 안에 안정적으로 다수의 블록을 인식할 수 있는 인식시스템의 설계 및 배치 인식 성능 측정 결과를 제시한다. 그 결과, 5초 이내로 30개 이상의 탠저블 블록 형태의 명령어들의 배치를 안정적으로 인식할 수 있었다. 본 인식시스템을 기존 코딩퍼즐 모바일 앱에 성공적으로 이식하였으며, 블루투스에 연동되는 모바일 앱을 통해 IoT 로봇을 구동할 수 있다.

• 한국시뮬레이션학회논문지
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• 제19권2호
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• pp.107-118
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• 2010

자동차 제조업은 수천 가지의 다른 구성품 또는 부품의 조립이 필요한 복잡한 생산시스템이다. 엔진과 트랜스미션은 자동차의 동력을 담당하는 주요 구성품이다. 엔진의 경우 생산공정이 대부분 유사한 공정들로 구성되어 있음에도 불구하고 공장별로 생산시스템의 배치안은 상이하다. 그 이유는 각 공장마다 기계들을 어떠한 직렬구조와 병렬구조를 조합하여 배치하는지에 대한 개념이 다르기 때문이다. 이 논문에서는 서로 다른 공장에서 적용하고 있는 세 종류의 엔진 라인을 소개한다. 그리고 시뮬레이션을 이용하여 각 라인의 설계개념이 라인의 성과에 미치는 영향에 대해 비교분석하고자 한다.

• 응용통계연구
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• 제15권2호
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• pp.405-414
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• 2002

반복이 같은 이원배치 혼합효과 분산분석모형에서 무정보 사전분포를 이용하여 오차분산을 추정하는 문제를 생각하고자 한다. 먼저 무정보 사전분포로 제프리스사전분포, 준거 사전분포 그리고 확률일치 사전분포를 유도하고 이들 각각의 사전분포들에 대하여 주변사후분포를 제시하였다. 끝으로 실제 자료를 근거로 오차분산의 주변사후밀도함수에 대한 그래프와 오차분산에 대한 신용구간들을 구하고 이 구간들을 비교한다.

• 한국시뮬레이션학회:학술대회논문집
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• 한국시뮬레이션학회 2001년도 춘계 학술대회 논문집
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• pp.49-53
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• 2001

지금까지 컨테이너터미널을 계획하면서 시뮬레이션을 이용하여 소요자원의 규모나 생산성 등을 분석하려는 연구는 많이 진행되어왔다. 그렇지만 컨테이너터미널의 구성 요소에 대한 전제 조건이 부족한 경우에 도입 가능한 다양한 컨테이너 취급 시스템과 그에 관련된 배치안 및 운영 알고리즘의 조합으로 구성되는 모든 대안들을 시뮬레이션하여 비교 평가하기 위해서는 많은 비용과 시간이 필요하다. 따라서 본 연구의 목적은 상세 분석이 필요한 대상을 선정하기 위해 개발 조건을 고려한 컨테이너터미널의 적정 처리능력, 대안별 시설 규모 및 위치 그리고 하역 장비의 종류 및 운영대수 등을 대략적으로 계획하고 시뮬레이션 분석과 운영정보가 이에 체계적으로 연결되어 효율적인 의사결정을 할 수 있게 정보와 흐름을 통합 관리하는 시스템을 설계하는 것이다. 통합관리시스템은 수행 역할에 따라 프로젝트 관리, 운영정보 관리, 능력계획, 배치계획 그리고 시뮬레이션의 모듈들로 구성된다. 본 논문에서는 각 구성모듈의 기능과 모듈간의 입출력 정보를 정의하였고 시뮬레이션에서 필요한 주요 객체 및 제어 흐름을 설계하기 위해 개체지향방법론의 표준인 UML을 이용하였다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2011년도 한국컴퓨터종합학술대회논문집 Vol.38 No.1(D)
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• pp.167-170
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• 2011

많은 측위 알고리즘이 참조노드가 정사각형의 모서리에 위치한다고 가정 하고 있지만, 실제로는 다각형이 되거나 매쉬형으로 배치될 수 있다. 신호세기를 달리함으로써 동심원을 구성하여 측위하는 WMRL(Weighted Multiple Rings Localization)도 기본적으로 참조노드의 배치가 정사각형으로 가정하고 있다. 본 논문에서는 참조노드는 임의로 배치되어 있는 경우에서의 측위로 확장한다. 즉, 측위하는 센서 노드가 수신 가능한 전파를 송신하는 모든 참조노드로부터 링 번호를 기반으로 자신의 위치를 추청한다. WMRL의 다중 신호 세기 링 방식을 채용, 각 링의 도달거리를 기반으로 센서노드가 자신과 참조노드 간의 거리를 유추하고, 최소자승법을 이용해 자신의 좌표를 계산하는 알고리즘을 제안한다. 실험 결과 제안한 알고리즘은 에러가 없는 환경과 다수 참조노드 환경에서 WMRL 및 WCL(Weighted Centroid Localization)보다 2배 이상의 성능향상을 보였으며, 에러가 있는 전파환경에서는 DV-hop 보다 평균 6%, WCL 및 WMRL에는 평균 16% 정도의 성능 향상 결과를 보였다.

• 한국추진공학회지
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• 제8권4호
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• pp.102-108
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• 2004

고성능 액체로켓엔진 개발을 위하여 터보펌프를 사용하는 재생냉각형 액체로켓엔진시스템의 배치안을 마련하였다. 엔진시스템을 구성하는 부품들에 대하여 각각의 특성을 고려하고 현실적으로 제작 및 조립이 가능하도록 3차원 디지털 모형을 제작하여 검증하였다. 1단 엔진시스템은 1축 김벌링을 하며 4개의 엔진 조립체로 클러스터링할 수 있도록 설계하였다. 2단용 엔진시스템은 2축 김벌링을 하며 1개의 엔진 조립체로 구성하였다. 1단 및 2단 엔진시스템의 조립 및 분해 공정 그리고 관련 프로그램 또한 개발하였다. 그리고 엔진시스템의 조립 및 분해 공정을 효율적으로 수행하기 위하여 여러 형태의 전용 치/공구 또한 설계하였다.

• 한국시뮬레이션학회논문지
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• 제27권3호
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• pp.117-129
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• 2018

이 논문에서는 철도차량 의장공장에서 적용되는 두 종류의 배치안 개념에 대한 논의하고자 한다. 현재 시스템은 전통적인 흐름라인 방식에 따라 조립라인이 설계되어 있지만 새로운 시스템은 고정위치형 배치방식을 따르고자 한다. 시스템에 영향을 주는 요소로는 공정시간의 변동성, 결품률 및 결품시간의 분포를 고려하였다. 시뮬레이션 실험결과 해당시스템의 경우 생산량, 차량당 평균 체류시간, 편성당 평균 체류시간 모두 고정위치형 배치방식을 사용하는 것이 좋다는 결론을 얻었다. 또한 시스템의 고정위치형 방식이 흐름라인 방식에 비해 변화에 둔감하게 반응함으로써 강건성 측면에서도 우수하다는 결론을 얻었다.

• 한국항공우주학회지
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• 제49권10호
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• pp.849-858
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• 2021

항공기 내 장비의 장착 위치 결정은 환경조건, 감항성, 정비성 등 고려해야 할 사항이 많아 정량적인 기준을 세우기 힘들다. 또한 장비의 숫자 증가에 따라 설계안은 기하급수적으로 늘어나기 때문에 제한된 일정 내에 검토하기 위하여 설계자의 경험에 많이 의존하여 설계가 진행되고 있다. 본 논문에서는 설계안을 비교할 수 있는 정량적인 기준을 만들기 위하여 장비의 위치에 따른 와이어링 하네스 길이 및 중량을 계산하는 방법과 유전 알고리즘을 이용하여 와이어링 하네스의 중량과 장비들의 CG를 최적화하는 방법을 제안하였다. 그리고 최적설계와 실제설계를 비교하여 최적화 결과가 유용함을 확인하였다.

• 전기전자학회논문지
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• 제22권2호
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• pp.420-426
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• 2018

가까운 미래에, 전자의 ballastic 혹은 near-ballastic 이동이 가능한 CNT(Carbon NanoTube)를 활용한 CNTFET(Carbon NanoTube Field Effect Transistor)은 현재의 실리콘 기반 트랜지스터를 교체할 유력한 후보 중 하나로 고려되고 있다. 고성능의 CNTFET으로 대규모 집적회로를 구현하기 위해서는 semiconducting CNT가 CNTFET 안에 동일한 간격과 높은 밀도로 정렬되어 배치되어야 하지만, CNTFET 공정의 미성숙으로, CNTFET 안의 CNT는 불규칙하게 배치하게 되고, 현존하는 HSPICE 라이브러리 파일은 불규칙한 CNT 배치에 의한 성능의 변화를 회로 레벨에서 평가할 수 있는 기능을 지원하지 않는다. 이러한 성능의 변화를 평가하기 위해서 선형 프로그래밍을 활용한 방법이 과거에 제안되었으나, CNTFET의 전류와 게이트 커패시턴스를 계산하는 과정에서 오차가 발생할 수 있는 문제점이 있다. 본 논문에서는 언급한 오차가 발생되는 이유에 대해서 자세히 논하고, 이 오차를 줄일 수 있는 새로운 방법을 제시하고자 한다. 시뮬레이션 검토 결과, 새롭게 제시된 방법이 기존 방법의 오차, 7.096%를 3.15%까지 줄일 수 있음을 보이고 있다.

• 전기전자학회논문지
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• 제25권3호
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• pp.473-478
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• 2021

CNTFET은 기존 반도체 소자의 성능을 약 13배 향상시킬 수 있어 큰 관심을 받아 왔지만, CNT를 일정하게 배치시키는 공정의 미성숙으로 인해 상용화에 어려움을 겪어 왔다. 이러한 어려움을 극복하기 위해, 그동안 알려진 CNTFET 공정상 한계를 고려한 회로 디자인 방법이 점점 높은 관심을 받고 있다. SRAM은 마이크로프로세서를 구성하는 주요 요소로서 캐시 메모리 안에 규칙적으로 그리고 반복적으로 배치되어 있어, SRAM 안의 CNT는 다른 회로 블록에 비해 보다 쉽게 그리고 고밀도로 배치될 수 있는 장점이 있다. 이러한 장점을 활용하기 위해, 본 논문에서는 CNT 밀도를 고려한 SRAM 셀의 회로 디자인 방법을 소개하고 그 성능 향상 정도를 HSPICE 시뮬레이션으로 검토하고자 한다. 시뮬레이션 결과, SRAM에 CNTFET을 적용할 경우, gate width를 약 1.7배 줄일 수 있음을 발견하였으며, 동일한 gate width에서 CNT 밀도를 높였을 경우, 읽기 속도 또한 약 2배 정도 향상될 수 있음을 알 수 있었다.