네트워크의 발전은 통신망의 발전과 더불어 심각한 사회문제를 발생시킨다. 즉, 보안에 관련된 문제는 네트워크를 사용할 경우 해킹과 크래킹에 대하여 더욱 주의해야한다는 것이다. 이러한 해커나 크래커로부터 보안을 유지하기 위해서는 새로운 암호알고리즘을 개발하거나 키길이를 길게하여 정해진 시간안에 복호불가의 상태를 유지하는 방법이 일반적으로 사용되고 있다. 본 논문에서, RSA 암호시스템에서 제안된 몽고메리 승산기는 캐리부분만을 어레이 형태로 구성하였고 병목현상을 없애기 위하여 승산과정을 가변길이화로 구성하였다. 그러므로 제안된 몽고메리 승산기는 실시간 처리 및 외부의 크래킹을 막아낼 수 있는기능을 강화시켰다.
3GPP-WLAN(3rd Generation Partnership Project-Wireless Local Area Network) interworking은 WLAN UE(user equipment)에 의한 3GPP 시스템내에서 자원 이용과 서비스 접근을 의미하며, 3GPP 서비스와 기능을 WALN 액세스 환경으로 확장함으로써, 3GPP 시스템에 무선 액세스 기술로 WLAN을 보완적으로 이용하는 것을 목적으로 한다. 본 논문에서는 3GPP-WLAN interworking에서 UE 개시 터널 설정을 위한 효율적인 메커니즘을 제안한다. 제안된 메커니즘은 UE와 3GPP AAA(Authentication, Authorization Accounting) 서버 사이의 인증과 키 일치 과정에서 미리 분배된 비밀키에 기반 한다. 따라서 UE에서 많은 계산을 필요로 하는 모듈러 지수승 연산과 공개키 서명 연산을 피할 수 있다. 또한 제안된 기법은 UE와 PDGW(Packet Data Gateway) 사이에 상호 인증과 세션 키 설정을 제공한다.
현재, 자동화 시스템을 위한 통신분야는 TCP/IP를 기반으로 하는 네트워크 기반 원격제어 부분과 시스템의 각 내부 장치들간의 통신을 위한 간단한 직렬통신으로 나뉠 수 있다. 네트워크의 비약적인 발전에도 불구하고 내부 제어를 위한 통신부분은 현재까지 간단한 RS232기반을 사용하고 있다. 또한, 시스템의 개발기법은 각 기능단위의 모듈러 프로그래밍 기법에서 객체지향 프로그램으로 발전하였으며, 현재는 소프트웨어의 부품단위인 컴포넌트 기반 개발기법으로 발전하였다. 이는, 비즈니스 로직을 포함하는 독립적인 운영단위를 조립하며 새로운 시스템의 개발로 이어지는 기법으로서 소프트웨어 개발기법의 새로운 대안으로 제시되고 있다. 따라서, 본 연구는 컴포넌트 기반의 개발 기법을 적용한 GUI기반의 RS232C에서의 내부통신 Emulate를 구현하였다. 이는, 수신부와 송신부로 나뉘어지는 통신 제어부분을 컴포넌트화 하였으며, 이를 합성함으로서 제어부에서는 송,수신 데이터의 핸들링을 담당하도록 하였다.
통신망 및 그 이외의 네트워크 환경의 발전은 사회적으로 중요한 문제를 발생시켰다. 이러한 문제점 중 가장 중요한 것이 네트워크 보안 문제이다. 보안과 관련된 문제점들은 해킹, 크랙킹과 같은 방법으로 반 보안 분야를 확장시키며 발전되었다. 새로운 암호 알고리즘의 발달 없이 해커나 크래커로부터 데이터를 보호하기 위해서는 기존과 같이 키의 길이를 증대하거나 처리 데이터의 양을 증대시키는 방법 밖에는 없다. 본 논문에서는 공개키 암호 알고리즘의 몽고메리 승산부에서 처리속도를 감소시키기 위한 M3 알고리즘을 제안하였다. 매트릭스 함수 M(·)과 룩업테이블을 사용하는 제안된 M3 알고리즘은 몽고메리 승산부의 반복 연산부를 선택적으로 수행하게 된다. 이러한 결과로 변형된 반복 변환 부분은 기존 몽고메리 승산기에 비하여 30%의 처리율 향상을 가져왔다. 제안된 몽고메리 승산 M3 알고리즘은 캐리 생성부의 어레이 배열과 가변 길이 오퍼랜드 감소로 인한 병목 현상을 줄일 수 있다. 그러므로 본 논문에서는 제안된 M3 알고리즘을 공개키 암호시스템의 대표적인 시스템인 RSA에 적용하여 M3-RSA를 설계하였으며 설계 및 모의실험은 Synopsys ver 1999.10을 사용하였다. M3 알고리즘은 기존 승산알고리즘에 비하여 30%의 처리속도 증가를 보임으로서 크랙 및 처리율 향상에 영향이 많은 공개키 암호시스템에 적합하리라 사료된다.
최근 몇 십년간 이산사건시스템명세(DEVS) 형식론은 이산사건시스템을 모듈러하고 계층적으로 모델링할 수 있는 잘 정의된 의미론을 제공하여 왔다. 그럼에도 불구하고 실용 엔지니어들은 실세계의 시스템을 모델링에 적용하는데 어려움을 겪기도 하는데 이는 DEVS가 많은 상태와 사건들을 구조화되지 않은 형태로 명세해야 하는 것 때문이다. 본 논문은 집합 이론을 바탕으로 그러한 사건 및 상태집합들을 구조화된 형태로 표현하는 Structured DEVS 형식론과 이와 연관된 DEVS 다이어그램을 제안하고자 한다. 위상, 변수, 포트 등의 개념을 사용하여 집합들을 명세한 구조적 DEVS 형식론은 원래의 DEVS 형식론과 동등함을 증명하였다. DEVS 다이어그램을 이용하여 구조적 DEVS 형식론으로 표현된 예시 모델이 쉽게 객체지향 시뮬레이션 환경에서 구현될 수 있음을 보임으로써 제안된 형식론이 효과적임을 보였다.
최근 페어링 기반의 암호시스템에 대한 연구가 활발히 진행되고 있으며, 암호시스템의 효율성은 기존의 공개키 암호시스템과 같이 유한체에 의존한다. 페어링 기반의 암호시스템의 경우 주로 GF($3^m$)에서 고려되며 유한체 연산에서 곱셈 연산이 효율성에 가장 큰 영향을 미친다. 본 논문에서는 삼항 기약다항식 기반의 새로운 GF($3^m$) MSD-first Digit-Serial 곱셈기를 제안한다. 제안하는 MSD-first Digit-Serial 곱셈기는 모듈러 감산 연산부를 병렬화하여 공간복잡도는 기존의 결과와 거의 같으나 Critical Path Delay가 기존의 1MUL+(log ${\lceil}n{\rceil}$+1)ADD에서 1MUL+(log ${\lceil}n+1{\rceil}$)ADD으로 감소한다. 따라서 Digit이 $2^k$가 아닌 경우 1번의 덧셈에 대한 시간 지연이 감소한다.
이산사건시스템명세(DEVS) 형식론은 이산사건시스템을 모듈러하고 계층적으로 모델링할 수 있는 잘 정의된 의미론을 제공하고 있어 이산사건시스템 모델링 시뮬레이션 (M&S)에 많이 사용되어 왔다. 이러한 수학적 표현 대신에 DEVS 다이어그램은 복잡한 시스템을 보다 직관적이며 편리한 표현력을 제공한다. 본 논문은 DEVS 다이어그램을 이용하여 표현된 모델을 시뮬레이션 코드로 체계적으로 구현하며 검증하는 DEVS 클린룸 프로세스를 제안하였다. 구체적으로, 주어진 다이어그램 모델의 적합성 검사, 테이블 DEVS 모델로의 변환, 마지막으로 시뮬레이션 소스코드로 변환하는 방법과 역으로 추적성을 기반으로 한 검사기법을 통해 정적 검증하는 구체적인 방법을 제시하였다. 간단한 예제를 통해 제안된 프로세스를 적용하는 구체적인 방법을 설명하였으며, 적용사례 통해 제안된 기법이 실용적으로 적용 가능한 효과적인 프로세스임을 확인하였다.
폰 카메라용 렌즈모듈을 구성하는 각 단렌즈의 방향성을 고려한 자동 조합시스템을 개발하였다. 먼저 유동해석을 통하여 렌즈모듈의 조합성 도출 영향인자인 복굴절과 사출성형 조건의 상관성 및 조립 방향성에 따른 수율의 관계를 조사 하였다. 하나의 조립모듈에서 렌즈와 스페이서의 한 세트를 조립하도록 설계하여 생산성 향상 및 장비크기를 최소화하여 기존 장비의 약 25 %정도로 축소가 가능하였다. 또한, 기구적인 정렬기구인 센터링 기구 및 배럴가이드 적용하여 추가적인 비전시스템 없이 사이클 타임의 단축이 가능하였다. 개발한 시스템은 모듈러 설계를 통하여 픽커 및 가이드 등 일부 부품만의 교체로 생산모듈 변경에 대응 가능하도록 하여 급변하는 시장변화 및 소량생산에도 적용 가능하도록 제작되었다.
기술의 복합성이 증가하고 제품의 존속 수명주기가 불확실해지면서 기술개발자가 의도하는 바와는 관계없이 사업 영역과 기술기반의 변하고 있다. 이러한 환경 속에서 산업 내 기술의 특성을 분석하는 이른바 산업기술분석 역할은 매우 중요하다. 그러나 그 범위가 매우 광범위하고 그 중 기술개발에 있어 관련된 산업기술분석의 프레임이 구체적으로 적용된 사례를 제한적이다. 따라서 다양한 산업을 지원하는 정부 기술개발 기회의 경우, 반도체에 적용되는 모듈러 기반 기술개발 틀과 성과분석이 항공기, 지능형 로봇과 같은 복합 시스템 산업에 그대로 적용해왔던 것이 현실이다. 이는 기술을 제품화함에 있어 필수적인 개발시스템의 기술적 속성이 산업기술 분석 방법론에 효과적으로 체화되지 못했기 때문이다 본 연구는 시스템과 서브 부품으로 구성되는 제품설계 특성을 구조화한 제품 아키텍쳐 이론을 소개하고 이를 기술개발체계에 적용하는 실증적 연구를 수행한다. 실증적 분석을 위해 항공기 개발 전 과정을 분해하고 아키텍쳐 분석방법을 실제 적용하였다. 아키텍쳐는 대표적으로 모듈 형(Module)과 인테그랄 형(Integral)으로 구분한다. 실제로 한 가지의 제품 안에도 모듈형 부품과 인테그랄 형 부품이 복합적으로 혼합되어 있는 경우가 많다. 또한, 제품을 어느 레벨까지 분해할 지에 따라 모듈화의 정도도 달라 질 수 있다. 본 연구는 아키텍쳐 중 Integral 속성의 정도를 파악하여 아키텍쳐 정도를 파악하였다. 측정 기준으로 첫째, 타 부품과의 기능적인 상호연관성과 둘째, 체계종합 설계와의 상호의존성 두 가지를 설정하였다. 이러한 두 가지 아키텍쳐 기준을 547개의 항공우주 부품 및 기술을 적용해 본 결과, 항공기 개발과정은 총 $65\%$의 인테그럴 속성을 가지고 있으며 기술분야 별로 아키텍쳐 정도가 다르게 나타나고 있었다(전자 부품은 분야는 오히려 모듈형에 가까웠음). 비단 항공기 개발과정 뿐만 아니라 다른 산업, 제품에도 적용될 수 있는 틀을 마련함으로써, 기존 연구개발기회에서 산업기술 분석을 통한 체계적 기획으로 전환할 수 있는 새로운 대안을 제시한다. 결과적으로 산업기술의 특성과 구조를 반영한 기술개발 방법론으로 아키텍쳐 이론을 적용할 수 있는 단초를 마련했으며, 이것은 본 논문이 기대하는 바이기도 하다.
DEVS는 이산 사건 시스템을 명세하는 집합론에 근거한 수학적인 틀이다. 이러한 DEVS를 통해 시스템을 시뮬레이션할 때는 명세된 DEVS로부터 구현된 모델과 시뮬레이션 엔진으로 이루어진 실행 환경이 필요하다. 시뮬레이션 엔진은 스케줄링 알고리즘을 통해 모델을 해석하고 실행하는데, 주로 DEVS의 계층적이고 모듈러한 특성을 따라 계층적인 스케줄링 방법을 사용한다. 그러나 이 방법은 계층적인 구조로 인해 시간 관리와 메시지 패싱에 있어서 오버헤드가 존재한다. 본 논문에서는 이러한 오버헤드를 해결하기 위해 이벤트 지향 시뮬레이션을 적용한다. 이벤트 지향의 시뮬레이션은 이벤트에 의해서 모델이 실행되며 이벤트 리스트에 의해 이벤트가 관리된다. 이벤트 리스트에 의해서 시간 관리가 되고 메시지 패싱이 이루어지기 때문에 계층적인 오버헤드를 줄이고 성능 향상을 이룰 수 있다. 본 논문은 이벤트 리스트를 이용한 실행 환경을 제안하고 이러한 실행 환경을 위한 모델 구현 방안에 대해 논하며, 각 실행 환경의 성능을 비교, 분석한다.
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[게시일 2004년 10월 1일]
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