• Title/Summary/Keyword: 멀티 디코더

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A Study on the Design of Color Space Converter with Brightness effect (Brightness 기능을 갖는 컬러 스페이스 컨버터 설계에 관한 연구)

  • 배준석;박노경;문대철
    • The Journal of the Acoustical Society of Korea
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    • v.17 no.1
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    • pp.24-30
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    • 1998
  • 본 논문에서는 기존의 단방향 컬러 스페이스 컨버터(Color Space Converter)를 양방 향으로 변환하는 것뿐만 아니라, 기존의 디코더, 엔코터 및 모니터 등이 가지고 있는 Brightness 기능을 갖도록 변환 행렬 계수를 임의로 조정할 수 있는 컬러 스페이스 컨버터 를 설계하였다. 이러한 변환 계수 자체를 조정하여 휘도 및 색차 신호에 변화를 주는 방법 은 새롭게 제안한 방법으로 계수의 조정은 ROM형태를 이용하여 향후 인터페이스 부분을 부가하여 소프트웨어적으로 제어할 수 있도록 설계하였다. 본 논문에서 제안한 Brightness 기능을 갖는 컬러 스페이스 컨버터는 저가의 멀티미디어 비디오 관련 시스템을 구현할 수 있는 장점을 가지고 있다.

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An Internet Video Conferencing System Based on H.263 and G.723.1 (H.263과 G.723.1에 기반한 인터넷 화상회의 시스템)

  • 박일환;차호정
    • Proceedings of the Korean Information Science Society Conference
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    • 1999.10c
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    • pp.617-619
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    • 1999
  • 본 논문에서는 H.263과 G.723.1을 이용한 인터넷 화상회의 시스템의 구현을 기술한다. 시스템은 회의요청자의 요구에 대한 처리를 담당하는 프로세스와 미디어를 압축하여 전송하는 송신부, 그리고 상대방이 전송한 미디어를 복원하여 재생하는 수신부로 구성된다. 비디오와 오디오의 엔코더 및 디코더 모듈들은 소프트웨어 콤포넌트로 구현되어 다양한 스트리밍 시스템의 개발에 사용될 수 있다. 또한 IP 멀티캐스트, TCP/UDP 등의 프로토콜을 지원하여 다양한 형태의 회의를 가능하게 한다.

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Efficient Video Signal Processing Method on Dual Processor of RISC and DSP (RISC와 DSP의 듀얼 프로세서에서의 효율적인 비디오 신호 처리 방법)

  • 김범호;마평수
    • Proceedings of the Korean Information Science Society Conference
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    • 2003.10c
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    • pp.676-678
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    • 2003
  • 최근에 2.5G나 3G 이동 단말 장치를 위한 프로세서로, 다양한 멀티미디어가 가미된 응용구현이 가능하도록 RISC 프로세서와 DSP를 포함하는 단일 칩 프로세서 기술이 등장하고 있다. 이에 따라 듀얼 프로세서 구조에서 비디오 인코딩/디코딩의 처리 속도를 향상시키기 위안 비디오의 인코더/디코더 구조를 제안한다. 기존의 연구에서는 비디오의 인코딩/디코딩의 전 과정을 DSP가 담당하도록 설계하였으나 많은 비트 연산이 필요한 부분에서는 RISC 칩보다 효율성이 낮게 된다. 이러한 문제점을 해결하기 위하여 본 논문에서는 비디오 신호 처리의 인코딩/디코딩을 구성하는 모듈들을 DSP와 RISC의 특성에 맞도록 분리해 수행시킴으로써 효율성을 높이고자 한다.

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A Study on Efficient Memory Management Technique for Picture Predication Encoding (화면 예측 부호화를 위한 효율적인 메모리 관리기법에 관한 연구)

  • Jeon Hyung-Su;Jeong Sa-Kyun;Lee Yoon-Chae;Yoo Cheol-Jung;Chang Ok-Bae
    • Proceedings of the Korea Information Processing Society Conference
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    • 2006.05a
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    • pp.1259-1262
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    • 2006
  • H.264는 기존의 압축 표준들보다 월등한 압축률을 가지고 있어 다양한 멀티미디어 서비스에 적합하다. 특히 적은 양의 데이터 전송으로 서비스 받을 수 있는 모바일 기기에서는 빼놓을 수 없는 기술이 되었다. 현재 모바일 기기에서 영상 서비스는 하드웨어 기반의 디코더 형식으로 되어 있기 때문에 소프트웨어 기반의 디코더 개발이 시급하다. 그러기 위해서는 모바일 기기에서 탑재된 적은 용량의 메모리를 사용하므로써 빠른 재생이 가능해야 한다. 그래서 영상 복호화시에 사용되는 메모리 양을 줄일 수 있도록 참조픽처의 메모리를 관리하는 방법을 제안한다. 기존의 고정크기를 갖는 장기 참조픽처를 배제하고 단기 참조픽처로써 대체하고 비참조 픽처의 사용은 POC(Picture Order Count)에 전체 사용하지 않고 단지 순서를 정하기 위해 메모리 로드없이 순서 조합에 필요한 위치만 갖도록 하였다. 그러므로, 모바일 기기에서 메모리의 사용을 최대한 줄여 영상을 재생할 수 있도록 제안하였다.

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An Implementation of Sound Enhanced MPEG-1 Audio Decoder on Embedded OS Platform (음질향상 알고리즘을 내장한 MPEG-1 오디오 디코더의 Embedded OS 플랫폼에의 구현)

  • Hong, Sung-Min;Park, Kyu-Sik
    • Journal of Korea Multimedia Society
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    • v.10 no.8
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    • pp.958-966
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    • 2007
  • In this paper, we implement a sound-enhanced MPEG-1 audio decoder on embedded OS Platform. Low bit rate lossy audio codecs such as MP3, OGG, and AAC for mitigating the problems in storage space and network bandwidth suffer a major common problem such as a loss of high frequency fidelity of audio signal. This high frequency loss will reproduce only a band-limited low-frequency part of audio in the standard CD-quality audio. In order to overcome this problem, we embedded a sound enhancement algorithm into the MPEG-1 audio decoder and then the algorithms optimized according to the characteristic of the MPEG-1 audio layer I, II, III were implemented on an embedded OS platform. From the experimental results with spectrum analysis and listening test, we confirm the superiority of the proposed system compared to the standard MPEG-1 audio decoder.

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Design of Intra Prediction Circuit for HEVC and H.264 Multi-decoder Supporting UHD Images (UHD 영상을 지원하는 HEVC 및 H.264 멀티 디코더 용 인트라 예측 회로 설계)

  • Yu, Sanghyun;Cho, Kyeongsoon
    • Journal of the Institute of Electronics and Information Engineers
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    • v.53 no.12
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    • pp.50-56
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    • 2016
  • This paper proposes the architecture and design of intra prediction circuit for a multi-decoder supporting UHD images. The proposed circuit supports not only the latest video compression standard HEVC but also H.264. In addition to the basic function of performing intra prediction, this circuit has the capability of performing the reference sample filter operation defined in the H.264 standard, and the smoothing and strong sample filter operations defined in the HEVC standard. We reduced the circuit size by sharing the circuit blocks for common operations and internal storage, and improved the circuit performance by parallel processing. The proposed circuit was described at RTL using Verilog HDL and its functionality was verified by using NC-Verilog of Cadence. The RTL circuit was synthesized by using Design Compiler of Synopsys and 130nm standard cell library. The synthesized gate-level circuit consists of 69,694 gates and processes 100 ~ 280 frames per second for 4K-UHD HEVC images at the maximum operation frequency of 157MHz.

Implementation and Performance Analysis of H.264/AVC Decoder System for Mobile Digital Broadcasting (이동형 디지털 방송을 위한 H.264/AVC 디코더 시스템의 구현 및 성능 분석)

  • Jung, Jin-Won;Song, Yong-Ho
    • Journal of the Institute of Electronics Engineers of Korea SD
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    • v.44 no.10
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    • pp.38-48
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    • 2007
  • The increasing demand on the use of multimedia video contents drives more mobile embedded systems to incorporate H.264/AVC decoding capability. An H.264/AVC decoder often requires high computation bandwidth during its decoding phase. Depending upon processor computation capability and multimedia contents complexity, the decoder can be implemented either in hardware or software. However, without a thorough analysis on the Performance and resource requirements, it is difficult to choose a cost-effective methodology of implementing this codec. This paper presents both hardware and software implementation of H.264/AVC decoding subsystem in mobile embedded systems, and quantitatively analyses the performance and resource requirements. It also shows the methodology to identify performance bottleneck in Linux-based mobile embedded systems, which is in turn used to select feasible and efficient implementation methodology.

Frame Partition based Parallelization of H.264/AVC decoder (프레임 분할 기반 병렬화 H.264/AVC 디코더)

  • Kim, Won-Jin;Park, Joo-Yul;Chung, Ki-Seok
    • Proceedings of the Korean Society of Broadcast Engineers Conference
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    • 2010.07a
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    • pp.252-255
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    • 2010
  • 고해상도의 동영상 서비스가 보편화 되면서 동영상을 빠르게 처리를 위한 연구가 활발히 이루어 지고 있다. 그리고 멀티코어 프로세서의 사용이 증가 하고 멀티코어 시스템에서 H.264/AVC 디코더를 구현하기 위하여 다양한 병렬화 방법이 제안되고 있다. 하지만 H.264/AVC디코더의 병렬화를 진행하는 과정에서 각 스레드에서 처리하는 데이터의 처리시간 차이로 인하여 스레드의 동기를 확인 해야 한다. 이로 인하여 병렬화를 통한 성능 향상의 걸림돌이 된다. 우리는 이러한 병렬화 과정에서 발생하는 문제점을 고려하여 효과적으로 H.264/AVC 디코더를 병렬화 하는 방법에 대하여 연구하였다. 우리가 제안하는 Frame Partition based Parallelization (FPP) 방법은 프레임을 매크로 블록 묶음으로 나누어 병렬화 한다. 그리고 병렬화 과정에서 스레드를 처리하는 방법을 개선하여 성능을 향상 시켰다. 본 논문에서는 FFmpeg H.264/AVC 디코더를 이용하여 실험 하였고 인텔 쿼드 코어 기반의 멀티코어 시스템에서 멀티 스레드로 구현하였다. 우리는 FPP 방법을 적용하여 병렬화 방법 적용 전 H.264/AVC 디코더와 비교하여 최대 53%의 성능 향상을 보였다.

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Rendering Technology Processing on Native Space of JNI (JNI의 Native영역에서 처리하는 렌더링 기법)

  • 신용경;박지현;김미영;정재일;이현주;김상욱
    • Proceedings of the Korea Multimedia Society Conference
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    • 2001.11a
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    • pp.182-186
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    • 2001
  • 효율적인 스트리밍을 지원하기 위하여 JNI(Java Native Interface)를 이용한 플레이어를 구현한다. 미디어 플레이어는 전달 관리기, A/V 디코더, 렌더링 모듈, 자바 그래픽 라이브러리로 구성하고, 렌더링 모듈은 JNI Export Manager, Java Scene Manager, Drawing Manager,NJI API로 구성한다. 디코딩 된 스트림은 자바가 읽어들일 수 있는 객체 타입으로 변환하는 JNI Export Manager와 장면 구성하는 Java Scene Manager, 자바 그래픽 라이브러리를 이용하여 실제 화면에 드로잉하는 Drawing Manager를 통하여 재생한다. 본 논문은 Java Scene Manager를 Native 영역에서 처리하여 디코딩 된 스트림 객체를 전달받아 RGB변환하고, 장면 구성정보를 이용하여 장면을 구성하여 최종적으로 JNI Export Manager에게 전달한다. 따라서 장면을 구성하기 위한 정보를 JNI API를 통하여 전달할 필요가 없으므로 그 만큼의 성능 향상을 보이고, Native 영역에서 처리하므로 자바 언어에서 처리하는 것보다 효율적이다. 이는 성능 비교표를 통하여 재생시간 향상을 보인다.

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Analysis of Power Saving Factor for a DVS Based Multimedia Processor (DVS 기반 멀티미디어 프로세서의 전력절감율 분석)

  • Kim Byoung-Il;Chang Tae-Gyu
    • Journal of the Institute of Electronics Engineers of Korea SP
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    • v.42 no.1
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    • pp.95-100
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    • 2005
  • This paper proposes a DVS method which effectively reduces the power consumption of multimedia signal processor. Analytic derivations of effective range of its power saving factor are obtained with the assumption of a Gaussian distribution for the frame-based computational burden of the multimedia processor. A closed form equation of the power saving factor is derived in terms of the mean-standard deviation of the distribution. An MPEG-2 video decoder algorithm and AAC encoder algorithm are tested on ARM9 RISC processor for the experimental verification of the power saying of the proposed DVS approach. The experimental results with diverse MPEG-2 video and audio files show 50~30% power saving factor and show good agreement with those of the analytically derived values.